用vhdl開發(fā)的up3 clock,可以在up3的led上顯示24小時(shí)制時(shí)分秒
標(biāo)簽： up3 clock vhdl led
上傳時(shí)間： 2016-08-01
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上傳時(shí)間： 2016-08-02
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單片機(jī)數(shù)碼管顯示16進(jìn)制<->10進(jìn)制互換程序
標(biāo)簽： 進(jìn)制 lt gt 10
上傳時(shí)間： 2016-08-04
上傳用戶：shus521
幾種碼制之間的轉(zhuǎn)換 BCD HEX BIN
標(biāo)簽： BCD HEX BIN 轉(zhuǎn)換
上傳時(shí)間： 2016-08-05
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Optimization with Parabolas Mixture Distributions 數(shù)學(xué)算法
標(biāo)簽： Distributions Optimization Parabolas Mixture
上傳時(shí)間： 2014-01-09
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Numerical Integration 數(shù)學(xué)算法
標(biāo)簽： Integration Numerical 算法
上傳時(shí)間： 2013-12-30
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幾種進(jìn)制轉(zhuǎn)換的程序,在DELPHI使用。
標(biāo)簽： DELPHI 進(jìn)制轉(zhuǎn)換 程序
上傳時(shí)間： 2014-11-27
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1.對(duì)染噪doppler信號(hào)進(jìn)行小波包3層分解：分解層次j=1,2時(shí)，都是信號(hào)的概貌；當(dāng)j=3時(shí)，反映概貌的已幾乎不含噪聲分量，而其它噪聲分量的幅值已很小。 2.對(duì)加噪Blocks信號(hào)進(jìn)行不同閾值及不同閾值的使用方式降噪。
標(biāo)簽： doppler 分解 信號(hào)
上傳時(shí)間： 2016-08-08
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題目：電子時(shí)鐘的設(shè)計(jì) 一、實(shí)驗(yàn)?zāi)康模? 1． 掌握多位計(jì)數(shù)器相連的設(shè)計(jì)方法。 2． 掌握十進(jìn)制、六十進(jìn)制、二十四進(jìn)制計(jì)數(shù)器的設(shè)計(jì)方法。 3． 繼續(xù)鞏固多位數(shù)碼管的驅(qū)動(dòng)及編碼。 4． 掌握揚(yáng)聲器的驅(qū)動(dòng) 5． 掌握EPLD技術(shù)的層次化設(shè)計(jì)方法 二、實(shí)驗(yàn)要求： 1．用時(shí)、分、秒計(jì)數(shù)顯示功能，以24小時(shí)循環(huán)計(jì)時(shí)。 2．具用清零，調(diào)節(jié)小時(shí)、分鐘功能。 3．具用整點(diǎn)報(bào)時(shí)功能。
標(biāo)簽： 十進(jìn)制 計(jì)數(shù)器 設(shè)計(jì)方法 電子時(shí)鐘
上傳時(shí)間： 2013-12-23
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簡(jiǎn)單的計(jì)算器 1.鍵盤輸入兩個(gè)10進(jìn)制數(shù)據(jù)（1到4位），選擇實(shí)現(xiàn)加、減、乘、除運(yùn)算，并選擇以2進(jìn)制、8進(jìn)制、10進(jìn)制、16進(jìn)制方式輸入。 要求： 程序界面盡量方便使用并簡(jiǎn)潔。
標(biāo)簽： 計(jì)算器 數(shù)據(jù) 鍵盤 輸入
上傳時(shí)間： 2014-01-21
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