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數(shù)字搶答器

  • 用“飛思卡爾”MC9S12DG128單片機實現(xiàn)簡答搶答器功能

    用“飛思卡爾”MC9S12DG128單片機實現(xiàn)簡答搶答器功能,只要是用到中斷模塊,外圍鍵盤模塊。

    標簽: 128 MC9 S12 MC

    上傳時間: 2013-12-22

    上傳用戶:yoleeson

  • 是Nios II處理器下客製化指令的一個32位元浮點數(shù)除法器

    是Nios II處理器下客製化指令的一個32位元浮點數(shù)除法器,可將兩IEEE 754格式的值進行相除

    標簽: Nios 指令 除法器

    上傳時間: 2014-01-21

    上傳用戶:star_in_rain

  • 四字路口交通燈管理器的設(shè)計(含波形輸出)

    四字路口交通燈管理器的設(shè)計(含波形輸出)

    標簽: 交通燈 管理器 波形 輸出

    上傳時間: 2017-05-16

    上傳用戶:sardinescn

  • 計算機要想訪問HD61 202。必須 首先讀取狀態(tài)字寄存器的內(nèi)容。主要是 要判別狀態(tài)宇中的 Busy”標志;在 “Busy”標志表示為O時。計算機方可 訪問HD61202。

    計算機要想訪問HD61 202。必須 首先讀取狀態(tài)字寄存器的內(nèi)容。主要是 要判別狀態(tài)宇中的 Busy”標志;在 “Busy”標志表示為O時。計算機方可 訪問HD61202。

    標簽: Busy 61202 HD 202

    上傳時間: 2017-06-07

    上傳用戶:zhliu007

  • 德州儀器新款dsp TMS320F28335 看門狗程式設(shè)計,簡易重置看門狗計數(shù)功能,方便使用者開發(fā)程式!

    德州儀器新款dsp TMS320F28335 看門狗程式設(shè)計,簡易重置看門狗計數(shù)功能,方便使用者開發(fā)程式!

    標簽: F28335 28335 320F dsp

    上傳時間: 2013-12-20

    上傳用戶:woshini123456

  • 二進位的補數(shù)產(chǎn)生器

    二進位的補數(shù)產(chǎn)生器,將輸入的數(shù)0 1交換再加1,內(nèi)附範例的輸入檔。

    標簽:

    上傳時間: 2013-12-17

    上傳用戶:ZJX5201314

  • 逆變器數(shù)字控制技術(shù)研究與實現(xiàn).rar

    逆變器廣泛應(yīng)用于工業(yè)生產(chǎn)的各個方面,數(shù)字控制具有方便實現(xiàn)復(fù)雜算法、抗干擾性強和產(chǎn)品容易升級等優(yōu)點,已成為未來逆變器的發(fā)展趨勢。使用數(shù)字技術(shù)控制設(shè)計逆變器,控制器的性能決定了逆變系統(tǒng)系統(tǒng)的性能。然而在很多高頻應(yīng)用的場合,目前常用的控制器的速度往往不能完全達到要求。與傳統(tǒng)單片機和DSP芯片相比,F(xiàn)PGA器件具有更高的處理速度。同時FPGA應(yīng)用在數(shù)字化逆變器設(shè)計中,還可以大大簡化控制系統(tǒng)結(jié)構(gòu),并可實現(xiàn)多種高速算法,具有較高的性價比。在逆變器的全數(shù)字化控制領(lǐng)域,F(xiàn)PGA具有很好的應(yīng)用價值。 論文首先介紹了SPWM基本原理及其控制方式,SPWM的生成方法,并結(jié)合本課題給出了查表法生成SPWM波的一般方法,且以單相全橋逆變器為例進行了仿真。分析其的電路特點,建立PWM逆變器的統(tǒng)一電路模型、連續(xù)狀態(tài)空間以及離散狀態(tài)空間模型,在此數(shù)學模型基礎(chǔ)上,針對逆變器研究分析了目前用于逆變器設(shè)計的各種數(shù)字控制技術(shù)、控制方案,討論了其控制方法的優(yōu)缺點,相關(guān)控制器設(shè)計的一般問題,最后比較了其優(yōu)缺點,指出其存在的共性問題,總結(jié)了使用FPGA設(shè)計逆變器數(shù)字控制器的優(yōu)勢。然后以單相電壓型PWM逆變器為控制模型采用新型模數(shù)結(jié)合現(xiàn)場可編程門陣列FPGA實現(xiàn)數(shù)字化控制器的方案,給出了純正正弦波逆變器的設(shè)計方案。 論文詳細論述了采用模數(shù)混合型FPGA作為主控芯片的高頻逆變器設(shè)計方法與實現(xiàn)過程。系統(tǒng)主控芯片采用Fusion系列AFS600,世界上首個模數(shù)混合型FPGA。主要設(shè)計要點包括:逆變器硬件電路設(shè)計以及SPWM數(shù)字控制系統(tǒng)軟件設(shè)計。外圍強電電路的設(shè)計的難點在于用于前端升壓的高頻變壓器的設(shè)計以及輸出端LC濾波電感與電容的選取。另外,SPWM“H”字全橋逆變電路中的高懸浮電壓也是設(shè)計中需要值得注意的重要環(huán)節(jié)。在控制系統(tǒng)軟件設(shè)計方面,采用FPGA自上而下的設(shè)計方法,對其控制系統(tǒng)進行了功能劃分,完成了SPWM產(chǎn)生器以及加入死區(qū)補償?shù)腜WM發(fā)生器、和反饋等模塊的設(shè)計。 論文的結(jié)束部分給出了設(shè)計結(jié)果,并指出了進一步的工作的思路和方向。

    標簽: 逆變器 數(shù)字控制 技術(shù)研究

    上傳時間: 2013-05-19

    上傳用戶:小碼農(nóng)lz

  • 基于DSP的中壓變頻器控制軟件的設(shè)計.rar

    本論文針對6kV/400kW三相異步電動機的中壓變頻器試驗裝置,從分析目前中壓變頻器常用的主回路拓撲入手,詳細闡述并分析了本文研究的單元串聯(lián)型中壓變頻器控制系統(tǒng)。 本文首先從理論上分析了多單元串聯(lián)型中壓變頻器脈寬控制原理。然后,把一種高性能的V/f控制方案引入中壓變頻器控制系統(tǒng)。通過矢量補償定子壓降,進行轉(zhuǎn)差補償和對電機電流進行限制控制,實現(xiàn)了具有很好的低頻性能并具有防“跳閘”等功能的V/f控制方案。 同時,本文將Siemens公司通用變頻器的時隙、連接紙的概念運用到中壓變頻器控制領(lǐng)域。增加了系統(tǒng)的可變性,自由性和方便性。設(shè)計了具有系統(tǒng)組態(tài)功能的模塊化軟件,其中著重對控制軟件中的幾個重要功能進行了分析討論。這些重要功能模塊有:控制字和狀態(tài)字、順序控制、V/f曲線、給定積分器、基于電壓補償?shù)妮敵鲎詣臃€(wěn)壓算法、通訊功能等。 中壓變頻器在實驗室設(shè)計為6kV/22kW試驗系統(tǒng),實際設(shè)計為6kV/400kW的變頻系統(tǒng)裝置。本文給出了實驗室調(diào)試結(jié)果及分析。實驗結(jié)果表明,該中壓變頻器能夠安全、穩(wěn)定地運行。

    標簽: DSP 中壓變頻器 控制軟件

    上傳時間: 2013-04-24

    上傳用戶:mingaili888

  • 圖象壓縮系統(tǒng)中熵編解碼器的FPGA設(shè)計及實現(xiàn)

    隨著移動終端、多媒體、Internet網(wǎng)絡(luò)、通信,圖像掃描技術(shù)的發(fā)展,以及人們對圖象分辨率,質(zhì)量要求的不斷提高,用軟件壓縮難以達到實時性要求,而且會帶來因傳輸大量原始圖象數(shù)據(jù)帶來的帶寬要求,因此采用硬件實現(xiàn)圖象壓縮已成為一種必然趨勢。而熵編碼單元作為圖像變換,量化后的處理環(huán)節(jié),是圖像壓縮中必不可少的部分。研究熵編解碼器的硬件實現(xiàn),具有廣闊的應(yīng)用背景。本文以星載視頻圖像壓縮的硬件實現(xiàn)項目為背景,對熵編碼器和解碼器的硬件實現(xiàn)進行探討,給出了并行熵編碼和解碼器的實現(xiàn)方案。熵編解碼器中的難點是huffman編解碼器的實現(xiàn)。在設(shè)計并行huffman編碼方案時通過改善Huffman編碼器中變長碼流向定長碼流轉(zhuǎn)換時的控制邏輯,避免了因數(shù)據(jù)處理不及時造成數(shù)據(jù)丟失的可能性,從而保證了編碼的正確性。而在實現(xiàn)并行的huffman解碼器時,解碼算法充分利用了規(guī)則化碼書帶來的碼字的單調(diào)性,及在特定長度碼字集內(nèi)碼字變化的連續(xù)性,將并行解碼由模式匹配轉(zhuǎn)換為算術(shù)運算,提高了存儲器的利用率、系統(tǒng)的解碼效率和速度。在實現(xiàn)并行huffman編碼的基礎(chǔ)上,結(jié)合針對DC子帶的預(yù)測編碼,針對直流子帶的游程編碼,能夠?qū)D像壓縮系統(tǒng)中經(jīng)過DWT變換,量化,掃描后的數(shù)據(jù)進行正確的編碼。同時,在并行huffman解碼基礎(chǔ)上的熵解碼器也可以解碼出正確的數(shù)據(jù)提供給解碼系統(tǒng)的后續(xù)反量化模塊,進一步處理。在本文介紹的設(shè)計方案中,按照自頂向下的設(shè)計方法,對星載圖像壓縮系統(tǒng)中的熵編解碼器進行分析,進而進行邏輯功能分割及模塊劃分,然后分別實現(xiàn)各子模塊,并最終完成整個系統(tǒng)。在設(shè)計過程中,用高級硬件描述語言verilogHDL進行RTL級描述。利用了Altera公司的QuartusII開發(fā)平臺進行設(shè)計輸入、編譯、仿真,同時還采用modelsim仿真工具和symplicity的綜合工具,驗證了設(shè)計的正確性。通過系統(tǒng)波形仿真和下板驗證熵編碼器最高頻率可以達到127M,在62.5M的情況下工作正常。而熵解碼器也可正常工作在62.5M,吞吐量可達到2500Mbps,也能滿足性能要求。仿真驗證的結(jié)果表明:設(shè)計能夠滿足性能要求,并具有一定的使用價值。

    標簽: FPGA 圖象壓縮

    上傳時間: 2013-05-19

    上傳用戶:吳之波123

  • 高速數(shù)據(jù)轉(zhuǎn)換器評估平臺(HSDCEP)用戶指南評估

    高速數(shù)據(jù)轉(zhuǎn)換器評估平臺(HSDCEP)是基于PC的平臺,提供評估Maxim RF數(shù)/模轉(zhuǎn)換器(RF-DAC,支持更新速率≥ 1.5Gsps)和Maxim數(shù)字上變頻器(DUC)的齊全工具。HSDCEP可以在每對數(shù)據(jù)引腳產(chǎn)生速率高達1.25Gbps的測試碼型,支持多達4條并行16位LVDS總線。通過USB 2.0端口將最長64兆字(Mw)、每字16位寬的數(shù)據(jù)碼型裝載至HSDCEP存儲器

    標簽: HSDCEP 高速數(shù)據(jù) 轉(zhuǎn)換器 評估平臺

    上傳時間: 2013-10-25

    上傳用戶:zycidjl

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