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JLINK仿真器如何調(diào)試ARM

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標(biāo)簽： arm

上傳時間： 2022-06-30

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labview計時器設(shè)計

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標(biāo)簽： labview 計時器

上傳時間： 2022-07-22

上傳用戶：bluedrops
單片機(jī)定時器中斷原理和C語言代碼詳解

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標(biāo)簽： 單片機(jī)

上傳時間： 2022-08-10

上傳用戶：d1997wayne
基于FPGA的GSM解擴(kuò)解調(diào)的設(shè)計與實(shí)現(xiàn).rar

擴(kuò)頻通信系統(tǒng)與常規(guī)的通信系統(tǒng)相比，具有很強(qiáng)的抗窄帶干擾，抗多徑干擾，抗人為干擾的能力，并具有信息隱蔽、多址保密通信等優(yōu)點(diǎn)，在近年來得到了迅速的發(fā)展。論文針對直擴(kuò)通信系統(tǒng)中偽碼和載波同步問題而展開，研究了直擴(kuò)系統(tǒng)的結(jié)構(gòu)、性能及完成了相關(guān)參數(shù)的計算，改進(jìn)了包絡(luò)算法，設(shè)計了解擴(kuò)和解調(diào)器，最后用ISE9.1實(shí)現(xiàn)了解擴(kuò)和解調(diào)器的仿真波形，驗(yàn)證了設(shè)計的正確性。論文研究了擴(kuò)頻通信系統(tǒng)的特點(diǎn)、國內(nèi)外發(fā)展現(xiàn)狀及理論基礎(chǔ)，完成了DS-QPSK接收機(jī)的解擴(kuò)器和解調(diào)器的設(shè)計與實(shí)現(xiàn)。解擴(kuò)器主要圍繞著偽碼的捕獲與跟蹤這一核心，分析了解擴(kuò)器的結(jié)構(gòu)、性能及其完成了相關(guān)參數(shù)的計算，完成了數(shù)字下變頻器、偽碼發(fā)生電路、偽碼相關(guān)積分提取電路、多通道快碼捕獲電路、偽碼跟蹤鑒相電路、偽碼時鐘調(diào)整電路的設(shè)計，并在ISE9.1編程綜合得到仿真結(jié)果，驗(yàn)證了設(shè)計的正確性。由于相關(guān)積分包絡(luò)算法是整個系統(tǒng)的基礎(chǔ)和核心，為了減少時延和系統(tǒng)所占硬件資源，改進(jìn)了包絡(luò)算法并得到了仿真驗(yàn)證。結(jié)果表明，它不但減少了硬件資源的占用、縮短了延時，而且對整個系統(tǒng)的優(yōu)化起著決定性的作用。論文給出了偽碼同步的仿真結(jié)果及資源占用情況，有力地說明了解擴(kuò)器占用資源少、時延短等特點(diǎn)。解調(diào)器研究了頻偏及載波相位誤差對信號的影響及同步方案，完成了數(shù)控振蕩器、反正切鑒頻器、環(huán)路濾波器的設(shè)計并得到了相關(guān)的仿真波形，實(shí)現(xiàn)了載波的跟蹤，給出了仿真結(jié)果及資源占用情況，對系統(tǒng)實(shí)現(xiàn)過程中的一些經(jīng)驗(yàn)進(jìn)行了總結(jié)。最后是對論文工作的一些總結(jié)和對今后工作的展望。

標(biāo)簽： FPGA GSM 解調(diào)

上傳時間： 2013-06-13

上傳用戶：924484786
基于FPGA的DDC在頻譜儀中的設(shè)計.rar

軟件無線電思想的出現(xiàn)帶來了接收機(jī)實(shí)現(xiàn)方式的革新。隨著近年來軟件無線電理論和應(yīng)用趨于成熟與完善，軟件無線電技術(shù)已經(jīng)被越來越廣泛地應(yīng)用于無線通信系統(tǒng)和電子測量測試儀器中。數(shù)字下變頻技術(shù)作為軟件無線電的核心技術(shù)之一，在頻譜分析儀中也得到了越來越普遍的應(yīng)用。本人參與的手持式頻譜分析儀項(xiàng)目采用的是中頻數(shù)字化實(shí)現(xiàn)方式，可滿足輕巧，可重配置和低功耗的需求。數(shù)字化中頻的關(guān)鍵部件數(shù)字下變頻器DDC采用的是Intersil公司的ISL5216，這個器件和高性能FPGA共同組成手持頻譜儀的數(shù)字信號處理前端。這個數(shù)字前端就手持頻譜分析儀來說存在一定的局限性，ISL5216的信號處理帶寬單通道為1 MHz，4個通道級聯(lián)為3MHz，未能滿足譜儀分析帶寬日益增加的需求；系統(tǒng)集成度不高，ISL5216的功能要是集成到FPGA，可進(jìn)一步提高系統(tǒng)集成度，降低物料成本和系統(tǒng)功耗。基于以上兩個方面的考慮，現(xiàn)正以手持頻譜分析儀項(xiàng)目為依托，基于Xilinx Spartan3A-DSP系列FPGA實(shí)現(xiàn)高速高處理帶寬的DDC。本論文首先描述了數(shù)字下變頻基本理論和結(jié)構(gòu)，對完成各級數(shù)字信號處理所涉及的數(shù)字正交變換、CORDIC算法、CIC、HB、多相濾波等關(guān)鍵算法做了適當(dāng)介紹；然后介紹了當(dāng)前主流FPGA的數(shù)字信號處理特性和其內(nèi)部的DSP資源。接著詳細(xì)描述了數(shù)控振蕩器NCO、復(fù)數(shù)數(shù)字混頻器MIXER、5級CIC濾波器、5級HB濾波器和255階可編程FIR的設(shè)計和實(shí)現(xiàn)，并對各個模塊的不同實(shí)現(xiàn)方式作了對比和仿真測試數(shù)據(jù)作了分析。最后介紹了所設(shè)計DDC在手持頻譜分析儀中的主要應(yīng)用。

標(biāo)簽： FPGA DDC 頻譜儀

上傳時間： 2013-04-24

上傳用戶：a155166
基于FPGA的全數(shù)字中頻接收機(jī)的研究與實(shí)現(xiàn).rar

本論文基于直接擴(kuò)頻通信的理論設(shè)計了一種全數(shù)字的中頻接收機(jī)，使用Xilinx公司的FPGA芯片xc3s400作為接收機(jī)的主芯片，實(shí)現(xiàn)中頻數(shù)字信號的下變頻，基帶解調(diào)，PN碼的捕獲及跟蹤環(huán)路的設(shè)計并給出了它們的具體設(shè)計步驟及RTL級邏輯電路圖。本文對于數(shù)字下變頻器的設(shè)計、數(shù)字抑制載波恢復(fù)環(huán)的設(shè)計進(jìn)行了詳細(xì)的論述，還使用Matlab中的Simulink對本接收機(jī)系統(tǒng)所要使用的全數(shù)字Costas環(huán)進(jìn)行了功能仿真并給出了仿真結(jié)果。本文使用高速模數(shù)轉(zhuǎn)換器AD9601對中頻模擬信號進(jìn)行采樣，最后再用高速數(shù)模轉(zhuǎn)換器AD9740還原出原始信息，并給出了它們與核心芯片xc3s400的接口設(shè)計方法及原理電路圖。

標(biāo)簽： FPGA 全數(shù)字中頻接收機(jī)

上傳時間： 2013-07-30

上傳用戶：weiwolkt
OFDMMIMO系統(tǒng)接收機(jī)關(guān)鍵技術(shù)研究與FPGA實(shí)現(xiàn)

近年來，移動通信技術(shù)在全球范圍內(nèi)得到了迅猛的發(fā)展及應(yīng)用，各種全新的無線通信概念層出不窮、各種新的體制及其關(guān)鍵技術(shù)日新月異。由于正交頻分復(fù)用(OFDM)技術(shù)可以高效地利用頻譜資源并有效地對抗頻率選擇性衰落，多入多出(MIMO)利用多個天線實(shí)現(xiàn)多發(fā)多收，在不增加帶寬和發(fā)送功率的情況下，可以成倍提高信道容量，因此OFDM-MIMO技術(shù)被廣泛認(rèn)為是后三代通信系統(tǒng)(B3G)的關(guān)鍵技術(shù)，是當(dāng)今移動通信領(lǐng)域研究的熱點(diǎn)。本文對OFDM-MIMO通信系統(tǒng)接收機(jī)的關(guān)鍵技術(shù)--數(shù)字下變頻，OFDM同步、解調(diào)進(jìn)行了相關(guān)研究，在多天線接收板的XC2VP70-5FF1704芯片上，完成了數(shù)字下變頻，OFDM同步和解調(diào)的FPGA設(shè)計與實(shí)現(xiàn)。通過功能仿真、時序仿真、板級電路測試，驗(yàn)證了該設(shè)計的正確性。本文首先介紹了OFDM基本原理以其特點(diǎn)，然后對同步技術(shù)和數(shù)字下變頻技術(shù)作了相應(yīng)的介紹。同步是OFDM系統(tǒng)設(shè)計中的一項(xiàng)關(guān)鍵技術(shù)，即是針對系統(tǒng)中存在的時間偏差、頻率偏差進(jìn)行定時恢復(fù)、頻偏的估計與補(bǔ)償，來減少各種同步偏差對系統(tǒng)性能的影響。數(shù)字下變頻是軟件無線電的核心技術(shù)之一，其基本功能是從高速中頻數(shù)字信號中提取所需的窄帶信號，將其下變頻為基帶信號，降低數(shù)據(jù)率，以供后續(xù)DSP器件作進(jìn)一步處理。在數(shù)字下變頻器的設(shè)計和實(shí)現(xiàn)方面，本文先介紹了數(shù)字下變頻器的原理和基本結(jié)構(gòu)，然后根據(jù)系統(tǒng)要求對其進(jìn)行了設(shè)計，并在實(shí)現(xiàn)上作了一些簡化，節(jié)約了硬件資源。在對時間同步的設(shè)計和實(shí)現(xiàn)方面，本文采用了利用PN序列進(jìn)行時間同步的算法。在實(shí)現(xiàn)上根據(jù)系統(tǒng)實(shí)際情況將數(shù)據(jù)分為四路分別與本地PN碼做滑動相關(guān)運(yùn)算，更有效的利用了同步數(shù)據(jù)，達(dá)到了更好的同步性能。在OFDM的頻率同步的設(shè)計和實(shí)現(xiàn)方面，本文采用重復(fù)的PN碼兩兩相關(guān)來估計頻偏值，并聯(lián)合一個二階負(fù)反饋環(huán)路進(jìn)行補(bǔ)償。該算法利用環(huán)路自身噪聲帶寬抑制噪聲，提高頻率估計精度，并同時利用負(fù)反饋擴(kuò)大頻偏估計范圍。本文在對算法的詳細(xì)研究分析的基礎(chǔ)上對其進(jìn)行了FPGA設(shè)計與實(shí)現(xiàn)。

標(biāo)簽： OFDMMIMO FPGA 接收機(jī)

上傳時間： 2013-04-24

上傳用戶：heminhao
基于FPGA的軟件無線電DDC設(shè)計

軟件無線電DDC(數(shù)字下變頻)系統(tǒng)作為前端ADC與后端通用DSP器件之間的橋梁，通過降低數(shù)據(jù)流的速率，把低速數(shù)據(jù)送給后端通用DSP器件進(jìn)行處理，其性能的優(yōu)劣將對整個軟件無線電系統(tǒng)的穩(wěn)定性產(chǎn)生直接影響。采用專用DDC芯片完成數(shù)字下變頻，雖然具有抽取比大、性能穩(wěn)定等優(yōu)點(diǎn)，但價格昂貴，靈活性不強(qiáng)，不能充分體現(xiàn)軟件無線電的優(yōu)勢。FPGA工藝發(fā)展迅速，處理能力大大增強(qiáng)，相對于ASIC、DSP來說具有吞吐量高、開發(fā)周期短、可實(shí)現(xiàn)在線重構(gòu)等諸多優(yōu)勢。正因?yàn)檫@些優(yōu)點(diǎn)，使得FPGA在軟件無線電的研究和開發(fā)中起著越來越重要的作用。本次設(shè)計的目標(biāo)是在一塊FPGA芯片上實(shí)現(xiàn)單通道數(shù)字下變頻系統(tǒng)。現(xiàn)階段主要對軟件無線電數(shù)字下變頻器的FPGA實(shí)現(xiàn)方法進(jìn)行了研究分析，重點(diǎn)完成了其主要模塊的設(shè)計和仿真以及初步的系統(tǒng)級驗(yàn)證。論文首先對軟件無線電數(shù)字下變頻的國內(nèi)外現(xiàn)狀進(jìn)行了分析，然后對FPGA實(shí)現(xiàn)數(shù)字下變頻設(shè)計的優(yōu)勢作了闡述。在對軟件無線電理論基礎(chǔ)、數(shù)字信號處理的相關(guān)知識深入研究的基礎(chǔ)上重點(diǎn)研究軟件無線電數(shù)字下變頻技術(shù)。對數(shù)字下變頻的NCO、混頻、CIC、HB、FIR模塊的實(shí)現(xiàn)方法進(jìn)行深入研究，在：MATLAB中設(shè)定整體系統(tǒng)方案、完成模塊劃分和接口定義，并對部分模塊建立數(shù)學(xué)模型并仿真、對模塊的性能進(jìn)行優(yōu)化。從數(shù)字下變頻的系統(tǒng)層次上考慮了各模塊彼此問的性能制約，從而選擇合理配置、優(yōu)化系統(tǒng)結(jié)構(gòu)以獲得模塊間的性能均衡和系統(tǒng)性能的最優(yōu)化。最后通過使用編寫'Verilog程序和調(diào)用部分lP Core相結(jié)合的方法完成數(shù)字下變頻各個模塊的設(shè)計并完成仿真和調(diào)試。結(jié)果表明設(shè)計的思想和結(jié)構(gòu)是正確的，在下一步工作中主要完成系統(tǒng)的板級調(diào)試。

標(biāo)簽： FPGA DDC 軟件無線電

上傳時間： 2013-04-24

上傳用戶：隱界最新
基于FPGA的軟件無線電通信平臺

軟件無線電技術(shù)作為一種新的通信技術(shù)，其基本思想是構(gòu)造一個通用硬件平臺，使寬帶A/D，D/A盡量靠近天線，在數(shù)字域完成信號處理，通過選用不同軟件模塊即可實(shí)現(xiàn)不同的通信功能，這樣大大縮短了電臺的研發(fā)周期。該技術(shù)在通信(尤其是在移動通信)領(lǐng)域有著迫切的需求和廣闊的應(yīng)用前景。本文闡述了軟件無線電的基礎(chǔ)理論，對信號采樣理論、多速率信號處理技術(shù)、高效數(shù)字濾波器、數(shù)字正交變換理論進(jìn)行了分析和研究。從目前器件發(fā)展水平和實(shí)驗(yàn)研究條件出發(fā)，設(shè)計了一個基于FPGA的軟件無線電通信平臺。設(shè)計采用了中頻數(shù)字化處理的硬件平臺結(jié)構(gòu)，選用Altera Cyclone系列FPGA作為信號處理和總體控制配置的核心，并結(jié)合專用通信芯片，數(shù)字上變頻器AD9856和數(shù)字下變頻器AD6654來實(shí)現(xiàn)該平臺。采用VHDL和Verilog HDL語言對時分復(fù)用模塊、信道編解碼模塊、調(diào)制解調(diào)模塊等進(jìn)行了模塊化設(shè)計，并對電路板設(shè)計過程中系統(tǒng)的配置和控制、無源濾波器設(shè)計、阻抗匹配電路設(shè)計等問題進(jìn)行了詳細(xì)的討論，最后對印制電路板進(jìn)行測試和調(diào)試，獲得了預(yù)期的效果。本文給出的設(shè)計方案，大大簡化了數(shù)字通信系統(tǒng)的硬件設(shè)備，具有較強(qiáng)的通用性和靈活性，通過修改系統(tǒng)參數(shù)和配置程序，即可適應(yīng)不同的通信模式和信道狀況，充分體現(xiàn)了軟件無線電的優(yōu)勢。該平臺不僅僅能應(yīng)用在通信設(shè)備上，在許多系統(tǒng)驗(yàn)證平臺、測試設(shè)備中均可應(yīng)用，頗具實(shí)用價值。

標(biāo)簽： FPGA 軟件無線電通信平臺

上傳時間： 2013-07-21

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上傳時間： 2013-10-19

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