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CPLD VHDL 數(shù)碼管程序 流水燈程序 時(shí)鐘程序CPLD VHDL 數(shù)碼管程序 流水燈程序 時(shí)鐘程序
標(biāo)簽： CPLD VHDL 數(shù)碼管 程序
上傳時(shí)間： 2013-08-11
上傳用戶：huang111
Altera_FPGA管腳弱上拉電阻的軟件設(shè)置方法
標(biāo)簽： Altera_FPGA 管腳 上拉電阻 軟件
上傳時(shí)間： 2013-08-13
上傳用戶：hj_18
有關(guān)FPGA芯片的管腳的封裝的一些資料。
標(biāo)簽： FPGA 芯片 管腳 封裝
上傳時(shí)間： 2013-08-18
上傳用戶：dljwq
Altera FPGA配置的特殊管腳說明。
標(biāo)簽： Altera FPGA 管腳
上傳時(shí)間： 2013-08-27
上傳用戶：hfnishi
AlteraFPGA的特殊管腳的連接(中文)
標(biāo)簽： Altera FPGA 管腳 連接
上傳時(shí)間： 2013-09-01
上傳用戶：xhwst
Xilinx-FPGA器件管腳說明
標(biāo)簽： Xilinx-FPGA 器件 管腳
上傳時(shí)間： 2013-09-03
上傳用戶：牛津鞋
FPGA特殊管腳說明
標(biāo)簽： FPGA 管腳
上傳時(shí)間： 2013-09-04
上傳用戶：奔跑的雪糕
工作原理：\r\n 脈沖輸入，記錄30個(gè)脈沖的間隔時(shí)間（總時(shí)間），LED顯示出來，牽涉到數(shù)碼管的輪流點(diǎn)亮，以及LED的碼。輸入端口一定要用個(gè)\r\n74LS14整一下，圖上沒有。數(shù)碼管使用共陰數(shù)碼管。MAXPLUS編譯。\r\n測試時(shí)將光電門的信號端一塊連接到J2口的第三管腳，同時(shí)第一管腳為地，應(yīng)該與光電門的地連接（共地）。\r\n開始測試：\r\n 按下按鍵，應(yīng)該可以見到LED被點(diǎn)亮，指示可以開始轉(zhuǎn)動轉(zhuǎn)動慣量盤，等遮光片遮擋30次光電門后，\r\n LED熄滅，數(shù)碼管有數(shù)字顯示，此為時(shí)間值，單位為秒，與
標(biāo)簽： CPLD LED 控制 數(shù)碼管
上傳時(shí)間： 2013-09-05
上傳用戶：123454
運(yùn)用PTOTEUS仿真74595對6個(gè)LED數(shù)碼管的驅(qū)動顯示，了解串口的數(shù)據(jù)傳送模式。
標(biāo)簽： PTOTEUS 74595 LED 仿真
上傳時(shí)間： 2013-09-21
上傳用戶：epson850
一個(gè)數(shù)碼管與NTC的應(yīng)用實(shí)例,數(shù)字的顯示在PROTEUS里面是反向的
標(biāo)簽： NTC 數(shù)碼管 應(yīng)用實(shí)例
上傳時(shí)間： 2013-09-22
上傳用戶：liglechongchong
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