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時鐘源

  • 基于stm32f103c8t6單片機的RTC源碼

    說明:  基于stm32f103c8t6單片機的RTC實時時鐘源碼,固件庫為3.5版本(Based on the real-time clock source stm32f103c8t6 MCU RTC firmware library version 3.5)

    標簽: stm32 單片機

    上傳時間: 2022-05-16

    上傳用戶:得之我幸78

  • BLE芯片BK3431Q-BK3432參考源碼|例程解析-PWM應用實驗

    軟件實現功能:pwm采用的是內部32K RC振蕩器作為時鐘源,輸出頻率為8KHZ。采用P13口輸出。BK3431Q|BK3432 可替代 cc2541,nrf51822,TLSR8266,DA14580等市面主流ble芯片。

    標簽: ble 芯片 bk3431q bk3432 pwm

    上傳時間: 2022-08-10

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  • 基于FPGA的光接收機數據恢復電路

    隨著信息產業的不斷發展,人們對數據傳輸速率要求越來越高,從而對數據發送端和接收端的性能都提出了更高的要求。接收機的一個重要任務就是在于克服各種非理想因素的干擾下,從接收到的被噪聲污染的數據信號中提取同步信息,并進而將數據正確的恢復出來。而數據恢復電路是光纖通信和其他許多類似數字通信領域中不可或缺的關鍵電路,其性能決定了接收端的總體性能。 目前,數據恢復電路的結構主要有“時鐘提取”和“過采樣”兩種結構。基于“過采樣”的數據恢復方法的關鍵是過采樣,即通過引入參考時鐘,并增加時鐘源個數的方式來代替第一種方法中的“時鐘提取”。與“時鐘提取”的數據恢復方法相比,基于“過采樣”的數據恢復方法在性能上還有較大的差距,但是后者擁有高帶寬、立即鎖存能力、較低的等待時間和更高的抖動容限,更易于通過數字的方法實現,實現更簡單,成本更低,并且這是一種數字化的模擬技術。如果能通過“過采樣”方法在普通的邏輯電路上實現622.08Mb/s甚至更高速率的數據恢復,并將它作為一個IP模塊來代替專用的時鐘恢復芯片,這無疑將是性能和成本的較好結合。 本文主要研究“過采樣”數據恢復電路的基本原理,通過全數字的設計方法,給出了在低成本可編程器件FPGA上實現數據恢復電路兩種不同的過采樣的實現方案,即基于時鐘延遲的過采樣和基于數據延遲的過采樣。基于時鐘延遲的過采樣數據恢復電路方案,通過測試驗證,其最高恢復的數據傳輸率可達到640Mb/s。測試結果表明,采用該方案實現的時鐘恢復電路可工作在光纖通信系統STM-4速率級,即622.08MHz頻率上,各方面指標基本符合要求。

    標簽: FPGA 光接收機 數據恢復 電路

    上傳時間: 2013-04-24

    上傳用戶:axxsa

  • 常用數字邏輯功能都在CPLD器件上用VHDL語言實現

    利用一塊芯片完成除時鐘源、按鍵、揚聲器和顯示器(數碼管)之外的所有數字電路功能。所有數字邏輯功能都在CPLD器件上用VHDL語言實現。這樣設計具有體積小、設計周期短(設計過程中即可實現時序仿真)、調試方便、故障率低、修改升級容易等特點

    標簽: CPLD VHDL 數字邏輯 器件

    上傳時間: 2013-08-11

    上傳用戶:hn891122

  • 了解ADF7021的AFC環路并為實現最小前同步碼長度而進行優化

    無線電通信網絡中的遠程收發器使用自己的獨立時鐘源。因此,這些收發器容易產生頻率誤差。當發射機啟動通信鏈路時,關聯的接收機需要在數據包的前同步碼階段校正這些誤差,以確保正確的解調

    標簽: 7021 ADF AFC 環路

    上傳時間: 2013-10-20

    上傳用戶:qiaoyue

  • AVR單片機原理及應用

    《AVR單片機原理及應用》詳細介紹了ATMEL公司開發的ATmega8系列高速嵌入式單片機的硬件結構、工作原理、指令系統、接口電路、C編程實例,以及一些特殊功能的應用和設計,對讀者掌握和使用其他ATmega8系列的單片機具有極高的參考價值 AVR單片機原理及應用》具有較強的系統性和實用性,可作為有關工程技術人員和硬件工程師的應用手冊,亦可作為高等院校自動化、計算機、儀器儀表、電子等專業的教學參考書。 目錄 第1章 緒論 1.1 AVR單片機的主要特性 1.2 主流單片機系列產品比較 1.2.1 ATMEL公司的單片機 1.2.2 Mkcochip公司的單片機 1.2.3 Cygnal公司的單片機 第2章 AVR系統結構概況 2.1 AVR單片機ATmega8的總體結構 2.1.1 ATmega8特點 2.1.2 結構框圖 2.1.3 ATmega8單片機封裝與引腳 2.2 中央處理器 2.2.1 算術邏輯單元 2.2.2 指令執行時序 2.2.3 復位和中斷處理 2.3 ATmega8存儲器 2.3.1 Flash程序存儲器 2.3.2 SRAM 2.3.3 E2pROM 2.3.4 I/O寄存器 2.3.5 ATmega8的鎖定位、熔絲位、標識位和校正位 2.4 系統時鐘及其分配 2.4.1 時鐘源 2.4.2 外部晶振 2.4.3 外部低頻石英晶振 2.4.4 外部:RC振蕩器 2.4.5 可校準內部.RC振蕩器 2.4.6 外部時鐘源 2.4.7 異步定時器/計數器振蕩器 2.5 系統電源管理和休眠模式 2.5.1 MCU控制寄存器 2.5.2 空閑模式 2.5.3 ADC降噪模式 2.5.4 掉電模式 2.5.5 省電模式 2.5.6 等待模式 2.5.7 最小功耗 2.6 系統復位 2.6.1 復位源 2.6.2 MCU控制狀態寄存器——MCUCSR 2.6.3 內部參考電壓源 2.7 I/O端口 2.7.1 通用數字I/O端口 2.7.2 數字輸入使能和休眠模式 2.7.3 端口的第二功能 第3章 ATmega8指令系統 3.1 ATmega8匯編指令格式 3.1.1 匯編語言源文件 3.1.2 指令系統中使用的符號 3.1.3 ATmega8指令 3.1.4 匯編器偽指令 3.1.5 表達式 3.1.6 文件“M8def.inc” 3.2 尋址方式和尋址空間 3.3 算術和邏輯指令 3.3.1 加法指令 3.3.2 減法指令 3.3.3 取反碼指令 3.3.4 取補碼指令 3.3.5 比較指令 3.3.6 邏輯與指令 3.3.7 邏輯或指令 3.3.8 邏輯異或 3.3.9 乘法指令 3.4 轉移指令 3.4.1 無條件轉移指令 3.4.2 條件轉移指令 3.4.3 子程序調用和返回指令 3.5 數據傳送指令 3.5.1 直接尋址數據傳送指令 3.5.2 間接尋址數據傳送指令 3.5.3 從程序存儲器中取數裝入寄存器指令 3.5.4 寫程序存儲器指令 3.5.5 I/0端口數據傳送 3.5.6 堆棧操作指令 3.6 位操作和位測試指令 3.6.1 帶進位邏輯操作指令 3.6.2 位變量傳送指令 3.6.3 位變量修改指令 3.7 MCU控制指令 3.8 指令的應用 第4章 中斷系統 4.1 外部向量 4.2 外部中斷 4.3 中斷寄存器 第5章 自編程功能 5.1 引導加載技術 5.2 相關I/O寄存器 5.3 Flash程序存儲器的自編程 5.4 Flash自編程應用 第6章 定時器/計數器 6.1 定時器/計數器預定比例分頻器 6.2 8位定時器/計數器O(T/CO) 6.3 16位定時器/計數器1(T/C1) 6.3.1 T/C1的結構 6.3.2 T/C1的操作模式 6.3.3 T/121的計數時序 6.3.4 T/C1的寄存器 6.4 8位定時器/計數器2(T/C2) 6.4.1 T/C2的組成結構 6.4.2 T/C2的操作模式 6.4.3 T/C2的計數時序 6.4.4 T/02的寄存器 6.4.5 T/C2的異步操作 6.5 看門狗定時器 第7章 AVR單片機通信接口 7.1 AVR單片機串行接口 7.1.1 同步串行接口 7.1.2 通用串行接口 7.2 兩線串行TWT總線接口 7.2.1 TWT模塊概述 7.2.2 TWT寄存器描述 7.2.3 TWT總線的使用 7.2.4 多主機系統和仲裁 第8章 AVR單片機A/D轉換及模擬比較器 8.1 A/D轉換 8.1.1 A/D轉換概述 8.1.2 ADC噪聲抑制器 8.1.3 ADC有關的寄存器 8.2 AvR單片機模擬比較器 第9章 系統擴展技術 9.1 串行接口8位LED顯示驅動器MAX7219 9.1.1 概述 9.1.2 引腳功能及內部結構 9.1.3 操作說明 9.1.4 應用 9.1.5 軟件設計 9.2 AT24C系列兩線串行總線E2PPOM 9.2.1 概述 9.2.2 引腳功能及內部結構 9.2.3 操作說明 9.2.4 軟件設計 9.3 AT93C46——三線串行總線E2PPOM接口芯片 9.3.1 概述 9.3.2 內部結構及引腳功能 9.3.3 操作說明 9.3.4 軟件設計 9.4 串行12位的ADCTL543 9.4.1 概述 9.4.2 內部結構及引腳功能 9.4.3 操作說明 9.4.4 AD620放大器介紹 9.4.5 軟件設計 9.5 串行輸出16位ADCMAXl95 9.5.1 概述 9.5.2 引腳功能及內部結構 9.5.3 操作說明 9.5.4 應用 9.5.5 軟件設計 9.6 串行輸入DACTLC5615 9.6.1 概述 9.6.2 引腳功能及內部結構 9.6.3 操作說明 9.6.4 軟件設計 9.7 串行12位的DACTLC5618 9.7.1 概述 9.7.2 內部結構及引腳功能 9.7.3 操作說明 9.7.4 軟件設計 9.8 串行非易失性靜態RAMX24C44 9.8.1 概述 9.8.2 引腳功能及內部結構 9.8.3 操作說明 9.8.4 軟件設計 9.9 數據閃速存儲器AT45DB041B 9.9.1 概述 9.9.2 引腳功能及內部結構 9.9.3 操作說明 9.9.4 軟件設計 9.10 GM8164串行I/0擴展芯片 9.10.1 概述 9.10.2 引腳功能說明 9.10.3 操作說明 9.10.4 軟件設計 9.11 接口綜合實例 附錄1 ICCACR簡介 附錄2 ATmega8指令表 參考文獻

    標簽: AVR 單片機原理

    上傳時間: 2013-10-29

    上傳用戶:lanwei

  • SH69P8XX系列單片機定時/計數器使用指南

    本使用指南介紹SH69P8XX系列單片機(SH69P801/SH69P802/SH69P822/SH69P842/SH69P862)的定時/計數器。SH69P8XX系列單片機具有2個8位定時/計數器T0,T1。T0和T1都是向上計數的自動重載入計數器,其計數的起始值可由外部來寫入,計數的值可以被讀出,計數溢出時能夠產生中斷。T0的時鐘源可以是內部系統時鐘(OSC/4),也可以是外部時鐘,而T1的時鐘源只能是內部系統時鐘(OSC/4)。當對內部系統時鐘的標準脈沖序列進行計數時即為定時器,對外部脈沖計數時就可作為計數器使用。當T0時鐘源為外部脈沖時,可以選擇脈沖的觸發方式,上升沿或者下降沿。為了擴大定時或計數范圍,可以設置定時器方式寄存器TM0和TM1,對定時器時鐘源分頻,分頻比可以選擇為:1:1、1:2、1:4、1:8、1:32、1:128、1:512或1:2048等。定時/計數器的內部結構見圖4-1。

    標簽: 69P 8XX SH 69

    上傳時間: 2013-10-21

    上傳用戶:1477849018@qq.com

  • 深度睡眠模式操作技術筆記

    LM3S系列單片機主要有3種工作模式:運行模式(Run-Mode)、睡眠模式(Sleep-Mode)、深度睡眠模式(Deep-Sleep-Mode)。某些型號還具有單獨的極為省電的冬眠模塊(Hibernation Module)。而對各個模式下的外設時鐘選通以及系統時鐘源的控制主要由表 2.1中的寄存器來完成。 運行模式是正常的工作模式,處理器內核將積極地執行代碼。在睡眠模式下,系統時鐘不變,但處理器內核不再執行代碼(內核因不需要時鐘而省電)。在深度睡眠模式下,系統時鐘可變,處理器內核同樣也不再執行代碼。深度睡眠模式比睡眠模式更為省電。有關這3種工作模式的具體區別請參見表 2.2的描述。調用函數SysCtlSleep( )可使處理器立即進入睡眠模式,而調用函數SysCtlDeepSleep( )可使處理器立即進入深度睡眠模式。任一中斷都可以將處理器從睡眠或深度睡眠模式喚醒,并使處理器恢復到睡眠前的運行狀態。因此在進入睡眠或深度睡眠之前,必須配置某個片內外設的中斷并允許其在睡眠或深度睡眠模式下繼續工作,如果不這樣,則只有復位或重新上電才能結束睡眠或深度睡眠狀態。

    標簽: 深度睡眠 模式 操作

    上傳時間: 2013-11-08

    上傳用戶:ArmKing88

  • Luminary復位電路匯總

    由于Luminary系列的ARM高速低功耗低工作電壓導致其噪聲容限低這是對數字電路極限的挑戰對電源的紋波瞬態響應性能時鐘源的穩定度電源監控可靠性等諸多方面也提出了更高的要求ARM監控技術是復雜并且非常重要的。計算機系統在上電、掉電或遇到突發狀況電源電壓下降情況下,都有可能因為電源的不穩定而出錯。因此,就必須有一個可靠的復位系統來保證計算機系統不出錯。設計復位系統時一般都采用專用的復位監控器件,這樣可以大大的提高系統的復位性能。監控器件的工作原理是通過確定的復位閥值電壓來啟動復位操作(復位都能保持一定時間),防止CPU誤操作效果,保證系統運行安全、可靠。同時還可以排除瞬間干擾的影響。Luminary的Stellaris系列單片機為低電平有效外部復位,上電復位的閥值為2.0v,掉電復位閥值的額定值為2.90v、最小值和最大值分別為2.85v和2.95v。根據這些特性及實際應用需要本文選擇了適合Stellaris系列單片機的復位監控器件。

    標簽: Luminary 復位電路

    上傳時間: 2013-11-07

    上傳用戶:leesuper

  • 采用納瓦技術的8/14引腳閃存8位CMOS單片機 PIC12

    采用納瓦技術的8/14引腳閃存8位CMOS單片機 PIC12F635/PIC16F636/639數據手冊 目錄1.0 器件概述 2.0 存儲器構成3.0 時鐘源4.0 I/O 端口 5.0 Timer0 模塊6.0 具備門控功能的Timer1 模塊 7.0 比較器模塊8.0 可編程低壓檢測(PLVD)模塊9.0 數據EEPROM 存儲器10.0 KeeLoq® 兼容加密模塊 11.0 模擬前端(AFE)功能說明 (僅限PIC16F639)12.0 CPU 的特殊功能13.0 指令集概述14.0 開發支持15.0 電氣特性16.0 DC 和AC 特性圖表17.0 封裝信息Microchip 網站變更通知客戶服務客戶支持讀者反饋表 附錄A: 數據手冊版本歷史產品標識體系全球銷售及服務網點

    標簽: CMOS PIC 14 12

    上傳時間: 2013-11-17

    上傳用戶:qlpqlq

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