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  • 基于DSP和FPGA的數字化開關電源的實用化研究.rar

    文章開篇提出了開發背景。認為現在所廣泛應用的開關電源都是基于傳統的分立元件組成的。它的特點是頻率范圍窄、電力小、功能少、器件多、成本較高、精度低,對不同的客戶要求來“量身定做”不同的產品,同時幾乎沒有通用性和可移植性。在電子技術飛速發展的今天,這種傳統的模擬開關電源已經很難跟上時代的發展步伐。 隨著DSP、ASIC等電子器件的小型化、高速化,開關電源的控制部分正在向數字化方向發展。由于數字化,使開關電源的控制部分的智能化、零件的共通化、電源的動作狀態的遠距離監測成為了可能,同時由于它的智能化、零件的共通化使得它能夠靈活地應對不同客戶的需求,這就降低了開發周期和成本。依靠現代數字化控制和數字信號處理新技術,數字化開關電源有著廣闊的發展空間。 在數字化領域的今天,最后一個沒有數字化的堡壘就是電源領域。近年來,數字電源的研究勢頭與日俱增,成果也越來越多。雖然目前中國制造的開關電源占了世界市場的80%以上,但都是傳統的比較低端的模擬電源。高端市場上幾乎沒有我們份額。 本論文研究的主要內容是在傳統開關電源模擬調節器的基礎上,提出了一種新的數字化調節器方案,即基于DSP和FPGA的數字化PID調節器。論文對系統方案和電路進行了較為具體的設計,并通過測試取得了預期結果。測試證明該方案能夠適合本行業時代發展的步伐,使系統電路更簡單,精度更高,通用性更強。同時該方案也可用于相關領域。 本文首先分析了國內外開關電源發展的現狀,以及研究數字化開關電源的意義。然后提出了數字化開關電源的總體設計框圖和實現方案,并與傳統的開關電源做了較為詳細的比較。本論文的設計方案是采用DSP技術和FPGA技術來做數字化PID調節,通過數字化PID算法產生PWM波來控制斬波器,控制主回路。從而取代傳統的模擬PID調節器,使電路更簡單,精度更高,通用性更強。傳統的模擬開關電源是將電流電壓反饋信號做PID調節后--分立元器件構成,采用專用脈寬調制芯片實現PWM控制。電流反饋信號來自主回路的電流取樣,電壓反饋信號來自主回路的電壓采樣。再將這兩個信號分別送至電流調節器和電壓調節器的反相輸入端,用來實現閉環控制。同時用來保證系統的穩定性及實現系統的過流過壓保護、電流和電壓值的顯示。電壓、電流的給定信號則由單片機或電位器提供。再次,文章對各個模塊從理論和實際的上都做了仔細的分析和設計,并給出了具體的電路圖,同時寫出了軟件流程圖以及設計中應該注意的地方。整個系統由DSP板和ADC板組成。DSP板完成PWM生成、PID運算、環境開關量檢測、環境開關量生成以及本地控制。ADC板主要完成前饋電壓信號采集、負載電壓信號采集、負載電流信號采集、以及對信號的一階數字低通濾波。由于整個系統是閉環控制系統,要求采樣速率相當高。本系統采用FPGA來控制ADC,這樣就避免了高速采樣占用系統資源的問題,減輕了DSP的負擔。DSP可以將讀到的ADC信號做PID調節,從而產生PWM波來控制逆變橋的開關速率,從而達到閉環控制的目的。 最后,對數字化開關電源和模擬開關電源做了對比測試,得出了預期結論。同時也提出了一些需要改進的地方,認為該方案在其他相關行業中可以廣泛地應用。模擬控制電路因為使用許多零件而需要很大空間,這些零件的參數值還會隨著使用時間、溫度和其它環境條件的改變而變動并對系統穩定性和響應能力造成負面影響。數字電源則剛好相反,同時數字控制還能讓硬件頻繁重復使用、加快上市時間以及減少開發成本與風險。在當前對產品要求體積小、智能化、共通化、精度高和穩定度好等前提條件下,數字化開關電源有著廣闊的發展空間。本系統來基本上達到了設計要求。能夠滿足較高精度的設計要求。但對于高精度數字化電源,系統還有值得改進的地方,比如改進主控器,提高參考電壓的精度,提高采樣器件的精度等,都可以提高系統的精度。 本系統涉及電子、通信和測控等技術領域,將數字PID算法與電力電子技術、通信技術等有機地結合了起來。本系統的設計方案不僅可以用在電源控制器上,只要是相關的領域都可以采用。

    標簽: FPGA DSP 數字化

    上傳時間: 2013-06-29

    上傳用戶:dreamboy36

  • 基于DSP/FPGA的多波形數字脈沖壓縮系統硬件的研究與實現

    現代雷達系統廣泛采用脈沖壓縮技術,用以解決作用距離與分辨能力之間的矛盾。脈沖壓縮是指雷達通過發射寬脈沖,保證足夠的最大作用距離,而接收時,采用相應的脈沖壓縮法獲得窄脈沖以提高距離分辨率的過程。同時,數字信號處理技術的迅猛發展和廣泛應用,為雷達脈沖壓縮處理的數字化實現提供了可能。 本文主要研究雷達多波形頻域數字脈沖壓縮系統的硬件系統實現。在匹配濾波理論的指導下,成功研制了基于FPGAEP1K100QC208-1和4片高性能ADSP21160M的多波形頻域數字脈沖壓縮系統。該系統可處理時寬在42μs以內、帶寬在5MHz以下的線性調頻信號(LFM),非線性調頻信號(NLFM)和Taylor四相碼信號,且技術指標完全滿足實用系統的設計要求。 本文完成的主要工作和創新之處有:(1)基于雙通道模數轉換器AD10242設計高精度數據采集電路,為整個脈壓系統的工作提供必要的條件。完成了前端模擬信號輸入電路的優化和差分輸入時鐘的產生,以實現高精度采樣。 (2)根據協議和脈壓系統的工作要求,以基于FPGAEP1K100QC208完成系統控制,使整個脈壓系統正確穩定地工作。同時以該FPGA生成雙口RAM,實現數據暫存,以匹配采樣速率和脈壓系統頻率。 (3)設計基于4片高性能ADSP21160M的緊耦合并行處理系統,以完成多波形頻域數字脈沖壓縮的全部運算工作。4片DSP共享外部總線,且各DSP以鏈路口互連,進行數據通信。各DSP還使用一個鏈路口連接到接口板DSP,將脈壓結果送出。 (4)以一片ADSP21160M和一片EP1K100QC208為核心,設計輸出板電路,完成數據對齊、求模和數據向下一級的輸出,并產生模擬輸出。 (5)調試并改進處理板和輸出板。

    標簽: FPGA DSP 多波形 壓縮系統

    上傳時間: 2013-06-11

    上傳用戶:qq277541717

  • LabVIEW8.2從入門到精通配套光碟實例

    【書名】LabVIEW8.20程序設計從入門到精通 【出版社】清華大學出版社 【作者】陳錫輝,張銀鴻編著 隨書附贈的與書配套的光盤實例

    標簽: LabVIEW 8.2

    上傳時間: 2013-07-19

    上傳用戶:dong

  • 基于ARM的嵌入式系統開發與應用

    隨著現代計算機技術和互聯網技術的飛速發展,嵌入式系統成為當前最熱門的焦點之一;ARM以其高性能低功耗等特性成為目前應用最廣泛的32位嵌入式處理器。近年來得到快速發展的機電一體化設備的人民幣紙幣清分機系統,是嵌入式系統的典型應用;它的主要工作流程是:人民幣圖像通過圖像傳感器采集得到的模擬信號,經過放大、A/D轉換和FPGA協調之后得到數字圖像,經緩存后進入到主CPU--S3C2410,通過圖像識別,實現面向、面值、新舊分級、破損程度等特征的識別,最后送出結果到控制CPU對識別結果進行相應的顯示和機械動作。論文主要涉及以下這些內容: 1):基于ARM的嵌入式系統和清分機系統介紹。 2):人民幣清分機的硬件系統基本構架,清分機的各關鍵硬件的選型及主要原理;著重介紹清分機的處理核心--S3C2410。 3):圖像處理基礎。介紹了清分機系統中各類圖像的特點,圖像分析中的常用工具--灰度直方圖,從而為識別算法做好準備。 4):介紹了人民幣的特征識別算法原理及實現基本流程,通過MATLAB對算法進行仿真研究。 5):嵌入式linux設備驅動的開發。針對清分機設備種類繁多而又是多任務的特點,本文提出使用可裁剪而又穩定的linux操作系統來管理整個清分機系統;而實現操作系統對清分機的管理首先就要實現設備與操作系統的連接--設備驅動。

    標簽: ARM 嵌入式 系統開發

    上傳時間: 2013-06-01

    上傳用戶:xoxoliguozhi

  • 一種公歷到農歷日期轉換算法的實現

    本文主要從單片機軟件實現角度介紹一種公歷到農歷轉換的算法思想, 算法采用MCS-51 指令系統實現。并給出程序流程圖,另外對二十四節氣和生肖的算法也做詳細介紹。關鍵詞:單片機;MCS-51 指

    標簽: 農歷 日期轉換算法

    上傳時間: 2013-04-24

    上傳用戶:lnnn30

  • 基于ARM的噴氣織機電子送經和卷取控制系統研究

    現代噴氣織機以其高速、高性能等優勢,占據了無梭織機的大部分市場,并成為最有發展前景的一種織機。送經、卷取機構是織機控制系統的重要組成部分,其對經紗張力的控制精度已成為評定織機質量的重要技術指標。因此,提高和改善噴氣織機的電子送經和卷取控制系統的性能非常必要,而且,開發具有高速、高精度的獨立電子送經和卷取控制模塊具有廣闊的應用前景。 本課題研究開發了一款獨立的電子送經和卷取控制模塊,通過人機界面或CAN通訊對該控制系統所需參數進行設置,使其可以根據參數設置應用于不同型號的噴氣織機。通過對系統的控制分析,本課題主要從硬件電路設計、軟件控制及張力控制算法三個方面進行研究。 首先,通過對噴氣織機的性能要求及控制器結構與性能的綜合考慮,系統采用以高速ARM7TDMI為內核的低功耗微處理器LPC2294作為系統控制器,該控制器不僅速度快、性能穩定,而且其豐富的外圍模塊大大簡化了硬件電路的設計。硬件電路設計采用模塊化設計方法,主要功能模塊包括嵌入式最小系統模塊、主軸編碼器采集模塊、張力采集模塊、電機控制模塊、通訊模塊、人機界面模塊、輸入輸出信號模塊等。根據系統需要,對各個模塊的控制器件進行選取,并設計出各個模塊的接口電路。最后,為了提高系統的穩定性和可靠性,在硬件電路設計中采取了隔離、去耦等硬件抗干擾措施。 在軟件設計方面,系統采用嵌入式實時操作系統μC/OS-II,便于系統升級和維護。在系統硬件平臺的基礎上,根據設計要求對操作系統內核進行剪裁和移植,并對系統時鐘節拍進行修改。結合硬件電路及系統控制要求,對系統啟動代碼進行修改;并根據系統對各個功能模塊控制的時效性要求,對系統任務進行合理規劃。為了說明系統采用該RTOS的可行性,對實時性要求最高的張力采集任務進行了實時性分析。對CAN通訊協議進行制定和編程實現,并對I2C、CAN和LCD驅動程序進行開發,另外,對每個任務的功能及控制流程和任務間及任務與中斷間的信息通訊進行了說明。系統在軟件方面也采用了一定的抗干擾技術,對硬件抗干擾進行補充。 最后,針對經紗張力的非線性和滯后性等復雜特性,對張力調節采用模糊參數自整定PID控制算法,設計出張力模糊參數自整定PID控制器。并在Matlab及Simulink工具下,對PID控制器下的張力算法及模糊參數自整定PID控制器下的張力算法進行仿真研究。而且對張力模糊PID控制算法在LPC2294中的實現進行了說明。關鍵詞:ARM; μC/OS-II;噴氣織機;送經卷取;模糊PID

    標簽: ARM 噴氣織機 電子送經 控制

    上傳時間: 2013-06-11

    上傳用戶:ivan-mtk

  • 1K到10MHZ信號發生器

    1K到10MHZ信號發生器1K到10MHZ信號發生器

    標簽: MHZ 10 信號發生器

    上傳時間: 2013-07-07

    上傳用戶:Miyuki

  • 基于ARM的織機送經和卷取控制系統的設計

    目前,織機向著高速化、智能化方向發展,無梭織機也越來越占主導地位,開發中高檔織機控制系統是當前紡織機械領域的重要課題。織機的電子送經和卷取控制系統是中高檔織機控制的關鍵技術之一,同時它也是無梭織機優越于有梭織機的重要特征之一,因此研究送經和卷取控制系統具有重要意義。 本文研究的內容是織機的送經和卷取控制系統,主要目的是保證織機在織造過程中紗線張力的動態穩定。主要工作如下: (1)在分析送經卷取系統原理和功能的基礎上,提出了一種用較低成本完成所需控制功能的解決方案——以ARM嵌入式處理器S3C44B0為中心構建硬件平臺,以嵌入式操作系統uClinux為基礎構建軟件平臺。 (2)利用嵌入式處理器S3C44B0豐富的硬件資源,對電子送經卷取控制系統進行硬件設計:包括以S3C44B0為核心的最小系統電路的設計、與上位機通訊接口電路的設計、經紗張力檢測與采樣電路的設計、伺服電機驅動接口電路的設計和編碼器接口電路的設計等. (3)利用嵌入式操作系統uClinux高實時、多任務等優點,對電子送經卷取控制系統進行軟件設計: ●在分析uClinux系統的特點和功能的基礎上,完成了在硬件電路板上的移植; ●在分析系統引導程序功能的基礎上,完成了Boot Loader的設計; ●完成了系統設備驅動程序的設計:包括串口驅動程序設計、A/D驅動程序的設計和IIC驅動程序的設計等; ●在對織機工藝了解的基礎上,以模塊化的思想完成了系統應用程序的設計:包括張力傳感器數據采集模塊、控制算法模塊和通訊模塊等; (4)詳細介紹了整個控制系統的調試過程。 本文設計的系統能使控制的經紗張力恒定,反應快速,控制精度高,很好地解決了開車痕等問題,能滿足中高檔織機的要求,具有實際應用價值。

    標簽: ARM 控制系統

    上傳時間: 2013-04-24

    上傳用戶:athjac

  • 液晶顯示器維修配板從入門到精通

    液晶顯示器維修配板從入門到精通 液晶顯示器維修配板從入門到精通

    標簽: 液晶 顯示器維修

    上傳時間: 2013-04-24

    上傳用戶:pwcsoft

  • 基于FPGA的DAB信道編碼器輸入接口的設計與實現

    電臺廣播在我們的社會生活中占有重要的地位。隨著我國廣播事業的發展,對我國廣播業開發技術、信號的傳輸質量和速度提出了更高更新的要求,促使廣播科研人員不斷更新現有技術,以滿足人民群眾日益增長的需求。 本論文主要分析了現行廣播發射臺的數字廣播激勵器輸入接口的不足之處,根據歐洲ETS300799標準,實現了一種激勵器輸入接口的解決方案,這種方案將復接器送來的ETI(NA,G704)格式的碼流轉換成符合ETS300799標準ETI(NI)的標準碼流,并送往后面的信道編碼器。ETI(NA,G704)格式與現行的ETI(NI,G703)格式相比,主要加入了交織和RS糾錯編碼,使得信號抗干擾能力大大加強,提高了節目從演播室到發射臺的傳輸質量,特別是實時直播節目要求信號質量比較好時具有更大的作用。 本論文利用校驗位為奇數個的RS碼,對可檢不可糾的錯誤發出報警信號,通過其它方法替代原有信號,對音質影響不大,節省了糾正這個錯誤的資源和開發成本。 同時,我們采用FPGA硬件開發平臺和VHDL硬件描述語言編寫代碼實現硬件功能,而不采用專用芯片實現功能,使得修改電路和升級變得異常方便,大大提高了開發產品的效率,降低了成本。 經過軟件仿真和硬件驗證,本系統已經基本實現了預想的功能,擴展性較好,硬件資源開銷較小,具有實用價值。

    標簽: FPGA DAB 信道 編碼器

    上傳時間: 2013-07-15

    上傳用戶:afeiafei309

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