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時序時序非平穩(wěn)性<b>ADF</b>檢驗法的理論與應(yīng)用

無位置傳感器無刷直流電動機(jī)運行理論和控制系統(tǒng)研究.rar

v無刷直流電動機(jī)具有結(jié)構(gòu)簡單、可靠性高、維護(hù)方便、運行效率高和調(diào)速性能好等優(yōu)點，隨著微處理器技術(shù)、電力電子技術(shù)、控制理論，以及低成本、高磁能積永磁材料的發(fā)展，得到越來越廣泛的應(yīng)用。無刷直流電動機(jī)采用無位置傳感器控制，電動機(jī)結(jié)構(gòu)更加簡單，應(yīng)用范圍擴(kuò)大，相對于有位置傳感器控制優(yōu)勢明顯。本論文圍繞無刷直流電動機(jī)的無位置傳感器控制進(jìn)行較為系統(tǒng)和深入的研究。首先，論文從基本電磁定律出發(fā)，在分析無刷直流電動機(jī)結(jié)構(gòu)和工作原理的基礎(chǔ)上，建立了無刷直流電動機(jī)的數(shù)學(xué)模型，為分析無刷直流電動機(jī)無位置傳感器控制奠定基礎(chǔ)。其次，根據(jù)無刷直流電動機(jī)反電勢過零檢測原理，對反電勢過零檢測法的各種實現(xiàn)方法進(jìn)行研究，比較各種實現(xiàn)方法的優(yōu)缺點，指出它們的適用范圍。在此基礎(chǔ)上，給出帶通濾波法及其簡化電路形式，提出使用帶通濾波器獲取反電勢三次諧波的方法。論文將直流電源負(fù)端電壓作為帶通濾波法和帶通濾波三次諧波法的參考電平。論文對無刷直流電動機(jī)無位置傳感器控制中的關(guān)鍵問題-起動方法進(jìn)行研究，在詳細(xì)分析“三段式”起動方法的實現(xiàn)過程的基礎(chǔ)上，給出了從外同步到自同步平穩(wěn)切換的條件。論文在研究無刷直流電動機(jī)無位置傳感器控制換相方法的基礎(chǔ)上，提出了一種新的換相方法，提高了電動機(jī)運行平穩(wěn)性和系統(tǒng)穩(wěn)定性。在帶通濾波三次諧波法中使用該換相方法，無需對三次諧波積分即可得到換相時刻。濾波器是反電勢法中反電勢過零檢測電路的重要組成部分。論文在分析無刷直流電動機(jī)端電壓信號特點的基礎(chǔ)上，給出濾波電路的技術(shù)要求，根據(jù)濾波器基本設(shè)計原理，分別對一階RC無源帶通濾波器和二階RC有源低通濾波器進(jìn)行電路設(shè)計和參數(shù)計算，并通過實驗驗證理論分析和仿真結(jié)果。這些為通過檢測反電勢過零點獲得可靠的換相信號創(chuàng)造了條件。論文還分析了無刷直流電動機(jī)無位置傳感器控制中產(chǎn)生轉(zhuǎn)子位置檢測誤差的原因，提出了相應(yīng)的校正方法。通過分析無刷直流電動機(jī)的換相過程，建立了換相狀態(tài)的等效電路和數(shù)學(xué)模型，研究了轉(zhuǎn)子位置誤差引起的電動機(jī)超前、滯后換相現(xiàn)象，及其由此產(chǎn)生的非導(dǎo)通相環(huán)流，在理論分析的基礎(chǔ)上，進(jìn)行了仿真計算，并與實驗結(jié)果對照分析。功率器件的功率損耗分析在逆變器設(shè)計和提高控制系統(tǒng)的可靠性方面具有重要作用。論文構(gòu)建了由IGBT組成的簡化逆變器模型，并進(jìn)行仿真研究。針對不同的開關(guān)頻率和柵極電阻，定量計算了IGBT開關(guān)過程中各階段的功率損耗，給出了變化規(guī)律，對逆變器的設(shè)計具有重要的指導(dǎo)意義。最后，論文研制了基于反電勢過零檢測法的無位置傳感器無刷直流電動機(jī)控制系統(tǒng)，控制系統(tǒng)由硬件和控制軟件兩部分組成。硬件部分包括主電源整流濾波電路、控制電源電路、反電勢過零檢測電路、驅(qū)動和逆變電路以及保護(hù)電路等，控制軟件包括電動機(jī)起動模塊(包括定位、加速、切換)、電動機(jī)運行控制模塊(包括過零檢測及校正、換相)和各保護(hù)功能模塊。對系統(tǒng)進(jìn)行了調(diào)試，并對論文中所分析和提出的各種方法進(jìn)行了相關(guān)的實驗研究，給出了實驗結(jié)果。

標(biāo)簽： 無位置傳感器控制無刷直流電動機(jī)

上傳時間： 2013-06-06

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基于FPGA的語音增強(qiáng)算法研究與實現(xiàn).rar

現(xiàn)實生活中的語音不可避免的要受到周圍環(huán)境的影響，背景噪聲例如機(jī)械噪聲、街頭音樂噪音，其他說話者的話音等均會嚴(yán)重地影響語音信號的質(zhì)量：此外傳輸系統(tǒng)本身也會產(chǎn)生各種噪聲，因此接收端的信號為帶噪語音信號?；殳B在語音信號中的噪聲按類別可分為環(huán)境噪聲等的加法性噪聲及電器線路干擾等的乘法性噪聲；按性質(zhì)可分為平穩(wěn)噪聲和非平穩(wěn)噪聲。語音增強(qiáng)的根本目的就是凈化語音質(zhì)量。把不需要的噪音減低到最小程度。但是由于噪音的復(fù)雜性，很難歸納出一個統(tǒng)一的特征，因此不可能尋求一種算法完全適應(yīng)于所有的噪音消除，因此語音增強(qiáng)是一個復(fù)雜的工程。有關(guān)抗噪聲技術(shù)的研究以及實際環(huán)境下的語音信號處理系統(tǒng)的開發(fā)，在國內(nèi)外已經(jīng)成為語音信號處理非常重要的研究課題，已經(jīng)作了大量的研究工作，取得了豐富的研究成果。本文僅對加性噪聲下的語音增強(qiáng)技術(shù)做了較為仔細(xì)的討論，我們先給出語音信號處理的基本理論，它是語音增強(qiáng)算法研究和實現(xiàn)的理論基礎(chǔ)，在此基礎(chǔ)總結(jié)了自適應(yīng)信號處理技術(shù)的特點以及在語音增強(qiáng)方面的應(yīng)用。選取工程領(lǐng)域最常用的自適應(yīng)LMS濾波算法和RLS濾波算法作為研究對象，提出了利用最小均方誤差意義下自適應(yīng)濾波器的輸出信號與主通道噪聲信號的等效關(guān)系，得到濾波器最佳自適應(yīng)參數(shù)的方法，并分析了在平穩(wěn)和非平穩(wěn)噪聲環(huán)境下，L M S濾波器族和R L S濾波器在不同噪音輸入下的權(quán)系數(shù)收斂速度、權(quán)系數(shù)穩(wěn)定性、跟蹤輸入信號的能力和信噪比的改善等特性。研究了MATLAB語言程序設(shè)計和使用MALTLAB對語音算法進(jìn)行仿真、并輸入了多種實際環(huán)境下的噪音進(jìn)行濾波仿真并對仿真的結(jié)果進(jìn)行比較和分析?？偨Y(jié)出了LMS、NLMS、SIGN-ERROR-LMS、RLS自適應(yīng)濾波器在語音濾波方面的特點和應(yīng)用情況。最后在MATLAB仿真的基礎(chǔ)上，利用Altera公司的Cyclone2系列FPGA芯片和多種EDA工具，完成了L M S自適應(yīng)濾波器的FPGA設(shè)計。關(guān)鍵詞：語音增強(qiáng)，背景噪音，自適應(yīng)濾波器，LMS，RLS，F(xiàn)PGA

標(biāo)簽： FPGA 語音增強(qiáng) 算法研究

上傳時間： 2013-04-24

上傳用戶：lijianyu172
數(shù)字邏輯電路的ASIC設(shè)計.pdf.rar

書名:數(shù)字邏輯電路的ASIC設(shè)計/實用電子電路設(shè)計叢書作者:（日）小林芳直著，蔣民譯，趙寶瑛校出版社：科學(xué)出版社原價：30.00 出版日期：2004-9-1 ISBN：9787030133960 字?jǐn)?shù)：348000 頁數(shù)：293 印次：版次：1 紙張：膠版紙開本：商品標(biāo)識：8901735 編輯推薦 -------------------------------------------------------------------------------- 內(nèi)容提要 -------------------------------------------------------------------------------- 本書是“實用電子電路設(shè)計叢書”之一。本書以實現(xiàn)高速高可靠性的數(shù)字系統(tǒng)設(shè)計為目標(biāo)，以完全同步式電路為基礎(chǔ)，從技術(shù)實現(xiàn)的角度介紹ASIC邏輯電路設(shè)計技術(shù)。內(nèi)容包括：邏輯門電路、邏輯壓縮、組合電路、Johnson計數(shù)器、定序器設(shè)計及應(yīng)用等，并介紹了實現(xiàn)最佳設(shè)計的各種工程設(shè)計方法。本書可供信息工程、電子工程、微電子技術(shù)、計算技術(shù)、控制工程等領(lǐng)域的高等院校師生及工程技術(shù)人員、研制開發(fā)人員學(xué)習(xí)參考。目錄 -------------------------------------------------------------------------------- 第1章 ASIC=同步式設(shè)計=更高可靠性設(shè)計方法的實現(xiàn) 1.1 面向高性能系統(tǒng)的設(shè)計 1.2 同步電路的不足 1.3 同步電路設(shè)計 1.4 ASIC機(jī)能設(shè)計方法有待思考的地方第2章邏輯門電路詳解 2.1 邏輯門電路的最基本的知識 2.2 加法電路及其構(gòu)成方法 2.3 其他輸入信號為３位的邏輯單元 2.4 復(fù)合邏輯門電路的調(diào)整第3章邏輯壓縮與奎恩·麥克拉斯基法 3.1 除去玻色項的方法 3.2 奎恩·麥克拉斯基法第4章組合電路設(shè)計 4.1 選擇器、解碼器、編碼器 4.2 比較和運算電路的設(shè)計第5章計數(shù)器電路的設(shè)計 5.1 計數(shù)器設(shè)計的基礎(chǔ) 5.2 各種各樣的計數(shù)器設(shè)計 5.3 LFSR(M系列發(fā)生器)的設(shè)計第6章江遜計數(shù)器 6.1 設(shè)計高可靠性的江遜計數(shù)器 6.2 沖刷順序的組成第7章定序器設(shè)計 7.1 定序器電路設(shè)計的基礎(chǔ)知識 7.2 把江遜計數(shù)器制作成狀態(tài)機(jī) 7.3 一比特?zé)嵛粻顟B(tài)機(jī)與江遜狀態(tài)機(jī) 7.4 跳躍動作的設(shè)計第8章定序器的高可靠化技術(shù) 8.1 高可靠性定序器概述 8.2 關(guān)注高可靠性江遜狀態(tài)機(jī) 第9章定序器的應(yīng)用設(shè)計 9.1 軟件處理與硬件處理 9.2 自動扶梯的設(shè)計 9.3 信號機(jī)的設(shè)計 9.4 數(shù)碼存錢箱的設(shè)計 9.5 數(shù)字鎖相環(huán)的設(shè)計第10章實現(xiàn)最佳設(shè)計的方法 10.1 如何杜絕運行錯誤的產(chǎn)生 10.2 16位乘法器的電路整定 10.3 冒泡分類器（bubble sorter）的電路設(shè)定參考文獻(xiàn)

標(biāo)簽： ASIC 數(shù)字邏輯電路

上傳時間： 2013-06-15

上傳用戶：龍飛艇
基于面向?qū)ο蟮那度胧较到y(tǒng)軟件開發(fā)方法研究及其應(yīng)用.rar

十多年來，隨著信息技術(shù)、電子技術(shù)和通訊技術(shù)的發(fā)展，嵌入式系統(tǒng)已經(jīng)獲得了空前的應(yīng)用和發(fā)展。隨著嵌入式應(yīng)用系統(tǒng)功能復(fù)雜度的提高、對軟件產(chǎn)品的非功能約束的特別關(guān)注以及由于市場的激烈競爭導(dǎo)致嵌入式軟件推出周期的縮短，都使得嵌入式軟件開發(fā)人員面臨著嚴(yán)峻的危機(jī)和挑戰(zhàn)。傳統(tǒng)的結(jié)構(gòu)化開發(fā)方法已經(jīng)顯得力不從心，于是嵌入式軟件開發(fā)人員在軟件開發(fā)中引入了目前較為流行的“面向?qū)ο蠓椒?OO)”，．但是目前對該方法的應(yīng)用還只是停留在傳統(tǒng)的以編程為中心的嵌入式軟件開發(fā)方法上，不能很好地保證軟件復(fù)用和代碼的重用，因此難以滿足市場對嵌入式軟件開發(fā)效率和開發(fā)質(zhì)量的要求。本課題的研究內(nèi)容是應(yīng)用面向?qū)ο蠓椒ǖ目蚣芗夹g(shù)，對嵌入式系統(tǒng)領(lǐng)域的專有結(jié)構(gòu)組件進(jìn)行封裝，創(chuàng)新性地提出了面向嵌入式系統(tǒng)領(lǐng)域的通用實時框架ARTIC(Abstract real-time contrO1)。ARTIC框架除了具有框架的共有優(yōu)點一最大限度實現(xiàn)軟件重用外，最突出的是具備以下兩個特點： 1、功能和非功能的分離在應(yīng)用面向?qū)ο蟮募夹g(shù)時，傳統(tǒng)的嵌入式軟件開發(fā)方法關(guān)注的重點是軟件結(jié)構(gòu)和功能分解，、忽略了嵌入式環(huán)境下特殊的非功能性要求。為了在實現(xiàn)系統(tǒng)功能需求的同時，保證軟件系統(tǒng)的非功能性需求的實現(xiàn)，ARTIC框架引入了面向方面的思想，、把系統(tǒng)的非功能性需求從功能模塊中分離出來，為它們單獨設(shè)計組件。開發(fā)人員在應(yīng)用該框架進(jìn)行嵌入式軟件設(shè)計時，只需要關(guān)注功能需求的實現(xiàn)，對于實時性、調(diào)度等非功能需求的實現(xiàn)可以通過調(diào)用ARTIC提供的時間管理模型和任務(wù)調(diào)度模型直接實現(xiàn)。 2、基于狀態(tài)機(jī)的主動對象設(shè)計模式根據(jù)嵌入式系統(tǒng)通常由多個控制線程組成的特點，應(yīng)用基于狀態(tài)機(jī)的主動對象設(shè)計模式，把嵌入式軟件系統(tǒng)構(gòu)建成多個主動對象的緝合。相對于傳統(tǒng)的面向?qū)ο蠓椒ǎ疚奶岢龅闹鲃訉ο蟮淖畲筇攸c在于：它提供對事件隊列、控制線程和表示主動對象動態(tài)行為狀態(tài)機(jī)等的封裝，并且該模式可以直接支持嵌入式系統(tǒng)的并行性。 ARTIC框架的應(yīng)用能夠幫助嵌入式軟件的開發(fā)人員快速地開發(fā)出高質(zhì)量的嵌入式軟件，除此之外，因為它包含了一個微小的實時操作系統(tǒng)(RTOS) 報包裝，在某些場合可以作為一個簡易的RTOS使用。為了驗證ARTIC的性能，本文將該框架應(yīng)用于硬幣搬送實時控制系統(tǒng)的開發(fā)設(shè)計，從該系統(tǒng)的應(yīng)用中充分體現(xiàn)了ARTIC框架的優(yōu)點。

標(biāo)簽： 嵌入式系統(tǒng) 軟件開發(fā)

上傳時間： 2013-06-21

上傳用戶：cxl274287265
基于FPGA的精確時鐘同步方法研究.rar

在工業(yè)控制領(lǐng)域，多種現(xiàn)場總線標(biāo)準(zhǔn)共存的局面從客觀上促進(jìn)了工業(yè)以太網(wǎng)技術(shù)的迅速發(fā)展，國際上已經(jīng)出現(xiàn)了HSE、Profinet、Modbus TCP/IP、Ethernet/IP、Ethernet Powerlink、EtherCAT等多種工業(yè)以太網(wǎng)協(xié)議。將傳統(tǒng)的商用以太網(wǎng)應(yīng)用于工業(yè)控制系統(tǒng)的現(xiàn)場設(shè)備層的最大障礙是以太網(wǎng)的非實時性，而實現(xiàn)現(xiàn)場設(shè)備間的高精度時鐘同步是保證以太網(wǎng)高實時性的前提和基礎(chǔ)。 IEEE 1588定義了一個能夠在測量和控制系統(tǒng)中實現(xiàn)高精度時鐘同步的協(xié)議——精確時間協(xié)議(Precision Time Protocol)。PTP協(xié)議集成了網(wǎng)絡(luò)通訊、局部計算和分布式對象等多項技術(shù)，適用于所有通過支持多播的局域網(wǎng)進(jìn)行通訊的分布式系統(tǒng)，特別適合于以太網(wǎng)，但不局限于以太網(wǎng)。PTP協(xié)議能夠使異質(zhì)系統(tǒng)中各類不同精確度、分辨率和穩(wěn)定性的時鐘同步起來，占用最少的網(wǎng)絡(luò)和局部計算資源，在最好情況下能達(dá)到系統(tǒng)級的亞微級的同步精度。基于PC機(jī)軟件的時鐘同步方法，如NTP協(xié)議，由于其實現(xiàn)機(jī)理的限制，其同步精度最好只能達(dá)到毫秒級；基于嵌入式軟件的時鐘同步方法，將時鐘同步模塊放在操作系統(tǒng)的驅(qū)動層，其同步精度能夠達(dá)到微秒級?，F(xiàn)場設(shè)備間微秒級的同步精度雖然已經(jīng)能滿足大多數(shù)工業(yè)控制系統(tǒng)對設(shè)備時鐘同步的要求，但是對于運動控制等需求高精度定時的系統(tǒng)來說，這仍然不夠?；谇度胧杰浖臅r鐘同步方法受限于操作系統(tǒng)中斷響應(yīng)延遲時間不一致、晶振頻率漂移等因素，很難達(dá)到亞微秒級的同步精度。本文設(shè)計并實現(xiàn)了一種基于FPGA的時鐘同步方法，以IEEE 1588作為時鐘同步協(xié)議，以Ethernet作為底層通訊網(wǎng)絡(luò)，以嵌入式軟件形式實現(xiàn)TCP/IP通訊，以數(shù)字電路形式實現(xiàn)時鐘同步模塊。這種方法充分利用了FPGA的特點，通過準(zhǔn)確捕獲報文時間戳和動態(tài)補(bǔ)償晶振頻率漂移等手段，相對于嵌入式軟件時鐘同步方法實現(xiàn)了更高精度的時鐘同步，并通過實驗驗證了在以集線器互連的10Mbps以太網(wǎng)上能夠達(dá)到亞微秒級的同步精度。

標(biāo)簽： FPGA 時鐘同步方法研究

上傳時間： 2013-08-04

上傳用戶：hn891122
磁共振用超導(dǎo)磁體的磁場均勻性研究

隨著生物工程及醫(yī)學(xué)影像學(xué)的發(fā)展，磁共振成像在醫(yī)學(xué)診斷學(xué)方面發(fā)揮著越來越重要的角色。磁場的均勻性是大型醫(yī)療設(shè)備——核磁共振(MRI)成像的理論基礎(chǔ)，是評價該設(shè)備的一個重要的技術(shù)參數(shù)，磁場的均勻性分析也是電磁場理論分析的一個重要方向。良好、穩(wěn)定的磁場均勻性對核磁共振圖像的信噪比(SNR)的提高有重要的意義，同時也是飽和壓脂序列實現(xiàn)的唯一條件。該課題的主要內(nèi)容是在介紹磁共振成像原理與磁共振超導(dǎo)磁體的超導(dǎo)勻場線圈的形狀及位置的基礎(chǔ)上，分析各個線圈中電流的大小與空間某點磁場強(qiáng)度的關(guān)系。同時借鑒磁共振成像原理，設(shè)計輔助測量水膜，對空間某一特定半徑的球體腔內(nèi)各點的磁場強(qiáng)度進(jìn)行自動化測量。在當(dāng)前使用的被動式勻場的基礎(chǔ)上，利用分析軟件，對線圈的選擇及電流的大小進(jìn)行計算與優(yōu)化。實驗結(jié)果表明效果良好，磁場均勻度有很大的改善。采用的主要方法是利用磁共振成像原理及傅里葉轉(zhuǎn)化技術(shù)去設(shè)計一種精確、方便、快捷的勻場方法。通過計算機(jī)模擬及有限元分析的方法進(jìn)行計算、優(yōu)化，最終得到理想的磁場均勻度。良好的磁場均勻性是磁共振成像的基礎(chǔ)，是飽和壓脂序列(FATSAT)、平面回波成像(EPI)、彌散成像、頻譜分析等一系列近幾年新出現(xiàn)的先進(jìn)序列實現(xiàn)的前提條件。從而為臨床醫(yī)學(xué)提供了一種先進(jìn)的檢查手段，為疾病診治的及時性、準(zhǔn)確性、可靠性及病灶確切位置的判斷都提供了基礎(chǔ)。該文所介紹的磁場均勻性測量、分析方法以及在此基礎(chǔ)上設(shè)計的勻場計算分析軟件已在多臺磁共振安裝調(diào)試過程中得到應(yīng)用，達(dá)到了預(yù)期的目的，能夠滿足現(xiàn)場調(diào)試的要求。該方法對于今后超導(dǎo)磁體磁共振的磁場均勻性調(diào)試，及在醫(yī)學(xué)影像學(xué)方面的發(fā)展有很好的應(yīng)用價值。該項技術(shù)在該領(lǐng)域的推廣必然會提高磁場均勻性的精度，推動醫(yī)學(xué)影像學(xué)及臨床診斷學(xué)的發(fā)展。并能帶來良好的社會效益及經(jīng)濟(jì)效益，具有關(guān)闊的應(yīng)用前景。

標(biāo)簽： 磁共振超導(dǎo)磁體磁場

上傳時間： 2013-04-24

上傳用戶：tianjinfan
ARMFPGA嵌入式系統(tǒng)設(shè)計及在測量儀器上的應(yīng)用.pdf

目前在各行各業(yè)中應(yīng)用種類繁多的測量儀器隨著儀器性能指標(biāo)要求的逐漸提升以及功能的不斷拓展，對儀器控制系統(tǒng)的實時性和集成化程度等性能的要求也越來越高。目前發(fā)展的趨勢是開放式、集成度向芯片級靠攏的高實時性儀器。針對目前傳統(tǒng)的系統(tǒng)設(shè)計存在著功能簡單、速度慢、實時性差、對數(shù)據(jù)的再加工處理能力極為有限等問題，本文根據(jù)課題需要提出了一種基于ARM+FPGA架構(gòu)的高速實時數(shù)據(jù)采集嵌入式系統(tǒng)方案，應(yīng)用在小功率半導(dǎo)體測量儀器上。方案采用三星S3C2410的ARM處理器進(jìn)行管理控制，處理數(shù)據(jù)，界面顯示；Altera公司的Cyclone系列的1C12 FPGA器件用來進(jìn)行高速數(shù)據(jù)采集，提高了系統(tǒng)的實時性和集成化程度。本文首先給出了ARM+FPGA架構(gòu)的總體設(shè)計。硬件方面，簡要討論了ARM處理器的特點和優(yōu)勢，F(xiàn)PGA在高速采集和并行性上的優(yōu)勢，給出了硬件的總體結(jié)構(gòu)和主要部件及相關(guān)接口。軟件方面，研究了基于嵌入式Linux的嵌入式系統(tǒng)的構(gòu)建和BootLoader的啟動以及內(nèi)核和根文件系統(tǒng)的結(jié)構(gòu)，構(gòu)建了嵌入式Linux系統(tǒng)包括建立交叉開發(fā)環(huán)境，修改移植BootLoader和裁減移植Linux內(nèi)核，并且根據(jù)課題實際需要精簡建立了根文件系統(tǒng)。為了滿足測量儀器的實時性，設(shè)計了ARM與FPGA的高速數(shù)據(jù)采集接口。進(jìn)行了FPGA內(nèi)部與ARM接口相關(guān)部分的硬件電路設(shè)計；通過分析ARM與FPGA內(nèi)部時序的差異，針對ARM與FPGA內(nèi)部FIFO時序不匹配的問題，解決了測量儀器中高速數(shù)據(jù)采集與處理速度不匹配的問題。接著，通過研究Linux設(shè)備驅(qū)動基本原理和驅(qū)動程序的開發(fā)過程，設(shè)計了Linux下的FPGA數(shù)據(jù)采集接口驅(qū)動程序，并且實現(xiàn)了中斷傳輸。使得FPGA芯片通過高效可靠的驅(qū)動程序可以很好的與ARM進(jìn)行通訊。最后為了方便用戶操作，進(jìn)行了人機(jī)交互系統(tǒng)的設(shè)計。為了降低成本和提高實用性利用FPGA芯片剩余的資源實現(xiàn)了對PS/2鍵盤鼠標(biāo)接口的控制，應(yīng)用到系統(tǒng)中，大大提高了人機(jī)交互能力；通過比較分析目前比較流行的幾種嵌入式GUI圖形設(shè)計工具的優(yōu)缺點，結(jié)合課題的實際情況選擇了MiniGUI作為課題圖形界面的開發(fā)。根據(jù)具體要求設(shè)計了適合測量儀器方面上使用的人機(jī)交互界面，并且移植到了ARM平臺上，給測量儀器的使用提供了更好的交互操作。本課題完成了嵌入式Linux開發(fā)環(huán)境的建立，針對課題實際硬件電路設(shè)計修改移植了bootloader，裁減移植了內(nèi)核以及根文件系統(tǒng)的建立；設(shè)計了FPGA內(nèi)部硬件電路，解決了接口中ARM與FPGA時序不匹配的問題，實現(xiàn)了ARM與FPGA之間的高速數(shù)據(jù)采集；設(shè)計了高速采集接口在嵌入式Linux下的驅(qū)動程序以及中斷傳輸和應(yīng)用程序；合理設(shè)計了適合測量儀器使用的人機(jī)交互界面，并巧妙設(shè)計了PS/2鍵盤鼠標(biāo)接口，進(jìn)一步提高了交互操作。

標(biāo)簽： ARMFPGA 嵌入式系統(tǒng)設(shè)計測量儀器

上傳時間： 2013-06-21

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基于ARM的T波交替檢測技術(shù)

心血管系統(tǒng)疾病是現(xiàn)今世界上發(fā)病率和死亡率最高的疾病之一。T波交替(T-wavealtemans,TWA)作為一種非穩(wěn)態(tài)的心電變異性現(xiàn)象，是指心電T波段振幅、形態(tài)甚至極性逐拍交替變化。大量研究表明，TWA與室性心律失常、心臟性猝死等有直接密切的關(guān)系，已成為一種無創(chuàng)獨立性預(yù)測指標(biāo)。隨著數(shù)字信號處理技術(shù)和計算機(jī)技術(shù)的迅速發(fā)展，微伏級的TWA已經(jīng)可以被檢出，并且精度越來越高。本文以T波交替檢測為中心，基于ARM給出了T波交替檢測技術(shù)原理性樣機(jī)的硬件及軟件，實現(xiàn)實時監(jiān)護(hù)的目的。在TWA檢測研究中，需要對心電信號進(jìn)行預(yù)處理，即信號去噪和特征點檢測。小波分析以其多分辨率的特性和表征時頻兩域信號局部特征的能力成為我們選取的心電信號自動分析手段。文中采用小波變換將原始心電信號分解為不同頻段的細(xì)節(jié)信號，根據(jù)三種主要噪聲的不同能量分布，采用自適應(yīng)閾值和軟硬閾值折衷處理策略用閾值濾波方法對原始信號進(jìn)行去噪處理：同時基于心電信號的特征點R峰對應(yīng)于Mexican-hat小波變換的極值點，因此我們使用Mexican-hat小波檢測R峰，通過附加檢測方案確保了位置的準(zhǔn)確性，并根據(jù)需要提出了T波矩陣提取方法。隨后文章介紹了T波交替的產(chǎn)生機(jī)理及研究進(jìn)展，分別從臨床應(yīng)用和檢測方法上展現(xiàn)了目前TWA的發(fā)展進(jìn)程，并利用了譜分析法、相關(guān)分析法和移動平均修正算法分別從時域和頻域?qū)σ恍颖緮?shù)據(jù)進(jìn)行T波交替檢測。在檢測中譜分析法抗噪能力較強(qiáng)，但作為一種頻域檢測方法，無法檢測非穩(wěn)態(tài)TWA信號，而相關(guān)分析法受呼吸、噪聲影響較大，數(shù)據(jù)要求較高，因此可以在譜分析檢測為陽性TWA基礎(chǔ)上，再對信號進(jìn)行相關(guān)分析，從而克服自身算法缺陷，確定交替幅度和時間段。最后對影響檢測結(jié)果的因素進(jìn)行討論研究，從而降低檢測誤差。文章還設(shè)計了T波交替檢測技術(shù)原理性樣機(jī)的關(guān)鍵部分電路和軟件框架。硬件部分圍繞ARM核的Samsung S3C44BOX為核心，設(shè)計了該樣機(jī)的關(guān)鍵電路，包括采集模塊、數(shù)據(jù)處理模塊(外部存儲電路、通信接口電路等)。其中在采集模塊中針對心電信號是微弱信號并且干擾大的特點，采用了具有高共模抑制比和高輸入阻抗的分級放大電路，有效的提取了信號分量：A/D轉(zhuǎn)換電路保證了信號量化的高精度。利用USB接口芯片和刪內(nèi)部異步串行通訊實現(xiàn)系統(tǒng)與外界聯(lián)系。系統(tǒng)軟件中首先介紹了系統(tǒng)的軟件開發(fā)環(huán)境，然后給出了心電信號分析及處理程序設(shè)計流程圖及實現(xiàn)，使它們共同完成系統(tǒng)的軟件監(jiān)護(hù)功能。

標(biāo)簽： ARM 檢測技術(shù)

上傳時間： 2013-07-27

上傳用戶：familiarsmile
基于ARM嵌入式系統(tǒng)的智能渦流探傷儀的研制

無線數(shù)據(jù)傳輸是指終端和監(jiān)控中心通過無線網(wǎng)絡(luò)的方式進(jìn)行數(shù)據(jù)通信。本文以ARM處理器S3C2440A為核心搭建硬件平臺，選用Linux作為嵌入式操作系統(tǒng)，實現(xiàn)了基于CDMA網(wǎng)絡(luò)的無線數(shù)據(jù)傳輸系統(tǒng)。系統(tǒng)以ARM920T微處理器芯片S3C2440A和CDMA模塊Q2438F為實現(xiàn)核心。論文首先研究了基于S3C2440A微處理器的嵌入式系統(tǒng)硬件平臺的架構(gòu)，詳細(xì)分析了ARM最小系統(tǒng)中各個功能組成模塊；然后建立了嵌入式系統(tǒng)開發(fā)的arm-linux-gcc交叉編譯環(huán)境，重點研究了Bootloader和Linux內(nèi)核的配置與編譯，并且在硬件平臺上移植了Linux操作系統(tǒng)。在ARM嵌入式Linux開發(fā)平臺上，研究了基于Video4Linux的USB攝像頭采集圖像的解決方案，即在Linux內(nèi)核中加載Video4Linux模塊，通過V4L模塊提供的編程接口，操作USB攝像頭設(shè)備文件/dev/video0，并且采用內(nèi)存映射方式截取視頻，完成了圖像采集的軟件設(shè)計。此外，論文還研究了在Linux環(huán)境下PPP協(xié)議撥號上網(wǎng)的實現(xiàn)方法，即通過AT指令初始化CDMA模塊，使之附在CDMA網(wǎng)絡(luò)上，通過編寫腳本程序的方法建立PPP連接，獲得網(wǎng)絡(luò)運營商ISP動態(tài)分配給數(shù)據(jù)傳輸終端的IP地址，從而實現(xiàn)了無線模塊撥號上網(wǎng)功能。在無線終端通過PPP撥號上網(wǎng)后，采用了客戶端/服務(wù)器端模式，運行套接字(Socket)應(yīng)用程序，將設(shè)備采集到的圖像數(shù)據(jù)通過CDMA網(wǎng)絡(luò)后再經(jīng)過Internet傳送到監(jiān)控中心，實現(xiàn)了傳輸終端和監(jiān)控中心之間的數(shù)據(jù)的發(fā)送與接收。論文研究和實現(xiàn)的基于ARM嵌入式Linux和CDMA網(wǎng)絡(luò)的無線數(shù)據(jù)傳輸系統(tǒng)滿足設(shè)計要求，達(dá)到了預(yù)期目標(biāo)。終端內(nèi)嵌TCP/IP協(xié)議，可以通過CDMA網(wǎng)絡(luò)連接到互聯(lián)網(wǎng)，數(shù)據(jù)傳輸實時性強(qiáng)，為用戶提供透明的數(shù)據(jù)傳輸通道。相比于傳統(tǒng)的傳輸系統(tǒng)，它具有高可靠性、組網(wǎng)方便、可遠(yuǎn)程控制等特點，因此在電力自動化、環(huán)保、交通監(jiān)控等領(lǐng)域有著廣泛的應(yīng)用，特別適用于移動環(huán)境、難于布線的場所和邊遠(yuǎn)地區(qū)。

標(biāo)簽： ARM 嵌入式系統(tǒng) 儀的研制渦流

上傳時間： 2013-06-11

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基于ARM和uCOS-Ⅱ嵌入式平臺的NAND Flash存儲驅(qū)動系統(tǒng)設(shè)計

隨著現(xiàn)代計算機(jī)技術(shù)和互聯(lián)網(wǎng)技術(shù)的飛速發(fā)展，嵌入式系統(tǒng)成為了當(dāng)前信息行業(yè)最熱門的焦點之一。ARM以其高性能低功耗的特點成為目前主流的32位嵌入式處理器而在數(shù)碼產(chǎn)品中廣泛使用，隨著數(shù)碼相機(jī)的普及，數(shù)碼相框產(chǎn)品得到推廣，數(shù)碼相框通過一個液晶的屏幕顯示數(shù)碼照片而非紙質(zhì)照片，數(shù)碼相框比普通相框更靈活多變，也給現(xiàn)在日益使用的數(shù)碼相片一個新的展示空間。在嵌入式操作系統(tǒng)方面，uC/OS—Ⅱ憑借其小內(nèi)核、多任務(wù)、豐富的系統(tǒng)服務(wù)、容易使用以及源碼公開等特點被嵌入式系統(tǒng)開發(fā)者廣泛用在各種嵌入式設(shè)備開發(fā)中。uC/FS嵌入式文件系統(tǒng)由于穩(wěn)定性，可移植性以及與uC/OS—Ⅱ內(nèi)核的相兼容被廣泛用在基于uC/OS—Ⅱ的嵌入式系統(tǒng)開發(fā)中。NAND Flash存儲器由于其大容量數(shù)據(jù)存儲、高速存取速度、易于擦除和重寫、功耗小等特點被廣泛應(yīng)用于便攜式電子設(shè)備的數(shù)據(jù)存儲、嵌入式系統(tǒng)的程序存儲載體中。本論文的硬件工作平臺是艾科公司研發(fā)的數(shù)碼相框芯片方案ARK1600，該平臺集成了嵌入式系統(tǒng)設(shè)計所需的相關(guān)硬件模塊。本論文的主要設(shè)計目標(biāo)是在該平臺上實現(xiàn)NAND Flash存儲設(shè)備驅(qū)動的系統(tǒng)級方案，即在ARK1600平臺上通過構(gòu)建uC/OS—Ⅱ操作系統(tǒng)以及uC/FS文件系統(tǒng)來實現(xiàn)NAND Flash設(shè)備驅(qū)動掛接。本論文是在Windows環(huán)境下通過ARM ADS實現(xiàn)代碼的編譯，通過Multi—ICE進(jìn)行前期調(diào)試以及USB—Debug進(jìn)行后期的系統(tǒng)整合調(diào)試。本論文的主要研究工作具體涉及以下三個的方面：首先研究了ARM相關(guān)構(gòu)架以及uC/OS—Ⅱ操作系統(tǒng)的特點，并在此基礎(chǔ)上移植uC/OS—Ⅱ操作系統(tǒng)到ARK1600平臺，分析ARK1600硬件體系結(jié)構(gòu)的基礎(chǔ)上詳細(xì)分析了BootLoader的相關(guān)概念，并重點闡述了NAND BootLoader程序設(shè)計與實現(xiàn)過程；其次在文件系統(tǒng)方面，本論文成功移植uC/FS嵌入式文件系統(tǒng)到ARK1600平臺，在移植的過程中采用了動態(tài)文件緩沖區(qū)算法提高了該文件系統(tǒng)的數(shù)據(jù)傳輸效率；最后重點討論了NAND Flash驅(qū)動在ARK1600的實現(xiàn)，主要分析了NAND Flash的數(shù)據(jù)存儲結(jié)構(gòu)，并從物理層，邏輯層和文件系統(tǒng)接口層三個方面具體分析了NAND Flash驅(qū)動程序的實現(xiàn)，并在NAND Flash邏輯層驅(qū)動實現(xiàn)時通過采用壞塊處理表算法實現(xiàn)了NAND的磨損均衡問題。

標(biāo)簽： Flash uCOS NAND ARM

上傳時間： 2013-07-31

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