·PID參數(shù)自整定在溫度控制系統(tǒng)中的應(yīng)用
標(biāo)簽： PID 參數(shù) 中的應(yīng)用 自整定
上傳時間： 2013-04-24
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·智能控制在電機(jī)調(diào)速系統(tǒng)中的應(yīng)用
標(biāo)簽： 智能控制 中的應(yīng)用 電機(jī)調(diào)速系統(tǒng)
上傳時間： 2013-06-17
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通過MSP430單片機(jī)控制VS1003播放SD卡中的音樂。
標(biāo)簽： 1003 MSP 430 VS
上傳時間： 2013-08-02
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WinAVR中自帶的延時函數(shù)說明 WinAVR中自帶的延時函數(shù)說明
標(biāo)簽： WinAVR 延時函數(shù)
上傳時間： 2013-06-14
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uCOS II在AVR單片機(jī)中移植的關(guān)鍵技術(shù)
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關(guān)于電路中3V與5V混合連接的一些方法和電路介紹
標(biāo)簽： 邏輯接口
上傳時間： 2013-05-21
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處理3x3中值濾波，代碼分模塊，很好的硬件實(shí)現(xiàn)方法。
標(biāo)簽： verilog 3x3 中值濾波
上傳時間： 2013-07-23
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影響FPGA設(shè)計(jì)中時鐘因素的探討,能幫組FPGA的設(shè)計(jì)
標(biāo)簽： FPGA 時鐘
上傳時間： 2013-08-05
上傳用戶：wkxiian
講解了在FPGA中時序設(shè)計(jì)時應(yīng)該注意的問題，并分享了設(shè)計(jì)經(jīng)驗(yàn)
標(biāo)簽： FPGA 時序設(shè)計(jì)
上傳時間： 2013-08-06
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基于FPGA的神經(jīng)網(wǎng)絡(luò)硬件實(shí)現(xiàn)中的關(guān)鍵問題研究，適合用fpga研究神經(jīng)網(wǎng)絡(luò)的工程人員參考
標(biāo)簽： FPGA 神經(jīng)網(wǎng)絡(luò) 硬件實(shí)現(xiàn)
上傳時間： 2013-08-07
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