正交頻分復用(OFDM)技術是一種多載波數字調制技術，它具有頻譜利用率高、抗多徑能力強等特點，在寬帶無線多媒體通信領域中受到了廣泛的關注。 OFDM系統(tǒng)可分為連續(xù)工作模式和突發(fā)工作模式。在IEEE802.11a、HiperLANType2等無線局域網標準中采用了OFDM的突發(fā)工作模式，該模式下的接收機首先對符合某種特定格式的幀做出檢測。本文介紹了一種基于最小錯誤概率準則的幀檢測算法，提出了該算法的FPGA實現(xiàn)方案。 同步技術是OFDM最關鍵的技術之一，它包括載波頻率同步和符號同步。載波頻率同步是為了糾正接收端相對于發(fā)送端的載波頻率偏移，以保證子載波間的正交性；符號同步確定OFDM符號有用數據信息的開始時刻，也就是確定FFT窗的開始時刻。本文首先介紹了一種基于自相關的載波頻率同步算法，給出了它的FPGA實現(xiàn)方案，重點講述了其中用到的Cordic算法及其實現(xiàn)；然后介紹了分別基于互相關和自相關的兩種符號同步算法，給出了各自的FPGA實現(xiàn)方案，從實現(xiàn)的角度比較了兩種算法的優(yōu)缺點，并且在FPGA設計中體現(xiàn)了面積復用和流水線操作的設計思想。 文章最后介紹了系統(tǒng)調試的情況，總結出一種ChipScopePro與Matlab相結合的調試方法，該方法在FPGA調試方面具有一定的通用性。
上傳時間： 2013-07-16
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本文主要研究Turbo碼的編碼和譯碼算法及其FPGA硬件實現(xiàn).在概述信道編碼理論及其發(fā)展歷程之后,簡要地論述了Turbo碼的原理.然后分別對Turbo碼的MAP譯碼算法,LOG-MAP算法進行推導,在給出LOG-MAP的推導之后,提出了對于LOG-MAP譯碼算法的兩點改進,采用三階牛頓插值函數對校驗函數進行擬合,采用雙滑動窗口技術取代傳統(tǒng)的單滑動窗口技術.Turb碼還有一種譯碼復雜度相對較低的算法——SOVA算法,本文也給出了SOVA算法的詳細推導過程.在對LOG-MAP和SOVA算法的詳細推導之后,本文給出Turbo碼的軟件仿真,采用Matlab語言編寫Turbo碼仿真系統(tǒng)程序,仿真系統(tǒng)比較了單滑動窗口技術和雙滑動窗口技術在不同的信噪比下的譯碼性能.在軟件仿真的基礎上,本文給出了Turbo碼編碼器和采用LOG-MAP譯碼算法譯碼器的FPGA硬件實現(xiàn)方法.
上傳時間： 2013-06-19
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礦用隔爆饋電開關是煤礦井下配電系統(tǒng)的關鍵設備，作為配電開關，用于含有瓦斯或煤塵等爆炸危險環(huán)境的礦井中，控制和保護低壓供電網絡。其性能好壞直接影響著煤礦井下的生產安全和生產效率，而目前國內饋電開關普遍存在集成度低、可靠性差、智能監(jiān)控水平低等缺點。 本課題將嵌入式網絡控制系統(tǒng)應用到饋電開關中，通過對礦山供電系統(tǒng)工作原理、真空饋電開關工作原理以及基于EasyARM2200(Philips LPC2210為處理器、ARM7為內核)嵌入式網絡控制系統(tǒng)的研究，實現(xiàn)了總體網絡拓撲結構的設計和智能饋電開關控制系統(tǒng)硬件電路的設計；通過對嵌入式實時操作系統(tǒng)的移植、嵌入式TCP/IP協(xié)議棧的實現(xiàn)和移植以及基于C/S模式下的套接字編程等的研究和分析，完成了監(jiān)控主機與嵌入式系統(tǒng)的通信軟件和保護控制算法的應用程序的編寫，從而實現(xiàn)了礦井地面監(jiān)控主機與井下嵌入式系統(tǒng)饋電開關的快速通信，解決了地面監(jiān)控主機對井下饋電回路及電氣開關的遠程智能監(jiān)控的難題，最終設計出一套集實時保護控制和遠程監(jiān)控功能于一身的智能型饋電開關網絡控制系統(tǒng)。 實驗結果表明：在嵌入式系統(tǒng)端的通信軟件和監(jiān)控主機端的通信軟件的驅動下，實現(xiàn)了嵌入式系統(tǒng)與監(jiān)控主機的快速遠程通信，通信速度快、可靠性高、可視化效果好，完全滿足了監(jiān)控系統(tǒng)的快速通信要求。 本課題的研究成果為工業(yè)控制領域提供了一個開放式、全分布、可互操作性的通信控制平臺，為提高煤礦井下設備的遠程智能監(jiān)控水平和安全操控系數提供了新的解決方法，為地面監(jiān)控系統(tǒng)實現(xiàn)更大規(guī)模、更深層次地對井下電氣設備的集中控制、分散管理奠定了理論和實踐基礎。
標簽： ARM 嵌入式網絡 中的應用 控制系統(tǒng)
上傳時間： 2013-06-25
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本文從AES的算法原理和基于ARM核嵌入式系統(tǒng)的開發(fā)著手，研究了AES算法的設計原則、數學知識、整體結構、算法描述以及AES存住的優(yōu)點利局限性。 針對ARM核的體系結構及特點，對AES算法進行了優(yōu)化設計，提出了從AES算法本身和其結構兩個方面進行優(yōu)化的方法，在算法本身優(yōu)化方面是把加密模塊中的字節(jié)替換運算、列混合運算和解密模塊中的逆列混合運算中原來的復雜的運算分別轉換為簡單的循環(huán)移位、乘和異或運算。在算法結構優(yōu)化方面是在輸入輸山接口上采用了4個32位的寄存器對128bits數據進行了并行輸入并行輸出的優(yōu)化設計；在密鑰擴展上的優(yōu)化設計是采用內部擴展，即在進行每一輪的運算過程的同時算出下一輪的密鑰，并把下一輪的密鑰暫存在SRAM里，使得密鑰擴展與加/解密運算并行執(zhí)行；加密和解密優(yōu)化設計是將輪函數查表操作中的四個操作表查詢工作合并成一個操作表查詢工作，同時為了使加密代碼在解密代碼中可重用，節(jié)省硬件資源，在解密過程中采用了與加密相一致的過程順序。 根據上述的優(yōu)化設計，基于ARM核嵌入式系統(tǒng)的ADS開發(fā)環(huán)境，提出了AES實現(xiàn)的軟硬件方案、AES加密模塊和解密模塊的實現(xiàn)方案以及測試方案，總結了基于ARM下的高效編程技巧及混合接口規(guī)則，在集成開發(fā)環(huán)境下對算法進行了實現(xiàn)，分別得出了初始密鑰為128bits、192bits和256bits下的加密與解密的結果，并得劍了正確驗證。在性能測試的過程中應用編譯器的優(yōu)化選項和其它優(yōu)化技巧優(yōu)化了算法，使算法具有較高的加密速度。
標簽： ARM AES 嵌入式系統(tǒng) 算法優(yōu)化
上傳時間： 2013-04-24
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GPS技術在導航、定位及精確打擊等方面產生了重要影響，已經廣泛地應用在各種武器平臺上。但是，在干擾環(huán)境下也顯現(xiàn)出許多問題。由于其到達地球表面的信號極其微弱(-160dBW)，在現(xiàn)在復雜的電磁環(huán)境中容易受到干擾，尤其是C/A碼信號更易受到干擾，并且隨著導航戰(zhàn)的發(fā)展對GPS的抗干擾已成為爭取導航資源的有效措施。因此，研究干擾環(huán)境下的GPS接收機設計具有重要意義。 本文首先簡要介紹了GPS信號的結構及構成，通過對GPS信號特征以及接收機抗干擾能力的分析，結合干擾對接收機的作用方式及效果，確定GPS最易受的干擾類型為阻塞式干擾，然后針對這種干擾類型提出了一種有效的抗干擾技術-----自適應調零天線技術。接下來，著重研究了GPS接收機在此抗干擾技術前提下的若干抗干擾方法，并對其進行了詳細的分析和討論。 研究過程中，通過對最佳化準則和空域自適應濾波的理解，首先對不同天線陣列結構進行了性能仿真和比較分析，然后在對稱圓形天線陣列的基礎上對空域自適應算法進行了仿真分析，針對其自由度有限的問題接著對空時濾波方法做了詳細討論，在7元對稱圓形陣列的基礎上仿真說明了二者各自的優(yōu)缺點?？紤]到實際的干擾環(huán)境和本課題研究的初期階段，因此選用了適合本課題干擾環(huán)境的空域濾波方法，并對其自適應算法進行了適當的改進，使得其抗干擾性能獲得了一定程度的改善。 最后，詳細說明了該接收機抗干擾模塊的FPGA實現(xiàn)原理。詳細給出了頂層及各子模塊的設計流程與RTL視圖，實驗結果驗證了該算法的有效性。
上傳時間： 2013-06-03
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H.264/AVC是國際電信聯(lián)盟與國際標準化組織/國際電工委員會聯(lián)合推出的活動圖像編碼標準，簡稱H.264。作為最新的國際視頻編碼標準，H.264/AVC與MPEG-4、H.263等視頻編碼標準相比，性能有了很大的提高，并已在流媒體、數字電視、電話會議、視頻存儲等諸多領域得到廣泛的應用。 本論文的研究課題是基于H.264/AVC視頻編碼標準的CAVLC(Context-based Adaptive Variable Length Coding，基于上下文的自適應可變長編碼)編碼算法研究及FPGA實現(xiàn)。對于變換后的熵編碼，H.264/AVC支持兩種編碼模式：基于上下文的可變長編碼(CAVLC)和基于上下文的自適應算術編碼(CABAC，Context-based Adaptive BinaryArithmetic Coding)。在H.264/AVC中，盡管CAVLC算法也是采用了VLC編碼，但是同以往標準不同，它所有的編碼都是基于上下文進行。這種方法比傳統(tǒng)的查單一表的方法提高了編碼效率，但也增加了設計上的困難。 作者在全面學習H.264/AVC協(xié)議和深入研究CAVLC編碼算法的基礎上，確定了并行編碼的CAVLC編碼器結構框圖，并總結出了影響CAVLC編碼器實現(xiàn)的瓶頸。針對這些瓶頸，對CAVLC編碼器中的各個功能模塊進行了優(yōu)化設計，這些優(yōu)化設計包括多參考塊的表格預測法、快速查找表法、算術消除法等。最后，用Verilog硬件描述語言對所設計的CAVLC編碼器進行了描述，用EDA軟件對其主要功能模塊進行了仿真，并在Cyclone II系列EP2C20F484的FPGA上驗證了它們的功能。結果表明，該CAVLC編碼器各編碼單元的編碼速度得到了顯著提高且均能滿足實時通信要求，為整個CAVLC編碼器的實時通信提供了良好的基礎。
上傳時間： 2013-06-04
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本論文對DSP和FPGA在交流伺服電機控制系統(tǒng)中的應用進行了詳細的設計，并完成了系統(tǒng)的規(guī)劃。論文完成的設計任務主要有：1、根據系統(tǒng)要求，詳細分析了運動控制系統(tǒng)，給出了運動控制系統(tǒng)的總體設計，提出了一套對已有外圍設備適用的設計方案。2、根據實際情況，提出了簡單易于實現(xiàn)、實時性好的軌跡插補算法，并給出了插補算法的軟件設計，并在DSP中得以實現(xiàn)。3、使用匯編語言進行軟件設計，完成了運動控制卡中由DSP完成的運動控制任務，即在插補計算的同時完成加減速控制和三軸聯(lián)動的協(xié)調控制，以及其后的脈沖分配數的計算。4、根據系統(tǒng)運動要求，使用FPGA芯片設計了可連續(xù)發(fā)送均勻分布脈沖的脈沖分配器，實現(xiàn)對交流伺服系統(tǒng)發(fā)送運動控制指令。并給出了VHDL在FPGA中的軟件實現(xiàn)。
上傳時間： 2013-04-24
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用戶對寬帶無線接入業(yè)務、尤其是對于寬帶無線化以及移動化的需求日益增加,使無線寬帶接入技術WiMAX(World interoperability for Microwave Access,即全球微波接入互操作性技術)應運而生、迅猛發(fā)展,成為這兩年業(yè)界關注的焦點。除了通常的互聯(lián)網接入應用外,它還將在提供IPTV和VOIP等寬帶業(yè)務方面取得成功,它還有可能成為一種先進的4G蜂窩電話技術。WiMAX未來將進入蜂窩電話、筆記本電腦和機頂盒等應用中。 本文在介紹WiMAX傳輸標準802.16d基礎上,詳細闡述了WiMAX接收機中信道解調芯片中的自動增益控制(Automatic Gain Control,AGC)部分。首先介紹了自動增益控制系統(tǒng)的基本組成和其主要特性指標,通過對一個步進式AGC的分析,得到AGC模型的輸出公式。然后針對WiMAX接收機內AGC系統(tǒng)中的模數轉換器以及AGC電路進行介紹和理論分析。本文采用SPW(Signal Processing WorkSystem)模型對AGC電路基本結構的算法分析,并結合仿真結果對AGC電路做了詳盡解說并對參數進行了解釋說明。 最后給出了基于SPW和FPGA(Field Programmable Gate Array)驗證的結果。通過SPW對AGC進行了單獨的性能測試,并結合整個系統(tǒng)的性能測試來說明AGC可以和系統(tǒng)的其他模塊協(xié)同工作。在FPGA測試中,可以證明用Verilog實現(xiàn)后AGC也同樣能較好的工作。 本文實現(xiàn)的基于導頻的步進式的數字AGC是針對WiMAX系統(tǒng)的自動增益控制電路提出的解決方案。此算法結合WiMAX系統(tǒng)的傳輸方式,提出的算法具有迅速鎖定信號的特點,能夠滿足WiMAX系統(tǒng)的要求。同時,由于各種關鍵參數設計為寄存器可配的方式,具有很好的靈活性,也就具有了更高的移植性,可以作為一種通用的數字AGC算法。
上傳時間： 2013-04-24
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常模信號是一類非常重要的信號，而專門應用于常模信號的常模算法[1]具有復雜度較低、實現(xiàn)起來比較簡單、對陣列模型的偏差不敏感等顯著的優(yōu)點。因此，常模算法引起了眾多學者的廣泛關注。近年來，常模算法在多用戶檢測領域[2]的研究越來越受到諸多學者的關注。不僅如此，常模算法在其他領域也是備受矚目，如常模算法在盲均衡以及波束形成等領域的應用也是目前研究的熱點。除此之外，常模算法已經不僅僅局限在應用于常模信號，也可應用于多模信號[3]等。 本文對常模算法在多用戶檢測領域的應用以及FPGA[4]實現(xiàn)作了較多的研究工作，共分六章進行闡述。第一章為緒論，介紹了論文相關背景和本文的結構；第二章首先對常模算法作了理論分析，并改進了傳統(tǒng)的2-2型常模算法，我們稱之為M2-2CMA，它在誤碼率性能上有一些改善；之后在MATLAB平臺上搭建了仿真平臺，分析了常模算法在多用戶檢測中的應用；第三章研究了相關文獻，簡單介紹了FPGA概念及其設計流程和設計方法，并對VerilogHDL以及Quartus軟件做了簡要介紹；第四章則詳細介紹了常模算法的FPGA實現(xiàn)，用一種基于統(tǒng)計數據的方法確定了數據位長及精度，提出了其實現(xiàn)的系統(tǒng)框圖，并詳細闡述了各主要模塊的設計與實現(xiàn)，同時給出了最后的報告文件以及最高數據處理速度；第五章則在MATLAB平臺和QuartuslI的基礎上搭建了一個仿真平臺，借助于平臺分析了2-2型常模算法移植到FPGA平臺后的性能，對不同的精度對系統(tǒng)性能的影響做了討論，也統(tǒng)計了不同信噪比、多址干擾下的誤碼率性能。最后一章是對全文的總結和對未來的展望。
上傳時間： 2013-06-23
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可編程邏輯芯片特別是現(xiàn)場可編程門陣列(Field-Programmable Gate Array，F(xiàn)PGA)芯片的快速發(fā)展，使得新的芯片能夠根據具體應用動態(tài)地調整結構以獲得更好的性能，這類芯片稱為動態(tài)可重構FPGA芯片(Dynamically ReconfigurableFPGA，DRFPGA)。然而，使用這類芯片構建的可重構系統(tǒng)在實際應用前還有許多問題需要解決。一個基本的問題就是動態(tài)可重構FPGA芯片中的可重構功能單元(Reconfigurable Functional Unit，RFU)的模塊布局問題和模塊間的布線問題。 本文從基本的FPGA芯片結構和CAD算法談起，介紹了可重構計算的概念，建立了可重構計算系統(tǒng)模型和動態(tài)可重構FPGA芯片模型，在此模型上提出一個基于劃分和時延驅動的在線布局算法，和一個基于Pathfinder協(xié)商擁塞算法的布線算法，來解決動態(tài)可重構FPGA芯片的布局和布線問題。由硬件描述語言(Hardware Description Language，HDL)描述的電路首先被劃分成有限數目的層，然后將這些電路層布局到芯片的每一層，同時確保關鍵路徑的時延最小。實驗結果表明，布局算法與傳統(tǒng)的布局算法(或者文獻[37]中的算法)相比，在時延上平均減少27％，在線長上平均減少34％(或者11％)，在運行時間上平均減少42％(或者97％)。布線算法與傳統(tǒng)的布線算法相比，能夠將線長降低26％，將水平通道寬度降低27％，顯示出較高的性能。
標簽： FPGA 動態(tài)可重構 布局布線 算法研究
上傳時間： 2013-05-24
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