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查找表乘<b>法器</b>

  • 樣板 B 樹 ( B - tree ) 規(guī)則 : (1) 每個(gè)節(jié)點(diǎn)內(nèi)元素個(gè)數(shù)在 [MIN,2*MIN] 之間, 但根節(jié)點(diǎn)元素個(gè)數(shù)為 [1,2*MIN] (2) 節(jié)點(diǎn)內(nèi)元素由小排到大, 元素不

    樣板 B 樹 ( B - tree ) 規(guī)則 : (1) 每個(gè)節(jié)點(diǎn)內(nèi)元素個(gè)數(shù)在 [MIN,2*MIN] 之間, 但根節(jié)點(diǎn)元素個(gè)數(shù)為 [1,2*MIN] (2) 節(jié)點(diǎn)內(nèi)元素由小排到大, 元素不重複 (3) 每個(gè)節(jié)點(diǎn)內(nèi)的指標(biāo)個(gè)數(shù)為元素個(gè)數(shù)加一 (4) 第 i 個(gè)指標(biāo)所指向的子節(jié)點(diǎn)內(nèi)的所有元素值皆小於父節(jié)點(diǎn)的第 i 個(gè)元素 (5) B 樹內(nèi)的所有末端節(jié)點(diǎn)深度一樣

    標(biāo)簽: MIN 元素 tree

    上傳時(shí)間: 2017-05-14

    上傳用戶:日光微瀾

  • 歐幾里德算法:輾轉(zhuǎn)求余  原理: gcd(a,b)=gcd(b,a mod b)  當(dāng)b為0時(shí),兩數(shù)的最大公約數(shù)即為a  getchar()會(huì)接受前一個(gè)scanf的回車符

    歐幾里德算法:輾轉(zhuǎn)求余  原理: gcd(a,b)=gcd(b,a mod b)  當(dāng)b為0時(shí),兩數(shù)的最大公約數(shù)即為a  getchar()會(huì)接受前一個(gè)scanf的回車符

    標(biāo)簽: gcd getchar scanf mod

    上傳時(shí)間: 2014-01-10

    上傳用戶:2467478207

  • DA算法中的使用的查找表模塊

    DA算法中的使用的查找表模塊,本程序先設(shè)計(jì)查找表,然后設(shè)計(jì)4*4DA算法模塊,之后進(jìn)行位擴(kuò)展和字?jǐn)U展得到32階濾波器程序.附帶4各表,和FIR濾波器序數(shù)

    標(biāo)簽: 算法 查找表 模塊

    上傳時(shí)間: 2017-07-03

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  • 完整的基于ROM查找表的NCO 產(chǎn)生10位寬的正交信號(hào)

    完整的基于ROM查找表的NCO 產(chǎn)生10位寬的正交信號(hào)

    標(biāo)簽: ROM NCO 查找表 位寬

    上傳時(shí)間: 2013-12-06

    上傳用戶:BOBOniu

  • 本設(shè)計(jì)基于數(shù)字頻率合成技術(shù),采用正弦查找表實(shí)現(xiàn)波形產(chǎn)生.直接數(shù)字頻率合成技術(shù)(DDS)是一種先進(jìn)的電路結(jié)構(gòu)

    本設(shè)計(jì)基于數(shù)字頻率合成技術(shù),采用正弦查找表實(shí)現(xiàn)波形產(chǎn)生.直接數(shù)字頻率合成技術(shù)(DDS)是一種先進(jìn)的電路結(jié)構(gòu),能在全數(shù)字下對(duì)輸出信號(hào)頻率進(jìn)行精確而快速的控制,DDS技術(shù)還在解決輸出信號(hào)頻率增量選擇方面具有很好的應(yīng)用,DDS所產(chǎn)生的信號(hào)具有頻率分辨率高、頻率切換速度快、頻率切換時(shí)相位連續(xù)、輸出相位噪聲低和可以產(chǎn)生任意波形等諸多優(yōu)點(diǎn)。 文中介紹了DDS的基本原理,對(duì)DDS的質(zhì)譜及其散雜抑制進(jìn)行了分析。程序設(shè)計(jì)采用超高速硬件描述語言VHDL描述DDS,在此基礎(chǔ)上設(shè)計(jì)了正弦波、三角波、方波等信號(hào)發(fā)生器,。完成了軟件和硬件的設(shè)計(jì),以及實(shí)驗(yàn)樣機(jī)的部分調(diào)試。

    標(biāo)簽: DDS 數(shù)字頻率 合成技術(shù) 正弦

    上傳時(shí)間: 2017-08-16

    上傳用戶:xmsmh

  • 數(shù)據(jù)結(jié)構(gòu)課程設(shè)計(jì) 數(shù)據(jù)結(jié)構(gòu)B+樹 B+ tree Library

    數(shù)據(jù)結(jié)構(gòu)課程設(shè)計(jì) 數(shù)據(jù)結(jié)構(gòu)B+樹 B+ tree Library

    標(biāo)簽: Library tree 數(shù)據(jù)結(jié)構(gòu)

    上傳時(shí)間: 2013-12-31

    上傳用戶:semi1981

  • 基于uCOSII最高優(yōu)先級(jí)就緒任務(wù)查找表的構(gòu)造C語言代碼

    基于uCOSII最高優(yōu)先級(jí)就緒任務(wù)查找表的構(gòu)造C語言代碼這是一份非常不錯(cuò)的資料,歡迎下載,希望對(duì)您有幫助!

    標(biāo)簽: ucosii

    上傳時(shí)間: 2022-03-05

    上傳用戶:kent

  • 軟件無線電中數(shù)字下變頻技術(shù)研究及FPGA實(shí)現(xiàn).rar

    軟件無線電(SDR,Software Defined Radio)由于具備傳統(tǒng)無線電技術(shù)無可比擬的優(yōu)越性,已成為業(yè)界公認(rèn)的現(xiàn)代無線電通信技術(shù)的發(fā)展方向。理想的軟件無線電系統(tǒng)強(qiáng)調(diào)體系結(jié)構(gòu)的開放性和可編程性,減少靈活性著的硬件電路,把數(shù)字化處理(ADC和DAC)盡可能靠近天線,通過軟件的更新改變硬件的配置、結(jié)構(gòu)和功能。目前,直接對(duì)射頻(RF)進(jìn)行采樣的技術(shù)尚未實(shí)現(xiàn)普及的產(chǎn)品化,而用數(shù)字變頻器在中頻進(jìn)行數(shù)字化是普遍采用的方法,其主要思想是,數(shù)字混頻器用離散化的單頻本振信號(hào)與輸入采樣信號(hào)在乘法器中相乘,再經(jīng)插值或抽取濾波,其結(jié)果是,輸入信號(hào)頻譜搬移到所需頻帶,數(shù)據(jù)速率也相應(yīng)改變,以供后續(xù)模塊做進(jìn)一步處理。數(shù)字變頻器在發(fā)射設(shè)備和接收設(shè)備中分別稱為數(shù)字上變頻器(DUC,Digital Upper Converter)和數(shù)字下變頻器(DDC,Digital Down Converter),它們是軟件無線電通信設(shè)備的關(guān)鍵部什。大規(guī)模可編程邏輯器件的應(yīng)用為現(xiàn)代通信系統(tǒng)的設(shè)計(jì)帶來極大的靈活性。基于FPGA的數(shù)字變頻器設(shè)計(jì)是深受廣大設(shè)計(jì)人員歡迎的設(shè)計(jì)手段。本文的重點(diǎn)研究是數(shù)字下變頻器(DDC),然而將它與數(shù)字上變頻器(DUC)完全割裂后進(jìn)行研究顯然是不妥的,因此,本文對(duì)數(shù)字上變頻器也作適當(dāng)介紹。 第一章簡(jiǎn)要闡述了軟件無線電及數(shù)字下變頻的基本概念,介紹了研究背景及所完成的主要研究工作。 第二章介紹了數(shù)控振蕩器(NCO),介紹了兩種實(shí)現(xiàn)方法,即基于查找表和基于CORDIC算法的實(shí)現(xiàn)。對(duì)CORDIc算法作了重點(diǎn)介紹,給出了傳統(tǒng)算法和改進(jìn)算法,并對(duì)基于傳統(tǒng)CORDIC算法的NCO的FPGA實(shí)現(xiàn)進(jìn)行了EDA仿真。 第三章介紹了變速率采樣技術(shù),重點(diǎn)介紹了軟件無線電中廣泛采用的級(jí)聯(lián)積分梳狀濾波器 (cascaded integratot comb, CIC)和ISOP(Interpolated Second Order Polynomial)補(bǔ)償法,對(duì)前者進(jìn)行了基于Matlab的理論仿真和FPGA實(shí)現(xiàn)的EDA仿真,后者只進(jìn)行了基于Matlab的理論仿真。 第四章介紹了分布式算法和軟件無線電中廣泛采用的半帶(half-band,HB)濾波器,對(duì)基于分布式算法的半帶濾波器的FPGA實(shí)現(xiàn)進(jìn)行了EDA仿真,最后簡(jiǎn)要介紹了FIR的多相結(jié)構(gòu)。 第五章對(duì)數(shù)字下變頻器系統(tǒng)進(jìn)行了噪聲綜合分析,給出了一個(gè)噪聲模型。 第六章介紹了數(shù)字下變頻器在短波電臺(tái)中頻數(shù)字化應(yīng)用中的一個(gè)實(shí)例,給出了測(cè)試結(jié)果,重點(diǎn)介紹了下變頻器的:FPGA實(shí)現(xiàn),其對(duì)應(yīng)的VHDL程序收錄在本文最后的附錄中,希望對(duì)從事該領(lǐng)域設(shè)計(jì)的技術(shù)人員具有一定參考價(jià)值。

    標(biāo)簽: FPGA 軟件無線電 數(shù)字下變頻

    上傳時(shí)間: 2013-06-30

    上傳用戶:huannan88

  • 基于FPGA的JPEG編解碼芯片設(shè)計(jì)

    近年來,隨著微電子技術(shù)的高速發(fā)展,數(shù)字圖像壓縮編碼技術(shù)的逐漸成熟,實(shí)時(shí)圖象處理在多媒體、HDTV、圖像通信等領(lǐng)域有著越來越廣泛的應(yīng)用,圖像壓縮/解壓的IC芯片也已成為多媒體技術(shù)的核心,實(shí)現(xiàn)這些算法芯片的研究成為信息產(chǎn)業(yè)的新熱點(diǎn).該文基于FPGA設(shè)計(jì)了JPEG圖像壓縮編解碼芯片,通過改進(jìn)算法優(yōu)化結(jié)構(gòu),在合理地利用硬件資源的條件下,有效地挖掘出算法內(nèi)在的并行性.在JPEG編碼器設(shè)計(jì)中,改進(jìn)了JEONG的DCT變換算法,采用流水線優(yōu)化算法解決時(shí)間并行性問題,提高了DCT/IDCT模塊的運(yùn)算速度;設(shè)計(jì)了基于查找表結(jié)構(gòu)的定點(diǎn)乘法器,便于在設(shè)計(jì)中共享乘法單元,以適應(yīng)流水線設(shè)計(jì)的要求;依據(jù)Huffman編碼表的規(guī)律性,采用并行查找表結(jié)構(gòu),用較少的存儲(chǔ)單元完成Huffman編解碼的運(yùn)算,同時(shí)也提高了編解碼速度.在JPEG解碼器設(shè)計(jì)中,根據(jù)Huffman碼字本身的特點(diǎn)和JPEG標(biāo)準(zhǔn),設(shè)計(jì)了一種Huffman碼字分組結(jié)構(gòu),基于該結(jié)構(gòu)提出分組Huffman查找表及地址編碼的設(shè)計(jì)方法,進(jìn)而完成了新的快速Huffman解碼算法及其模塊設(shè)計(jì).整個(gè)設(shè)計(jì)及其各個(gè)模塊都在ALTERA公司的EDA工具QUARTUSII平臺(tái)上進(jìn)行了邏輯綜合及功能和時(shí)序仿真.綜合和仿真結(jié)果表明,基于FPGA的JPEG圖像編解碼芯片消耗很少的FPGA硬件資源,達(dá)到了較高的工作頻率,在速度和資源利用率方面均達(dá)到了較優(yōu)的狀態(tài),可滿足實(shí)時(shí)JPEG圖像編解碼的要求.在邏輯設(shè)計(jì)的基礎(chǔ)上,該設(shè)計(jì)可以進(jìn)一步作硬件仿真和實(shí)驗(yàn),將源代碼燒錄進(jìn)FPGA芯片,作為獨(dú)立器件或有自主知識(shí)產(chǎn)權(quán)的JPEG IP模塊,應(yīng)用于可視電話、手機(jī)和會(huì)議電視等低成本JPEG編解碼系統(tǒng)的實(shí)現(xiàn).

    標(biāo)簽: FPGA JPEG 編解碼 芯片設(shè)計(jì)

    上傳時(shí)間: 2013-05-31

    上傳用戶:yuying4000

  • 基于FPGA的靜止圖像壓縮系統(tǒng)的研究

    基于FPGA的靜止圖像壓縮系統(tǒng)的研究-JPEG編碼器的設(shè)計(jì)電力電子與電力傳動(dòng)數(shù)字圖像在人們生活中的應(yīng)用越來越廣泛,由于原始圖像數(shù)據(jù)量比較大,因此數(shù)字圖像壓縮技術(shù)逐漸成為圖像應(yīng)用的一個(gè)核心環(huán)節(jié)。在數(shù)字圖像壓縮領(lǐng)域,國(guó)際標(biāo)準(zhǔn)化組織于1992年推出的JPEG標(biāo)準(zhǔn)應(yīng)用最為廣泛。 本文基于FPGA設(shè)計(jì)了JPEG圖像壓縮系統(tǒng),通過改進(jìn)算法,優(yōu)化結(jié)構(gòu),在合理的利用硬件資源的條件下,有效的挖掘出算法內(nèi)部的并行性。改進(jìn)了DCT變換算法,設(shè)計(jì)了并行查找表結(jié)構(gòu)的乘法器,采用了流水線優(yōu)化算法來解決時(shí)間并行性問題,提高了DCT模塊的運(yùn)算速度。依據(jù)Huffman編碼表的規(guī)律性,采用并行查找表結(jié)構(gòu),用較少的存儲(chǔ)單元完成了Huffman編碼運(yùn)算,同時(shí)提高了編碼速度。整個(gè)設(shè)計(jì)通過EDA軟件進(jìn)行了邏輯綜合及功能與時(shí)序仿真。綜合和仿真結(jié)果表明,本文提出的算法在速度和資源利用方面均達(dá)到了較好的狀態(tài),可滿足實(shí)時(shí)JPEG圖像壓縮的要求。 設(shè)計(jì)了一個(gè)硬件開發(fā)平臺(tái),對(duì)JPEG圖像壓縮系統(tǒng)進(jìn)行了驗(yàn)證。硬件平臺(tái)上使用ADV7181B來實(shí)現(xiàn)AD轉(zhuǎn)換;使用TI公司TMS320C6416型DSP芯片實(shí)現(xiàn)了系統(tǒng)配置以及通過PCI接口與上位機(jī)PC的實(shí)現(xiàn)數(shù)據(jù)交換;使用Microsoft VC++6.0開發(fā)平臺(tái)開發(fā)了系統(tǒng)控制軟件平臺(tái),實(shí)現(xiàn)對(duì)整個(gè)壓縮系統(tǒng)的控制。

    標(biāo)簽: FPGA 圖像壓縮系統(tǒng)

    上傳時(shí)間: 2013-05-24

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