·2002精選實(shí)用自控電路
上傳時(shí)間： 2013-04-24
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夏宇聞著作：從算法設(shè)計(jì)到硬線邏輯的實(shí)現(xiàn),講解比較詳細(xì)，是一本不錯(cuò)的參考資料
標(biāo)簽： 算法設(shè)計(jì) 比較 邏輯
上傳時(shí)間： 2013-08-16
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上傳時(shí)間： 2013-10-08
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STC15系單片機(jī)仿真說(shuō)明
上傳時(shí)間： 2013-10-13
上傳用戶(hù)：Thuan
本書(shū)從應(yīng)用角度深入淺出地介紹國(guó)際上最流行的MOTOROLA M68HC05系列單片機(jī)的 結(jié)構(gòu)、指令系統(tǒng)、定時(shí)器、串行通訊接口(SCI)、串行外圍接口(SPI)、A/D轉(zhuǎn)換器、脈沖寬 度調(diào)制(PWM)、EPROM/EEPROM、液晶顯示(LCD)驅(qū)動(dòng)器、屏幕顯示(OSD)驅(qū)動(dòng)器、雙音多頻(DTMF)等I／O功能及其使用方法，重點(diǎn)詳細(xì)地論述匯編程序設(shè)計(jì)方法、系統(tǒng)設(shè)計(jì)方法、單片機(jī)開(kāi)發(fā)與應(yīng)用技術(shù)和大量具體應(yīng)用實(shí)例。本書(shū)實(shí)用性強(qiáng)、取材新穎、內(nèi)容豐富，適于電子、無(wú)線電、微機(jī)、自控、通訊等領(lǐng)域的工程技術(shù)人員和科研人員閱讀，也適合于作高等院校、專(zhuān)科學(xué)校和各類(lèi)培訓(xùn)班的教材或參考書(shū)。是單片機(jī)入門(mén)和開(kāi)發(fā)應(yīng)用單片機(jī)的實(shí)用資料。 MOTOROLA M68HC05系列8位單片機(jī)是國(guó)際上應(yīng)用最廣泛、功能最豐富和性能價(jià)格比最優(yōu)的單片機(jī)。由于該系列單片機(jī)具有功能全面、速度高、系統(tǒng)設(shè)計(jì)簡(jiǎn)單、使用方便、功耗低、可靠性高、價(jià)格低等許多特點(diǎn)，在家電、有線與無(wú)線通訊、儀表、測(cè)控系統(tǒng)、自控、汽車(chē)等領(lǐng)域得到了廣泛的應(yīng)用，因而它在市場(chǎng)占有率方面占有絕對(duì)優(yōu)勢(shì)。 隨著電子產(chǎn)品的智能化和小型化的發(fā)展，將單片機(jī)應(yīng)用于各類(lèi)產(chǎn)品中，使提高產(chǎn)品的性能與檔次成為必然的趨勢(shì)。無(wú)論從性能方面還是從價(jià)格方面考慮，選用M68HC05系列單片機(jī)都將是最適宜的。 M68HC05系列單片機(jī)片內(nèi)除具有RAM、ROM/EPROM/OTPROM(一次可編程ROM)或EEPROM、多功能16位定時(shí)器(具有輸入捕捉、輸出比較、溢出和實(shí)時(shí)中斷功能)、兩種省電低功耗方式、并行I/O口外，還具有許多特殊I/O功能，例如A/D轉(zhuǎn)換器、串行通訊接口(SCI)、串行外圍接口(SPI)、液晶顯示(LCD)驅(qū)動(dòng)器、脈沖寬度調(diào)制(PWM)、屏幕顯示(OSD)驅(qū)動(dòng)器、熒光顯示(VFD)驅(qū)動(dòng)器、雙音多頻(DTMF)發(fā)生/接收器、實(shí)時(shí)時(shí)鐘((RTC)、鍵盤(pán)中斷和H橋驅(qū)動(dòng)器等。M68HC05系列有近百種型號(hào)，可根據(jù)應(yīng)用場(chǎng)合方便地選用具有所需功能的型號(hào)。這樣，既能充分利用單片機(jī)片內(nèi)的資源，又不需外接其他電路芯片，使構(gòu)成的應(yīng)用系統(tǒng)極為簡(jiǎn)單。M68HC05系列的應(yīng)用系統(tǒng)是真正的單片系統(tǒng)，通常只需外接極少量元件。 由于用M68HC05單片機(jī)內(nèi)部的硬件完成所需的功能，因此，應(yīng)用系統(tǒng)電路簡(jiǎn)單，系統(tǒng)可靠性高、成本低、體積小、使用與調(diào)試方便，易于大批量生產(chǎn)，并且使與外圍功能有關(guān)的軟件程序的設(shè)計(jì)也大大簡(jiǎn)化。 本書(shū)實(shí)用性強(qiáng)，取材新穎，內(nèi)容豐富、全面，從應(yīng)用角度深入淺出地介紹M68HC05系列單片機(jī)的結(jié)構(gòu)、功能及其應(yīng)用系統(tǒng)的設(shè)計(jì)與開(kāi)發(fā)，還重點(diǎn)介紹程序設(shè)計(jì)和大量具體應(yīng)用實(shí)例。本書(shū)注重實(shí)用，以盡量簡(jiǎn)明的語(yǔ)言、最少的篇幅，使讀者花最少的時(shí)間就能掌握M68HC05系列單片機(jī)的設(shè)計(jì)、開(kāi)發(fā)與應(yīng)用技術(shù)。本書(shū)作者具有多年從事單片機(jī)教學(xué)和科研的經(jīng)驗(yàn)，該書(shū)是根據(jù)最新資料和科研成果并結(jié)合親身經(jīng)歷的實(shí)際教學(xué)內(nèi)容編寫(xiě)成的，希望也堅(jiān)信本書(shū)對(duì)廣大讀者一定會(huì)有裨益。 本書(shū)編著者有：剛寒冰、齊秋群、剛勵(lì)韜、徐英新、姜洪福、姜朋、高京齋、李宇仁、劉穎、邊萌。本書(shū)不足和謬誤之處，請(qǐng)批評(píng)指正。
上傳時(shí)間： 2013-10-18
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STC12系列單片機(jī)與PC機(jī)在數(shù)據(jù)采集系
標(biāo)簽： STC 12 PC機(jī) 單片機(jī)
上傳時(shí)間： 2013-11-03
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設(shè)計(jì)實(shí)現(xiàn)了一種基于MSP430系列超低功耗單片機(jī)的新型高精度自控式骨矯形器，介紹了系統(tǒng)的總體設(shè)計(jì)及硬件軟件設(shè)計(jì)。試驗(yàn)表明，該骨矯形器可實(shí)現(xiàn)自控內(nèi)固定、牽張、回縮及加壓固定功能，且功耗低、操控簡(jiǎn)單、控制精度高、安全可靠。
上傳時(shí)間： 2013-10-16
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Verilog數(shù)字系統(tǒng)設(shè)計(jì)教程(第二版) 夏宇聞
標(biāo)簽： Verilog 數(shù)字系統(tǒng) 設(shè)計(jì)教程
上傳時(shí)間： 2014-12-28
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Verilog_HDL的基本語(yǔ)法詳解（夏宇聞版）:Verilog HDL是一種用于數(shù)字邏輯電路設(shè)計(jì)的語(yǔ)言。用Verilog HDL描述的電路設(shè)計(jì)就是該電路的Verilog HDL模型。Verilog HDL既是一種行為描述的語(yǔ)言也是一種結(jié)構(gòu)描述的語(yǔ)言。這也就是說(shuō)，既可以用電路的功能描述也可以用元器件和它們之間的連接來(lái)建立所設(shè)計(jì)電路的Verilog HDL模型。Verilog模型可以是實(shí)際電路的不同級(jí)別的抽象。這些抽象的級(jí)別和它們對(duì)應(yīng)的模型類(lèi)型共有以下五種： 系統(tǒng)級(jí)（system）：用高級(jí)語(yǔ)言結(jié)構(gòu)實(shí)現(xiàn)設(shè)計(jì)模塊的外部性能的模型。 算法級(jí)（algorithm）：用高級(jí)語(yǔ)言結(jié)構(gòu)實(shí)現(xiàn)設(shè)計(jì)算法的模型。 RTL級(jí)（Register Transfer Level）：描述數(shù)據(jù)在寄存器之間流動(dòng)和如何處理這些數(shù)據(jù)的模型。 門(mén)級(jí)（gate-level）：描述邏輯門(mén)以及邏輯門(mén)之間的連接的模型。 開(kāi)關(guān)級(jí)（switch-level）：描述器件中三極管和儲(chǔ)存節(jié)點(diǎn)以及它們之間連接的模型。 一個(gè)復(fù)雜電路系統(tǒng)的完整Verilog HDL模型是由若干個(gè)Verilog HDL模塊構(gòu)成的，每一個(gè)模塊又可以由若干個(gè)子模塊構(gòu)成。其中有些模塊需要綜合成具體電路，而有些模塊只是與用戶(hù)所設(shè)計(jì)的模塊交互的現(xiàn)存電路或激勵(lì)信號(hào)源。利用Verilog HDL語(yǔ)言結(jié)構(gòu)所提供的這種功能就可以構(gòu)造一個(gè)模塊間的清晰層次結(jié)構(gòu)來(lái)描述極其復(fù)雜的大型設(shè)計(jì)，并對(duì)所作設(shè)計(jì)的邏輯電路進(jìn)行嚴(yán)格的驗(yàn)證。 Verilog HDL行為描述語(yǔ)言作為一種結(jié)構(gòu)化和過(guò)程性的語(yǔ)言，其語(yǔ)法結(jié)構(gòu)非常適合于算法級(jí)和RTL級(jí)的模型設(shè)計(jì)。這種行為描述語(yǔ)言具有以下功能： · 可描述順序執(zhí)行或并行執(zhí)行的程序結(jié)構(gòu)。 · 用延遲表達(dá)式或事件表達(dá)式來(lái)明確地控制過(guò)程的啟動(dòng)時(shí)間。 · 通過(guò)命名的事件來(lái)觸發(fā)其它過(guò)程里的激活行為或停止行為。 · 提供了條件、if-else、case、循環(huán)程序結(jié)構(gòu)。 · 提供了可帶參數(shù)且非零延續(xù)時(shí)間的任務(wù)（task）程序結(jié)構(gòu)。 · 提供了可定義新的操作符的函數(shù)結(jié)構(gòu)（function）。 · 提供了用于建立表達(dá)式的算術(shù)運(yùn)算符、邏輯運(yùn)算符、位運(yùn)算符。 · Verilog HDL語(yǔ)言作為一種結(jié)構(gòu)化的語(yǔ)言也非常適合于門(mén)級(jí)和開(kāi)關(guān)級(jí)的模型設(shè)計(jì)。因其結(jié)構(gòu)化的特點(diǎn)又使它具有以下功能： - 提供了完整的一套組合型原語(yǔ)（primitive）; - 提供了雙向通路和電阻器件的原語(yǔ); - 可建立MOS器件的電荷分享和電荷衰減動(dòng)態(tài)模型。 Verilog HDL的構(gòu)造性語(yǔ)句可以精確地建立信號(hào)的模型。這是因?yàn)樵赩erilog HDL中，提供了延遲和輸出強(qiáng)度的原語(yǔ)來(lái)建立精確程度很高的信號(hào)模型。信號(hào)值可以有不同的的強(qiáng)度，可以通過(guò)設(shè)定寬范圍的模糊值來(lái)降低不確定條件的影響。 Verilog HDL作為一種高級(jí)的硬件描述編程語(yǔ)言，有著類(lèi)似C語(yǔ)言的風(fēng)格。其中有許多語(yǔ)句如：if語(yǔ)句、case語(yǔ)句等和C語(yǔ)言中的對(duì)應(yīng)語(yǔ)句十分相似。如果讀者已經(jīng)掌握C語(yǔ)言編程的基礎(chǔ)，那么學(xué)習(xí)Verilog HDL并不困難，我們只要對(duì)Verilog HDL某些語(yǔ)句的特殊方面著重理解，并加強(qiáng)上機(jī)練習(xí)就能很好地掌握它，利用它的強(qiáng)大功能來(lái)設(shè)計(jì)復(fù)雜的數(shù)字邏輯電路。下面我們將對(duì)Verilog HDL中的基本語(yǔ)法逐一加以介紹。
標(biāo)簽： Verilog_HDL
上傳時(shí)間： 2013-11-23
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本資料是關(guān)于夏宇聞老師優(yōu)秀的verilog教程課件，其中包括verilog講稿PPT、verilog課件、verilog例題等。
上傳時(shí)間： 2013-10-24
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