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檢測功能

  • Cadence_16.6_OrCAD_Capture_CIS_新功能 連載（三）

    又到了該寫些文檔的時候了。以后我會每周更新新版本中的新功能以及使用小技巧的文檔。希望大家拍磚。^_^

    標(biāo)簽： OrCAD_Capture_CIS Cadence 16.6 新功能

    上傳時間： 2015-01-01

    上傳用戶：咔樂塢

  • 基于FPGA的多功能LCD顯示控制器設(shè)計

    通過對LCD1602/LCD12864顯示模塊控制時序和指令集的對比分析，利用Verilog HDL描述語言完成了多功能LCD顯示控制模塊的IP核設(shè)計．所設(shè)計的LCD顯示控制器具有很好的可移植性，只需通過端口的使能參數(shù)配置便可以驅(qū)動LCD1602/LCD12864模塊實現(xiàn)字符或圖形的實時顯示，并且該多功能LCD控制器的可行性也在Cyclone II系列的EP2C5T144C8 FPGA芯片上得到了很好的驗證．

    標(biāo)簽： FPGA LCD 多功能 顯示控制器

    上傳時間： 2015-01-01

    上傳用戶：wwwwwen5

  • 基于FPGA的多功能頻率計的設(shè)計

    基于Altera公司FPGA芯片EP2C8Q208，嵌入MC8051 IP Core，用C語言對MC8051 IP Core進(jìn)行編程，以其作為控制核心，實現(xiàn)系統(tǒng)控制。在FPGA芯片中，利用Verilog HDL語言進(jìn)行編程，設(shè)計了以MC8051 IP Core為核心的控制模塊、計數(shù)模塊、鎖存模塊和LCD顯示模塊等幾部分，實現(xiàn)了頻率的自動測量，測量范圍為0.1Hz~50MHz，測量誤差0.01%。并實現(xiàn)測頻率、周期、占空比等功能。  

    標(biāo)簽： FPGA 多功能 頻率計

    上傳時間： 2013-10-27

    上傳用戶：潛水的三貢

  • Verilog HDL實現(xiàn)I2C功能

    用Verilog HDL實現(xiàn)I2C總線功能

    標(biāo)簽： Verilog HDL I2C

    上傳時間： 2013-11-05

    上傳用戶：sssl

  • PADS BlazeRouter功能簡介之交互式高速PCB設(shè)計

    PADS高級教程，PADS BlazeRouter功能簡介之交互式高速PCB設(shè)計。 ? BlazeRouter設(shè)計環(huán)境

    標(biāo)簽： BlazeRouter PADS PCB 交互式

    上傳時間： 2013-11-12

    上傳用戶：hn891122

  • altium designer summer 09高級功能教程

    altium designer高級功能介紹

    標(biāo)簽： designer altium summer 教程

    上傳時間： 2013-11-03

    上傳用戶：wyc199288

  • 用FPGA設(shè)計多功能數(shù)字鐘

    用FPGA設(shè)計多功能數(shù)字鐘

    標(biāo)簽： FPGA 多功能 數(shù)字

    上傳時間： 2013-10-27

    上傳用戶：ommshaggar

  • XAPP483 - 利用 Platform Flash PROM 實現(xiàn)多重啟動功能

      一些應(yīng)用利用 Xilinx FPGA 在每次啟動時可改變配置的能力，根據(jù)所需來改變 FPGA 的功能。Xilinx Platform Flash XCFxxP PROM 的設(shè)計修訂 (Design Revisioning) 功能，允許用戶在單個PROM 中將多種配置存儲為不同的修訂版本，從而簡化了 FPGA 配置更改。在 FPGA 內(nèi)部加入少量的邏輯，用戶就能在 PROM 中存儲的多達(dá)四個不同的修訂版本之間進(jìn)行動態(tài)切換。多重啟動或從多個設(shè)計修訂進(jìn)行動態(tài)重新配置的能力，與 Spartan™-3E FPGA 和第三方并行 flashPROM 一起使用時所提供的 MultiBoot 選項相似。本應(yīng)用指南將進(jìn)一步說明 Platform Flash PROM 如何提供附加選項來增強(qiáng)配置失敗時的安全性，以及如何減少引腳數(shù)量和板面積。此外，Platform Flash PROM 還為用戶提供其他優(yōu)勢：iMPACT 編程支持、單一供應(yīng)商解決方案、低成本板設(shè)計和更快速的配置加載。本應(yīng)用指南還詳細(xì)地介紹了一個包含 VHDL 源代碼的參考設(shè)計。

    標(biāo)簽： Platform Flash XAPP PROM

    上傳時間： 2013-10-10

    上傳用戶：wangcehnglin

  • Cadence PSD 15.0版本功能介紹

    隨著PCB設(shè)計復(fù)雜程度的不斷提高，設(shè)計工程師對 EDA工具在交互性和處理復(fù)雜層次化設(shè)計功能的要求也越來越高。Cadence Design Systems, Inc. 作為世界第一的EDA工具供應(yīng)商，在這些方面一直為用戶提供業(yè)界領(lǐng)先的解決方案。在 Concept-HDL15.0中，這些功能又得到了大度地提升。首先，Concept-HDL15.0，提供了交互式全局屬性修改刪除，以及全局器件替換的圖形化工作界面。在這些全新的工作環(huán)境中，用戶可以在圖紙，設(shè)計，工程不同的級別上對器件，以及器件/線網(wǎng)的屬性進(jìn)行全局性的編輯。

    標(biāo)簽： Cadence 15.0 PSD 版本

    上傳時間： 2013-11-12

    上傳用戶：ANRAN

  • Allegro SPB V15.2 版新增功能

    15.2 已經(jīng)加入了有關(guān)貫孔及銲點(diǎn)的Z軸延遲計算功能. 先開啟 Setup - Constraints - Electrical constraint sets  下的 DRC 選項.  點(diǎn)選 Electrical Constraints dialog box 下 Options 頁面 勾選 Z-Axis delay欄. 

    標(biāo)簽： Allegro 15.2 SPB

    上傳時間： 2013-11-12

    上傳用戶：Late_Li

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