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  • 這是compiere2的官方?jīng)]問(wèn)題版本~我在fedora10上安裝正確無(wú)誤~不會(huì)出現(xiàn)錯(cuò)誤訊息 ~不過(guò)我發(fā)現(xiàn)compiere他自己本身有自己專(zhuān)屬的網(wǎng)站server~所以有架設(shè)網(wǎng)站的網(wǎng)友們~ 可能要斟

    這是compiere2的官方?jīng)]問(wèn)題版本~我在fedora10上安裝正確無(wú)誤~不會(huì)出現(xiàn)錯(cuò)誤訊息 ~不過(guò)我發(fā)現(xiàn)compiere他自己本身有自己專(zhuān)屬的網(wǎng)站server~所以有架設(shè)網(wǎng)站的網(wǎng)友們~ 可能要斟酌一下~最好把他獨(dú)立開(kāi)來(lái)比較好~= =~我發(fā)現(xiàn)他挺消耗系統(tǒng)資源的~

    標(biāo)簽: compiere2 compiere fedora server

    上傳時(shí)間: 2014-12-04

    上傳用戶(hù):yy541071797

  • 高速電路設(shè)計(jì) 詳細(xì)基礎(chǔ)理論知識(shí)

    設(shè)計(jì)高速電路必須考慮高速訊 號(hào)所引發(fā)的電磁干擾、阻抗匹配及串音等效應(yīng),所以訊號(hào)完整性 (signal  integrity)將是考量設(shè)計(jì)電路優(yōu)劣的一項(xiàng)重要指標(biāo),電路日異複雜必須仰賴(lài)可 靠的軟體來(lái)幫忙分析這些複雜的效應(yīng),才比較可能獲得高品質(zhì)且可靠的設(shè)計(jì), 因此熟悉軟體的使用也將是重要的研究項(xiàng)目之一。另外了解高速訊號(hào)所引發(fā)之 各種效應(yīng)(反射、振鈴、干擾、地彈及串音等)及其克服方法也是研究高速電路 設(shè)計(jì)的重點(diǎn)之一。目前高速示波器的功能越來(lái)越多,使用上很複雜,必須事先 進(jìn)修學(xué)習(xí),否則無(wú)法全盤(pán)了解儀器之功能,因而無(wú)法有效發(fā)揮儀器的量測(cè)功能。 其次就是高速訊號(hào)量測(cè)與介面的一些測(cè)試規(guī)範(fàn)也必須熟悉,像眼圖分析,探針 效應(yīng),抖動(dòng)(jitter)測(cè)量規(guī)範(fàn)及高速串列介面量測(cè)規(guī)範(fàn)等實(shí)務(wù)技術(shù),必須充分 了解研究學(xué)習(xí),進(jìn)而才可設(shè)計(jì)出優(yōu)良之教學(xué)教材及教具。

    標(biāo)簽: 高速電路

    上傳時(shí)間: 2021-11-02

    上傳用戶(hù):jiabin

  • JAVA 開(kāi)發(fā)的看圖軟件.可以自由開(kāi)啟圖像,而家可以加入冷色,暖色,對(duì)比色等較果.

    JAVA 開(kāi)發(fā)的看圖軟件.可以自由開(kāi)啟圖像,而家可以加入冷色,暖色,對(duì)比色等較果.

    標(biāo)簽: JAVA 比色

    上傳時(shí)間: 2013-12-26

    上傳用戶(hù):colinal

  • 類(lèi)比與介面裝置(AIPD)新產(chǎn)品研討會(huì)

    類(lèi)比與介面裝置(AIPD)新產(chǎn)品研討會(huì)

    標(biāo)簽: AIPD

    上傳時(shí)間: 2013-08-03

    上傳用戶(hù):eeworm

  • WCDMA數(shù)字直放站數(shù)字上下變頻及降低峰均比的研究與FPGA實(shí)現(xiàn).rar

    隨著3G網(wǎng)絡(luò)建設(shè)的展開(kāi),移動(dòng)用戶(hù)數(shù)量逐漸增加,用戶(hù)和運(yùn)營(yíng)商對(duì)網(wǎng)絡(luò)的質(zhì)量和覆蓋要求也越來(lái)越高。而在實(shí)際工作中,基站成本在網(wǎng)絡(luò)投資中占有很大比例,并且基站選址是建網(wǎng)的主要難題之一。同基站相比,直放站以其性?xún)r(jià)比高、建設(shè)周期短等優(yōu)點(diǎn)在我國(guó)移動(dòng)網(wǎng)絡(luò)上有著大量的應(yīng)用。目前,直放站已成為提高運(yùn)營(yíng)商網(wǎng)絡(luò)質(zhì)量、解決網(wǎng)絡(luò)盲區(qū)或弱區(qū)問(wèn)題、增強(qiáng)網(wǎng)絡(luò)覆蓋的主要手段之一。但由于傳統(tǒng)的模擬直放站受周邊環(huán)境因素影響較大、抗干擾能力較差、傳輸距離受限、功放效率低,同時(shí)設(shè)備間沒(méi)有統(tǒng)一的協(xié)議規(guī)范,無(wú)法滿(mǎn)足系統(tǒng)廠商與直放站廠商的兼容,所以移動(dòng)通信市場(chǎng)迫切需要通過(guò)數(shù)字化來(lái)解決這些問(wèn)題。 本文正是以設(shè)計(jì)新型數(shù)字化直放站為目標(biāo),以實(shí)現(xiàn)數(shù)字中頻系統(tǒng)為研究重心,圍繞數(shù)字中頻的相關(guān)技術(shù)而展開(kāi)研究。 文章介紹了數(shù)字直放站的研究背景和國(guó)內(nèi)外的研究現(xiàn)狀,闡述了數(shù)字直放站系統(tǒng)的設(shè)計(jì)思想及總體實(shí)現(xiàn)框圖,并對(duì)數(shù)字直放站數(shù)字中頻部分進(jìn)行了詳細(xì)的模塊劃分。針對(duì)其中的數(shù)字上下變頻模塊設(shè)計(jì)所涉及到的相關(guān)技術(shù)作詳細(xì)介紹,涉及到的理論主要有信號(hào)采樣理論、整數(shù)倍內(nèi)插和抽取理論等,在理論基礎(chǔ)上闡述了一些具體模塊的高效實(shí)現(xiàn)方案,最終利用FPGA實(shí)現(xiàn)了數(shù)字變頻模塊的設(shè)計(jì)。 在數(shù)字直放站系統(tǒng)中,降低峰均比是提高功放工作效率的關(guān)鍵技術(shù)之一。本文首先概述了降低峰均比的三類(lèi)算法,然后針對(duì)目前常用的幾種算法進(jìn)行了仿真分析,最后在綜合考慮降低峰均比效果與實(shí)現(xiàn)復(fù)雜度的基礎(chǔ)上,提出了改進(jìn)的二次限幅算法。通過(guò)仿真驗(yàn)證算法的有效性后,針對(duì)其中的噪聲整形濾波器提出了“先分解,再合成”的架構(gòu)實(shí)現(xiàn)方式,并指出其中間級(jí)窄帶濾波器采用內(nèi)插級(jí)聯(lián)的方式實(shí)現(xiàn),最后整個(gè)算法在FPGA上實(shí)現(xiàn)。 在軟件無(wú)線電思想的指導(dǎo)下,本文利用系統(tǒng)級(jí)的設(shè)計(jì)方法完成了WCDMA數(shù)字直放站中頻系統(tǒng)設(shè)計(jì)。遵照3GPP等相關(guān)標(biāo)準(zhǔn),完成了系統(tǒng)的仿真測(cè)試和實(shí)物測(cè)試。最后得出結(jié)論:該系統(tǒng)實(shí)現(xiàn)了WCDMA數(shù)字直放站數(shù)字中頻的基本功能,并可保證在現(xiàn)有硬件不變的基礎(chǔ)上實(shí)現(xiàn)不同載波間平滑過(guò)渡、不同制式間輕松升級(jí)。

    標(biāo)簽: WCDMA FPGA 數(shù)字

    上傳時(shí)間: 2013-07-07

    上傳用戶(hù):林魚(yú)2016

  • 基于FPGA的卷積編碼和維特比譯碼的研究與實(shí)現(xiàn).rar

    在數(shù)字通信中,采用差錯(cuò)控制技術(shù)(糾錯(cuò)碼)是提高信號(hào)傳輸可靠性的有效手段,并發(fā)揮著越來(lái)越重要的作用。糾錯(cuò)碼主要有分組碼和卷積碼兩種。在碼率和編碼器復(fù)雜程度相同的情況下,卷積碼的性能優(yōu)于分組碼。 卷積碼的譯碼方法主要有代數(shù)譯碼和概率譯碼。代數(shù)譯碼是基于碼的代數(shù)結(jié)構(gòu);而概率譯碼不僅基于碼的代數(shù)結(jié)構(gòu),還利用了信道的統(tǒng)計(jì)特性,能充分發(fā)揮卷積碼的特點(diǎn),使譯碼錯(cuò)誤概率達(dá)到很小。 卷積碼譯碼器的設(shè)計(jì)是由高性能的復(fù)雜譯碼器開(kāi)始的,對(duì)于概率譯碼最初的序列譯碼,隨著譯碼約束長(zhǎng)度的增加,其譯碼錯(cuò)誤概率可達(dá)到非常小。后來(lái)慢慢地向低性能的簡(jiǎn)單譯碼器演化,對(duì)不太長(zhǎng)的約束長(zhǎng)度,維特比(Viterbi)算法是非常實(shí)用的。維特比算法是一種最大似然的譯碼方法。當(dāng)編碼約束度不太大(小于等于10)或者誤碼率要求不太高(約10-5)時(shí),Viterbi譯碼算法效率很高,速度很快,譯碼器也較簡(jiǎn)單。 目前,卷積碼在數(shù)傳系統(tǒng),尤其是在衛(wèi)星通信、移動(dòng)通信等領(lǐng)域已被廣泛應(yīng)用。 本論文對(duì)卷積碼編碼和Viterbi譯碼的設(shè)計(jì)原理及其FPGA實(shí)現(xiàn)方案進(jìn)行了研究。同時(shí),將交織和解交織技術(shù)應(yīng)用于編碼和解碼的過(guò)程中。 首先,簡(jiǎn)要介紹了卷積碼的基礎(chǔ)知識(shí)和維特比譯碼算法的基本原理,并對(duì)硬判決譯碼和軟判決譯碼方法進(jìn)行了比較。其次,討論了交織和解交織技術(shù)及其在糾錯(cuò)碼中的應(yīng)用。然后,介紹了FPGA硬件資源和軟件開(kāi)發(fā)環(huán)境Quartus Ⅱ,包括數(shù)字系統(tǒng)的設(shè)計(jì)方法和設(shè)計(jì)規(guī)則。再有,對(duì)基于FPGA的維特比譯碼器各個(gè)模塊和相應(yīng)算法實(shí)現(xiàn)、優(yōu)化進(jìn)行了研究。最后,在Quartus Ⅱ平臺(tái)上對(duì)硬判決譯碼和軟判決譯碼以及有無(wú)交織等不同情況進(jìn)行了仿真,并根據(jù)仿真結(jié)果分析了維特比譯碼器的性能。 分析結(jié)果表明,系統(tǒng)的誤碼率達(dá)到了設(shè)計(jì)要求,從而驗(yàn)證了譯碼器設(shè)計(jì)的可靠性,所設(shè)計(jì)基于FPGA的并行Viterbi譯碼器適用于高速數(shù)據(jù)傳輸?shù)膱?chǎng)合。

    標(biāo)簽: FPGA 卷積 編碼

    上傳時(shí)間: 2013-04-24

    上傳用戶(hù):tedo811

  • OFDM系統(tǒng)中信道編碼的FPGA實(shí)現(xiàn)及降低峰均比的研究

    低壓電力線通信(PLC)具有網(wǎng)絡(luò)分布廣、無(wú)需重新布線和維護(hù)方便等優(yōu)點(diǎn)。近年來(lái),低壓電力線通信被看成是解決信息高速公路“最后一英里”問(wèn)題的一種方案,在國(guó)內(nèi)外掀起了一個(gè)新的研究熱潮。電力線信道中不僅存在多徑干擾和子信道衰落,而且還存在開(kāi)關(guān)噪聲和窄帶噪聲,因此在電力線通信系統(tǒng)中,信道編碼是不可或缺的重要組成部分。 本文著重研究了在FPGA上實(shí)現(xiàn)OFDM系統(tǒng)中的信道編解碼方案。其中編碼端由卷積碼編碼器和交織器組成,解碼端由Viterbi譯碼器和解交織器組成,同時(shí)為了與PC機(jī)進(jìn)行通信,還在FPGA上做了一個(gè)RS232串行接口模塊,以上所有的模塊均采用硬件描述語(yǔ)言VerilogHDL編寫(xiě)。另外,峰值平均功率比(PAR)較大是OFDM系統(tǒng)所面臨的一個(gè)重要問(wèn)題,必須要考慮如何降低大峰值功率信號(hào)出現(xiàn)的概率。本文重點(diǎn)研究了三種降低PAR的方法:即信號(hào)預(yù)畸變技術(shù)、信號(hào)非畸變技術(shù)和編碼技術(shù)。這三種方法各有優(yōu)缺點(diǎn),但是迄今為止還沒(méi)有一種好方法能夠徹底地解決OFDM系統(tǒng)中較高PAR的弊病。本論文內(nèi)容安排如下:第一章介紹了課題的背景,可編程器件和OFDM技術(shù)的發(fā)展歷程。第二章詳細(xì)介紹了OFDM的原理以及實(shí)現(xiàn)OFDM所采用的一些技術(shù)細(xì)節(jié)。第三章詳細(xì)介紹了本課題中信道編碼的方案,包括信道編碼的基本原理,組成結(jié)構(gòu)以及方案中采用的卷積碼和交織的原理及設(shè)計(jì)。第四章詳細(xì)討論了編碼方案如何在FPGA上實(shí)現(xiàn),包括可編程邏輯器件FPGA/CPLD的結(jié)構(gòu)特點(diǎn),開(kāi)發(fā)流程,以及串口通信接口、編解碼器的FPGA設(shè)計(jì)。第五章詳細(xì)介紹了如何降低OFDM系統(tǒng)中的峰值平均功率比。最后,在第六章總結(jié)全文,并對(duì)課題中需要進(jìn)一步完善的方面進(jìn)行了探討。

    標(biāo)簽: OFDM FPGA 信道編碼

    上傳時(shí)間: 2013-04-24

    上傳用戶(hù):520

  • 基于FPGA的卷積編碼和維特比譯碼

    在數(shù)字通信中,采用差錯(cuò)控制技術(shù)(糾錯(cuò)碼)是提高信號(hào)傳輸可靠性的有效手段,并發(fā)揮著越來(lái)越重要的作用。糾錯(cuò)碼主要有分組碼和卷積碼兩種。在碼率和編碼器復(fù)雜程度相同的情況下,卷積碼的性能優(yōu)于分組碼。 卷積碼的譯碼方法主要有代數(shù)譯碼和概率譯碼。代數(shù)譯碼是基于碼的代數(shù)結(jié)構(gòu);而概率譯碼不僅基于碼的代數(shù)結(jié)構(gòu),還利用了信道的統(tǒng)計(jì)特性,能充分發(fā)揮卷積碼的特點(diǎn),使譯碼錯(cuò)誤概率達(dá)到很小。 卷積碼譯碼器的設(shè)計(jì)是由高性能的復(fù)雜譯碼器開(kāi)始的,對(duì)于概率譯碼最初的序列譯碼,隨著譯碼約束長(zhǎng)度的增加,其譯碼錯(cuò)誤概率可達(dá)到非常小。后來(lái)慢慢地向低性能的簡(jiǎn)單譯碼器演化,對(duì)不太長(zhǎng)的約束長(zhǎng)度,維特比(Viterbi)算法是非常實(shí)用的。維特比算法是一種最大似然的譯碼方法。當(dāng)編碼約束度不太大(小于等于10)或者誤碼率要求不太高(約10-5)時(shí),Viterbi譯碼算法效率很高,速度很快,譯碼器也較簡(jiǎn)單。 目前,卷積碼在數(shù)傳系統(tǒng),尤其是在衛(wèi)星通信、移動(dòng)通信等領(lǐng)域已被廣泛應(yīng)用。 本論文對(duì)卷積碼編碼和Viterbi譯碼的設(shè)計(jì)原理及其FPGA實(shí)現(xiàn)方案進(jìn)行了研究。同時(shí),將交織和解交織技術(shù)應(yīng)用于編碼和解碼的過(guò)程中。 首先,簡(jiǎn)要介紹了卷積碼的基礎(chǔ)知識(shí)和維特比譯碼算法的基本原理,并對(duì)硬判決譯碼和軟判決譯碼方法進(jìn)行了比較。其次,討論了交織和解交織技術(shù)及其在糾錯(cuò)碼中的應(yīng)用。然后,介紹了FPGA硬件資源和軟件開(kāi)發(fā)環(huán)境Quartus Ⅱ,包括數(shù)字系統(tǒng)的設(shè)計(jì)方法和設(shè)計(jì)規(guī)則。再有,對(duì)基于FPGA的維特比譯碼器各個(gè)模塊和相應(yīng)算法實(shí)現(xiàn)、優(yōu)化進(jìn)行了研究。最后,在Quartus Ⅱ平臺(tái)上對(duì)硬判決譯碼和軟判決譯碼以及有無(wú)交織等不同情況進(jìn)行了仿真,并根據(jù)仿真結(jié)果分析了維特比譯碼器的性能。 分析結(jié)果表明,系統(tǒng)的誤碼率達(dá)到了設(shè)計(jì)要求,從而驗(yàn)證了譯碼器設(shè)計(jì)的可靠性,所設(shè)計(jì)基于FPGA的并行Viterbi譯碼器適用于高速數(shù)據(jù)傳輸?shù)膱?chǎng)合。

    標(biāo)簽: FPGA 卷積 編碼 譯碼

    上傳時(shí)間: 2013-04-24

    上傳用戶(hù):zhenyushaw

  • 卷積編碼和維特比譯碼的FPGA實(shí)現(xiàn)

    由于其很強(qiáng)的糾錯(cuò)性能和適合硬件實(shí)現(xiàn)的編譯碼算法,卷積編碼和軟判決維特比譯碼目前已經(jīng)廣泛應(yīng)用于衛(wèi)星通信系統(tǒng)。然而隨著航天事業(yè)的發(fā)展,衛(wèi)星有效載荷種類(lèi)的增多和分辨率的不斷提高,信息量越來(lái)越大。如何在低信噪比的功率受限信道條件下提高傳輸速率成為目前亟待解決的問(wèn)題。本論文結(jié)合在研項(xiàng)目,在編譯碼算法、編譯碼器的設(shè)計(jì)與實(shí)現(xiàn)、編譯碼器性能提高三個(gè)方面對(duì)卷積編碼和維特比譯碼進(jìn)行了深入研究,并進(jìn)一步介紹了使用VHDL語(yǔ)言和原理圖混合輸入的方式,實(shí)現(xiàn)一種(7,3/4)增信刪余方式的高速卷積編碼器和維特比譯碼器的詳細(xì)過(guò)程;然后將設(shè)計(jì)下載到XILINX的Virtex2 FPGA內(nèi)部進(jìn)行功能和時(shí)序確認(rèn),最終在整個(gè)數(shù)據(jù)傳輸系統(tǒng)中測(cè)試其性能。本文所實(shí)現(xiàn)的維特比譯碼器速率達(dá)160Mbps,遠(yuǎn)遠(yuǎn)高于目前國(guó)內(nèi)此領(lǐng)域內(nèi)的相關(guān)產(chǎn)品速率。 首先,論文具體介紹了卷積編碼和維特比譯碼的算法,研究卷積碼的各種參數(shù)(約束長(zhǎng)度、生成多項(xiàng)式、碼率以及增信刪余等)對(duì)其譯碼性能的影響;針對(duì)項(xiàng)目需求,確定卷積編碼器的約束長(zhǎng)度、生成多項(xiàng)式格式、碼率和相應(yīng)的維特比譯碼器的回歸長(zhǎng)度。 其次,論文介紹了編解碼器的軟、硬件設(shè)計(jì)和調(diào)試一根據(jù)已知條件,使用VHDL語(yǔ)言和原理圖混合輸入的方式設(shè)計(jì)卷積編碼和維特比譯碼的源代碼和原理圖,分別采用功能和電路級(jí)仿真,確定卷積編碼和維特比譯碼分別需要占用的資源,考慮卷積編碼器和維特比譯碼器的具體設(shè)計(jì)問(wèn)題,包括編譯碼的基本結(jié)構(gòu),各個(gè)模塊的功能及實(shí)現(xiàn)策略,編譯碼器的時(shí)序、邏輯綜合等;根據(jù)軟件仿真結(jié)果,分別確定卷積編碼器和維特比譯碼器的接口、所需的FPGA器件選型和進(jìn)行各自的印制板設(shè)計(jì)。利用卷積碼本身的特點(diǎn),結(jié)合FPGA內(nèi)部結(jié)構(gòu),采用并行卷積編碼和譯碼運(yùn)算,設(shè)計(jì)出高速編譯碼器;對(duì)軟、硬件分別進(jìn)行驗(yàn)證和調(diào)試,并將驗(yàn)證后的軟件下載到FPGA進(jìn)行電路級(jí)調(diào)試。 最后,論文討論了卷積編碼和維特比譯碼的性能:利用已有的測(cè)試設(shè)備在整個(gè)數(shù)據(jù)傳輸系統(tǒng)中測(cè)試其性能(與沒(méi)有采用糾錯(cuò)編碼的數(shù)傳系統(tǒng)進(jìn)行比對(duì));在信道中加入高斯白噪聲,模擬高斯信道,進(jìn)行誤碼率和信噪比測(cè)試。

    標(biāo)簽: FPGA 卷積 編碼 譯碼

    上傳時(shí)間: 2013-04-24

    上傳用戶(hù):mingaili888

  • 信噪比估計(jì)方法研究

    在QPSK調(diào)制方式下,分別研究推導(dǎo)了基于輔助數(shù)據(jù)的極大似然比信噪比估計(jì)算法研究、基于矩的信噪比估計(jì)算法研究以及基于高階累積量的信噪比估計(jì)算法。通過(guò)仿真比較了信噪比估計(jì)算法的性能,著重分析比較了采用的迭代次數(shù)及數(shù)據(jù)長(zhǎng)度等參數(shù)對(duì)算法性能的影響,最終根據(jù)算法各自的特點(diǎn)給出了相應(yīng)的適用范圍。

    標(biāo)簽: 信噪比 方法研究

    上傳時(shí)間: 2013-10-20

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