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FPGA中雙向端口IO的研究FPGA中雙向端口IO的研究.
標(biāo)簽： FPGA 雙向端口
上傳時間： 2013-08-09
上傳用戶：fdfadfs
FPGA開發(fā)板上寫的Verilog代碼：\r\n功能是從電腦端發(fā)送一個字節(jié)，然后把它接收回來。\r\n
標(biāo)簽： Verilog FPGA 開發(fā)板 代碼
上傳時間： 2013-08-15
上傳用戶：copu
:針對現(xiàn)場可編程門陣列(FPGA)芯片的特點(diǎn),研究FPGA中雙向端口I/O的設(shè)計(jì),同時給出仿真初始化雙向端口I/O的方法。采用這種雙向端口的設(shè)計(jì)方法,選用Xilinx的Spartan2E芯片設(shè)計(jì)一個多通道圖像信號處理系統(tǒng)。
上傳時間： 2013-08-17
上傳用戶：xiaoyunyun
真序擴(kuò)頻通信系統(tǒng)的SYSTEMVIEW信真及其FPGA實(shí)現(xiàn)發(fā)送端設(shè)計(jì)
標(biāo)簽： SYSTEMVIEW FPGA 發(fā)送
上傳時間： 2013-08-28
上傳用戶：debuchangshi
cpld與單片機(jī)8051的通信的設(shè)計(jì)方法 以及cpld和單片機(jī)的端口對應(yīng)
標(biāo)簽： cpld 8051 單片機(jī) 通信
上傳時間： 2013-09-01
上傳用戶：wettetw
FPGAadvantage61Crack.rar is for MentorGraphics高端設(shè)計(jì)工具FPGAAdvantage
標(biāo)簽： FPGAAdvantage 高端 設(shè)計(jì)工具
上傳時間： 2013-09-03
上傳用戶：黃蛋的蛋黃
Allegro 里面如何在端接匹配的情況下調(diào)等長線
標(biāo)簽： Allegro 端接 等長線
上傳時間： 2013-09-06
上傳用戶：gdgzhym
圖1所示電路可將高頻單端輸入信號轉(zhuǎn)換為平衡差分信號，用于驅(qū)動16位10 MSPS PulSAR® ADC AD7626。該電路采用低功耗差分放大器ADA4932-1來驅(qū)動ADC，最大限度提升AD7626的高頻輸入信號音性能。此器件組合的真正優(yōu)勢在于低功耗、高性能
標(biāo)簽： MSPS 7626 ADC AD
上傳時間： 2013-10-21
上傳用戶：佳期如夢
帶有異步復(fù)位端的D觸發(fā)器#2
標(biāo)簽： 異步復(fù)位 D觸發(fā)器
上傳時間： 2014-12-23
上傳用戶：caiqinlin
本設(shè)計(jì)通過采用分割電容陣列對DAC進(jìn)行優(yōu)化，在減小了D/A轉(zhuǎn)換開關(guān)消耗的能量、提高速度的基礎(chǔ)上，實(shí)現(xiàn)了一款采樣速度為1 MS/s的10-bit單端逐次逼近型模數(shù)轉(zhuǎn)換器。使用cadence spectre 工具進(jìn)行仿真，仿真結(jié)果表明，設(shè)計(jì)的D/A轉(zhuǎn)換器和比較器等電路滿足10-bit A/D 轉(zhuǎn)換的要求，逐次逼近A/D轉(zhuǎn)換器可以正常工作。
標(biāo)簽： bit SAR ADC 10
上傳時間： 2013-11-21
上傳用戶：chukeey
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