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水滿(mǎn)報(bào)警器

  • 1、以不同的視角觀察球面 和圓柱面 所圍區域。2、畫出s(t)=cos(2/3πf0t)的曲線及其付氏變換的曲線.設:f0=1KHz,時域分辨率 dt=0.01ms, 采樣點數 N=2k, k>

    1、以不同的視角觀察球面 和圓柱面 所圍區域。2、畫出s(t)=cos(2/3πf0t)的曲線及其付氏變換的曲線.設:f0=1KHz,時域分辨率 dt=0.01ms, 采樣點數 N=2k, k>10.(均為M文件)

    標簽: 0.01 cos KHz f0t

    上傳時間: 2014-11-04

    上傳用戶:wangzhen1990

  • 設計一個小的成績查詢系統(*) 任務:有M個學生

    設計一個小的成績查詢系統(*) 任務:有M個學生,學習N門課程,已知所有學生的各科成績,分別輸出每個學生的平均成績和每門課程的平均成績。

    標簽: 成績查詢系統

    上傳時間: 2016-07-27

    上傳用戶:heart520beat

  • 附件中的m代碼包括了一系列的擬合函數

    附件中的m代碼包括了一系列的擬合函數,這些函數通常的輸入是概率分布的樣本。還有最大似然估計仿真器、最小平方仿真器、混合高斯分布估計的EM算法、

    標簽: 附件 代碼 函數

    上傳時間: 2016-07-31

    上傳用戶:zmy123

  • 七號信令解碼器

    七號信令解碼器,N多人多年心血,奉獻給需要的人,有問題請email:leafboyman@tom.com

    標簽: 七號信令 解碼器

    上傳時間: 2016-08-02

    上傳用戶:love_stanford

  • 1. 以單項循環鏈表存儲結構模擬約瑟夫環問題。即編號為1、2、3…、n的n個人按順時針方向圍坐一圈

    1. 以單項循環鏈表存儲結構模擬約瑟夫環問題。即編號為1、2、3…、n的n個人按順時針方向圍坐一圈,每人持有一個密碼(正整數)。一開始任選一個正整數作為報數上限值m,從第一個人開始按順時針方向自1開始報數,報到m時停止報數。報m的人出列,將他的密碼作為新的m值,從他在順時針方向下一個人開始重新從1報數,如此下去,直至所有的人全部出列為止。按出列順序印出各人編號。 2. 演示程序以用戶與計算機的對話方式執行,用戶輸入相應的數據,輸出結果顯示在其后。

    標簽: 循環 存儲結構 模擬 方向

    上傳時間: 2013-12-27

    上傳用戶:chenjjer

  • 問題描述: 1.初始化輸入:N-參賽學校總數

    問題描述: 1.初始化輸入:N-參賽學校總數,M-男子競賽項目數,W-女子競賽項目數; 各項目名次取法有如下幾種: 取前5名:第1名得分 7,第2名得分 5,第3名得分3,第4名得分2,第5名得分 1; 取前3名:第1名得分 5,第2名得分 3,第3名得分2; 用戶自定義:各名次權值由用戶指定。 2.由程序提醒用戶填寫比賽結果,輸入各項目獲獎運動員的信息。 3.所有信息記錄完畢后,用戶可以查詢各個學校的比賽成績,生成團體總分報表,查看參賽學校信息和比賽項目信息等。

    標簽: 初始化 輸入

    上傳時間: 2014-02-08

    上傳用戶:redmoons

  • 約瑟夫環 1. 以單項循環鏈表存儲結構模擬約瑟夫環問題。即編號為1、2、3…、n的n個人按順時針方向圍坐一圈

    約瑟夫環 1. 以單項循環鏈表存儲結構模擬約瑟夫環問題。即編號為1、2、3…、n的n個人按順時針方向圍坐一圈,每人持有一個密碼(正整數)。一開始任選一個正整數作為報數上限值m,從第一個人開始按順時針方向自1開始報數,報到m時停止報數。報m的人出列,將他的密碼作為新的m值,從他在順時針方向下一個人開始重新從1報數,如此下去,直至所有的人全部出列為止。按出列順序印出各人編號。 2. 演示程序以用戶與計算機的對話方式執行,用戶輸入相應的數據,輸出結果顯示在其后。

    標簽: 循環 存儲結構 模擬 方向

    上傳時間: 2014-01-26

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  • 題目:約瑟夫環問題 一.問題描述 設有n個人圍做一圈

    題目:約瑟夫環問題 一.問題描述 設有n個人圍做一圈,現從某個人開始報數,數到m的人出列,接著從出列的下一個人開始重新報數,數到m的人又出列,如此下去,直到所有人都出列為止。試設計確定他們的出列次序序列的程序。

    標簽:

    上傳時間: 2013-12-17

    上傳用戶:klin3139

  • 本文使用實例描述了在 FPGA/CPLD 上使用 VHDL 進行分頻器設 計

    本文使用實例描述了在 FPGA/CPLD 上使用 VHDL 進行分頻器設 計,包括偶數分頻、非 50%占空比和 50%占空比的奇數分頻、半整數 (N+0.5)分頻、小數分頻、分數分頻以及積分分頻。所有實現均可 通過 Synplify Pro 或 FPGA 生產廠商的綜合器進行綜合,形成可使 用的電路,并在 ModelSim 上進行驗證。

    標簽: FPGA CPLD VHDL 分頻器

    上傳時間: 2013-12-15

    上傳用戶:從此走出陰霾

  • 約瑟夫環 已知n個人(以編號1

    約瑟夫環 已知n個人(以編號1,2,3...n分別表示)圍坐在一張圓桌周圍。從編號為k的人開始報數,數到m的那個人出列;他的下一個人又從1開始報數,數到m的那個人又出列;依此規律重復下去,直到圓桌周圍的人全部出列。(有詳細注解)數據結構學習的好例子

    標簽:

    上傳時間: 2016-10-12

    上傳用戶:wxhwjf

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