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浮點(diǎn)(diǎn)數(shù)(shù)

跟我學(xué)數(shù)字電子技朮

數(shù)字電子技朮

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上傳時(shí)間： 2013-10-09

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（N+X）熱插拔模塊并聯(lián)逆變電源應(yīng)用前景

隨著我國通信、電力事業(yè)的發(fā)展，通信、電力網(wǎng)絡(luò)的規(guī)模越來越大，系統(tǒng)越來越復(fù)雜。與之相應(yīng)的對(duì)交流供電的可靠性、靈活性、智能化、免維護(hù)越來越重要。在中國通信、電力網(wǎng)絡(luò)中，傳統(tǒng)的交流供電方案是以UPS或單機(jī)式逆變器提供純凈不間斷的交流電源。由于控制技術(shù)的進(jìn)步、完善，（N+X）熱插拔模塊并聯(lián)逆變電源已經(jīng)非常成熟、可靠；在歐美的通信、電力發(fā)達(dá)的國家，各大通信運(yùn)營商、電力供應(yīng)商、軍隊(duì)均大量應(yīng)用了這種更合理的供電方案。與其它方案相比較，（N+X）熱插拔模塊并聯(lián)逆變電源具有以下明顯的優(yōu)點(diǎn)。

標(biāo)簽： 熱插拔模塊并聯(lián) 應(yīng)用前景

上傳時(shí)間： 2014-03-24

上傳用戶：alan-ee
浮點(diǎn)除法運(yùn)算及其在單片機(jī)上的實(shí)現(xiàn)

浮點(diǎn)除法運(yùn)算及其在單片機(jī)上的實(shí)現(xiàn)

標(biāo)簽： 浮點(diǎn)除法運(yùn)算單片機(jī)

上傳時(shí)間： 2013-11-01

上傳用戶：ssj927211
51單片機(jī)串口發(fā)N字節(jié)

適用于51單片機(jī)的串口發(fā)n

標(biāo)簽： 51單片機(jī) 串口字節(jié)

上傳時(shí)間： 2014-12-25

上傳用戶：qingzhuhu
一種用N+1條線實(shí)現(xiàn)矩陣鍵盤

89c51一種用N+1條線實(shí)現(xiàn)矩陣鍵盤

標(biāo)簽： 矩陣鍵盤

上傳時(shí)間： 2014-12-26

上傳用戶：lhw888
高壓雙管反激變換器的設(shè)計(jì)

高壓雙管反激變換器的設(shè)計(jì):介紹一種雙管反激的電路拓?fù)洌治隽似涔ぷ髟恚o出了一些關(guān)鍵技術(shù)參數(shù)的計(jì)算公式，設(shè)計(jì)并研制成功的30W 380V AC5 0H z/510V DC/+15.1 V DC(1A )、+5.2VDC(2A)輔助開關(guān)電源具有功率密度高、變換效率高、可靠性高等優(yōu)良的綜合性能。該變換器在高電壓輸人情況下有重要的應(yīng)用價(jià)值。【關(guān) 鍵詞】變換器，輔助開關(guān)電源，雙管反激 [Abstract】 A n e wt opologyfo rd oubles witchfl ybackc onverteris in troduced.Th eo perationp rincipleis a nalyzeda nds ome for mulas for calculating key parameters for the topology are presented. The designed and produced auxiliary switching power supply,i. e. 30W 380V AC5 0H z/5 10V DC/+15.1 V DC《1A )、+5.2 V DC《2A )，hase xcellentc omprehensivep erformances sucha sh ighp owerd ensity, hi ghc onversione fficiencya ndh ighr eliability.Th isc onverterh asim portanta pplicationv aluef orh igh input voltag [Keywords ]converter,au xiliary switchingp owers upply,do ubles witchf lybac

標(biāo)簽： 雙管反激變換器

上傳時(shí)間： 2013-11-01

上傳用戶：Ants
51單片機(jī)浮點(diǎn)子程序庫

子程序庫的使用方法如下：１．將子程序庫全部內(nèi)容鏈接在應(yīng)用程序之后，統(tǒng)一編譯即可。優(yōu)點(diǎn)是簡單方便，缺點(diǎn)是程序太長，大量無關(guān)子程序也包含在其中。２．僅將子程序庫中的有關(guān)部分內(nèi)容鏈接在應(yīng)用程序之后，統(tǒng)一編譯即可。有些子程序需要調(diào)用一些低級(jí)子程序，這些低級(jí)子程序也應(yīng)該包含在內(nèi)。優(yōu)點(diǎn)是程序緊湊，缺點(diǎn)是需要對(duì)子程序庫進(jìn)行仔細(xì)刪節(jié)。ＭＣＳ－５１浮點(diǎn)運(yùn)算子程序庫及其使用說明本浮點(diǎn)子程序庫有三個(gè)不同層次的版本，以便適應(yīng)不同的應(yīng)用場(chǎng)合：１．小型庫（FQ51A.ASM）：只包含浮點(diǎn)加、減、乘、除子程序。２．中型庫（FQ51B.ASM）：在小型庫的基礎(chǔ)上再增加絕對(duì)值、倒數(shù)、比較、平方、開平方、數(shù)制轉(zhuǎn)換等子程序。３．大型庫（FQ51.ASM）：包含本說明書中的全部子程序。為便于讀者使用本程序庫，先將有關(guān)約定說明如下：１．雙字節(jié)定點(diǎn)操作數(shù)：用[R0]或[R1]來表示存放在由R0或R1指示的連續(xù)單元中的數(shù) 據(jù)，地址小的單元存放高字節(jié)。如果[R0]=1234H，若(R0)=30H，則(30H)=12H，(31H)=34H。２．二進(jìn)制浮點(diǎn)操作數(shù)：用三個(gè)字節(jié)表示，第一個(gè)字節(jié)的最高位為數(shù)符，其余七位為階碼（補(bǔ)碼形式），第二字節(jié)為尾數(shù)的高字節(jié)，第三字節(jié)為尾數(shù)的低字節(jié)，尾數(shù)用雙字節(jié) 純小數(shù)（原碼）來表示。

標(biāo)簽： 51單片機(jī) 浮點(diǎn) 程序庫

上傳時(shí)間： 2013-10-15

上傳用戶：wmwai1314
DSP定點(diǎn)與浮點(diǎn)運(yùn)算的比較

定點(diǎn)運(yùn)算DSP在應(yīng)用中已取得了極大的成功，而且仍然是DSP應(yīng)用的主體。然而，隨著對(duì)DSP處理速度與精度、存儲(chǔ)器容量、編程的靈活性和方便性要求的不斷提高、自80年代中后期以來，各DSP生產(chǎn)廠家陸續(xù)推出了各自的32bit浮點(diǎn)運(yùn)算DSP。

標(biāo)簽： DSP 定點(diǎn) 浮點(diǎn)運(yùn)算比較

上傳時(shí)間： 2013-10-10

上傳用戶：jiiszha
對(duì)Altera 28nm FPGA浮點(diǎn)DSP設(shè)計(jì)流程和性能的獨(dú)立分析

　　電子發(fā)燒友網(wǎng)核心提示：Altera公司昨日宣布，在業(yè)界率先在28 nm FPGA器件上成功測(cè)試了復(fù)數(shù)高性能浮點(diǎn)數(shù)字信號(hào)處理（DSP）設(shè)計(jì)。獨(dú)立技術(shù)分析公司Berkeley設(shè)計(jì)技術(shù)有限公司（BDTI）驗(yàn)證了能夠在 Altera Stratix V和Arria V 28 nm FPGA開發(fā)套件上簡單方便的高效實(shí)現(xiàn)Altera浮點(diǎn)DSP設(shè)計(jì)流程，同時(shí)驗(yàn)證了要求較高的浮點(diǎn)DSP應(yīng)用的性能。本文是BDTI完整的FPGA浮點(diǎn)DSP分析報(bào)告。　　 Altera的浮點(diǎn)DSP設(shè)計(jì)流程經(jīng)過規(guī)劃，能夠快速適應(yīng)可參數(shù)賦值接口的設(shè)計(jì)更改，其工作環(huán)境包括來自MathWorks的MATLAB和 Simulink，以及Altera的DSP Builder高級(jí)模塊庫，支持FPGA設(shè)計(jì)人員比傳統(tǒng)HDL設(shè)計(jì)更迅速的實(shí)現(xiàn)并驗(yàn)證復(fù)數(shù)浮點(diǎn)算法。這一設(shè)計(jì)流程非常適合設(shè)計(jì)人員在應(yīng)用中采用高性能 DSP，這些應(yīng)用包括，雷達(dá)、無線基站、工業(yè)自動(dòng)化、儀表和醫(yī)療圖像等。

標(biāo)簽： Altera FPGA DSP 28

上傳時(shí)間： 2014-12-28

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WP409利用Xilinx FPGA打造出高端比特精度和周期精度浮點(diǎn)DSP算法實(shí)現(xiàn)方案

WP409利用Xilinx FPGA打造出高端比特精度和周期精度浮點(diǎn)DSP算法實(shí)現(xiàn)方案： High-Level Implementation of Bit- and Cycle-Accurate Floating-Point DSP Algorithms with Xilinx FPGAs

標(biāo)簽： Xilinx FPGA 409 DSP

上傳時(shí)間： 2013-11-07

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