人臉識(shí)別技術(shù)繼指紋識(shí)別、虹膜識(shí)別以及聲音識(shí)別等生物識(shí)別技術(shù)之后，以其獨(dú)特的方便、經(jīng)濟(jì)及準(zhǔn)確性而越來越受到世人的矚目。作為人臉識(shí)別系統(tǒng)的重要環(huán)節(jié)—人臉檢測(cè)，隨著研究的深入和應(yīng)用的擴(kuò)大，在視頻會(huì)議、圖像檢索、出入口控制以及智能人機(jī)交互等領(lǐng)域有著重要的應(yīng)用前景，發(fā)展速度異常迅猛。 FPGA的制造技術(shù)不斷發(fā)展，它的功能、應(yīng)用和可靠性逐漸增加，在各個(gè)行業(yè)也顯現(xiàn)出自身的優(yōu)勢(shì)。FPGA允許用戶根據(jù)自己的需要來建立自己的模塊，為用戶的升級(jí)和改進(jìn)留下廣闊的空間。并且速度更高，密度也更大，其設(shè)計(jì)方法的靈活性降低了整個(gè)系統(tǒng)的開發(fā)成本，F(xiàn)PGA 設(shè)計(jì)成為電子自動(dòng)化設(shè)計(jì)行業(yè)不可缺少的方法。 本文從人臉檢測(cè)算法入手，總結(jié)基于FPGA上的嵌入式系統(tǒng)設(shè)計(jì)方法，使用IBM的Coreconnect掛接自定義模塊技術(shù)。經(jīng)過訓(xùn)練分類器、定點(diǎn)化、以及硬件加速等方法后，能夠使人臉檢測(cè)系統(tǒng)在基于Xilinx的Virtex II Pro開發(fā)板上平臺(tái)上，達(dá)到實(shí)時(shí)的檢測(cè)效果。本文工作和成果可以具體描述如下： 1. 算法分析：對(duì)于人臉檢測(cè)算法，首先確保的是檢測(cè)率的準(zhǔn)確性程度。本文所采用的是基于Paul Viola和Michael J.Jones提出的一種基于Adaboost算法的人臉檢測(cè)方法。算法中較多的是積分圖的特征值計(jì)算，這便于進(jìn)一步的硬件設(shè)計(jì)。同時(shí)對(duì)檢測(cè)算法進(jìn)行耗時(shí)分析確定運(yùn)行速度的瓶頸。 2. 軟硬件功能劃分：這一步考慮市場(chǎng)可以提供的資源狀況，又要考慮系統(tǒng)成本、開發(fā)時(shí)間等諸多因素。Xilinx公司提供的Virtex II Pro開發(fā)板，在上面有可以供利用的Power PC處理器、可擴(kuò)展的存儲(chǔ)器、I/O接口、總線及數(shù)據(jù)通道等，通過分析可以對(duì)算法進(jìn)行細(xì)致的劃分，實(shí)現(xiàn)需要加速的模塊。 3. 定點(diǎn)化：在Adaboost算法中，需要進(jìn)行大量的浮點(diǎn)計(jì)算。這里采用的方法是直接對(duì)數(shù)據(jù)位進(jìn)行操作它提取指數(shù)和尾數(shù)，然后對(duì)尾數(shù)執(zhí)行移位操作。 4. 改進(jìn)檢測(cè)用的級(jí)聯(lián)分類器的訓(xùn)練，提出可以迅速提高分類能力、特征數(shù)量大大減小的一種訓(xùn)練方法。 5. 最后對(duì)系統(tǒng)的整體進(jìn)行了驗(yàn)證。實(shí)驗(yàn)表明，在視頻輸入輸出接入的同時(shí)，人臉檢測(cè)能夠達(dá)到17fps的檢測(cè)速度，并且獲得了很好的檢測(cè)率以及較低的誤檢率。
標(biāo)簽： FPGA 人臉檢測(cè) 系統(tǒng)設(shè)計(jì)
上傳時(shí)間： 2013-07-01
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入研究有源濾波器各種理論的基礎(chǔ)上，綜合比較各個(gè)部分的設(shè)計(jì) 方法，對(duì)一臺(tái)有源電力濾波器各部分電路進(jìn)行了設(shè)計(jì)，并對(duì)有源電力濾波器補(bǔ) 償電流成份的計(jì)算電路使用MATLAB工具軟件進(jìn)行了模擬。
標(biāo)簽： DSP 有源電力濾波器 數(shù)字控制
上傳時(shí)間： 2013-06-27
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軟件工程、項(xiàng)目管理相關(guān)的書籍眾多，各種理論與技巧也是層出不窮，但面對(duì)現(xiàn)實(shí)環(huán)境，卻總有削足適履之苦。到底哪里才是入手之處呢?又應(yīng)該從哪里開始屬于自己的千里之行呢?筆者結(jié)合多年的實(shí)踐談?wù)勛约? 的感悟，以期能夠給讀者帶來一些啟發(fā)。
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上傳時(shí)間： 2013-04-24
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隨著ASIC設(shè)計(jì)規(guī)模的增長(zhǎng)，功能驗(yàn)證已成為整個(gè)開發(fā)周期的瓶頸。傳統(tǒng)的基于軟件模擬和硬件仿真的邏輯驗(yàn)證方法已難以滿足應(yīng)用的要求，基于FPGA組的原型驗(yàn)證方法能有效縮短系統(tǒng)的開發(fā)周期，可提供更快更全面的驗(yàn)證。由于FPGA芯片容量的增加跟不上ASIC設(shè)計(jì)規(guī)模的增長(zhǎng)，單芯片已無法容納整個(gè)設(shè)計(jì)，所以常常需要對(duì)設(shè)計(jì)進(jìn)行邏輯分割，將子邏輯塊映射到FPGA陣列中。 本文對(duì)邏輯驗(yàn)證系統(tǒng)的可配置互連結(jié)構(gòu)和ASIC邏輯分割算法進(jìn)行了深入的研究，提出了FPGA陣列的非對(duì)稱可配置互連結(jié)構(gòu)。與現(xiàn)有的對(duì)稱互連結(jié)構(gòu)相比，該結(jié)構(gòu)能提供更多的互連通道，可實(shí)現(xiàn)對(duì)I/O數(shù)量、電平類型和互連路徑的靈活配置。 本文對(duì)邏輯分割算法進(jìn)行了較深入的研究。針對(duì)現(xiàn)有的兩類分割算法存在的不足，提出并實(shí)現(xiàn)了基于設(shè)計(jì)模塊的邏輯分割算法，該算法有三個(gè)重要特征：1)基于設(shè)計(jì)代碼；2)以模塊作為邏輯分割的最小單位；3)使用模塊資源信息指導(dǎo)邏輯分割過程，避免了設(shè)計(jì)分割過程的盲目性，簡(jiǎn)化了邏輯分割過程。 本文還對(duì)并行邏輯分割方法進(jìn)行了研究，提出了兩種基于不同任務(wù)分配策略的并行分割算法，并對(duì)其進(jìn)行了模擬和性能分析；驗(yàn)證了采用并行方案對(duì)ASIC邏輯進(jìn)行分割和映射的可行性。 最后基于改進(jìn)的芯片互連結(jié)構(gòu)，使用原型系統(tǒng)驗(yàn)證方法對(duì)某一大規(guī)模ASIC設(shè)計(jì)進(jìn)行了邏輯分割和功能驗(yàn)證。實(shí)驗(yàn)結(jié)果表明，使用改進(jìn)后的FPGA陣列互連結(jié)構(gòu)可以更方便和快捷地實(shí)現(xiàn)ASIC設(shè)計(jì)的分割和驗(yàn)證，不但能顯著提高芯片間互連路徑的利用率，而且能給邏輯分割乃至整個(gè)驗(yàn)證過程提供更好的支持，滿足現(xiàn)在和將來大規(guī)模ASIC邏輯驗(yàn)證的需求。
標(biāo)簽： FPGA ASIC 邏輯 驗(yàn)證技術(shù)
上傳時(shí)間： 2013-06-12
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一種8 位I/O口的單片機(jī)顯示器和鍵盤接口
上傳時(shí)間： 2013-07-29
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隨著21世紀(jì)的到來,計(jì)算機(jī)技術(shù),信息處理技術(shù),半導(dǎo)體技術(shù)和網(wǎng)絡(luò)技術(shù)不斷發(fā)展,人類社會(huì)進(jìn)入了信息化時(shí)代。與此同時(shí),無線視頻傳感器網(wǎng)絡(luò)也得到了突飛猛進(jìn)的發(fā)展,成為當(dāng)今國(guó)際上備受關(guān)注的熱點(diǎn)研究領(lǐng)域。無線視頻傳感器網(wǎng)絡(luò)有著很多的優(yōu)點(diǎn)和十分廣泛的應(yīng)用前景。在軍事,工業(yè),城市管理和監(jiān)控系統(tǒng)等重要領(lǐng)域都有潛在的使用價(jià)值。 無線視頻傳感器網(wǎng)絡(luò)有著顯著的特征,例如：網(wǎng)絡(luò)節(jié)點(diǎn)能源有限；網(wǎng)絡(luò)帶寬有限；對(duì)處理速度要求較高等。由此可見,傳統(tǒng)的視頻編碼標(biāo)準(zhǔn)無法應(yīng)用于無線視頻傳感器網(wǎng)絡(luò)。MPEG-4,H.263,H.264等視頻編碼標(biāo)準(zhǔn),全是基于運(yùn)動(dòng)估計(jì)補(bǔ)償實(shí)現(xiàn)的,計(jì)算量十分巨大,在能量,存儲(chǔ)空間和處理能力均有限的節(jié)點(diǎn)難以實(shí)現(xiàn)這類高復(fù)雜度的編碼算法。 本文針對(duì)無線視頻傳感器網(wǎng)絡(luò)對(duì)視頻編碼算法的具體需求,提出一種基于運(yùn)動(dòng)檢測(cè)的低復(fù)雜度視頻編碼算法。該算法只對(duì)當(dāng)前編碼幀中的運(yùn)動(dòng)對(duì)象進(jìn)行編碼,并且以面向?qū)ο蟮慕Y(jié)構(gòu)輸出碼流。實(shí)驗(yàn)結(jié)果表明,與H.264全I(xiàn)幀編碼相比,本文提出的算法編碼速度提高了約3倍,編碼性能提高了約2dB。與H.264基本檔次相比,雖然編碼性能略有下降,但是編碼速度平均提高了8倍左右。因此,本文提出的算法可以在編碼效率和編碼速度之間獲得很好的折衷,在一定程度上可以滿足無線視頻傳感器網(wǎng)絡(luò)的需求。 本文選用ALDVK_270作為硬件實(shí)驗(yàn)平臺(tái)。在分析算法結(jié)構(gòu)的同時(shí),結(jié)合嵌入式系統(tǒng)的特點(diǎn),從算法,內(nèi)存,高級(jí)語言和匯編語言等幾個(gè)方面提出優(yōu)化方案,最終在ARM嵌入式平臺(tái)下實(shí)現(xiàn)了面向無線視頻傳感器網(wǎng)絡(luò)的低復(fù)雜度視頻編碼算法。測(cè)試結(jié)果表明,與優(yōu)化前相比,優(yōu)化后的編碼速度有了很大的提高,對(duì)于CIF格式的監(jiān)控視頻序列能夠滿足實(shí)時(shí)處理的要求。
標(biāo)簽： ARM 無線視頻 傳感器網(wǎng)絡(luò) 復(fù)雜度
上傳時(shí)間： 2013-07-26
上傳用戶：小小小熊
目前運(yùn)動(dòng)控制主要有兩種實(shí)現(xiàn)方式,一是使用PLC加運(yùn)動(dòng)控制模塊來實(shí)現(xiàn)：二是使用PC加運(yùn)動(dòng)控制卡來實(shí)現(xiàn)。兩者各有優(yōu)缺點(diǎn),但兩者有以下共同的缺點(diǎn)：一是由于它們兒乎都是采用通用微控制器(MCU和DSP)來實(shí)現(xiàn)電機(jī)控制,由于受CPU速度的限制,以及CPU的多個(gè)進(jìn)程同時(shí)處理,故無法在控制精度和控制速度比較高的場(chǎng)合中應(yīng)用。二是它們的設(shè)計(jì)只是把運(yùn)動(dòng)控制部件當(dāng)作系統(tǒng)的一個(gè)部分,如果要完成一個(gè)機(jī)械設(shè)備的完整控制,還需要輔助有其他的數(shù)字量/模擬量控制設(shè)備。這樣在提高了系統(tǒng)成本的同時(shí),也降低了系統(tǒng)的可靠性。 論文設(shè)計(jì)了一種基于ARM+CPLD的高速運(yùn)動(dòng)控制器,該控制器采用高速的CPLD處理器來完成電機(jī)的閉環(huán)控制,輔助以NXP的32位ARM7TDMI處理器LPC231X來實(shí)現(xiàn)復(fù)雜的運(yùn)動(dòng)規(guī)劃,使得運(yùn)動(dòng)控制精度更高、速度更快、運(yùn)動(dòng)更加平穩(wěn)；同時(shí)為系統(tǒng)擴(kuò)展了常規(guī)運(yùn)動(dòng)控制卡不具備的通用I/O接口,除開4軸運(yùn)動(dòng)控制所需要的8點(diǎn)高速脈沖輸入和8點(diǎn)高速脈沖輸出外,系統(tǒng)具有24點(diǎn)數(shù)字量輸入(可選共陰或共陽),25點(diǎn)繼電器輸出,僅一臺(tái)這樣的專用設(shè)備就可以完成4軸運(yùn)動(dòng)控制和設(shè)備上其它開關(guān)量控制。 系統(tǒng)采用可移植的軟、硬件設(shè)計(jì)。硬件上以運(yùn)動(dòng)控制部件為核心,可以方便的在ARM處理器預(yù)留的資源上擴(kuò)展出數(shù)字輸入,數(shù)字輸出,AD輸入,DA輸出等常用功能模塊。系統(tǒng)軟件構(gòu)架如下：在最上層,系統(tǒng)采用μC/OS-Ⅱ操作系統(tǒng)來完成系統(tǒng)任務(wù)調(diào)度；在底層,將底層設(shè)備的操作打包編寫成底層驅(qū)動(dòng)的形式,可直接供用戶程序調(diào)用；在中間層,可根據(jù)不同的用戶要求編寫用戶程序,再將其傳遞給μC/OS-Ⅱ來調(diào)度該用戶程序。 將該運(yùn)動(dòng)控制器應(yīng)用于工業(yè)應(yīng)用中的套標(biāo)機(jī),在對(duì)套標(biāo)機(jī)進(jìn)行運(yùn)動(dòng)分解之后,結(jié)合套標(biāo)機(jī)的電氣特性,很好的實(shí)現(xiàn)了運(yùn)動(dòng)控制器在套標(biāo)機(jī)上的二次開發(fā),滿足了套標(biāo)機(jī)在現(xiàn)場(chǎng)中的應(yīng)用。
標(biāo)簽： ARMCPLD 運(yùn)動(dòng)控制器
上傳時(shí)間： 2013-04-24
上傳用戶：牛津鞋
地鐵信號(hào)設(shè)備中輸入輸出設(shè)備是信號(hào)邏輯和現(xiàn)場(chǎng)設(shè)備之間的接口，有著四高（高安全，高可靠，高可維護(hù)，高可用）要求，目前信號(hào)系統(tǒng)廠家的傳統(tǒng)做法是整個(gè)信號(hào)系統(tǒng)產(chǎn)品由一家公司來完成，可是隨著技算機(jī)技術(shù)的快速發(fā)展，邏輯部份目前已可以采用通用COTS產(chǎn)品，而輸入輸出部分還是需要各個(gè)信號(hào)廠家自己設(shè)計(jì)和生產(chǎn)，因此設(shè)計(jì)出一款通用型的輸入輸出控制器已成地鐵行業(yè)的發(fā)展方向。 為了滿足以上要求，本文從實(shí)際應(yīng)用角度出發(fā)，使信號(hào)系統(tǒng)的產(chǎn)品更加的開放透明，設(shè)計(jì)出基于ARM的地鐵用安全型的智能I/O，從而使信號(hào)系統(tǒng)設(shè)計(jì)可以方便地和現(xiàn)場(chǎng)信號(hào)設(shè)備接口。 在硬件上采用冗余設(shè)計(jì)，以ARM為主處理器，整個(gè)系統(tǒng)無單點(diǎn)硬件故障，采集部分采用動(dòng)態(tài)異或輸入設(shè)計(jì)，驅(qū)動(dòng)部分采用安全驅(qū)動(dòng)設(shè)計(jì)。 基于ARM的地鐵用安全智能I/O嚴(yán)格遵循歐洲鐵路信號(hào)產(chǎn)品的標(biāo)準(zhǔn)，使系統(tǒng)的安全性，可靠性，可用性和可維護(hù)性有了充分的保障。 本文主要介紹了地鐵用安全型智能I/O控制器的設(shè)計(jì)和實(shí)現(xiàn)，包括設(shè)計(jì)思想，具體實(shí)施，硬件和軟件的設(shè)計(jì)等。
上傳時(shí)間： 2013-06-12
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(臺(tái)達(dá))開關(guān)電源基本原理與設(shè)計(jì)介紹，比較實(shí)用
標(biāo)簽： 開關(guān)電源
上傳時(shí)間： 2013-06-15
上傳用戶：ybysp008
根據(jù)機(jī)械電子工程類專業(yè)測(cè)控實(shí)驗(yàn)教學(xué)平臺(tái)數(shù)據(jù)采集的需要，在綜合考慮成本和性能基礎(chǔ)上，提出以為主處理芯片的數(shù)據(jù)采集卡設(shè)計(jì)方案。 該方案的主要特點(diǎn)是，使用基于ARM7TDMI內(nèi)核的，工作主頻最高可達(dá)44MHz；內(nèi)置高性能的ADC和DAC模塊，采樣速度最高可達(dá)1MSPS，采樣精度為12位；模擬信號(hào)輸入通道最多可達(dá)16路，模擬信號(hào)輸出通道最高可達(dá)4路；具有豐富的外設(shè)資源可以使用，GPIO口數(shù)目最高可達(dá)40個(gè)。 在設(shè)計(jì)中采用了模塊化思想，將系統(tǒng)分為四個(gè)功能模塊：主模塊的功能是控制ADC進(jìn)行信號(hào)采集和DAC進(jìn)行模擬信號(hào)輸出；模擬信號(hào)模塊的作用是對(duì)傳感器輸入信號(hào)和DAC輸出波形進(jìn)行簡(jiǎn)單的調(diào)理；數(shù)字信號(hào)模塊引出32路數(shù)字I/O口，可用于需要采集數(shù)字量的場(chǎng)合；JTAG模塊可進(jìn)行程序的調(diào)試和下載，對(duì)于數(shù)據(jù)采集卡的二次開發(fā)有很大的作用。 在本數(shù)據(jù)采集卡上，嘗試進(jìn)行了μC/OSⅡ操作系統(tǒng)的移植，成功實(shí)現(xiàn)了四個(gè)任務(wù)的管理。在實(shí)際應(yīng)用中，工作數(shù)小時(shí)仍可保持正常的運(yùn)行。 為檢驗(yàn)數(shù)據(jù)采集卡的串口通訊能力，利用LabVIEW程序讀取下位機(jī)串口發(fā)送的已采集到的數(shù)據(jù)，進(jìn)行波形圖繪制。 為檢驗(yàn)本數(shù)據(jù)采集卡的ADC和DAC精度，設(shè)計(jì)實(shí)驗(yàn)利用DAC輸出波形，并利用ADC將采集到的波形通過LabVIEW顯示，測(cè)量結(jié)果顯示兩者電壓值誤差均在可允許的3LSB（Least Significant Bit）范圍內(nèi)，表明本數(shù)據(jù)采集卡已基本實(shí)現(xiàn)預(yù)期設(shè)計(jì)指標(biāo)。
標(biāo)簽： ARM 數(shù)據(jù)采集卡
上傳時(shí)間： 2013-04-24
上傳用戶：bruce
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