介紹了IIR 濾波器的FPGA 實(shí)現(xiàn)方法,給出了 IIR 數(shù)字濾波器的時序控制、延時、補(bǔ)碼乘法和累加四個模塊的設(shè)計方法,并用VHDL和FPGA 器件實(shí)現(xiàn)了IIR 數(shù)字濾波。
標(biāo)簽： FPGA IIR 濾波器 實(shí)現(xiàn)方法
上傳時間： 2013-08-12
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采用FPGA通過BT_656接口實(shí)現(xiàn)傳輸4路視頻流的方法
標(biāo)簽： FPGA 656 BT 接口
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xilinx spartan3 FPGA的最準(zhǔn)確權(quán)威的配置方法
標(biāo)簽： spartan3 xilinx FPGA 配置方法
上傳時間： 2013-08-13
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Altera_FPGA管腳弱上拉電阻的軟件設(shè)置方法
標(biāo)簽： Altera_FPGA 管腳 上拉電阻 軟件
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用FPGA器件實(shí)現(xiàn)UART核心功能的一種方法.doc
標(biāo)簽： FPGA UART 器件 核心
上傳時間： 2013-08-14
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基于FPGA的快速反正切運(yùn)算實(shí)現(xiàn)方法可以用于解調(diào)的相位計算
標(biāo)簽： FPGA 反正切 運(yùn)算 實(shí)現(xiàn)方法
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ＲＳ編碼在ＦＰＧＡ上實(shí)現(xiàn)的理論和方法，對設(shè)計ＲＳ編碼很有幫助，且ＦＯＧＡ資源占有少
標(biāo)簽： 編碼
上傳時間： 2013-08-16
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一種基于FPGA 實(shí)現(xiàn)的全并行結(jié)構(gòu)FFT 設(shè)計方法，采用全并行加流水結(jié)構(gòu), 可在一個時鐘節(jié)拍內(nèi)完成32 點(diǎn)FFT 運(yùn)算的功能, 設(shè)計最高運(yùn)算速度可達(dá)11ns
標(biāo)簽： FPGA FFT 并行 設(shè)計方法
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基于FPGA的USB2.0的實(shí)現(xiàn)方法，適用于急需開發(fā)usb2.0的人員
標(biāo)簽： FPGA 2.0 USB 實(shí)現(xiàn)方法
上傳時間： 2013-08-17
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altera的幾種新型的FPGA的配置方法和使用心得
標(biāo)簽： altera FPGA 配置方法
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