目前的有源電力濾波器通常是采用基于瞬時無功功率理論的諧波電流檢測方法。其中的ip-iq算法需要用到與電網電壓同步的正余弦信號，即與電網電壓同頻同相的標準正余弦信號。該信號的獲取可以采用鎖相環加正余弦函數發生器的方法，也可采用軟件查表的方法。本設計采用全硬件電路完成，即通過鎖相環加正弦函數發生器的方法，可自動實時跟蹤電網電壓的頻率和相位，不占用微處理器的軟、硬件資源，大大降低了諧波檢測算法編程的復雜度。
上傳時間： 2013-10-22
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同步整流技術簡單介紹大家都知道，對于開關電源，在次級必然要有一個整流輸出的過程。作為整流電路的主要元件，通常用的是整流二極管（利用它的單向導電特性），它可以理解為一種被動式器件：只要有足夠的正向電壓它就開通，而不需要另外的控制電路。但其導通壓降較高，快恢復二極管（FRD）或超快恢復二極管（SRD）可達1.0～1.2V，即使采用低壓降的肖特基二極管（SBD），也會產生大約0.6V的壓降。這個壓降完全是做的無用功，并且整流二極管是一種固定壓降的器件，舉個例子：如有一個管子壓降為0.7V，其整流為12V時它的前端要等效12.7V電壓，損耗占0.7/12.7≈5.5%.而當其為3.3V整流時，損耗為0.7/4（3.3+0.7）≈17.5%。可見此類器件在低壓大電流的工作環境下其損耗是何等地驚人。這就導致電源效率降低，損耗產生的熱能導致整流管進而開關電源的溫度上升、機箱溫度上升--------有時系統運行不穩定、電腦硬件使用壽命急劇縮短都是拜這個高溫所賜。隨著電腦硬件技術的飛速發展，如GeForce 8800GTX顯卡，其12V峰值電流為16.2A。所以必須制造能提供更大輸出電流（如多核F1，四路12V，每路16A；3.3V和5V輸出電流各高達24A）的電源轉換器。而當前世界的能源緊張問題的凸現，為廣大用戶提供更高轉換效率（如多核R80，完全符合80PLUS標準）的電源轉換器就是我們整個開關電源行業的不可回避的社會責任了。如何解決這些問題？尋找更好的整流方式、整流器件。同步整流技術和通態電阻（幾毫歐到十幾毫歐）極低的專用功率MOSFET就是在這個時刻走上開關電源技術發展的歷史舞臺了！作為取代整流二極管以降低整流損耗的一種新器件，功率MOSFET屬于電壓控制型器件，它在導通時的伏安特性呈線性關系。因為用功率MOSFET做整流器時，要求柵極電壓必須與被整流電壓的相位保持同步才能完成整流功能，故稱之為同步整流。它可以理解為一種主動式器件，必須要在其控制極（柵極）有一定電壓才能允許電流通過，這種復雜的控制要求得到的回報就是極小的電流損耗。在實際應用中，一般在通過20-30A電流時才有0.2-0.3V的壓降損耗。因為其壓降等于電流與通態電阻的乘積，故小電流時，其壓降和恒定壓降的肖特基不同，電流越小壓降越低。這個特性對于改善輕載效率（20%）尤為有效。這在80PLUS產品上已成為一種基本的解決方案了。對于以上提到的兩種整流方案，我們可以通過灌溉農田來理解：肖特基整流管可以看成一條建在泥土上沒有鋪水泥的灌溉用的水道，從源頭下來的水源在中途滲漏了很多，十方水可能只有七、八方到了農田里面。而同步整流技術就如同一條鑲嵌了光滑瓷磚的引水通道，除了一點點被太陽曬掉的損失外，十方水能有9.5方以上的水真正用于澆灌那些我們日日賴以生存的糧食。我們的多核F1，多核R80，其3.3V整流電路采用了通態電阻僅為0.004歐的功率MOSFET，在通過24A峰值電流時壓降僅為20*0.004=0.08V。如一般PC正常工作時的3.3V電流為10A，則其壓降損耗僅為10*0.004=0.04V，損耗比例為0.04/4=1%，比之于傳統肖特基加磁放大整流技術17.5%的損耗，其技術的進步已不僅僅是一個量的變化，而可以說是有了一個質的飛躍了。也可以說，我們為用戶修建了一條嚴絲合縫的灌溉電腦配件的供電渠道。
標簽： 同步整流
上傳時間： 2013-10-27
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pic18fxx8單片機通用同步異步收發器的接口電路和c源代碼
上傳時間： 2013-11-06
上傳用戶：zhangzhenyu
摘要：本文首先簡要說明了同步表在船舶電站中的用途，以及實船上同步表各個部分的功能和操作方法；文中介紹了在輪機模擬器上對于電站同步表的一種新的仿真模型以及該模擬器對同步表的要求，這一仿真模型和模擬器需求是文中介紹的基于單片機的同步表的基礎；根據這一模型，詳細介紹了用通用單片機STC89C51實現輪機模擬器電站系統上的同步表的系統構成，以及模擬實現同步表各項功能的的硬件和軟件方法，并在文中給出了詳細的軟件流程圖和部分硬件原理圖以及配套的軟件代碼；在文章最后，簡要介紹了本文實現的基于單片機的同步表的特點以及其在輪機模擬器上實際應用的表現。關鍵詞：船舶電站；同步表；單片機；模擬
上傳時間： 2013-11-23
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永磁同步電機控制程序(萬山明)永磁同步電機控制程序(萬山明)
上傳時間： 2013-11-22
上傳用戶：yinglimeng
同步技術是跳頻系統的核心。本文針對FPGA的跳頻系統，設計了一種基于獨立信道法，同步字頭法和精準時鐘相結合的快速同步方法，同時設計了基于雙圖案的改進型獨立信道法，同步算法協議，協議幀格式等。該設計使用VHDL硬件語言實現，采用Altera公司的EP3C16E144C8作為核心芯片，并在此硬件平臺上進行了功能驗證。實際測試表明，該快速同步算法建立時間短、同步穩定可靠。
上傳時間： 2013-10-21
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04_使用Timequest約束和分析源同步電路
上傳時間： 2013-10-30
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為實現設備中存在的低速數據光纖通信的同步復接/ 分接,提出一種基于FPGA 的幀同步頭信號提取檢測方案,其中幀頭由7 位巴克碼1110010 組成,在數據的接收端首先從復接數據中提取時鐘信號,進而檢測幀同步信號,為數字分接提供起始信號,以實現數據的同步分接。實驗表明,此方案成功地在光纖通信系統的接收端檢測到幀同步信號,從而實現了數據的正確分接。
上傳時間： 2013-10-17
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為了研制高性能的全數字永磁同步電機驅動系統，本文提出了一種基于FPGA的單芯片驅動控制方案。它采用硬件模塊化的現代EDA設計方法，使用VHDL硬件描述語言，實現了永磁同步電機矢量控制系統的設計。方案包括矢量變換、空間矢量脈寬調制(SVPWM)、電流環、速度環以及串行通訊等五部分。經過仿真和實驗表明，系統具有良好的穩定性和動態性能，調節轉速的范圍可以達到0.5r/min~4200r/min，對干擾誤差信號具有較強的容錯性，能夠滿足高性能的運動控制領域對永磁同步電機驅動系統的要求。
上傳時間： 2013-10-13
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IEEE 802.11n無線局域網標準為了避免不必要的波束成型采用了循環移位機制，該機制對符號同步造成障礙，使得符號同步產生所謂的假多徑問題。針對這個問題，本文提出了一種采用移位疊加的本地訓練序列互相關的同步方法。通過對IEEE 802.11n無線局域網系統進行建模仿真，對新提出的方法和前人所提出的方法進行比較。最終驗證該同步方法具有實用性，能夠大幅度的提升同步的精度，使得符號同步的定位誤差控制在2個采樣點之內。
上傳時間： 2013-10-29
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