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無(wú)線子系統(tǒng)

  • PCI的LAYOUT注意事項(xiàng)及特性阻抗

    主版上有很多PCI的介面可以利用,他的LAYOUT有一些注意事項(xiàng)及必須處理走線的特性阻抗才可以讓系統(tǒng)穩(wěn)定。

    標(biāo)簽: LAYOUT PCI 特性阻抗

    上傳時(shí)間: 2013-06-14

    上傳用戶:夢(mèng)雨軒膂

  • Lattice 公 司 把 當(dāng) 今 兩 種 最 新 的 系 統(tǒng) 設(shè) 計(jì) 技 術(shù)

    Lattice 公 司 把 當(dāng) 今 兩 種 最 新 的 系 統(tǒng) 設(shè) 計(jì) 技 術(shù),VHDL 和 在 系 統(tǒng) 可 編 程 ( ISP ) 邏 輯 器 件 聯(lián) 系 在 一 起, 構(gòu) 成 了isp-VHDl Viewlogic 系 統(tǒng)。isp-VHDL 是 進(jìn) 行 電 子 系 統(tǒng) 設(shè) 計(jì) 的 強(qiáng) 有 力 的 工 具, 使 用 它 可 以 加 快 設(shè) 計(jì) 產(chǎn) 品 投 放 市 場(chǎng) 的 時(shí) 間。 isp-VHDL Viewlogic 軟 件 能 用 于 各 種 邏 輯 設(shè) 計(jì), 這 套 軟 件 具 有 功 能 強(qiáng) 大 的 VHDL 綜 合、原 理 圖 輸 入、功 能 與 時(shí) 序 仿 真、ispDS+ 適 配 器 和 ispDOWNLOAD 能 力。

    標(biāo)簽: Lattice

    上傳時(shí)間: 2014-01-06

    上傳用戶:luopoguixiong

  • 產(chǎn)生頻率選擇性衰落的雷利通道

    產(chǎn)生頻率選擇性衰落的雷利通道,參數(shù)由天線結(jié)構(gòu)、OFDM系統(tǒng)的結(jié)構(gòu)與功率延時(shí)結(jié)構(gòu)來(lái)決定。

    標(biāo)簽:

    上傳時(shí)間: 2014-12-20

    上傳用戶:lizhizheng88

  • 一個(gè)自己寫(xiě)的簡(jiǎn)單員工管理系統(tǒng)

    一個(gè)自己寫(xiě)的簡(jiǎn)單員工管理系統(tǒng),這個(gè)系統(tǒng)是在dos運(yùn)行的

    標(biāo)簽: 系統(tǒng)

    上傳時(shí)間: 2013-12-19

    上傳用戶:talenthn

  • 一個(gè)自己寫(xiě)的簡(jiǎn)單員工管理系統(tǒng)

    一個(gè)自己寫(xiě)的簡(jiǎn)單員工管理系統(tǒng),這個(gè)系統(tǒng)是使用GUI運(yùn)行的,可以增加員工資料,查找員工資料,和觀看員工資料也能算出員工薪資總數(shù),平均薪資和員工總數(shù)

    標(biāo)簽: 系統(tǒng)

    上傳時(shí)間: 2014-01-09

    上傳用戶:愛(ài)死愛(ài)死

  • 本文件雖已力求正確

    本文件雖已力求正確,然而無(wú)法保證所有操作/設(shè)定範(fàn)例, 都可以順利的在您的系統(tǒng)上面進(jìn)行。 如果您依 照本文件的說(shuō)明而使您的系統(tǒng)發(fā)生任何問(wèn)題或損失, 作者都將不負(fù)任何責(zé)任。 希望由於本文的出現(xiàn),能大量減少在網(wǎng)路上一再重複出現(xiàn)的問(wèn)題:"為 什麼我不能輸入/看到中文?","為什 麼我 xxxx 裝不起來(lái)?" 等等。 雖然我也了解這是不太可能的...

    標(biāo)簽:

    上傳時(shí)間: 2013-12-19

    上傳用戶:wang5829

  • 神州墨香商業(yè)端

    放墨香商業(yè)版本, 巨陵-蠻牛掉元寶,願(yuàn)意打的就是高手 開(kāi)放包袱商人會(huì)帶備稀而物品給各位大俠購(gòu)買 本服轉(zhuǎn)身請(qǐng)登入官網(wǎng)轉(zhuǎn)身 本服遊戲幣個(gè)人上限是40億 如果帶多了 轉(zhuǎn)圖重登都會(huì)變回40億 全球最強(qiáng)防外掛系統(tǒng),打造2016年最公平的墨湘 本服承諾,絕無(wú)任何嚴(yán)重bug,保證遊戲穩(wěn)定運(yùn)行 本服禁止空白名,定期自動(dòng)清理帶空名的玩家

    標(biāo)簽: 墨香

    上傳時(shí)間: 2016-04-11

    上傳用戶:西子灣灣

  • cadence-allegro16.6高級(jí)教程

    主要內(nèi)容介紹 Allegro 如何載入 Netlist,進(jìn)而認(rèn)識(shí)新式轉(zhuǎn)法和舊式轉(zhuǎn)法有何不同及優(yōu)缺點(diǎn)的分析,透過(guò)本章學(xué)習(xí)可以對(duì) Allegro 和 Capture 之間的互動(dòng)關(guān)係,同時(shí)也能體驗(yàn)出 Allegro 和 Capture 同步變更屬性等強(qiáng)大功能。Netlist 是連接線路圖和 Allegro Layout 圖檔的橋樑。在這裏所介紹的 Netlist 資料的轉(zhuǎn)入動(dòng)作只是針對(duì)由 Capture(線路圖部分)產(chǎn)生的 Netlist 轉(zhuǎn)入 Allegro(Layout部分)1. 在 OrCAD Capture 中設(shè)計(jì)好線路圖。2. 然後由 OrCAD Capture 產(chǎn)生 Netlist(annotate 是在進(jìn)行線路圖根據(jù)第五步產(chǎn)生的資料進(jìn)行編改)。 3. 把產(chǎn)生的 Netlist 轉(zhuǎn)入 Allegro(layout 工作系統(tǒng))。 4. 在 Allegro 中進(jìn)行 PCB 的 layout。 5. 把在 Allegro 中產(chǎn)生的 back annotate(Logic)轉(zhuǎn)出(在實(shí)際 layout 時(shí)可能對(duì)原有的 Netlist 有改動(dòng)過(guò)),並轉(zhuǎn)入 OrCAD Capture 裏進(jìn)行回編。

    標(biāo)簽: cadence allegro

    上傳時(shí)間: 2022-04-28

    上傳用戶:kingwide

  • 步進(jìn)頻率雷達(dá)系統(tǒng)的模擬與測(cè)試

    任何雷達(dá)接收器所接收到的回波(echo)訊號(hào),都會(huì)包含目標(biāo)回波和背景雜波。雷達(dá)系統(tǒng)的縱向解析度和橫向解析度必須夠高,才能在充滿背景雜波的環(huán)境中偵測(cè)到目標(biāo)。傳統(tǒng)上都會(huì)使用短週期脈衝波和寬頻FM 脈衝來(lái)達(dá)到上述目的。

    標(biāo)簽: 步進(jìn)頻率 模擬 雷達(dá)系統(tǒng) 測(cè)試

    上傳時(shí)間: 2014-12-23

    上傳用戶:zhqzal1014

  • 單個(gè)電阻器設(shè)定DCDC轉(zhuǎn)換器的正或負(fù)輸出

    對(duì)於許多電子子繫統(tǒng)而言,比如:VFD (真空熒光顯示屏)、TFT-LCD、GPS 或 DSL 應(yīng)用,僅采用一個(gè)簡(jiǎn)單的降壓或升壓型 DC/DC 轉(zhuǎn)換器並不能滿足其要求

    標(biāo)簽: DCDC 電阻器 設(shè)定

    上傳時(shí)間: 2014-12-24

    上傳用戶:nostopper

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