主版上有很多PCI的介面可以利用，他的LAYOUT有一些注意事項及必須處理走線的特性阻抗才可以讓系統穩定。
標簽： LAYOUT PCI 特性阻抗
上傳時間： 2013-06-14
上傳用戶：夢雨軒膂
Lattice 公 司 把 當 今 兩 種 最 新 的 系 統 設 計 技 術，VHDL 和 在 系 統 可 編 程 ( ISP ) 邏 輯 器 件 聯 系 在 一 起， 構 成 了isp-VHDl Viewlogic 系 統。isp-VHDL 是 進 行 電 子 系 統 設 計 的 強 有 力 的 工 具， 使 用 它 可 以 加 快 設 計 產 品 投 放 市 場 的 時 間。 isp-VHDL Viewlogic 軟 件 能 用 于 各 種 邏 輯 設 計， 這 套 軟 件 具 有 功 能 強 大 的 VHDL 綜 合、原 理 圖 輸 入、功 能 與 時 序 仿 真、ispDS+ 適 配 器 和 ispDOWNLOAD 能 力。
標簽： Lattice
上傳時間： 2014-01-06
上傳用戶：luopoguixiong
產生頻率選擇性衰落的雷利通道，參數由天線結構、OFDM系統的結構與功率延時結構來決定。
標簽：
上傳時間： 2014-12-20
上傳用戶：lizhizheng88
一個自己寫的簡單員工管理系統，這個系統是在dos運行的
標簽： 系統
上傳時間： 2013-12-19
上傳用戶：talenthn
一個自己寫的簡單員工管理系統，這個系統是使用GUI運行的，可以增加員工資料，查找員工資料，和觀看員工資料也能算出員工薪資總數，平均薪資和員工總數
上傳時間： 2014-01-09
上傳用戶：愛死愛死
本文件雖已力求正確，然而無法保證所有操作／設定範例， 都可以順利的在您的系統上面進行。 如果您依 照本文件的說明而使您的系統發生任何問題或損失， 作者都將不負任何責任。 希望由於本文的出現，能大量減少在網路上一再重複出現的問題："為 什麼我不能輸入/看到中文?"，"為什 麼我 xxxx 裝不起來?" 等等。 雖然我也了解這是不太可能的...
標簽： 正
上傳用戶：wang5829
放墨香商業版本， 巨陵-蠻牛掉元寶,願意打的就是高手 開放包袱商人會帶備稀而物品給各位大俠購買 本服轉身請登入官網轉身 本服遊戲幣個人上限是40億 如果帶多了 轉圖重登都會變回40億 全球最強防外掛系統,打造2016年最公平的墨湘 本服承諾,絕無任何嚴重bug,保證遊戲穩定運行 本服禁止空白名,定期自動清理帶空名的玩家
標簽： 墨香
上傳時間： 2016-04-11
上傳用戶：西子灣灣
主要內容介紹 Allegro 如何載入 Netlist，進而認識新式轉法和舊式轉法有何不同及優缺點的分析，透過本章學習可以對 Allegro 和 Capture 之間的互動關係，同時也能體驗出 Allegro 和 Capture 同步變更屬性等強大功能。Netlist 是連接線路圖和 Allegro Layout 圖檔的橋樑。在這裏所介紹的 Netlist 資料的轉入動作只是針對由 Capture（線路圖部分）產生的 Netlist 轉入 Allegro（Layout部分）1． 在 OrCAD Capture 中設計好線路圖。2． 然後由 OrCAD Capture 產生 Netlist（annotate 是在進行線路圖根據第五步產生的資料進行編改）。 3． 把產生的 Netlist 轉入 Allegro（layout 工作系統）。 4． 在 Allegro 中進行 PCB 的 layout。 5． 把在 Allegro 中產生的 back annotate（Logic）轉出（在實際 layout 時可能對原有的 Netlist 有改動過），並轉入 OrCAD Capture 裏進行回編。
標簽： cadence allegro
上傳時間： 2022-04-28
上傳用戶：kingwide
任何雷達接收器所接收到的回波(echo)訊號，都會包含目標回波和背景雜波。雷達系統的縱向解析度和橫向解析度必須夠高，才能在充滿背景雜波的環境中偵測到目標。傳統上都會使用短週期脈衝波和寬頻FM 脈衝來達到上述目的。
標簽： 步進頻率 模擬 雷達系統 測試
上傳時間： 2014-12-23
上傳用戶：zhqzal1014
對於許多電子子繫統而言，比如：VFD (真空熒光顯示屏)、TFT-LCD、GPS 或 DSL 應用，僅采用一個簡單的降壓或升壓型 DC/DC 轉換器並不能滿足其要求
標簽： DCDC 電阻器 正 設定
上傳時間： 2014-12-24
上傳用戶：nostopper
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