"Quartus II設計軟件是Altera提供的完整的多平臺設計環境，能夠直接滿足特定設計需要， 為可編程芯片系統（SOPC）提供全面的設計環境。"
標簽： QuartusII Edtition 10.1 Web
上傳時間： 2013-06-07
上傳用戶：奈雁歸dxh
FPGA布局算法和軟件位于工藝映射和布線之間，是一個承上啟下的階段，對最終的布通率和時序都有著重要的影響。 本論文的工作之一便是研究旨在提高布通率的布局算法。在研究了國內外裝箱和布局算法的基礎上，本文提出了一種新的結合了裝箱的布局算法框架，并稱之為"低溫交替改善的"布局算法。其基本思想是，在模擬退火的低溫階段交替的優化裝箱和布局。本文給了基于學術界標準布局布線軟件VPR的一個軟件實現，并且提出了低溫的判定條件以及一種新的選擇待交換邏輯單元的方法。采用三種不同的裝箱算法作為布局輸入，基于VPR的低溫交替改善的布局算法實現，在布通率上，比VPR分別提高了21.3％、15.5％、10.7％。而帶來的平均額外時間開銷不到20％。 FPGA布局軟件實現對整個FPGA CAD流程的運行效率，算法的可擴展性也有著不可忽視的影響。現代FPGA有著多樣而復雜的邏輯和布線資源。而學術界的布局軟件'VPR所面向的FPGA卻只能處理十分簡單的FPGA結構，對于宏、總線、多時鐘等實際應用中很重要的部分都沒有考慮。本文提出了"邏輯單元層"的概念，用具有特定幾何結構的邏輯單元層來統一處理多種類型的邏輯資源。針對相對位置約束在現代FPGA布局軟件中的重要地位，我們提出了一種處理相對位置約束的方法。這些討論均已經在面向Xilinx SpartanⅡ芯片布局的原型系統中得到了實現，初步證實了這些方法的可擴展性和實用性。
上傳時間： 2013-06-21
上傳用戶：ezgame
數字信號處理是信息科學中近幾十年來發展最為迅速的學科之一.目前,數字信號處理廣泛應用于通信、雷達、聲納、語音與圖像處理等領域.而數字信號處理算法的硬件實現一般來講有三種方式:用于通用目的的可編程DSP芯片;用于特定目的的固定功能DSP芯片組和ASIC;可以由用戶編程的FPGA芯片.隨著微電子技術的發展,采用現場可編程門陣列FPGA進行數字信號處理得到了飛速發展,FPGA正在越來越多地代替ASIC和PDSP用作前端數字信號處理的運算.該文主要探討了基于FPGA數字信號處理的實現.首先詳細闡述了數字信號處理的理論基礎,重點討論了離散傅立葉變換算法原理,由于快速傅立葉變換算法在實際中得到了廣泛的應用,該文給出了基-2FFT算法原理、討論了按時間抽取FFT算法的特點.該論文對硬件描述語言的描述方法和風格做了一定的探討,介紹了硬件描述語言的開發環境MAXPLUSII.在此基礎上,該論文詳細闡述了數字集成系統的高層次設計方法,討論了數字系統設計層次的劃分和數字系統的自頂向下的設計方法,探討了數字集成系統的系統級設計和寄存器傳輸級設計,描述了數字集成系統的高層次綜合方法.最后該文描述了數字信號處理系統結構的實現方法,指出常見的高速、實時信號處理系統的四種結構;由于FFT算法在數字信號處理中占有重要的地位,所以該文提出了用FPGA實現FFT的一種設計思想,給出了總體實現框圖;重點設計實現了FFT算法中的蝶形處理單元,采用了一種高效乘法器算法設計實現了蝶形處理單元中的旋轉因子乘法器,從而提高了蝶形處理器的運算速度,降低了運算復雜度.
上傳時間： 2013-05-23
上傳用戶：Divine
作者：華清遠見嵌入式學院。《Linux設備驅動開發詳解》第16章、Linux網絡設備驅動。網絡設備是完成用戶數據包在網絡媒介上發送和接收的設備，它將上層協議傳遞下來的數據包以特定的媒介訪問控制方式進行發送，并將接收到的數據包傳遞給上層協議。 與字符設備和塊設備不同，網絡設備并不對應于/dev目錄下的文件，應用程序最終使用套接字（socket）完成與網絡設備的接口。因而在網絡設備身上并不能體現出“一切都是文件”的思想。 Linux系統對網絡設備驅動定義了4個層次，這4個層次為網絡協議接口層、網絡設備接口層、提供實際功能的設備驅動功能層和網絡設備與媒介層。
上傳時間： 2013-05-17
上傳用戶：小火車啦啦啦
·詳細說明：本程序將指定的16K采樣的語音數據文件轉換為經G.723編解碼后的8K語音數據。降采樣前先使用180階的FIR濾波器對語音數據進行頻率壓縮，然后進行抽取，并對抽取的數據進行G.723編解碼。該程序在非特定語音識別的庫文件處理中使用，也可擴展至其他用途。文件列表: 16kto8k .......\16kto8k.dsp .......\16kto8
上傳時間： 2013-04-24
上傳用戶：qw12
-------------------------------------------------------- 《串口獵人》十大功能簡介： -------------------------------------------------------- 1、基本功能，支持基本的 收、發、查看、保存、清除等功能。 2、基本功能，自動/手動搜索串口，串口參數的設置和查看。 3、基本功能，支持HEX/ASCII/中文漢字收發。 4、高級發碼功能，支持多組（最多16組）數據輪流發送。間隔和循環次數可設置。 5、高級發碼功能，支持文件逐行發送。間隔和循環次數可設置。 6、高級發碼功能，支持自動添加幀頭、幀尾、幀長、校驗、回車換行符。 7、高級收碼功能，支持按幀接收，能自動進行幀結束判定（方式非常靈活，可以按時間、幀長或特定字）。 8、高級收碼功能，擁有八個獨立接收通道，可以自動從指定幀中指定位置，按照指定的格式收取有效數據。 9、高級收碼功能，可進一步把收取的數據送示波器、碼表或柱形顯示 10、所有的用戶設置，可以保存、或重新載入。也可以恢復默認值。或者可以設定為啟動時載入上次的設置。
上傳時間： 2013-07-21
上傳用戶：thesk123
· 摘要： 本文利用了十六位SPCE061A單片機的強大的DSP功能,實現了特定發音人識別(Speaker Dependent)功能.結合大容量的FLASH存儲器,成功地實現將語音播放與識別技術應用于智能家居控制系統中.另外,詳細介紹了具有語音識別功能的新一代智能家居控制系統的硬件配置與軟件流程,從而在實現系統功能的同時,將低成本、低功耗與友好人機界面有機結合起來.
上傳時間： 2013-04-24
上傳用戶：xwd2010
· 摘要： 傳統的DSP軟件開發都是先設計DSP上的算法并仿真然后將其寫成特定DSP的代碼(c或是匯編)在目標板上實現.介紹了一種新的高效、集成的DSP軟件設計方法.利用MATLAB7.0新提供的Embeded Target for TI C2000 DSP、simulink、Real-Time Workshop和TI的CCS IDE相結合,在MATLAB環境下生成DSP的C代
上傳時間： 2013-07-26
上傳用戶：hebmuljb
·摘要： DDB SDRAM使用雙倍數據速率結構,它能獲得比SDRAM更高的性能.DDR SDRAM需要特定的DDB控制器才能完成與DSP、FPGA之間的通信.由于Xilinx VirtexTM-4系列FPGA具備ChipSync源同步技術等優勢,本設計采用它來實現DDRSDRAM控制器.該DDR SDRAM控制器采用直接時鐘數據捕獲技術,本文將重點闡述該技術.
標簽： Xilinx_FPGA DDR_SDRAM 控制器
上傳時間： 2013-05-24
上傳用戶：zxc23456789
不同于一般形式的軟件編程，嵌入式系統編程建立在特定的硬件平臺上，勢必要求 其編程語言具備較強的硬件直接操作能力。無疑，匯編語言具備這樣的特質。但是，歸 因于匯編語言開發過程的復雜性，它并不是嵌入式系統開發的一般選擇。而與之相比， C 語言--一種"高級的低級"語言，則成為嵌入式系統開發的最佳選擇。筆者在嵌入式系 統項目的開發過程中，一次又一次感受到C 語言的精妙，沉醉于C 語言給嵌入式開發帶 來的便利。
上傳時間： 2013-04-24
上傳用戶：jlyaccounts
