struts+spring+ibatis實現(xiàn)的簡單CRUE，源碼中l(wèi)ib去掉了，自己加上就可以了
標簽： struts spring ibatis CRUE
上傳時間： 2014-01-25
上傳用戶：xwd2010
倒數(shù)計時器 提供時間到關(guān)機的功能 可自由設(shè)定是否關(guān)機或者提供警示
標簽：
上傳時間： 2016-02-02
上傳用戶：lepoke
nbnghm ng m,hjfgb nfgb
標簽： nbnghm hjfgb nfgb ng
上傳時間： 2013-12-10
上傳用戶：上善若水
本書分為上篇、中篇和下篇三個部分，上篇為Windows CE結(jié)構(gòu)分析，中篇為Windows CE情景分析，下篇為實驗手冊。每一篇又劃分為若 干章。上篇包含有引言，Windows CE體系結(jié)構(gòu)，處理 器排程，儲存管理 ，檔案系統(tǒng)和設(shè)備管理 等六 章。中篇包含有系統(tǒng)初始化，處理 器排程過程，分頁處理 ，檔案處理 和驅(qū)動器載入等五章。下篇包含有Windows CE應(yīng)用程式開發(fā)，Windows CE系統(tǒng)開發(fā)，評測與總結(jié)以及實習(xí)等四章。 上篇的重點在於分析Windows CE kernel的結(jié)構(gòu)以及工作原理 。這個部分是掌握Windows CE作業(yè)系統(tǒng)的基礎(chǔ)。 中篇重點在於分析Windows CE kernel的實際運行 過程。如果說 上篇是從靜態(tài)的角度 分析Windows CE kernel，那麼中篇則是試圖從動態(tài)的角度 給讀 者一個有關(guān)Windows CE kernel的描述。希望讀 者能夠通過對中篇的閱讀 理 解，在頭腦中形成有關(guān)Windows CE kernel的多方位的運作情景。 下篇著重於有關(guān)Windows CE的應(yīng)用。對理 論 的掌握最終要應(yīng)用到實務(wù)中。
標簽： 分
上傳時間： 2013-12-23
上傳用戶：FreeSky
VerilogHDL_advanced_digital_design_code_Ch11 VerilogHDL高級數(shù)字設(shè)計源碼Ch
標簽： VerilogHDL_advanced_digital_desig VerilogHDL n_code_Ch 11
上傳時間： 2016-02-13
上傳用戶：shizhanincc
altera Quartus II FSM使用 可設(shè)定時間波形，手動調(diào)整波形頻率。 (含電路)
標簽： Quartus altera FSM II
上傳用戶：kbnswdifs
SmaRTclock Silicon labs Real Time Clock 實現(xiàn)
標簽： SmaRTclock Silicon Clock Real
上傳時間： 2013-12-20
上傳用戶：silenthink
使用Silicon Labs C8051f300 實現(xiàn)PWM
標簽： C8051f300 Silicon Labs PWM
上傳時間： 2016-03-03
上傳用戶：qq1604324866
使用應(yīng)廣PDK82C13 來實現(xiàn)8顆CPU的處理
標簽： PDK 82C C13 CPU
上傳用戶：asasasas
這是一個修改Oreilly Java 網(wǎng)路程式設(shè)計範例的程式 主要是將裡面的一個小程式加上視窗管理者介面方便使用 使用環(huán)境： 需有JRE的環(huán)境 path需有指到JAVA_HOME下bin/ 如環(huán)境設(shè)定OK，在windows直接點選執(zhí)行即可 如在其他OS(unix-like) java -jar nsLookUp.jar
標簽： JAVA_HOME Oreilly Java path
上傳時間： 2014-01-15
上傳用戶：1966640071
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