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  • 基于FPGA的8位增強(qiáng)型CPU設(shè)計(jì)與驗(yàn)證

    隨著信息技術(shù)的發(fā)展,系統(tǒng)級芯片SoC(System on a Chip)成為集成電路發(fā)展的主流。SoC技術(shù)以其成本低、功耗小、集成度高的優(yōu)勢正廣泛地應(yīng)用于嵌入式系統(tǒng)中。通過對8位增強(qiáng)型CPU內(nèi)核的研究及其在FPGA(Field Programmable Gate Arrav)上的實(shí)現(xiàn),對SoC設(shè)計(jì)作了初步研究。 在對Intel MCS-8051的匯編指令集進(jìn)行了深入地分析的基礎(chǔ)上,按照至頂向下的模塊化的高層次設(shè)計(jì)流程,對8位CPU進(jìn)行了頂層功能和結(jié)構(gòu)的定義與劃分,并逐步細(xì)化了各個(gè)層次的模塊設(shè)計(jì),建立了具有CPU及定時(shí)器,中斷,串行等外部接口的模型。 利用5種尋址方式完成了8位CPU的數(shù)據(jù)通路的設(shè)計(jì)規(guī)劃。利用有限狀態(tài)機(jī)及微程序的思想完成了控制通路的各個(gè)層次模塊的設(shè)計(jì)規(guī)劃。利用組合電路與時(shí)序電路相結(jié)合的思想完成了定時(shí)器,中斷以及串行接口的規(guī)劃。采用邊沿觸發(fā)使得一個(gè)機(jī)器周期對應(yīng)一個(gè)時(shí)鐘周期,執(zhí)行效率提高。使用硬件描述語言實(shí)現(xiàn)了各個(gè)模塊的設(shè)計(jì)。借助EDA工具ISE集成開發(fā)環(huán)境完成了各個(gè)模塊的編程、調(diào)試和面向FPGA的布局布線;在Synplify pro綜合工具中完成了綜合;使用Modelsim SE仿真工具對其進(jìn)行了完整的功能仿真和時(shí)序仿真。 設(shè)計(jì)了一個(gè)通用的擴(kuò)展接口控制器對原有的8位處理器進(jìn)行擴(kuò)展,加入高速DI,DO以及SPI接口,增強(qiáng)了8位處理器的功能,可以用于現(xiàn)有單片機(jī)進(jìn)行升級和擴(kuò)展。 本設(shè)計(jì)的CPU全面兼容MCS-51匯編指令集全部的111條指令,在時(shí)鐘頻率和指令的執(zhí)行效率指標(biāo)上均優(yōu)于傳統(tǒng)的MCS-51內(nèi)核。本設(shè)計(jì)以硬件描述語言代碼形式存在可與任何綜合庫、工藝庫以及FPGA結(jié)合開發(fā)出用戶需要的固核和硬核,可讀性好,易于擴(kuò)展使用,易于升級,比較有實(shí)用價(jià)值。本設(shè)計(jì)通過FPGA驗(yàn)證。

    標(biāo)簽: FPGA CPU 8位 增強(qiáng)型

    上傳時(shí)間: 2013-04-24

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  • 51單片機(jī)的串行口擴(kuò)展方法

    在以單片機(jī)為核心的多級分布式系統(tǒng)中,常常需要擴(kuò)展單片機(jī)的串行通信口,本文分別介紹了基于SP2538 專用串行口擴(kuò)展芯片及Intel8251 的兩種串行口擴(kuò)展方法,并給出了實(shí)際的硬件電路原理及相應(yīng)的通信

    標(biāo)簽: 51單片機(jī) 串行口 擴(kuò)展方法

    上傳時(shí)間: 2013-08-01

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  • C語言實(shí)現(xiàn)RS232上、下位機(jī)串行通信

    C語言實(shí)現(xiàn)RS232上、下位機(jī)串行通信 C語言實(shí)現(xiàn)RS232上、下位機(jī)串行通信

    標(biāo)簽: 232 RS C語言 下位機(jī)

    上傳時(shí)間: 2013-06-03

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  • 工具軟件\圖片漢字取模字庫生成查看套件

    5月1日凌晨發(fā)布第一測試版 功能介紹: 1.生成中英文數(shù)字混合的字符串的字模數(shù)據(jù). 2.可選擇字體,大小,并且可獨(dú)立調(diào)整文字的長和寬,生成任意形狀的字符。 3.各種旋轉(zhuǎn),翻轉(zhuǎn)文字功能 4.任意調(diào)整輸出點(diǎn)陣大小,并任意調(diào)整字符在點(diǎn)陣中的位置。 5.字模數(shù)據(jù)輸出可自定義各種格式,系統(tǒng)預(yù)設(shè)了C語言和匯編語言兩種格式,并且可自己 定義出新的數(shù)據(jù)輸出格式;每行輸出數(shù)據(jù)個(gè)數(shù)可調(diào)。 6.支持四種取模方式:逐行(就是橫向逐行取點(diǎn)),逐列(縱向逐列取點(diǎn)),行列(先 橫向取第一行的8個(gè)點(diǎn)作為第一個(gè)字節(jié),然后縱向取第二行的8個(gè)點(diǎn)作為第二個(gè)字節(jié)……), 列行(先縱向取第一列的前8個(gè)點(diǎn)作為第一個(gè)字節(jié),然后橫向取第二列的前8個(gè)點(diǎn)作為第二個(gè) 字節(jié)……) 7.支持陰碼(亮點(diǎn)為1),陽碼(亮點(diǎn)為0)取模 8.支持縱向(第一位為低位)(,倒向第一位為高位)取模 9.輸出數(shù)制可選16進(jìn)制或10進(jìn)制 10.可生成索引文件,用于在生成的大量字庫中可快速檢索到需要的漢字 11.動態(tài)液晶面板彷真,可調(diào)節(jié)彷真面板象素點(diǎn)大小和顏色 12.圖形模式下可任意用鼠標(biāo)作畫,左鍵畫圖,右鍵擦圖。 12.旋轉(zhuǎn),翻轉(zhuǎn),平移等字符模式下的功能也可用與對BMP圖象的處理 版本為pctolcd1.94 5月1日晚上發(fā)布第二測試版 更新如下: 1.增加鎖定點(diǎn)陣大小功能,例如可鎖定24X24點(diǎn)陣大小,然后調(diào)節(jié)獨(dú)立調(diào)節(jié)字點(diǎn)陣的大小 2.增加熱鍵功能,可用光標(biāo)配合Ctrl,Shift對文字大小和位置修改 3.增加精簡輸出格式選項(xiàng) 4.把文字輸入框換成了文字輸入組合框,這樣就可以保存歷史紀(jì)錄。 5.輸出數(shù)據(jù)會自動清除以前的數(shù)據(jù) 6.可隱藏自定義格式,簡化操作 7.一些小的BUG修正。 版本為pctolcd2.03 5月3日凌晨發(fā)布第三測試版 更新如下: 1.增加了一些小東西,例如演示動畫一類的,我懶的一一寫了 2.改掉一些可惡的小BUG,例如點(diǎn)陣輸入框的自動完成。 3.增加大量文字處理和導(dǎo)入TXT文本文件功能,并且可以去除文本中的空白和重復(fù)字符, 可以對文本進(jìn)行排序,適合于生成小字庫。我這里測試是3萬多字的TXT文件在2分鐘內(nèi)轉(zhuǎn)成16X16點(diǎn)陣的字庫文件。 版本號為pctolcd2.53 由于本軟件側(cè)重于對字符的處理,所以在圖象方面功能較弱,請見晾。 5月8日發(fā)布正式版 正式版已經(jīng)開始朝著液晶字庫生成軟件的方向進(jìn)化了,我在后來的更新中把主要精力也放 在這部分,由于我目前還沒有發(fā)現(xiàn)有同類的軟件具備這個(gè)功能,也無法得到任何的參考,只能 自己摸索前進(jìn),所以如果還有不方便的地方請大家多提意見. 具體更新如下: 1.重寫大部分的內(nèi)核代碼以配合漢字庫生成的功能,目前這個(gè)內(nèi)核已經(jīng)進(jìn)行了反復(fù)的測試, 相信穩(wěn)定性和速度較前一版本有了巨大的提高. 2.去掉那個(gè)比較愚蠢的熱鍵區(qū)了,因?yàn)橛锰幉淮? 3.增加漢字庫生成功能,這是最重要的改進(jìn)之處,下文將詳細(xì)介紹. 4.修正許多小BUG,使軟件更加成熟些. 5月12日發(fā)布完美版 這次發(fā)布的PCtoLCD2002完美版與前一版本相比沒有增加太多的功能,因?yàn)槲矣X得現(xiàn)有的這些功能已經(jīng)足夠用于生成各種字模的需要了,所以完美版的主要工作是反復(fù)測試,精心去除各種BUG,以及調(diào)節(jié)一些細(xì)微之處,目的當(dāng)然就是追求完美!不過世上不會有真正完美的東西,這個(gè)軟件也不例外,而且這個(gè)軟件從頭至尾全部是我一個(gè)人編寫完成,精力有限,難免會顧此失彼,如果大家發(fā)現(xiàn)了這個(gè)版本中存在的BUG,請及時(shí)告訴我。 更新說明: 1。界面采用新的字體,不會再有那種難看的黑色粗體字,比以前的要漂亮多了。 2。加入全面的提示幫助,盡量減少普通用戶的各種疑惑。 3。修正生成文件的擴(kuò)展名的一些BUG,不會總是加上FON的擴(kuò)展名了。 4。修正生成字模數(shù)據(jù)的一些格式BUG,現(xiàn)在生成的C51格式字模數(shù)據(jù)基本上可以直接粘貼到源程序中使用而不需要修改了 5。加入新的字模數(shù)據(jù)格式調(diào)整項(xiàng),允許用戶更自由的定制自己需要的數(shù)據(jù)格式 6。最重要的更新:全面支持保存當(dāng)前設(shè)置功能,用戶設(shè)置的字模格式,主窗口狀態(tài)和字庫生成窗口選項(xiàng)信息均可保存,下一次打開窗口時(shí)不用重新設(shè)置。 7。修正了新建圖象時(shí)會自動跳到圖形模式的BUG 8。增加輸出緊湊格式數(shù)據(jù)選項(xiàng),可以生成不包含空白行的字模數(shù)據(jù)。 9。完善了每行數(shù)據(jù)顯示個(gè)數(shù)的功能,可以任意設(shè)置每行顯示的數(shù)據(jù)個(gè)數(shù),并同時(shí)可以設(shè)置每行索引數(shù)據(jù)顯示個(gè)數(shù)。 10。修正了取模說明的一些錯(cuò)誤,并改動了格式。 11。現(xiàn)在當(dāng)用戶選擇10進(jìn)制輸出時(shí),會自動去掉生成字模數(shù)據(jù)前的“0x",或后面的“H”,選擇16進(jìn)制時(shí)則會自動加上。 12。對各個(gè)窗體重新設(shè)計(jì)以全面適應(yīng)最大化的需要,如果您覺得當(dāng)前窗口不夠大,可以最大化使用。 13。增加生成英文點(diǎn)陣字庫功能,可自動生成ASCII碼從0-127的任意點(diǎn)陣字庫,使用方法同生成國標(biāo)點(diǎn)陣字庫功能。 14。再次優(yōu)化代碼,去掉各種調(diào)試信息,使程序速度再快一些。 15。還有許多細(xì)微的調(diào)整我記不清了…… 需要注意的地方: 在測試的過程中我發(fā)現(xiàn)了一個(gè)問題:在WIN98或WINME下當(dāng)用戶直接生成特大點(diǎn)陣的字模時(shí)(例如320*320,1024*768的漢字字模),此時(shí)由于數(shù)據(jù)量非常龐大,而WIN98/WINME會有64K的數(shù)據(jù)容量限制,所以在主窗口中是無法得到全部的字模數(shù)據(jù)的,這時(shí)您需要使用字庫生成功能,通過形成一個(gè)數(shù)據(jù)文件才能得到完整的字模數(shù)據(jù)。 我認(rèn)為到現(xiàn)在這個(gè)軟件功能已經(jīng)很完善了,但可能使用上有點(diǎn)不方便,如果你有什么不明白 的地方,可以發(fā)帖子或發(fā)MAIL詢問

    標(biāo)簽: 軟件 漢字 取模 字庫

    上傳時(shí)間: 2013-07-26

    上傳用戶:sssnaxie

  • 利用VC++6.0實(shí)現(xiàn)上位機(jī)與PLC的串行通信

    介紹了西門子S7–200 系列 PLC 的自由口通信模式及在Windows 環(huán)境下應(yīng)用VC++6.0 實(shí)現(xiàn)PC 機(jī)與PLC串行通信的編程方法,開發(fā)了玻璃器皿沖壓機(jī)上位機(jī)監(jiān)控系統(tǒng)。實(shí)際運(yùn)行證明,該監(jiān)控系

    標(biāo)簽: 6.0 PLC VC 上位機(jī)

    上傳時(shí)間: 2013-06-28

    上傳用戶:branblackson

  • 基于FPGA的路徑識別圖像傳感器的設(shè)計(jì)

    基于彩色路徑識別的視覺導(dǎo)航方法是當(dāng)前自動導(dǎo)航小車領(lǐng)域的研究熱點(diǎn)和方向。視覺導(dǎo)航是指根據(jù)地面路徑和被控對象之間的位置偏差控制其運(yùn)行的方向,因此,地面彩色路徑圖像的攝取及其識別處理就成為視覺導(dǎo)航系統(tǒng)中的基礎(chǔ)和關(guān)鍵。在當(dāng)前的視覺導(dǎo)航系統(tǒng)設(shè)計(jì)中,圖像處理的硬件平臺都是基于通用微處理器,嵌入式微處理器或者DSP進(jìn)行設(shè)計(jì)的。這些處理器一個(gè)共同的特點(diǎn)就是數(shù)據(jù)串行處理,而圖像處理過程涉及大量的并行處理操作,因此傳統(tǒng)的串行處理方式滿足不了圖像處理的實(shí)時(shí)性要求。 鑒于微處理器這方面的不足,作者提出一種使用FPGA實(shí)現(xiàn)圖像識別的并行處理方案,并據(jù)此設(shè)計(jì)一個(gè)智能圖像傳感器。該傳感器采用先進(jìn)的FPGA技術(shù),將圖像采集及其顯示,路徑的識別處理以及通信控制等模塊集成在一個(gè)芯片上,形成一個(gè)片上系統(tǒng)(SOC)。其主要功能是對所采集的彩色路徑圖像進(jìn)行識別處理,獲得彩色路徑的坐標(biāo)及其方向角,并將處理結(jié)果發(fā)送給上位機(jī),為自動導(dǎo)航提供控制依據(jù)。 本文將彩色路徑的識別處理過程劃分為三個(gè)階段,第一階段為顏色聚類識別,以獲得二值路徑圖像,第二階段為數(shù)學(xué)形態(tài)學(xué)運(yùn)算,用于對第一階段中獲得的二值圖像進(jìn)行去斑處理,第三階段為路徑中心線的定位及其方向角的測量。圖像傳感器與上位機(jī)的通信采用異步串行方式,由于上位機(jī)需要控制該傳感器執(zhí)行多種任務(wù),作者定義一種基于異步串行通信的應(yīng)用層協(xié)議,用于上位機(jī)對傳感器的控制。在圖像的顯示中,為了彌補(bǔ)圖像采集的速率和VGA顯示速率的不匹配,作者提出一種基于單端口存儲器的圖像幀緩沖機(jī)制,通過VGA接口將采集的圖像實(shí)時(shí)地顯示出來。 根據(jù)上述思想,作者完成了系統(tǒng)的硬件電路設(shè)計(jì),并對整個(gè)系統(tǒng)進(jìn)行了現(xiàn)場調(diào)試。調(diào)試結(jié)果表明,傳感器系統(tǒng)的各個(gè)模塊都能正常工作,F(xiàn)PGA中的數(shù)字邏輯電路能夠?qū)崟r(shí)地將路徑從圖像中準(zhǔn)確地識別出來,.充分體現(xiàn)了FPGA對路徑圖像的高速處理優(yōu)勢,達(dá)到了設(shè)計(jì)預(yù)期目標(biāo),在一定程度上豐富了路徑圖像識別處理的技術(shù)和方法。

    標(biāo)簽: FPGA 路徑識別 圖像傳感器

    上傳時(shí)間: 2013-04-24

    上傳用戶:ghostparker

  • 基于FPGA的全彩色LED同步顯示屏

    LED顯示屏作為一項(xiàng)高新科技產(chǎn)品正引起人們的高度重視,它以其動態(tài)范圍廣,亮度高,壽命長,工作性能穩(wěn)定而日漸成為顯示媒體中的佼佼者,現(xiàn)已廣泛應(yīng)用于廣告、證券、交通、信息發(fā)布等各方面,且隨著全彩屏顯示技術(shù)的日益完善,LED顯示屏有著廣闊的市場前景。 本文主要研究的對象為全彩色LED同步顯示屏控制系統(tǒng),提出了一個(gè)系統(tǒng)實(shí)現(xiàn)方案,整個(gè)系統(tǒng)分三部分組成:DVI解碼電路、發(fā)送系統(tǒng)以及接收系統(tǒng)。DVI解碼模塊用于從顯卡的DVI口獲取視頻源數(shù)據(jù),經(jīng)過T.D.M.S.解碼恢復(fù)出可供LED屏顯示的紅、綠、藍(lán)共24位像素?cái)?shù)據(jù)和一些控制信號。發(fā)送系統(tǒng)用于將收到的數(shù)據(jù)流進(jìn)行緩存,經(jīng)處理后發(fā)送至以太網(wǎng)芯片進(jìn)行以太網(wǎng)傳輸。接收系統(tǒng)接收以太網(wǎng)上傳來的視頻數(shù)據(jù)流,經(jīng)過位分離操作后存入SRAM進(jìn)行緩存,再串行輸入至LED顯示屏進(jìn)行掃描顯示。然后,從多方面論述了該方案的可行性,仔細(xì)推導(dǎo)了LED顯示屏各技術(shù)參數(shù)之間的聯(lián)系及約束關(guān)系。 本課題采用可編程邏輯器件來完成系統(tǒng)功能,可編程邏輯器件具有高集成度、高速度、在線可編程等特點(diǎn),不僅可以滿足高速圖像數(shù)據(jù)處理對速度的要求,而且增加了設(shè)計(jì)的靈活性,不需修改電路硬件設(shè)計(jì),縮短了設(shè)計(jì)周期,還可以進(jìn)行在線升級。

    標(biāo)簽: FPGA LED 全彩色 同步顯示

    上傳時(shí)間: 2013-06-22

    上傳用戶:jennyzai

  • 基于FPGA的串行通信實(shí)現(xiàn)與CRC校驗(yàn)

    本文應(yīng)用EDA技術(shù),基于FPGA器件設(shè)計(jì)與實(shí)現(xiàn)UART,并采用CRC校驗(yàn)。主要工作如下: 1、在異步串行通信電路部分完全用FPGA來實(shí)現(xiàn)。選用Xilinx公司的SpartanⅢ系列的XC3S1000來實(shí)現(xiàn)異步串行通信的接收、發(fā)送和接口控制功能,利用FPGA集成度比較高,具有在線可編程能力,在其完成各種功能的同時(shí),完全可以將串行通信接口構(gòu)建其中,可根據(jù)實(shí)際需求分配資源。 2、利用VerilogHDL語言非常容易掌握,功能比VHDL更強(qiáng)大的特點(diǎn),可以在設(shè)計(jì)時(shí)不斷修改程序,來適用不同規(guī)模的應(yīng)用,而且采用Verilog輸入法與工藝性無關(guān),利用系統(tǒng)設(shè)計(jì)時(shí)對芯片的要求,施加不同的約束條件,即可設(shè)計(jì)出實(shí)際電路。 3、利用ModelSim仿真工具對程序進(jìn)行功能仿真和時(shí)序仿真,以驗(yàn)證設(shè)計(jì)是否能獲得所期望的功能,確定設(shè)計(jì)程序配置到邏輯芯片之后是否可以運(yùn)行,以及程序在目標(biāo)器件中的時(shí)序關(guān)系。 4、為保證數(shù)據(jù)傳輸?shù)恼_性,采用循環(huán)冗余校驗(yàn)CRC(CyclicRedundancyCheck),該編碼簡單,誤判概率低,為了減少硬件成本,降低硬件設(shè)計(jì)的復(fù)雜度,本設(shè)計(jì)通過CRC算法軟件實(shí)現(xiàn)。 實(shí)驗(yàn)結(jié)果表明,基于EDA技術(shù)的現(xiàn)場可編程門陣列FPGA集成度高,結(jié)構(gòu)靈活,設(shè)計(jì)方法多樣,開發(fā)周期短,調(diào)試方便,修改容易,采用FPGA較好地實(shí)現(xiàn)了串行數(shù)據(jù)的通信功能,并對數(shù)據(jù)作了一定的處理,本設(shè)計(jì)中為CRC校驗(yàn)。另外,可以利用FPGA的在線可編程特性,對本設(shè)計(jì)電路進(jìn)行功能擴(kuò)展,以滿足更高的要求。

    標(biāo)簽: FPGA CRC 串行 通信實(shí)現(xiàn)

    上傳時(shí)間: 2013-04-24

    上傳用戶:Altman

  • 圖像采集與遠(yuǎn)程傳輸系統(tǒng)的研究

    嵌入式圖像采集、處理與傳輸系統(tǒng)具有體積小、穩(wěn)定性高等優(yōu)點(diǎn),在智能交通、電力、通訊、計(jì)算機(jī)視覺等領(lǐng)域應(yīng)用廣泛。隨著DSP技術(shù)的發(fā)展,在DSP上用軟件實(shí)現(xiàn)實(shí)時(shí)視頻壓縮成為數(shù)字視頻壓縮標(biāo)準(zhǔn)應(yīng)用的亮點(diǎn),這種應(yīng)用比起專門的壓縮芯片更具有靈活性和升級潛力。 本文主要研究一種基于DSP TMS320VC5402脫機(jī)視頻采集、壓縮編碼和視頻數(shù)據(jù)通信的方法和DSP外圍硬件系統(tǒng)設(shè)計(jì)。 在本設(shè)計(jì)中,圖像采集部分利用SAA7111視頻采集芯片完成視頻信號的精確采集;利用FPGA完成復(fù)雜且高速的邏輯控制及時(shí)序設(shè)計(jì),完成DSP外擴(kuò)RAM,F(xiàn)lash等高速硬件電路設(shè)計(jì),同時(shí)完成DSP的地址譯碼電路,將采集的數(shù)字視頻信號存儲在DSP外擴(kuò)存儲空間中;用FPGA基于N1OSⅡ來虛擬設(shè)計(jì)了I

    標(biāo)簽: 圖像采集 遠(yuǎn)程傳輸

    上傳時(shí)間: 2013-07-02

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  • 用FPGA實(shí)現(xiàn)8051內(nèi)核及外設(shè)I2C接口

    8051處理器自誕生起近30年來,一直都是嵌入式應(yīng)用的主流處理器,不同規(guī)模的805l處理器涵蓋了從低成本到高性能、從低密度到高密度的產(chǎn)品。該處理器極具靈活性,可讓開發(fā)者自行定義部分指令,量身訂制所需的功能模塊和外設(shè)接口,而且有標(biāo)準(zhǔn)版和經(jīng)濟(jì)版等多種版本可供選擇,可讓設(shè)計(jì)人員各取所需,實(shí)現(xiàn)更高性價(jià)比的結(jié)構(gòu)。如此多的優(yōu)越性使得8051處理器牢固地占據(jù)著龐大的應(yīng)用市場,因此研究和發(fā)展8051及與其兼容的接口具有極大的應(yīng)用前景。在眾多8051的外設(shè)接口中,I2C總線接口扮演著重要的角色。通用的12C接口器件,如帶12C總線的RAM,ROM,AD/DA,LCD驅(qū)動器等,越來越多地應(yīng)用于計(jì)算機(jī)及自動控制系統(tǒng)中。因此,本論文的根本目的就是針對如何在8051內(nèi)核上擴(kuò)展I2C外設(shè)接口進(jìn)行較深入的研究。 本課題項(xiàng)目采用可編程技術(shù)來開發(fā)805l核以及12C接口。由于8051內(nèi)核指令集相容,我們能借助在現(xiàn)有架構(gòu)方面的經(jīng)驗(yàn),發(fā)揮現(xiàn)有的大量代碼和工具的優(yōu)勢,較快地完成設(shè)計(jì)。在8051核模塊里,我們主要實(shí)現(xiàn)中央處理器、程序存儲器、數(shù)據(jù)存儲器、定時(shí)/計(jì)數(shù)器、并行接口、串行接口和中斷系統(tǒng)等七大單元及數(shù)據(jù)總線、地址總線和控制總線等三大總線,這些都是標(biāo)準(zhǔn)8051核所具有的模塊。在其之上我們再嵌入12C的串行通信模塊,采用自下而上的方法,逐次實(shí)現(xiàn)一位的收發(fā)、一個(gè)字節(jié)的收發(fā)、一個(gè)命令的收發(fā),直至實(shí)現(xiàn)I2C的整個(gè)通信協(xié)議。 8051核及I2C總線的研究通過可編程邏輯器件和一塊外圍I2C從設(shè)備TMPl01來驗(yàn)證。本課題的最終目的是可編程邏輯器件實(shí)現(xiàn)的8051核成功并高效地控制擴(kuò)展的12C接口與從設(shè)備TMPl01通信。 用EP2C35F672C6芯片開發(fā)的12C接口,數(shù)據(jù)的傳輸速率由該芯片嵌入8051微處理的時(shí)鐘頻率決定。經(jīng)測試其傳輸速率可達(dá)普通速率和快速速率。 目前集成了該12C接口的8051核已經(jīng)在工作中投入使用,主要用于POS設(shè)備的用戶數(shù)據(jù)加密及對設(shè)備溫度的實(shí)時(shí)控制。雖然該設(shè)備尚未大批量投產(chǎn),但它已成功通過PCI(PaymentCardIndustry)協(xié)會認(rèn)證。

    標(biāo)簽: FPGA 8051 I2C 內(nèi)核

    上傳時(shí)間: 2013-06-18

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