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用vhdl實(shí)(shí)現(xiàn)(xiàn)數(shù)(shù)字鐘

自己使用VHDL語(yǔ)言編寫(xiě)的24位寄存器.主要用于DDS中

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用VHDL硬件描述語(yǔ)言編寫(xiě)數(shù)碼管譯碼顯示

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7段數(shù)碼管譯碼器,用VHDL在FPGA2000上顯示

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這是用VHDL實(shí)現(xiàn)的8位加法器

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這個(gè)是用VHDL實(shí)現(xiàn)的正負(fù)脈寬調(diào)制器

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用VHDL語(yǔ)言設(shè)計(jì)四位全加器

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應(yīng)用VHDL語(yǔ)言編寫(xiě)交通燈的控制程序。熟悉該語(yǔ)言的基本用法。

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VHDL設(shè)計(jì)實(shí)體的基本結(jié)構(gòu) VHDL的語(yǔ)言要素用VHDL實(shí)現(xiàn)電路設(shè)計(jì)的方法 VHDL設(shè)計(jì)流程

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用VHDL編寫(xiě)的quartusii平臺(tái)上的串行EEPROM配置讀取的程序。

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利用VHDL編寫(xiě)的一個(gè)簡(jiǎn)單的16位計(jì)數(shù)器

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