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用vhdl實(shí)現(xiàn)數(shù)字鐘

基于51和FPGA的邏輯分析儀設計用C語言編寫程序和用VHDL編寫硬件程序設計

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本文介紹了如何用VHDL進行DDS的設計

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用VHDL開發的數字鐘資料完整的實驗代碼

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NCO 代碼設計使用VHDL語言

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采用VHDL語言實現17階的數字低通濾波器的設計

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用vhdl語言實現對按鍵的消抖

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基于FPGA的數字頻率計的設計11利用VHDL 硬件描述語言設計,并在EDA(電子設計自動化) 工具的幫助下,用大規模可編程邏輯器件(FPGA/ CPLD) 實現數字頻率計的設計原理及相關程序

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機器狀態機?？刂乒ぷ鞣绞?。用vhdl寫的。很不錯哦

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一個用vHDL語言編的同步程序

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用VHDL編的一個程序

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