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用vhdl實現數字鐘

這是分別用vhdl和verilog語言編寫的源程序

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用VHDL語言寫的程序包含如下功能：1.鍵盤掃描2.控制AD轉換3.產生PWM信號與51系列CPU接口

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用VHDL語言實現CCD圖象采集系統

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用VHDL語言開發的一個16位的具有5級流水線的CPU設計

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用vhdl開發的up3 clock,可以在up3的led上顯示24小時制時分秒

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用vhdl格式寫的sram源代碼

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這是一個用vhdl寫的電子琴的小程序（整個工程文件）

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內有多個用VHDL實現的元件代碼

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自己編寫的UART模塊用VHDL實現

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格雷編碼格雷編碼用VHDL編寫

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