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異或計(jì)算器

多工器ｖｅｒｉｌｏｇ設(shè)計(jì)1對多快速解碼提供控制功能

多工器ｖｅｒｉｌｏｇ設(shè)計(jì)1對多快速解碼提供控制功能

標(biāo)簽： 控制功能

上傳時(shí)間： 2014-01-16

上傳用戶：GavinNeko
verilog除頻器可用於編碼段運(yùn)用可以穩(wěn)定電路設(shè)計(jì)

verilog除頻器可用於編碼段運(yùn)用可以穩(wěn)定電路設(shè)計(jì)

標(biāo)簽： verilog

上傳時(shí)間： 2013-12-26

上傳用戶：372825274
ｖｅｒｉｌｏｇ實(shí)現(xiàn)算術(shù)運(yùn)算後利用7段顯示器將結(jié)果輸出

ｖｅｒｉｌｏｇ實(shí)現(xiàn)算術(shù)運(yùn)算後利用7段顯示器將結(jié)果輸出

標(biāo)簽：

上傳時(shí)間： 2014-01-05

上傳用戶：牛布牛
1、構(gòu)造該算符優(yōu)先文法的優(yōu)先關(guān)系矩陣或優(yōu)先函數(shù)； 2、輸入串應(yīng)是詞法分析的輸出二元式序列

1、構(gòu)造該算符優(yōu)先文法的優(yōu)先關(guān)系矩陣或優(yōu)先函數(shù)； 2、輸入串應(yīng)是詞法分析的輸出二元式序列，即某算術(shù)表達(dá)式“實(shí)驗(yàn)項(xiàng)目一”的輸出結(jié)果。輸出為輸入串是否為該文法定義的算術(shù)表達(dá)式的判斷結(jié)果。 3、算符優(yōu)先分析過程應(yīng)能發(fā)現(xiàn)輸入串出錯(cuò)。

標(biāo)簽： 矩陣函數(shù) 二元分

上傳時(shí)間： 2016-09-02

上傳用戶：yuzsu
12864LCD(帶漢字庫)顯示遙控鍵值讀取器 * * LCD型號：TS12864A-3（帶漢字庫）或兼容型號控制器ST7920 * * MCU:AT89S52 ,晶體頻率：11.0592M

12864LCD(帶漢字庫)顯示遙控鍵值讀取器 * * LCD型號：TS12864A-3（帶漢字庫）或兼容型號控制器ST7920 * * MCU:AT89S52 ,晶體頻率：11.0592MHz * * P0口為128*64LCD的數(shù)據(jù) D0-D7 * * K17鍵按下，繼電器吸合。K19鍵按下，繼電器關(guān)閉 * * 顯示程序在中斷服務(wù)程序之中

標(biāo)簽： 12864 LCD 11.0592 7920

上傳時(shí)間： 2014-01-10

上傳用戶：litianchu
FIQ有FIQ_PWM、FIQ_TMA和FIQ_TMB三個(gè)中斷源,當(dāng)定時(shí)器A或B計(jì)滿溢出時(shí)產(chǎn)生中斷請求信號TA_TIMEOUT_INT或TA_TIMEOUT_INT,CPU響應(yīng)后進(jìn)入中斷執(zhí)行相應(yīng)的子程

FIQ有FIQ_PWM、FIQ_TMA和FIQ_TMB三個(gè)中斷源,當(dāng)定時(shí)器A或B計(jì)滿溢出時(shí)產(chǎn)生中斷請求信號TA_TIMEOUT_INT或TA_TIMEOUT_INT,CPU響應(yīng)后進(jìn)入中斷執(zhí)行相應(yīng)的子程序控制二極管發(fā)光。A口的低四位接LED燈，B口的低四位接LED燈.

標(biāo)簽： TA_TIMEOUT_INT FIQ_PWM FIQ_TMA FIQ_TMB

上傳時(shí)間： 2013-12-11

上傳用戶：鳳臨西北
利用感知器算法實(shí)現(xiàn)邏輯或和邏輯與功能,實(shí)現(xiàn)成功

利用感知器算法實(shí)現(xiàn)邏輯或和邏輯與功能,實(shí)現(xiàn)成功

標(biāo)簽： 邏輯算法

上傳時(shí)間： 2014-01-06

上傳用戶：a6697238
Linux或Unix下的播放器Mplayer

Linux或Unix下的播放器Mplayer，可以支持多種音頻文件格式的播放，是Linux或Unix下的必備工具

標(biāo)簽： Mplayer Linux Unix 播放器

上傳時(shí)間： 2014-01-20

上傳用戶：czl10052678
半加器或門 1位二進(jìn)制全加器頂層設(shè)計(jì)描述

半加器或門 1位二進(jìn)制全加器頂層設(shè)計(jì)描述

標(biāo)簽： 半加器二進(jìn)制全加器或門

上傳時(shí)間： 2014-01-03

上傳用戶：cursor
編譯器設(shè)計(jì) Analysis-Synthesis Model 分析Analysis: 原始程式轉(zhuǎn)換成階層結(jié)構(gòu)稱為樹(tree)

編譯器設(shè)計(jì) Analysis-Synthesis Model 分析Analysis: 原始程式轉(zhuǎn)換成階層結(jié)構(gòu)稱為樹(tree)，語法樹(syntax tree) 合成Synthesis: 產(chǎn)生目標(biāo)碼

標(biāo)簽： Analysis-Synthesis Analysis Model tree

上傳時(shí)間： 2016-12-01

上傳用戶：dengzb84

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