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相敏檢波

  • 50V50A移相全橋ZVSDCDC變換器的設計.rar

    隨著通訊技術和電力系統的發展,對通訊用電源和電力操作電源的性能、重量、體積、效率和可靠性都提出了更高的要求。而應用于中大功率場合的全橋變換器與軟開關的結合解決了這一問題。因此,對其進行研究設計具有十分重要的意義。 首先,論文闡述PWM DC/DC變換器的軟開關技術,且根據移相控制PWM全橋變換器的主電路拓撲結構,選定適合于本論文的零電壓開關軟開關技術的電路拓撲,并對其基本工作原理進行闡述,同時給出ZVS軟開關的實現策略。 其次,對選定的主電路拓撲結構進行電路設計,給出主電路中各參量的設計及參數的計算方法,包括輸入、輸出整流橋及逆變橋的器件的選型,輸入整流濾波電路的參數設計、高頻變壓器及諧振電感的參數設計以及輸出整流濾波電路的參數設計。 然后,論述移相控制電路的形成,對移相控制芯片進行選擇,同時對移相控制芯片UC3875進行詳細的分析和設計。對主功率管MOSFET的驅動電路進行分析和設計。 最后,基于理論計算,對系統主電路進行仿真,研究其各部分設計的參數是否合乎實際電路。搭建移相控制ZV SDC/DC全橋變換器的實驗平臺,在系統實驗平臺上做了大量的實驗。 實驗結果表明,論文所設計的DC/DC變換器能很好的實現軟開關,提高效率,使輸出電壓得到穩定控制,最后通過調整移相控制電路,可實現直流輸出的寬范圍調整,具有很好的工程實用價值。

    標簽: ZVSDCDC 50V50A 移相全橋

    上傳時間: 2013-08-04

    上傳用戶:zklh8989

  • 風力發電并網逆變器的DSP控制系統研究.rar

    風能作為一種清潔可再生能源,發展迅速,已經成為世界新能源最主要的發展方向之一。本文以863計劃項目"MW級風力發電機組電控系統研制"為研究背景,介紹了1.2MW永磁同步電機變速恒頻風力發電系統,研究了變流系統中逆變器的控制方法。 本文首先對風力發電進行了概述,介紹了我國和世界風電發展狀況以及技術發展趨勢。當今風力發電技術,大功率直驅化和雙饋是兩個發展方向,本課題1.2MW風力發電系統就是采用了永磁同步電機加交直交變流系統的結構模式,中間省去了齒輪箱,減少了維護,具有較好的發展前景。 論文第二章首先對風輪機葉片的空氣動力特性進行了分析,介紹了不同風速下風力發電機的控制策略。就直驅技術與變速箱/感應電機技術--目前風力發電領域變速恒頻技術的兩大發展方向作了較為詳細的介紹分析。 在變流系統中,逆變并網是重要的環節,起到了將電能傳輸到電網的作用。文章中重點分析了三相并網逆變器的主電路結構、原理和工作方法,并進行了理論推導和公式說明。 本文對1.2MW永磁同步電機變速恒頻風力發電系統的主電路參數的選擇作了理論推導和計算,包括主電路直流側電容,網側電感,三重化升壓電感,網側濾波電容等,還確定了斬波和逆變部分所采用的開關管和六相整流所采用的二極管,并在額定正常工作情況下,分別計算斬波和逆變部分開關管的損耗和開關管的結溫。 本課題采用瞬時電流法對并網逆變器進行控制。在實驗中上確定了電壓外環和電流內環的PI參數,順利完成了閉環控制實驗。 文中采用DSP2407高速集成控制芯片是控制的核心,并根據控制流程圖對其控制進行了軟硬件設計,實現了控制板上的信號采集、運算、故障檢測、電路驅動等功能。并進行了小功率試驗,得到了較好的電壓電流波形,并對波形進行了詳細分析,驗證了本文采用方法的正確性。

    標簽: DSP 風力發電 并網逆變器

    上傳時間: 2013-07-06

    上傳用戶:wangdean1101

  • 正弦波逆變器.rar

    正弦波逆變器理論基礎知識,劉鳳君老師作品,對初學者和正在進行逆變器設計及改進會有幫助

    標簽: 正弦波逆變器

    上傳時間: 2013-07-06

    上傳用戶:liber

  • IGBT驅動電路模塊化設計.rar

     近年來,igbt功率器件在電機控制、開關電源和變流設備等領域的應用已經非常廣泛。igbt的驅動包括專門的驅動電路,以及過流保護電路等。本文設計參考了三菱、西門康等公司生產的igbt驅動模塊,加入了接口選擇模塊、功能選擇模塊、電源模塊、功率補充模塊等,實現了整個驅動電路的模塊化設計。單個模塊可以驅動一個橋臂的上下兩個igbt。可以通過方波控制或者spwm控制[1]等控制方式,驅動單相或者三相逆變器。

    標簽: IGBT 驅動電路 模塊化設計

    上傳時間: 2013-04-24

    上傳用戶:遠遠ssad

  • FPGA內全數字延時鎖相環的設計.rar

    現場可編程門陣列(FPGA)的發展已經有二十多年,從最初的1200門發展到了目前數百萬門至上千萬門的單片FPGA芯片。現在,FPGA已廣泛地應用于通信、消費類電子和車用電子類等領域,但國內市場基本上是國外品牌的天下。 在高密度FPGA中,芯片上時鐘分布質量變的越來越重要,時鐘延遲和時鐘偏差已成為影響系統性能的重要因素。目前,為了消除FPGA芯片內的時鐘延遲,減小時鐘偏差,主要有利用延時鎖相環(DLL)和鎖相環(PLL)兩種方法,而其各自又分為數字設計和模擬設計。雖然用模擬的方法實現的DLL所占用的芯片面積更小,輸出時鐘的精度更高,但從功耗、鎖定時間、設計難易程度以及可復用性等多方面考慮,我們更愿意采用數字的方法來實現。 本論文是以Xilinx公司Virtex-E系列FPGA為研究基礎,對全數字延時鎖相環(DLL)電路進行分析研究和設計,在此基礎上設計出具有自主知識產權的模塊電路。 本文作者在一年多的時間里,從對電路整體功能分析、邏輯電路設計、晶體管級電路設計和仿真以及最后對設計好的電路仿真分析、電路的優化等做了大量的工作,通過比較DLL與PLL、數字DLL與模擬DLL,深入的分析了全數字DLL模塊電路組成結構和工作原理,設計出了符合指標要求的全數字DLL模塊電路,為開發自我知識產權的FPGA奠定了堅實的基礎。 本文先簡要介紹FPGA及其時鐘管理技術的發展,然后深入分析對比了DLL和PLL兩種時鐘管理方法的優劣。接著詳細論述了DLL模塊及各部分電路的工作原理和電路的設計考慮,給出了全數字DLL整體架構設計。最后對DLL整體電路進行整體仿真分析,驗證電路功能,得出應用參數。在設計中,用Verilog-XL對部分電路進行數字仿真,Spectre對進行部分電路的模擬仿真,而電路的整體仿真工具是HSIM。 本設計采用TSMC0.18μmCMOS工藝庫建模,設計出的DLL工作頻率范圍從25MHz到400MHz,工作電壓為1.8V,工作溫度為-55℃~125℃,最大抖動時間為28ps,在輸入100MHz時鐘時的功耗為200MW,達到了國外同類產品的相應指標。最后完成了輸出電路設計,可以實現時鐘占空比調節,2倍頻,以及1.5、2、2.5、3、4、5、8、16時鐘分頻等時鐘頻率合成功能。

    標簽: FPGA 全數字 延時

    上傳時間: 2013-06-10

    上傳用戶:yd19890720

  • 基于DSP和FPGA的數字化開關電源的實用化研究.rar

    文章開篇提出了開發背景。認為現在所廣泛應用的開關電源都是基于傳統的分立元件組成的。它的特點是頻率范圍窄、電力小、功能少、器件多、成本較高、精度低,對不同的客戶要求來“量身定做”不同的產品,同時幾乎沒有通用性和可移植性。在電子技術飛速發展的今天,這種傳統的模擬開關電源已經很難跟上時代的發展步伐。 隨著DSP、ASIC等電子器件的小型化、高速化,開關電源的控制部分正在向數字化方向發展。由于數字化,使開關電源的控制部分的智能化、零件的共通化、電源的動作狀態的遠距離監測成為了可能,同時由于它的智能化、零件的共通化使得它能夠靈活地應對不同客戶的需求,這就降低了開發周期和成本。依靠現代數字化控制和數字信號處理新技術,數字化開關電源有著廣闊的發展空間。 在數字化領域的今天,最后一個沒有數字化的堡壘就是電源領域。近年來,數字電源的研究勢頭與日俱增,成果也越來越多。雖然目前中國制造的開關電源占了世界市場的80%以上,但都是傳統的比較低端的模擬電源。高端市場上幾乎沒有我們份額。 本論文研究的主要內容是在傳統開關電源模擬調節器的基礎上,提出了一種新的數字化調節器方案,即基于DSP和FPGA的數字化PID調節器。論文對系統方案和電路進行了較為具體的設計,并通過測試取得了預期結果。測試證明該方案能夠適合本行業時代發展的步伐,使系統電路更簡單,精度更高,通用性更強。同時該方案也可用于相關領域。 本文首先分析了國內外開關電源發展的現狀,以及研究數字化開關電源的意義。然后提出了數字化開關電源的總體設計框圖和實現方案,并與傳統的開關電源做了較為詳細的比較。本論文的設計方案是采用DSP技術和FPGA技術來做數字化PID調節,通過數字化PID算法產生PWM波來控制斬波器,控制主回路。從而取代傳統的模擬PID調節器,使電路更簡單,精度更高,通用性更強。傳統的模擬開關電源是將電流電壓反饋信號做PID調節后--分立元器件構成,采用專用脈寬調制芯片實現PWM控制。電流反饋信號來自主回路的電流取樣,電壓反饋信號來自主回路的電壓采樣。再將這兩個信號分別送至電流調節器和電壓調節器的反相輸入端,用來實現閉環控制。同時用來保證系統的穩定性及實現系統的過流過壓保護、電流和電壓值的顯示。電壓、電流的給定信號則由單片機或電位器提供。再次,文章對各個模塊從理論和實際的上都做了仔細的分析和設計,并給出了具體的電路圖,同時寫出了軟件流程圖以及設計中應該注意的地方。整個系統由DSP板和ADC板組成。DSP板完成PWM生成、PID運算、環境開關量檢測、環境開關量生成以及本地控制。ADC板主要完成前饋電壓信號采集、負載電壓信號采集、負載電流信號采集、以及對信號的一階數字低通濾波。由于整個系統是閉環控制系統,要求采樣速率相當高。本系統采用FPGA來控制ADC,這樣就避免了高速采樣占用系統資源的問題,減輕了DSP的負擔。DSP可以將讀到的ADC信號做PID調節,從而產生PWM波來控制逆變橋的開關速率,從而達到閉環控制的目的。 最后,對數字化開關電源和模擬開關電源做了對比測試,得出了預期結論。同時也提出了一些需要改進的地方,認為該方案在其他相關行業中可以廣泛地應用。模擬控制電路因為使用許多零件而需要很大空間,這些零件的參數值還會隨著使用時間、溫度和其它環境條件的改變而變動并對系統穩定性和響應能力造成負面影響。數字電源則剛好相反,同時數字控制還能讓硬件頻繁重復使用、加快上市時間以及減少開發成本與風險。在當前對產品要求體積小、智能化、共通化、精度高和穩定度好等前提條件下,數字化開關電源有著廣闊的發展空間。本系統來基本上達到了設計要求。能夠滿足較高精度的設計要求。但對于高精度數字化電源,系統還有值得改進的地方,比如改進主控器,提高參考電壓的精度,提高采樣器件的精度等,都可以提高系統的精度。 本系統涉及電子、通信和測控等技術領域,將數字PID算法與電力電子技術、通信技術等有機地結合了起來。本系統的設計方案不僅可以用在電源控制器上,只要是相關的領域都可以采用。

    標簽: FPGA DSP 數字化

    上傳時間: 2013-06-29

    上傳用戶:dreamboy36

  • 基于FPGA的高速IIR數字濾波器設計與實現.rar

    數字濾波器是現代數字信號處理系統的重要組成部分之一。ⅡR數字濾波器又是其中非常重要的一類慮波器,因其可以較低的階次獲得較高的頻率選擇特性而得到廣泛應用。 本文研究了ⅡR數字濾波器的常用設計方法,在分析各種ⅡR實現結構的基礎上,利用MATLAB針對并聯型結構的ⅡR數字濾波器做了多方面的仿真,從理論分析和仿真情況確定了所要設計的ⅡR數字濾波器的實現結構以及中間數據精度。然后基于FPGA的結構特點,研究了ⅡR數字濾波器的FPGA設計與實現,提出應用流水線技術和并行處理技術相結合的方式來提高ⅡR數字濾波器處理速度的方法,同時又從ⅡR數字濾波器的結構特性出發,提出利用ⅡR數字濾波器的分解技術來改善ⅡR濾波器的設計。在ⅡR實現方面,本文采用Verilog HDL語言編寫了相應的硬件實現程序,將內置SignalTap Ⅱ邏輯分析器的ⅡR設計下載到FPGA芯片,并利用Altera公司的SignalTap Ⅱ邏輯分析儀進行了定性測試,同時利用HP頻譜儀進行定性與定量的觀測,仿真與實驗測試結果表明設計方法正確有效。

    標簽: FPGA IIR 數字

    上傳時間: 2013-04-24

    上傳用戶:rockjablew

  • JPEG2000中小波變換的FPGA實現.rar

    JPEG 2000是為適應不斷發展的圖像壓縮應用而出現的新的靜止圖像壓縮標準,小波變換是JEPG 2000核心算法之一。小波變換是一種可達到時(空)域或頻率域局部化的時頻域或空頻域分析方法,其多尺度分解特性符合人類的視覺機制,更加適用于圖像信息的處理。提升小波變換是一類不采用傅立葉變換做為主要分析工具的小波變換新方法,提升小波變換的提出大大簡化了小波變換的計算,使其在實時信號處理領域得到廣泛的應用。通過提升的方法很容易構造一般的整數小波變換,由于圖像一般用位數較低的整數表示,整數小波變換可以將為整數序列的圖像矩陣映射成整數小波系數矩陣,這就大大簡化了小波變換的硬件電路設計。在當今數字化和信息化時代背景下,研究具有高速硬件處理功能的可變程邏輯器件在圖像壓縮算法領域的應用已經成為當今研究的熱點。 本文旨在探討和研制基于FPGA的小波變換模塊的可能性和方法。本文采用Xilinx公司的Spartan-Ⅲ系列芯片,根據JPEG 2000推薦無損提升小波算法和有損提升小波算法,設計圖像壓縮系統的小波變換模塊。主要工作如下: 第一部分介紹了傳統小波分析理論和提升小波分析理論。包括連續小波時頻局域性的特征,離散小波變換系數的意義,多分辨分析引出的構造小波基的系統方法和計算離散小波的快速算法等。重點放在介紹正交小波和雙正交小波的構造方法,并介紹了數字圖像在小波域的特點。討論了提升小波變換的基本思想,討論了用提升方法構造小波基以及傳統小波變換的提升實現,討論了整數小波變換。 第二部分介紹了FPGA結構及其設計流程。介紹了FPGA/CPLD器件的特征、發展趨勢及FPGA/CPLD基本結構,然后重點介紹了本文用到的Xilinx公司Spartan-Ⅲ系列芯片的結構特點,以及Xilinx的FPGA開發軟件ISE,最后介紹了硬件描述語言VHDL語言的特點。 最后一部分是本論文研究的主要內容,即JPEG 2000中最核心的算法-提升格式小波變換的一維變換模塊設計和二維變換模塊設計。一維提升小波變換模塊采用兩種不同的電路結構進行設計-低速低功耗的串行流水線結構和高速高功耗的并行陣列結構。同樣,二維小波變換模塊也采用了兩種不同的電路結構進行設計-低速低功耗的折疊結構和高速高功耗的串行結構。 文章對提升小波變換的FPGA實現中的大量細節問題進行了討論,給出了每種結構提升小波變換模塊的電路原理圖,并對原理圖進行了仿真測試,仿真測試結果不僅表明了模塊功能的正確性,而且表明不同小波模塊可以滿足相應領域的實際要求。

    標簽: JPEG 2000 FPGA

    上傳時間: 2013-06-08

    上傳用戶:dwzjt

  • 基于FPGA的DDS信號源的設計.rar

    頻率合成技術廣泛應用于通信、航空航天、儀器儀表等領域,目前,常用的頻率合成技術有直接頻率合成、鎖相頻率合成和直接數字頻率合成(DDS)等。其中DDS是一種新的頻率合成方法,是頻率合成的一次革命。全數字化的DDS技術由于具有頻率分辨率高、頻率切換速度快、相位噪聲低和頻率穩定度高等優點而成為現代頻率合成技術中的佼佼者。隨著數字集成電路、微電子技術和EDA技術的深入研究,DDS技術得到了飛速的發展。 DDS是把一系列數字量化形式的信號通過D/A轉換形成模擬量形式的信號的合成技術。主要是利用高速存儲器作查尋表,然后通過高速D/A轉換產生已經用數字形式存入的正弦波(或其它任意波形)。一個典型的DDS系統應包括以下三個部分:相位累加器可以時鐘的控制下完成相位的累加;相位一幅度碼轉換電路一般由ROM實現;D/A轉換電路,將數字形式的幅度碼轉換成模擬信號。 現場可編程門陣列(FPGA)設計靈活、速度快,在數字專用集成電路的設計中得到了廣泛的應用。本論文主要討論了如何利用FPGA來實現一個DDS系統,該DDS系統的硬件結構是以FPGA為核心實現的,使用Altera公司的Cyclone系列FPGA。 文章首先介紹了頻率合成器的發展,闡述了基于FPGA實現DDS技術的意義;然后介紹了DDS的基本理論;接著介紹了FPGA的基礎知識如結構特點、開發流程、使用工具等;隨后介紹了利用FPGA實現直接數字頻率合成(DDS)的原理、電路結構、優化方法等。重點介紹DDS技術在FPGA中的實現方法,給出了部分VHDL源程序。采用該方法設計的DDS系統可以很容易地嵌入到其他系統中而不用外接專用DDS芯片,具有高性能、高性價比,電路結構簡單等特點;接著對輸出信號頻譜進行了分析,特別是對信號的相位截斷誤差和幅度量化誤差進行了詳細的討論,由此得出了改善系統性能的幾種方法;最后給出硬件實物照片和測試結果,并對此作了一定的分析。

    標簽: FPGA DDS 信號源

    上傳時間: 2013-07-05

    上傳用戶:suxuan110425

  • 單片機產生準確頻率正弦波的新方法.rar

    單片機產生正弦波,簡紹了單片機產生高精度正弦波的方法

    標簽: 單片機 頻率 正弦波

    上傳時間: 2013-04-24

    上傳用戶:a296386173

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