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這本書是多年來(lái)我對(duì)專業(yè)程式員所做的C++ 教學(xué)課程下的一個(gè)自然產(chǎn)物。我發(fā)現(xiàn)，大部份學(xué)生在一個(gè)星期的密集訓(xùn)練之後，即可適應(yīng)這個(gè)語(yǔ)言的基本架構(gòu)，但要他們「將這些基礎(chǔ)架構(gòu)以有效的方式組合運(yùn)用」，我實(shí)在不感樂(lè)觀。於是我開始嘗試組織出一些簡(jiǎn)短、明確、容易記憶的準(zhǔn)則，做為C++ 高實(shí)效性程式開發(fā)過(guò)程之用。那都是經(jīng)驗(yàn)豐富的C++ 程式員幾乎總是會(huì)奉行或幾乎肯定要避免的一些事情。structures of computer science.
標(biāo)簽： 程式
上傳時(shí)間： 2016-10-13
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自組織映射網(wǎng)路(SOM) ，一種以競(jìng)爭(zhēng)架構(gòu)為學(xué)習(xí)基礎(chǔ)的類神經(jīng)網(wǎng)路模式 SOM網(wǎng)路是模仿腦神經(jīng)細(xì)胞『物以類聚』的特性
上傳時(shí)間： 2017-01-07
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幫助系統(tǒng)工程師，設(shè)計(jì)者，管理者在電視廣播上可以順利的傳輸類比訊號(hào)至數(shù)位訊號(hào)之基礎(chǔ)技術(shù)
上傳時(shí)間： 2014-01-07
上傳用戶：lht618
Smarty 入門 不過(guò)因?yàn)橛嗅槍?duì)舊有的內(nèi)容做一些小調(diào)整，所以這次把它放回到自己的 Blog 裡。 序言 剛開始接觸樣版引擎的 PHP 設(shè)計(jì)師，聽到 Smarty 時(shí)，都會(huì)覺(jué)得很難。其實(shí)筆者也不例外，碰都不敢碰一下。但是後來(lái)在剖析 XOOPS 的程式架構(gòu)時(shí)，開始發(fā)現(xiàn) Smarty 其實(shí)並不難。只要將 Smarty 基礎(chǔ)功練好，在一般應(yīng)用上就已經(jīng)相當(dāng)足夠了。當(dāng)然基礎(chǔ)能打好，後面的進(jìn)階應(yīng)用也就不用怕了。 這次的更新，主要加上了一些概念性的東西，當(dāng)然也有一些進(jìn)階的技巧。不過(guò)這些也許早已深入大家的程式之中，如果有更好的觀點(diǎn)，也歡迎大家能夠回饋。
標(biāo)簽： Smarty
上傳時(shí)間： 2014-12-01
上傳用戶：鳳臨西北
h264_and_mpeg4_video_compressed 英文書 原文電子檔 為h264_and_mpeg4之基礎(chǔ)教科書
標(biāo)簽： h264基礎(chǔ)
上傳時(shí)間： 2015-05-01
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GMSK基帶系統(tǒng)仿真 本試驗(yàn)是用數(shù)字基帶處理方法來(lái)實(shí)現(xiàn)調(diào)試期算法的基帶硬件實(shí)驗(yàn)。 通過(guò)用軟件matlab進(jìn)行了GMSK相位路徑和眼圖的仿真,之后對(duì)任何一種五位隨機(jī)碼，每周期八次的任一抽樣時(shí)刻，和任一相位區(qū)域(0、1、2、3)的任一組合，計(jì)算出相位 ，并對(duì) 以及 進(jìn)行1024位的量化、編碼成10位二進(jìn)制碼表。進(jìn)一步利用matlab從上述的碼表得出GMSK基帶波形的眼圖，和理論上計(jì)算的眼圖比較，一致性很好。
標(biāo)簽： GMSK matlab 仿真 基帶系統(tǒng)
上傳時(shí)間： 2013-12-10
上傳用戶：zukfu
本試驗(yàn)是用數(shù)字基帶處理方法來(lái)實(shí)現(xiàn)調(diào)試期算法的基帶硬件實(shí)驗(yàn)。 通過(guò)用軟件matlab進(jìn)行了GMSK相位路徑和眼圖的仿真,之后對(duì)任何一種五位隨機(jī)碼，每周期八次的任一抽樣時(shí)刻，和任一相位區(qū)域(0、1、2、3)的任一組合，計(jì)算出相位 ，并對(duì) 以及 進(jìn)行1024位的量化、編碼成10位二進(jìn)制碼表。進(jìn)一步利用matlab從上述的碼表得出GMSK基帶波形的眼圖，和理論上計(jì)算的眼圖比較，一致性很好。(眼圖主程序)
標(biāo)簽： matlab GMSK 數(shù)字基帶 處理方法
上傳時(shí)間： 2016-08-29
上傳用戶：dave520l
用vhdl硬件語(yǔ)言實(shí)現(xiàn)數(shù)字調(diào)制系統(tǒng)基帶碼發(fā)生器
標(biāo)簽： vhdl 硬件 數(shù)字調(diào)制 基帶
上傳時(shí)間： 2014-01-10
上傳用戶：helmos
有源電力濾波器是一種新型諧波，無(wú)功補(bǔ)償裝置。和傳統(tǒng)無(wú)源的補(bǔ)償裝置相比，有源電力濾波器具有很大的優(yōu)勢(shì)，可以對(duì)諧波，無(wú)功以及負(fù)序電流實(shí)現(xiàn)實(shí)時(shí)、準(zhǔn)確的補(bǔ)償。因此，有源電力濾波器得到了廣泛的研究，并開始進(jìn)入工業(yè)應(yīng)用階段。隨著數(shù)字信號(hào)處理技術(shù)的高速發(fā)展，以全數(shù)字化控制技術(shù)實(shí)現(xiàn)的有源電力濾波器必將成為電力電子技術(shù)中新的研究熱點(diǎn)。 本論文闡述了諧波抑制的背景和目的以及國(guó)內(nèi)外諧波抑制技術(shù)的發(fā)展現(xiàn)狀，深入分析、比較了目前常用的有源濾波器的結(jié)構(gòu)和工作原理，本論文探討了單相系統(tǒng)的諧波檢測(cè)算法的各種方案及其特點(diǎn)，選用負(fù)荷電流基波有功分量法對(duì)諧波電流進(jìn)行檢測(cè)。該方法結(jié)構(gòu)簡(jiǎn)單，不僅適用于單相系統(tǒng)而且適用于三相系統(tǒng)。本文對(duì)單相有源電力濾波器進(jìn)行了硬件和軟件設(shè)計(jì)，對(duì)各硬件部分實(shí)現(xiàn)的功能進(jìn)行了具體的介紹，并給出了實(shí)現(xiàn)原理圖。軟件設(shè)計(jì)部分給出了主要程序的設(shè)計(jì)流程圖。以上設(shè)計(jì)方案在MATLAB 仿真軟件包的SIMULINK 環(huán)境下進(jìn)行了仿真實(shí)現(xiàn)，仿真結(jié)果證實(shí)了本文設(shè)計(jì)的有源電力濾波器的正確性和諧波補(bǔ)償?shù)膶?shí)時(shí)性。 在理論分析和仿真研究的基礎(chǔ)上，設(shè)計(jì)了基于TMS320F2812 DSP 控制的單相并聯(lián)型電力有源濾波器，研制了實(shí)驗(yàn)樣機(jī)，對(duì)并聯(lián)型有源電力濾波器進(jìn)行了初實(shí)驗(yàn)結(jié)果表明，本論文采用的負(fù)載電流基波有功分量算法能夠?qū)崟r(shí)，準(zhǔn)確地提取出諧波和無(wú)功分量，同時(shí)也表明，這種基于TMS320F2812 DSP 的單相有源電力濾波器具有優(yōu)良的諧波補(bǔ)償特性。
上傳時(shí)間： 2013-06-19
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近幾年來(lái)，OFDM(Orthogonal Frequency Division Multiplexing)技術(shù)引起了人們的廣泛注意，根據(jù)這項(xiàng)新技術(shù)，很多相關(guān)協(xié)議被提出來(lái)。其中WiMax(Wireless MetropolitanArea Networks)代表空中接口滿足IEEE 802.16標(biāo)準(zhǔn)的寬帶無(wú)線通信系統(tǒng)，IEEE標(biāo)準(zhǔn)在2004年定義了空中接口的物理層(PHY)，即802.16d協(xié)議。該協(xié)議規(guī)定數(shù)據(jù)傳輸采用突發(fā)模式，調(diào)制方式采用OFDM技術(shù)，傳輸速率較高且實(shí)現(xiàn)方便、成本低廉，已經(jīng)成為首先推廣應(yīng)用的商業(yè)化標(biāo)準(zhǔn)。 本文主要對(duì)IEEE802.16d OFDM系統(tǒng)物理層進(jìn)行研究，并在XILINX公司的Virtexpro II芯片上實(shí)現(xiàn)了基帶算法。 首先討論了OFDM基本原理及其關(guān)鍵技術(shù)。根據(jù)IEEE802.16d OFDM系統(tǒng)的物理層發(fā)送端流程搭建了基帶仿真鏈路，利用MATLAB/SIMULINK仿真了OFDM系統(tǒng)在有無(wú)循環(huán)前綴(CP)、多徑數(shù)目不同等情況下的性能變化。由于同步算法和信道估計(jì)算法計(jì)算量都很大，為了找到適合采用FPGA實(shí)現(xiàn)的算法，分析了同步誤差和不同信道估計(jì)算法對(duì)接收信號(hào)的影響，并結(jié)合計(jì)算量的大小提出了一種新的聯(lián)合同步算法，以及得出了LS信道估計(jì)算法最適合802.16d系統(tǒng)的結(jié)論。 其次，完成了基帶發(fā)射機(jī)和接收機(jī)的FPGA硬件電路實(shí)現(xiàn)。為了使系統(tǒng)的時(shí)鐘頻率更高，采用了流水線的結(jié)構(gòu)。設(shè)計(jì)中采用編寫Verilog程序和使用IP核相結(jié)合的辦法，實(shí)現(xiàn)了新的聯(lián)合同步算法，并且通過(guò)簡(jiǎn)化結(jié)構(gòu)，避免了信道估計(jì)算法中的繁瑣除法。利用ISE9. 2i和Modelsim6.Oc軟件平臺(tái)對(duì)程序進(jìn)行設(shè)計(jì)、綜合和仿真，并將仿真結(jié)果和MATLAB軟件計(jì)算結(jié)果相對(duì)比。結(jié)果表明，采用16位數(shù)據(jù)總線可達(dá)到理想的精度。 最后，采用串口通信的方式對(duì)基帶系統(tǒng)進(jìn)行了驗(yàn)證。通過(guò)串口通信從功能上表明該系統(tǒng)確實(shí)可行。 關(guān)鍵詞：IEEE802. 16d； OFDM； 同步；信道估計(jì)；基帶系統(tǒng)
上傳時(shí)間： 2013-07-31
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