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硬線邏輯

  • BusHound.rar

    BusHound軟件是由美國(guó)perisoft公司研制的一種專用于PC機(jī)各種總線數(shù)據(jù)包監(jiān)視和控制的開(kāi)發(fā)工具軟件,其名“hound”的中文意思為“獵犬”,即指其能敏銳地感知到總線的絲毫變化。 Bus Hound是一個(gè)超級(jí)軟件總線協(xié)議分析器,用于捕捉來(lái)自設(shè)備的協(xié)議包和輸入輸出操作,其優(yōu)良特性如下: 支持所有版本的IDE,SCSI,USB,1394總線 支持各類設(shè)備如硬盤庫(kù),DVD,鼠標(biāo),掃描儀,網(wǎng)絡(luò)照相機(jī)等 捕捉數(shù)據(jù)的總量?jī)H受機(jī)器內(nèi)存限制 可以設(shè)置觸發(fā)信號(hào)自動(dòng)停止捕獲操作 測(cè)試讀取,同步等設(shè)備性能

    標(biāo)簽: BusHound

    上傳時(shí)間: 2013-06-14

    上傳用戶:康郎

  • USB總線監(jiān)視工具.rar

    是一個(gè)超級(jí)軟件總線協(xié)議分析器,用于捕捉來(lái)自設(shè)備的協(xié)議包和輸入輸出操作,其優(yōu)良特性如下: 支持所有版本的IDE,SCSI,USB,1394總線 支持各類設(shè)備如硬盤庫(kù),DVD,鼠標(biāo),掃描儀,網(wǎng)絡(luò)照相機(jī)等 支持Windows9X,WindowsMe

    標(biāo)簽: USB 總線 監(jiān)視

    上傳時(shí)間: 2013-04-24

    上傳用戶:huangzr5

  • 基于FPGA的直擴(kuò)調(diào)制解調(diào)器

    擴(kuò)頻通信系統(tǒng)與常規(guī)的通信系統(tǒng)相比,具有很強(qiáng)的抗窄帶干擾,抗多徑干擾,抗人為干擾的能力,并具有信息隱蔽、多址保密通信等優(yōu)點(diǎn)。在近年來(lái)得到了迅速的發(fā)展。本論文主要討論和實(shí)現(xiàn)了基于FPGA的直接序列擴(kuò)頻信號(hào)的解擴(kuò)解調(diào)處理。論文對(duì)該直擴(kuò)通信系統(tǒng)和FPGA設(shè)計(jì)方法進(jìn)行了相關(guān)研究,最后用Altera公司的最新的FPGA開(kāi)發(fā)平臺(tái)Quarus Ⅱ5.0實(shí)現(xiàn)了相關(guān)設(shè)計(jì)。 整個(gè)系統(tǒng)分為兩個(gè)部分,發(fā)送部分和接收部分。發(fā)送部分主要有串并轉(zhuǎn)換、差分卷積編碼、PN碼擴(kuò)頻、QPSK調(diào)制、成型濾波等模塊。接收部分主要有前端抗干擾、數(shù)字下變頻、解擴(kuò)解調(diào)等模塊。 論文首先介紹了擴(kuò)頻通信系統(tǒng)的特點(diǎn)以及相關(guān)技術(shù)的國(guó)內(nèi)外發(fā)展現(xiàn)狀,并介紹了本論文的研究思路和內(nèi)容。 然后,論文分析了幾種常用的窄帶干擾抑制、載波同步及PN碼同步算法,結(jié)合實(shí)際需要,設(shè)計(jì)了一種零中頻DSSS解調(diào)解擴(kuò)方案。給出了抗窄帶干擾、PN碼捕獲及跟蹤以及載波同步的算法分析,采用了基于數(shù)字外差調(diào)制的自適應(yīng)陷波器來(lái)進(jìn)行前端窄帶干擾抑制處理,用基于自適應(yīng)門限技術(shù)的滑動(dòng)相關(guān)捕獲和分時(shí)復(fù)用單相關(guān)器跟蹤來(lái)改善PN碼同步的性能,用基于硬判決的COSTAS(科斯塔斯)環(huán)來(lái)減少載波提取的算法復(fù)雜度,用改進(jìn)型CORDIC算法實(shí)現(xiàn)NCO來(lái)方便的進(jìn)行擴(kuò)展。 接著,論文給出了系統(tǒng)總體設(shè)計(jì)和發(fā)送及接受子系統(tǒng)的各個(gè)功能模塊的實(shí)現(xiàn)分析以及在Quartus Ⅱ5.0上的實(shí)現(xiàn)細(xì)節(jié),給出了仿真結(jié)果。 然后論文介紹了整個(gè)系統(tǒng)的硬件電路設(shè)計(jì)和它在真實(shí)系統(tǒng)中連機(jī)調(diào)試所得到的測(cè)試結(jié)果,結(jié)果表明該系統(tǒng)具有性能穩(wěn)定,靈活性好,生產(chǎn)調(diào)試容易,體積小,便于升級(jí)等特點(diǎn)并且達(dá)到課題各項(xiàng)指標(biāo)的要求。 最后是對(duì)論文工作的一些總結(jié)和對(duì)今后工作的展望。

    標(biāo)簽: FPGA 調(diào)制解調(diào)器

    上傳時(shí)間: 2013-07-04

    上傳用戶:yd19890720

  • 實(shí)時(shí)三維信息獲取系統(tǒng)

    三維彩色信息獲取系統(tǒng)目的是獲取對(duì)象的三維空間坐標(biāo)和顏色信息。它是計(jì)算機(jī)視覺(jué)研究的重要內(nèi)容,也是當(dāng)前信息科學(xué)研究中的一個(gè)重要熱點(diǎn)。 本文首先介紹了三維信息獲取技術(shù)的意義和實(shí)時(shí)可重構(gòu)三維激光彩色信息獲取系統(tǒng)總體方案。該方案合理劃分了系統(tǒng)的圖像處理任務(wù),充分地利用了擁有的硬、軟件資源。闡述了基于FPGA處理器的硬件系統(tǒng)結(jié)構(gòu)及其工作原理和系統(tǒng)工作時(shí)序。 本文還研究了圖像處理系統(tǒng)中的數(shù)字邏輯設(shè)計(jì),總結(jié)出了較完整、規(guī)范化的設(shè)計(jì)流程和方法,介紹了從圖像處理算法到可編程邏輯器件的規(guī)范化映射方法,總結(jié)了在視頻系統(tǒng)中的高級(jí)設(shè)計(jì)技巧,包括并行流水線技術(shù)和循環(huán)結(jié)構(gòu)的硬件實(shí)現(xiàn)方式等。 為了說(shuō)明提出的設(shè)計(jì)方法,本文分析了基于自適應(yīng)閾值的結(jié)構(gòu)光條紋中心的方向模板快速檢測(cè)算法的硬件實(shí)現(xiàn)。該算法是把自適應(yīng)閾值法與可變方向模板法相結(jié)合,具有穩(wěn)定性好、精度高、計(jì)算簡(jiǎn)單、數(shù)據(jù)存儲(chǔ)量小、實(shí)現(xiàn)速度快的特點(diǎn),此外,該方法有利于硬件快速實(shí)現(xiàn)。實(shí)踐證明這種方法是實(shí)用的、有效的。 本文的重點(diǎn)在于研制了具有完全自主知識(shí)產(chǎn)權(quán)的實(shí)時(shí)可重構(gòu)三維激光彩色信息獲取系統(tǒng)中視頻圖像處理專用集成電路。該集成電路是實(shí)現(xiàn)系統(tǒng)快速算法的核心,使用現(xiàn)場(chǎng)可編程器FPGA器件EPlK50實(shí)現(xiàn)提取激光線、提取人頭輪廓線和提取中心顏色線算法;該集成電路還要實(shí)現(xiàn)系統(tǒng)所需的控制邏輯??刂撇糠职▽⒁曨l采集輸出端口信號(hào)轉(zhuǎn)化為RGB真彩色信號(hào)的數(shù)據(jù)鎖存模塊、各FIFO緩存器的輸入輸出控制模塊和系統(tǒng)需要的其它信號(hào)控制模塊。提出提取輪廓線快速算法,即由FPGA處理器與主機(jī)交互式共同快速完成提取人頭正側(cè)影輪廓線算法。該專用集成電路研制是整個(gè)實(shí)時(shí)可重構(gòu)三維激光彩色信息獲取系統(tǒng)實(shí)現(xiàn)的關(guān)鍵。

    標(biāo)簽:

    上傳時(shí)間: 2013-07-23

    上傳用戶:lguotao

  • 船用導(dǎo)航雷達(dá)數(shù)字信號(hào)處理設(shè)計(jì)

    當(dāng)今的船用導(dǎo)航雷達(dá)具有數(shù)字化、多功能、高性能、多接口、網(wǎng)絡(luò)化。同時(shí)要求具有高可靠性、高集成度、低成本,信號(hào)處理單元的小型化,產(chǎn)品更新周期短。要同時(shí)滿足上述需求,高集成度的器件應(yīng)用是必須的。同時(shí)開(kāi)發(fā)周期要短,需求軟件的可移植性要強(qiáng),并且是模塊化設(shè)計(jì),現(xiàn)場(chǎng)可編程門陣列器件(FPGA)已經(jīng)成為設(shè)計(jì)首選。 現(xiàn)場(chǎng)可編程門陣列是基于通過(guò)可編程互聯(lián)連接的可配置邏輯塊(CLB)矩陣的可編程半導(dǎo)體器件。與為特殊設(shè)計(jì)而定制的專用集成電路(ASIC)相對(duì),F(xiàn)PGA可以針對(duì)所需的應(yīng)用或功能要求進(jìn)行編程。雖然具有一次性可編程(OTP)FPGA,但是主要是基于SRAM的,其可隨著設(shè)計(jì)的演化進(jìn)行重編程。CLB是FPGA內(nèi)的基本邏輯單元。實(shí)際數(shù)量和特性會(huì)依器件的不同而不同,但是每個(gè)CLB都包含一個(gè)由4或6個(gè)輸入、一些選型電路(多路復(fù)用器等)和觸發(fā)器組成的可配置開(kāi)關(guān)矩陣。開(kāi)關(guān)矩陣是高度靈活的,可以進(jìn)行配置以便處理組合邏輯、移位寄存器或RAM。當(dāng)今的FPGA已經(jīng)遠(yuǎn)遠(yuǎn)超出了先前版本的基本性能,并且整合了常用功能(如RAM、時(shí)鐘管理和:DSP)的硬(ASIC型)塊。由于具有可編程特性,所以FPGA是眾多市場(chǎng)的理想之選。它高集成度,以及用于設(shè)計(jì)的強(qiáng)大軟件平臺(tái)、IP核、在線升級(jí)可滿足需求。 本文介紹了基于FPGA實(shí)現(xiàn)船用導(dǎo)航雷達(dá)數(shù)字信號(hào)處理的設(shè)計(jì),這是一個(gè)具體的、已經(jīng)完成并進(jìn)行小批量生產(chǎn)的產(chǎn)品,對(duì)指導(dǎo)實(shí)踐具有一定意義。

    標(biāo)簽: 導(dǎo)航雷達(dá) 數(shù)字信號(hào)處理

    上傳時(shí)間: 2013-04-24

    上傳用戶:稀世之寶039

  • PCI的LAYOUT注意事項(xiàng)及特性阻抗

    主版上有很多PCI的介面可以利用,他的LAYOUT有一些注意事項(xiàng)及必須處理走線的特性阻抗才可以讓系統(tǒng)穩(wěn)定。

    標(biāo)簽: LAYOUT PCI 特性阻抗

    上傳時(shí)間: 2013-06-14

    上傳用戶:夢(mèng)雨軒膂

  • DVBT系統(tǒng)中內(nèi)編解碼模塊的軟件仿真

    數(shù)字電視按傳輸方式分為地面、衛(wèi)星和有線三種。其中,DVB-S和DVB-C這兩個(gè)全球化的衛(wèi)星和有線傳輸方式標(biāo)準(zhǔn),目前已作為世界統(tǒng)一標(biāo)準(zhǔn)被大多數(shù)國(guó)家所接受。而對(duì)于地面數(shù)字電視廣播標(biāo)準(zhǔn),經(jīng)國(guó)際電訊聯(lián)盟(ITU)批準(zhǔn)的共有三個(gè),包括歐盟的DVB-T(Digital Video Broadcasting-Terrestrial,數(shù)字視頻地面廣播)標(biāo)準(zhǔn)、美國(guó)的ATSC(Advanced Television System Committee,先進(jìn)電視制式委員會(huì))標(biāo)準(zhǔn)和日本的ISDB-T(Terrestrial Integrated Services DigitalBroadcasting,綜合業(yè)務(wù)數(shù)字廣播)標(biāo)準(zhǔn)。綜合比較起來(lái),歐洲的DVB-T標(biāo)準(zhǔn)在技術(shù)及應(yīng)用實(shí)踐上都更加成熟。 本論文首先介紹了DVB-T系統(tǒng)的主要結(jié)構(gòu),針對(duì)DVB-T標(biāo)準(zhǔn)中各模塊的實(shí)現(xiàn)進(jìn)行了闡述,并根據(jù)發(fā)射機(jī)端各個(gè)模塊討論了接收機(jī)端相關(guān)模塊的算法設(shè)計(jì)。 隨后,論文給出了基于Microsoft Visual Studio 2005平臺(tái)實(shí)現(xiàn)的數(shù)字電視基帶信號(hào)產(chǎn)生與接收的軟件仿真系統(tǒng)的總體設(shè)計(jì)流程,重點(diǎn)討論了內(nèi)編解碼器和內(nèi)交織/解交織器的算法與實(shí)現(xiàn),并在實(shí)現(xiàn)的多參數(shù)可選的數(shù)字電視基帶信號(hào)產(chǎn)生與接收軟件仿真平臺(tái)上,重點(diǎn)分析了內(nèi)編/解碼模塊在接收端Viterbi譯碼算法中采用硬判決、簡(jiǎn)化軟判決以及不同調(diào)制方式時(shí)對(duì)DVB-T系統(tǒng)整體性能的影響。 最后,論文討論了內(nèi)碼譯碼算法的實(shí)現(xiàn)改進(jìn),使得Viterbi譯碼更適合在FPGA上實(shí)現(xiàn),同時(shí)針對(duì)邏輯設(shè)計(jì)進(jìn)行優(yōu)化以便節(jié)省硬件資源。論文重點(diǎn)討論了對(duì)幸存路徑信息存儲(chǔ)譯碼模塊的改進(jìn),比較了此模塊三種不同的實(shí)現(xiàn)方式帶來(lái)的硬件速率和資源的優(yōu)劣,通過(guò)利用4塊RAM對(duì)幸存路徑信息的交互讀寫,完成了對(duì)傳統(tǒng)回溯算法的改進(jìn),實(shí)現(xiàn)了加窗回溯的譯碼輸出,同時(shí)實(shí)現(xiàn)了回溯長(zhǎng)度可配置以實(shí)現(xiàn)系統(tǒng)不同的性能要求。

    標(biāo)簽: DVBT 模塊 編解碼

    上傳時(shí)間: 2013-08-02

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  • FPGA低功耗布局布線算法的研究

    本文對(duì)嵌入硬核的FPGA布線通道寬度分布和改進(jìn)FPGA布局算法進(jìn)行了研究。文章在嵌入硬核的FPGA布線通道寬度分布研究中,引入了四種架構(gòu),其布線通道寬度分布函數(shù)分別為均勻、脈沖、高斯和三角分布。通過(guò)修改VPR工具的源代碼,使平臺(tái)適用于具有嵌入硬核的FPGA架構(gòu),利用MCNC基準(zhǔn)電路來(lái)測(cè)試這四種架構(gòu)的性能。實(shí)驗(yàn)結(jié)果表明:在以網(wǎng)線平均長(zhǎng)度作為指標(biāo)的測(cè)試中,通道寬度均勻分布的架構(gòu)具有更短的布線長(zhǎng)度、更優(yōu)的性能。

    標(biāo)簽: FPGA 低功耗 布局布線 法的研究

    上傳時(shí)間: 2013-06-27

    上傳用戶:xsnjzljj

  • 《從算法設(shè)計(jì)到硬件邏輯的實(shí)現(xiàn)》

    ·本書(shū)是《從算法設(shè)計(jì)到硬線邏輯的實(shí)現(xiàn)——復(fù)雜數(shù)字邏輯系統(tǒng)的Verilog HDL設(shè)計(jì)技術(shù)和方法》的配套用書(shū)。主要內(nèi)容包括12個(gè)實(shí)驗(yàn)練習(xí)和Verilog的語(yǔ)法手冊(cè)。各個(gè)實(shí)驗(yàn)由淺入深,從簡(jiǎn)單到復(fù)雜,介紹了用Verilog語(yǔ)言設(shè)計(jì)數(shù)字電路系統(tǒng)的實(shí)用方法與技術(shù),有較強(qiáng)的實(shí)踐性與指導(dǎo)意義。語(yǔ)法部分包括標(biāo)志符的使用、基本語(yǔ)句以及系統(tǒng)任務(wù)與函數(shù)的介紹。內(nèi)容較為詳盡,可方便學(xué)生與工程技術(shù)人員查詢使用,對(duì)學(xué)習(xí)Veri

    標(biāo)簽: 算法設(shè)計(jì) 硬件 邏輯

    上傳時(shí)間: 2013-06-30

    上傳用戶:萬(wàn)有引力

  • Android音頻實(shí)時(shí)傳輸與播放--客戶端

    Android音頻實(shí)時(shí)傳輸與播放, 實(shí)現(xiàn)音頻的硬編碼和實(shí)時(shí)播放。

    標(biāo)簽: Android 音頻 實(shí)時(shí)傳輸 播放

    上傳時(shí)間: 2013-04-24

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