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移位器
基于fpga和sopc的用VHDL語言編寫的EDA移位相加硬件乘法器
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CRC校驗(yàn)串行實(shí)現(xiàn)方法,verilog源碼,利用反饋線性移位寄存器的方法,實(shí)現(xiàn)簡(jiǎn)單,適用于串行通信協(xié)議中的CRC校驗(yàn).
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除法器的設(shè)計(jì)本文所采用的除法原理是：對(duì)于八位無符號(hào)被除數(shù)A
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I0口驅(qū)動(dòng)74LS164,8位同步移位寄存器
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此函數(shù)用來生成最大長度線性移位寄存器序列(m序列)
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CD4094的驅(qū)動(dòng)程序8位移位存儲(chǔ)總線寄存器 NSC/TI/PHI
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摘要: 基于AT89C2051 單片機(jī)設(shè)計(jì)步進(jìn)電機(jī)的驅(qū)動(dòng)電路. 以單片機(jī)AT89C2051 和移位寄存器CD4094 為主要元 件構(gòu)建步進(jìn)電機(jī)驅(qū)動(dòng)電路, 電路以CP 脈沖為復(fù)位信號(hào), 提高了電路的抗
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摘要: 基于AT89C2051 單片機(jī)設(shè)計(jì)步進(jìn)電機(jī)的驅(qū)動(dòng)電路. 以單片機(jī)AT89C2051 和移位寄存器CD4094 為主要元 件構(gòu)建步進(jìn)電機(jī)驅(qū)動(dòng)電路, 電路以CP 脈沖為復(fù)位信號(hào), 提高了電路的抗
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采用串行移位寄存器74HC595靜態(tài)顯示7段碼
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電子通信系統(tǒng)的建模與仿真 第4章 電子線路仿真試驗(yàn) 4.1 信號(hào)合并 4.2 微積分 4.3 觸發(fā)器 4.4 分頻器 4.5 使能開關(guān) 4.6 編程開關(guān) 4.7 移位寄存器
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