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移動虛擬

  • Verilog HDL的程式

    Verilog HDL的程式，上網找到SPI程式， vspi.v這程式相當好用可用來接收與傳送SPI，並且寫了一個傳輸信號測試，spidatasent.v這程式就是傳送的資料，分別為00 66... 01 77...... 02 55這樣的資料，並透過MAX+PULS II軟體進行模擬，而最外層的程式是test_createspi.v！

    標簽： Verilog HDL 程式

    上傳時間： 2017-03-06

    上傳用戶：onewq

  • 作者的課外作業

    作者的課外作業，模擬封包(packet)標頭，將之轉成二進制，再顯示二進制的相加結果，再做一的補數。 （並附上html檔，不會java的，直接開啟html即可執行）

    標簽：

    上傳時間： 2014-01-06

    上傳用戶：xjz632

  • 單片機I@C程序庫

    單片機I@C程序庫，很容易移槙，我已用過N多次，很好用

    標簽： 單片機 程序庫

    上傳時間： 2013-12-18

    上傳用戶：xiaoxiang

  • 很多網友說周立功Keil For ARM工程模板在RealVeiw MDK中編譯時會出現錯誤

    很多網友說周立功Keil For ARM工程模板在RealVeiw MDK中編譯時會出現錯誤，所以很多人在期盼周立功出一個在RealVeiw MDK編譯的工程模板，因為原來的只有ADS和原KEIL的工程模板。 在次我將周立功原Keil For ARM的EasyARM2100工程模板修改，移到RealVeiw MDK編譯器上。適用于LPC2100系列

    標簽： RealVeiw Keil For ARM

    上傳時間： 2017-03-15

    上傳用戶：sammi

  • 很多網友說周立功Keil For ARM工程模板在RealVeiw MDK中編譯時會出現錯誤

    很多網友說周立功Keil For ARM工程模板在RealVeiw MDK中編譯時會出現錯誤，所以很多人在期盼周立功出一個在RealVeiw MDK編譯的工程模板，因為原來的只有ADS和原KEIL的工程模板。 在次我將周立功原Keil For ARM的EasyARM2100工程模板修改，移到RealVeiw MDK編譯器上。適用于LPC2200系列

    標簽： RealVeiw Keil For ARM

    上傳時間： 2014-01-09

    上傳用戶：stewart·

  • 本章描述如何從µ C/OS 升級到 µ C/OS-II。如果已經將µ C/OS移植到了某類微處理器上

    本章描述如何從µ C/OS 升級到 µ C/OS-II。如果已經將µ C/OS移植到了某類微處理器上，移 植µ C/OS-II所要做的工作應當非常有限。在多數情況下，用戶能夠在1個小時之內完成這項工作。如果用戶熟悉µ C/OS的移植，可隔過本章前一部分直接參閱10.05節。

    標簽： micro OS-II OS 移植

    上傳時間： 2017-03-28

    上傳用戶：dyctj

  • 流媒體系統

    流媒體系統，直播時移設計方案，思路以及實現方式等

    標簽： 流媒體系統

    上傳時間： 2013-12-30

    上傳用戶：lanwei

  • 。使用Java語言來開發一個簡單的游戲一直以來是我的想法

    。使用Java語言來開發一個簡單的游戲一直以來是我的想法，游戲程序是比較復雜的，其中涉及到大量的編程技術，游戲中加載了圖片、動畫、聲音等功能。 相傳古印度，布拉瑪婆羅門圣廟的僧侶常進行一種被叫稱為漢偌塔的游戲，其裝置是一塊銅板，上面有三根柱子，第一個柱子自下而上、由大到小按順序串上64個金盤，游戲的目標是把第一個柱子上的金盤全部移到第三個柱子上，并按原有順序疊好，條件是每次移動都不許將大盤移到小盤上。

    標簽： Java 語言

    上傳時間： 2014-01-17

    上傳用戶：weixiao99

  • VHDL實現的桶型移位器

    VHDL實現的桶型移位器，能在一個時鐘周期實現對數據的（0－12位）算術右移

    標簽： VHDL 移位器

    上傳時間： 2017-04-16

    上傳用戶：hustfanenze

  • 目 錄 第一章 VHDL文本輸入設計方法 1.1 編輯輸入并存盤VHDL原文件 1.2 將當前設計設定為工程 1.3 選擇VHDL文本編譯版本號和排錯 1.4 時序仿真 1.5 硬件測試 1.

    目 錄 第一章 VHDL文本輸入設計方法 1.1 編輯輸入并存盤VHDL原文件 1.2 將當前設計設定為工程 1.3 選擇VHDL文本編譯版本號和排錯 1.4 時序仿真 1.5 硬件測試 1.6 部分實驗 第二章 全國大學生電子設計競賽賽題練習 2.1 等精度頻率計設計 2.2 數字移相正弦信號發生器設計 2.3 測相儀設計 2.4 邏輯分析相儀設計 2.5 存儲示波器設計

    標簽： VHDL 1.1 1.2 1.3

    上傳時間： 2014-12-02

    上傳用戶：diets

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