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算法分析

  • 基于遺傳算法的0-1背包問題的求解

    基于遺傳算法的0-1背包問題的求解，可進(jìn)一步另深對(duì)遺傳算法理解，學(xué)習(xí)算法分析與設(shè)計(jì)的可以看看

    標(biāo)簽： 算法 背包問題

    上傳時(shí)間： 2017-03-09

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  • 一個(gè)很全很強(qiáng)大的密碼算法庫

    一個(gè)很全很強(qiáng)大的密碼算法庫，是一個(gè)大學(xué)研究機(jī)構(gòu)編寫的，可以用來作算法分析和仿真驗(yàn)證。

    標(biāo)簽： 密碼 算法庫

    上傳時(shí)間： 2017-03-16

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  • 常用算法代碼

    常用算法代碼，cc++實(shí)現(xiàn)，算法分析的代碼

    標(biāo)簽： 算法 代碼

    上傳時(shí)間： 2013-12-27

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  • 計(jì)算機(jī)幾何--算法分析與設(shè)計(jì)

    中國計(jì)算機(jī)學(xué)會(huì)學(xué)術(shù)著作叢書，周培德著作，主講算法設(shè)計(jì)。

    標(biāo)簽： 計(jì)算機(jī) 幾何 算法分析

    上傳時(shí)間： 2017-04-03

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  • 算法導(dǎo)論 中文版

    算法導(dǎo)論 中文版  經(jīng)典算法、算法分析、算法思維。要求有C語言基礎(chǔ)

    標(biāo)簽： 算法

    上傳時(shí)間： 2018-05-20

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  • 算法期末考試題

    算法分析與設(shè)計(jì)的期末考試復(fù)習(xí)題，供大家查閱

    標(biāo)簽： 算法 試題

    上傳時(shí)間： 2019-06-20

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  • （網(wǎng)盤）算法編程書籍大合集

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    標(biāo)簽： 算法

    上傳時(shí)間： 2022-06-06

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  • 數(shù)據(jù)結(jié)構(gòu)和算法相關(guān)資料合集

    數(shù)據(jù)結(jié)構(gòu)1800題.rar 數(shù)據(jù)結(jié)構(gòu)源代碼.7z 168個(gè)數(shù)據(jù)結(jié)構(gòu)源代碼和習(xí)題集.rar C語言快速排序算法.doc 數(shù)據(jù)結(jié)構(gòu)講義 清華大學(xué).rar 數(shù)據(jù)結(jié)構(gòu).doc 數(shù)據(jù)結(jié)構(gòu)各種算法實(shí)現(xiàn)(C++模板).doc 清華大學(xué)嚴(yán)蔚敏編著《數(shù)據(jù)結(jié)構(gòu)(c語言版)》.rar 基于_C++數(shù)據(jù)結(jié)構(gòu)算法演示系統(tǒng).doc C語言經(jīng)典算法100例.doc 2012計(jì)算機(jī)考研大綱解析之?dāng)?shù)據(jù)結(jié)構(gòu).doc 數(shù)據(jù)結(jié)構(gòu)與算法分析_C++版答案.doc c++數(shù)據(jù)結(jié)構(gòu) 練習(xí)代碼.rar C++數(shù)據(jù)結(jié)構(gòu)原理與經(jīng)典問題求解（源代碼）.rar 數(shù)據(jù)結(jié)構(gòu)與算法綜合資料庫.CHM 數(shù)據(jù)結(jié)構(gòu)與算法分析C++描述第三版 PDF 包含(答案) .7z 大話設(shè)計(jì)模式源代碼.rar 數(shù)據(jù)結(jié)構(gòu)源代碼.chm 清華 殷人昆C++數(shù)據(jù)結(jié)構(gòu)課件.rar 嚴(yán)蔚敏《數(shù)據(jù)結(jié)構(gòu)》的全部代碼實(shí)現(xiàn)（C語言）.rar 數(shù)據(jù)結(jié)構(gòu)很好資料含PPT動(dòng)畫以及習(xí)題.zip 數(shù)據(jù)結(jié)構(gòu)習(xí)題解析-面向?qū)ο蠓椒ê虲++語言描述-殷人昆.doc 數(shù)據(jù)結(jié)構(gòu)C++算法.doc 算法導(dǎo)論 第三版英文版 有索引.pdf 數(shù)據(jù)結(jié)構(gòu)復(fù)習(xí)課件.rar 計(jì)算機(jī)科學(xué)中最重要的32個(gè)算法.doc 大話數(shù)據(jù)結(jié)構(gòu)源碼(PlayWithDataStructureSourceCode).rar C++數(shù)據(jù)結(jié)構(gòu)課件.rar 數(shù)據(jù)結(jié)構(gòu)課后習(xí)題答案.doc 數(shù)據(jù)結(jié)構(gòu)算法解析(2008版).rar 數(shù)據(jù)結(jié)構(gòu)算法演示.rar 數(shù)據(jù)結(jié)構(gòu)（C語言版）順序隊(duì)列(完整可運(yùn)行程序).rar 算法導(dǎo)論.rar 數(shù)據(jù)結(jié)構(gòu)與算法分析C語言描述源碼.zip C++數(shù)據(jù)結(jié)構(gòu)源代碼.rar

    標(biāo)簽： VISUAL 指紋 模式識(shí)別

    上傳時(shí)間： 2013-06-01

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  • 10本數(shù)據(jù)結(jié)構(gòu)與算法書籍合集

    算法藝術(shù)與信息學(xué)競(jìng)賽.學(xué)習(xí)指導(dǎo).pdf 算法分析與設(shè)計(jì).pdf 算法帝國.pdf 算法(普林斯頓-Robert Sedgewick).pdf 數(shù)據(jù)結(jié)構(gòu)基礎(chǔ)(C語言版)（第2版）.pdf 數(shù)據(jù)結(jié)構(gòu)基礎(chǔ)(C語言版) (第2版).PDF 數(shù)據(jù)結(jié)構(gòu)(C語言版) - 嚴(yán)蔚敏 吳偉民.pdf 大話數(shù)據(jù)結(jié)構(gòu).pdf 《零基礎(chǔ)學(xué)算法》.pdf 《啊哈！算法》.pdf

    標(biāo)簽： 500 電氣設(shè)計(jì) 禁忌

    上傳時(shí)間： 2013-08-03

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  • DVB系統(tǒng)信道編碼的研究與FPGA實(shí)現(xiàn).rar

    數(shù)字圖像通信的最廣泛的應(yīng)用就是數(shù)字電視廣播系統(tǒng)，與以往的模擬電視業(yè)務(wù)相比，數(shù)字電視在節(jié)省頻譜資源、提高節(jié)目質(zhì)量方面帶來了一場(chǎng)新的革命，而與此對(duì)應(yīng)的DVB（Digital Video Broadcasting）標(biāo)準(zhǔn)的建立更是加速了數(shù)字電視廣播系統(tǒng)的大規(guī)模應(yīng)用。DVB標(biāo)準(zhǔn)選定MPEG—2標(biāo)準(zhǔn)作為音頻及視頻的編碼壓縮方式，隨后對(duì)MPEG—2碼流進(jìn)行打包形成TS流（transport stream），進(jìn)行多個(gè)傳輸流復(fù)用，最后通過不同媒介進(jìn)行傳輸。在DVB標(biāo)準(zhǔn)的傳輸系統(tǒng)中，無論是衛(wèi)星傳輸，電纜傳輸還是地面?zhèn)鬏敚瑸榱吮Ｕ蠄D像質(zhì)量，使數(shù)字節(jié)目在傳輸過程中避免出現(xiàn)因受到各種信道噪聲干擾而出現(xiàn)失真的現(xiàn)象，都采用了信道編碼的方式來保護(hù)傳輸數(shù)據(jù)。信道編碼是數(shù)字通信系統(tǒng)中一個(gè)必需的、重要的環(huán)節(jié)。 信道編碼設(shè)計(jì)方案的優(yōu)劣決定了DVB系統(tǒng)的成功與否，本文重點(diǎn)研究了DVB系統(tǒng)中的信道編碼算法及其FPGA實(shí)現(xiàn)方案，主要進(jìn)行了如下幾項(xiàng)工作： 1）介紹了DVB系統(tǒng)信道編碼的基本概念及特點(diǎn)，深入研究了DVB標(biāo)準(zhǔn)中信道編碼部分的關(guān)鍵技術(shù)，并針對(duì)每個(gè)信道編碼模塊進(jìn)行工作原理分析、算法分析。 2）根據(jù)DVB信道編碼的特點(diǎn)，重點(diǎn)對(duì)信道編碼中四個(gè)模塊，包括擾碼、RS編碼、卷積交織編碼和卷積編碼的FPGA硬件實(shí)現(xiàn)算法進(jìn)行了比較詳細(xì)的分析，并闡述了每個(gè)模塊及QPSK調(diào)制的設(shè)計(jì)方案及實(shí)現(xiàn)模塊功能的程序流程。 3）在RS（204，188）編碼過程中，利用有限域常數(shù)乘法器的特點(diǎn)，對(duì)編碼器進(jìn)行了優(yōu)化，在很大程度上提高了編碼效率，卷積交織器部分采用RAM移位法，實(shí)現(xiàn)起來更為簡單且節(jié)省了FPGA器件內(nèi)部資源。 4）設(shè)計(jì)以Altera公司的QuartusⅡ?yàn)殚_發(fā)平臺(tái)，利用FPGA芯片EP1C6Q240C8完成了信道編碼各模塊及QPSK調(diào)制的硬件實(shí)現(xiàn)，通過Verilog HDL描述和時(shí)序仿真來驗(yàn)證算法的可行性，并給出系統(tǒng)設(shè)計(jì)中減少毛刺的方法，使系統(tǒng)更為穩(wěn)定。最終的系統(tǒng)仿真結(jié)果表明該系統(tǒng)工作穩(wěn)定，達(dá)到了DVB系統(tǒng)信道編碼設(shè)計(jì)的要求。

    標(biāo)簽： FPGA DVB

    上傳時(shí)間： 2013-06-26

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