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級(jí)聯(lián)電路
完整的jpeg encoder verilog code,DCT部分採(cǎi)用1991 IEEE transection paper,利用skew circular convolution來(lái)實(shí)現(xiàn)精簡(jiǎn)電路
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ALTERA PWM電路 這是一個(gè)ALTERA的PWM電路
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使用FPGA設(shè)計(jì)WiMax接收機(jī)之OFDM同步硬體電路(內(nèi)附VHDL code)
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ADS操作影片,教我們?cè)觞Ntuning電路.中文發(fā)音,步驟清楚,非常適合初學(xué)入門(mén)者.希望對(duì)大家有幫助.
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一個(gè)可以計(jì)算分壓電路的源碼。 可透過(guò)輸出與輸入電壓
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是一個(gè)用verilog寫(xiě)成的加法器電路,可把七個(gè)元件加起來(lái)
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使用硬體描述語(yǔ)言HDL 設(shè)計(jì)硬體電路
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5 bits 的加法器與減法器合併電路之原始程式製作
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verilog除頻器可用於編碼段運(yùn)用可以穩(wěn)定電路設(shè)計(jì)
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內(nèi)含fulladder結(jié)構(gòu)檔,電路檔,測(cè)試檔(testbench)以及執(zhí)行檔(.do)
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