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一個用VerilogHDL語言編寫的多路解復(fù)用器

一個用VerilogHDL語言編寫的多路解復(fù)用器

標(biāo)簽： VerilogHDL 語言編寫多路

上傳時間： 2013-12-16

上傳用戶：yph853211
一個8路鍵盤源程序

一個8路鍵盤源程序，很簡單的，沒有用編碼，比較經(jīng)典好用！

標(biāo)簽： 8路鍵盤源程序

上傳時間： 2014-12-03

上傳用戶：onewq
求取系統(tǒng)的絕對幅度響應(yīng)、相對的db值幅度響應(yīng)、相位響應(yīng)和群延時響應(yīng)的函數(shù) ％％db為相對振幅(dB) ％mag為絕對振幅％pha為相位響應(yīng) ％grd為群延時％w為頻率樣本點向量％

求取系統(tǒng)的絕對幅度響應(yīng)、相對的db值幅度響應(yīng)、相位響應(yīng)和群延時響應(yīng)的函數(shù) ％％db為相對振幅(dB) ％mag為絕對振幅％pha為相位響應(yīng) ％grd為群延時％w為頻率樣本點向量％b為Ha(z)分子多項式系數(shù)(對FIR而言，b=h) ％a為Hz(z)分母多項式系數(shù)(對FIR而言，a=1) ％

標(biāo)簽： mag grd pha 幅度

上傳時間： 2014-01-21

上傳用戶：ryb
這是我最近買的一套CPLD開發(fā)板VHDL源程序并附上開發(fā)板的原理圖,希望對你是一個很好的幫助!其中內(nèi)容為:8位優(yōu)先編碼器,乘法器,多路選擇器,二進制轉(zhuǎn)BCD碼,加法器,減法器,簡單狀態(tài)機,四位比較器,

這是我最近買的一套CPLD開發(fā)板VHDL源程序并附上開發(fā)板的原理圖,希望對你是一個很好的幫助!其中內(nèi)容為:8位優(yōu)先編碼器,乘法器,多路選擇器,二進制轉(zhuǎn)BCD碼,加法器,減法器,簡單狀態(tài)機,四位比較器,7段數(shù)碼管,i2c總線,lcd液晶顯示,撥碼開關(guān),串口,蜂鳴器,矩陣鍵盤,跑馬燈,交通燈,數(shù)字時鐘.

標(biāo)簽： CPLD VHDL BCD 開發(fā)板

上傳時間： 2015-07-23

上傳用戶：李夢晗
手機撥接上網(wǎng)一個小範(fàn)例希望能對大家有幫助

手機撥接上網(wǎng)一個小範(fàn)例希望能對大家有幫助

標(biāo)簽： 家

上傳時間： 2015-07-23

上傳用戶：yd19890720
AT89c52單片機六路搶答器匯編語言文件

AT89c52單片機六路搶答器匯編語言文件

標(biāo)簽： 89c c52 AT 89

上傳時間： 2015-07-24

上傳用戶：zgu489
參加挑戰(zhàn)杯之路 !經(jīng)典 ! 這我的親身體會哦! 希望能給大家以幫助!呵呵

參加挑戰(zhàn)杯之路 !經(jīng)典 ! 這我的親身體會哦! 希望能給大家以幫助!呵呵

標(biāo)簽： 家

上傳時間： 2013-12-25

上傳用戶：270189020
北京理工大學(xué)計算機系的并行計算的講義程序員通往架構(gòu)師的必經(jīng)之路

北京理工大學(xué)計算機系的并行計算的講義程序員通往架構(gòu)師的必經(jīng)之路

標(biāo)簽： 理工大學(xué) 并行計算架構(gòu)

上傳時間： 2013-12-27

上傳用戶：yoleeson
mcs51的vhdl IP核,是每個學(xué)習(xí)FPGA的必經(jīng)之路

mcs51的vhdl IP核,是每個學(xué)習(xí)FPGA的必經(jīng)之路，希望一起探討

標(biāo)簽： FPGA vhdl mcs 51

上傳時間： 2014-01-14

上傳用戶：wuyuying
本文檔講解了幾種排序方式的優(yōu)缺點。包含直接插入、希爾、直接選擇、冒泡、快速、堆、二路歸并等排序方式。

本文檔講解了幾種排序方式的優(yōu)缺點。包含直接插入、希爾、直接選擇、冒泡、快速、堆、二路歸并等排序方式。

標(biāo)簽： 排序方式文檔

上傳時間： 2014-01-04

上傳用戶：huyiming139