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基于FPGA流水線CPU控制器的設(shè)計與實(shí)現(xiàn)：在FPGA上設(shè)計并實(shí)現(xiàn)了一種具有MIPS風(fēng)格的CPU硬布線控制器。

基于FPGA流水線CPU控制器的設(shè)計與實(shí)現(xiàn)：在FPGA上設(shè)計并實(shí)現(xiàn)了一種具有MIPS風(fēng)格的CPU硬布線控制器。

標(biāo)簽： FPGA CPU MIPS 控制器

上傳時間： 2013-08-06

上傳用戶：qw12

在多FPGA陣列上實(shí)現(xiàn)SAR距離脈壓

SAR-GMTI_Range_Compression_Implementation_in_FPGAs\\r\\n\\r\\n在多FPGA陣列上實(shí)現(xiàn)SAR距離脈壓，超長點(diǎn)數(shù)脈壓的FPGA實(shí)現(xiàn)

標(biāo)簽： FPGA SAR 陣列 脈壓

上傳時間： 2013-08-09

上傳用戶：13160677563

快速了解FPGA/SOPC（可編程片上系統(tǒng)）開發(fā)的流程

作為一個簡明的教程，主要宗旨是讓初學(xué)者快速地了解FPGA/SOPC（可編程片上系統(tǒng)）開發(fā)的流程。

標(biāo)簽： FPGA SOPC 可編程片上系統(tǒng) 流程

上傳時間： 2013-08-09

上傳用戶：hphh

在Altera的FPGA開發(fā)板上運(yùn)行第一個FPGA程序

在Altera的FPGA開發(fā)板上運(yùn)行第一個FPGA程序，以后我還會陸續(xù)發(fā)布這方面的代碼

標(biāo)簽： FPGA Altera 開發(fā)板 運(yùn)行

上傳時間： 2013-08-10

上傳用戶：windwolf2000

常用數(shù)字邏輯功能都在CPLD器件上用VHDL語言實(shí)現(xiàn)

利用一塊芯片完成除時鐘源、按鍵、揚(yáng)聲器和顯示器（數(shù)碼管）之外的所有數(shù)字電路功能。所有數(shù)字邏輯功能都在CPLD器件上用VHDL語言實(shí)現(xiàn)。這樣設(shè)計具有體積小、設(shè)計周期短（設(shè)計過程中即可實(shí)現(xiàn)時序仿真）、調(diào)試方便、故障率低、修改升級容易等特點(diǎn)

標(biāo)簽： CPLD VHDL 數(shù)字邏輯 器件

上傳時間： 2013-08-11

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FPGA/SOPC開發(fā)教程,片上系統(tǒng)快速入門教程

FPGA/SOPC開發(fā)教程,片上系統(tǒng)快速入門教程

標(biāo)簽： FPGA SOPC 開發(fā)教程 片上系統(tǒng)

上傳時間： 2013-08-12

上傳用戶：redmoons

在FPGA上實(shí)現(xiàn)的出租車計價器VHDL源代碼

在FPGA上實(shí)現(xiàn)的出租車計價器VHDL源代碼\r\n能實(shí)現(xiàn)里程計價、誤時計價等功能

標(biāo)簽： FPGA VHDL 出租車計價器 源代碼

上傳時間： 2013-08-13

上傳用戶：18888888888

用Altera CPLD做為控制器從Flash上讀取image文件

用Altera CPLD做為控制器從Flash上讀取image文件對Altera FPGA編程

標(biāo)簽： Altera Flash image CPLD

上傳時間： 2013-08-13

上傳用戶：zwei41

FPGA開發(fā)板上自帶的LED測試?yán)?/a>

標(biāo)簽： FPGA LED 開發(fā)板 測試

上傳時間： 2013-08-13

上傳用戶：whymatalab2

Altera_FPGA管腳弱上拉電阻的軟件設(shè)置方法

Altera_FPGA管腳弱上拉電阻的軟件設(shè)置方法

標(biāo)簽： Altera_FPGA 管腳 上拉電阻 軟件

上傳時間： 2013-08-13

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