X電容是指跨于L-N之間的電容器， Y電容是指跨于L-G/N-G之間的電容器。(L=Line, N=Neutral, G=Ground).
標(biāo)簽： 電容
上傳時間： 2014-12-23
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Allegro15[1].X培訓(xùn)教材
標(biāo)簽： Allegro 15 培訓(xùn)教材
上傳時間： 2013-10-22
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X電容和Y電容的使用及注意方法
上傳時間： 2013-11-22
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介紹X,Y電容的一片通俗易懂的資料
標(biāo)簽： 電容
上傳時間： 2013-10-30
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隨著我國通信、電力事業(yè)的發(fā)展，通信、電力網(wǎng)絡(luò)的規(guī)模越來越大，系統(tǒng)越來越復(fù)雜。與之相應(yīng)的對交流供電的可靠性、靈活性、智能化、免維護(hù)越來越重要。在中國通信、電力網(wǎng)絡(luò)中，傳統(tǒng)的交流供電方案是以UPS或單機(jī)式逆變器提供純凈不間斷的交流電源。由于控制技術(shù)的進(jìn)步、完善，（N+X）熱插拔模塊并聯(lián)逆變電源已經(jīng)非常成熟、可靠；在歐美的通信、電力發(fā)達(dá)的國家，各大通信運營商、電力供應(yīng)商、軍隊均大量應(yīng)用了這種更合理的供電方案。與其它方案相比較，（N+X）熱插拔模塊并聯(lián)逆變電源具有以下明顯的優(yōu)點。
標(biāo)簽： 熱插拔 模塊 并聯(lián) 應(yīng)用前景
上傳時間： 2014-03-24
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提出了采用兩段式同軸波紋慢波結(jié)構(gòu)實現(xiàn)雙頻高功率微波輸出的相對論返波振蕩器， 推導(dǎo)了該結(jié)構(gòu)的TM0n模式色散方程，數(shù)值求解了兩段式同軸波紋慢波結(jié)構(gòu)TM0n模色散曲線，分析了該器件X波段雙頻高功率微波輸出的產(chǎn)生機(jī)理， 分析中考慮了電子注在慢波結(jié)構(gòu)第二段工作效率不變和下降時的雙頻工作點情況，并運用2.5 維全電磁粒子模擬程序驗證了雙頻微波信號的可靠性。關(guān)鍵詞高功率微波；雙頻；X 波段；相對論返波振蕩器 當(dāng)前， 應(yīng)用于高功率微波效應(yīng)的微波器件只有一個主頻率，已有的實驗結(jié)果表明，在現(xiàn)有條件下，單頻高功率微波用于攻擊敵方的電子系統(tǒng)所需的功率遠(yuǎn)遠(yuǎn)大于單只高功率微波源所能產(chǎn)生的功率，即破壞閾值很高[1]。但是，如果用兩個或多個頻率相近的高功率微波波束產(chǎn)生拍頻后用于攻擊電子系統(tǒng)，那么所需的功率密度將大大減小，即效應(yīng)閾值大大下降， 采用這種方式將有可能在現(xiàn)有的技術(shù)下使高功率微波實用化[2]，但是雙頻及多頻高功率微波源器件的研究目前是十分前沿的課題，處于剛起步階段，在國內(nèi)外極少有報道[2～4]，因而，用單個微波源器件產(chǎn)生穩(wěn)定輸出的雙頻甚至多頻高功率微波具有重要的實際應(yīng)用價值和學(xué)術(shù)價值，是高功率微波領(lǐng)域又一個新興的研究方向， 在高功率微波武器和新體制雷達(dá)等方面將有良好的應(yīng)用前景。
上傳時間： 2013-10-31
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Visual Assist X 10.6.1822.0（VC6.0智能插件）
標(biāo)簽： Visual Assist 1822 6.0
上傳時間： 2013-12-15
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MATLAB5[x]入門與提高.
標(biāo)簽： MATLAB5
上傳時間： 2014-01-25
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Allegro15[1].X培訓(xùn)教材
標(biāo)簽： Allegro 15 培訓(xùn)教材
上傳時間： 2014-01-08
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The Virtex-4 features, such as the programmable IDELAY and built-in FIFO support, simplifythe bridging of a high-speed, PCI-X core to large amounts of DDR-SDRAM memory. Onechallenge is meeting the PCI-X target initial latency specification. PCI-X Protocol Addendum tothe PCI Local Bus Specification Revision 2.0a ([Ref 6]) dictates that when a target signals adata transfer, "the target must do so within 16 clocks of the assertion of FRAME#." PCItermination transactions, such as Split Response/Complete, are commonly used to meet thelatency specifications. This method adds complexity to the design, as well as additional systemlatency. Another solution is to increase the ratio of the memory frequency to the PCI-X busfrequency. However, this solution increases the required power and clock resource usage.
上傳時間： 2013-11-24
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