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  • 北京眾志恒電機(jī)公司-直流-步進(jìn)電機(jī)樣本-40.4M.zip

    專輯類-元器件樣本專輯-116冊(cè)-3.03G 北京眾志恒電機(jī)公司-直流-步進(jìn)電機(jī)樣本-40.4M.zip

    標(biāo)簽: 40.4 zip 電機(jī) 步進(jìn)電機(jī)

    上傳時(shí)間: 2013-06-06

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  • 日本嘉美功-黑金剛-電解電容等產(chǎn)品樣本-175M.zip

    專輯類-元器件樣本專輯-116冊(cè)-3.03G 日本嘉美功-黑金剛-電解電容等產(chǎn)品樣本-175M.zip

    標(biāo)簽: 175 zip 日本 電解電容

    上傳時(shí)間: 2013-07-03

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  • 深圳晶美光電-數(shù)碼管-發(fā)光二極管-像素模塊-點(diǎn)陣-樣本-21.8M.zip

    專輯類-元器件樣本專輯-116冊(cè)-3.03G 深圳晶美光電-數(shù)碼管-發(fā)光二極管-像素模塊-點(diǎn)陣-樣本-21.8M.zip

    標(biāo)簽: 21.8 zip 美光 數(shù)碼管

    上傳時(shí)間: 2013-04-24

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  • 華為技術(shù)公司模擬電子技術(shù)培訓(xùn)教材,PDF格式.rar

    華為技術(shù)公司模擬電子技術(shù)培訓(xùn)教材,PDF格式

    標(biāo)簽: 華為技術(shù) 模擬電子技術(shù)

    上傳時(shí)間: 2013-07-11

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  • 中興公司印制電路板設(shè)計(jì)規(guī)范.rar

    中興公司印制電路板設(shè)計(jì)規(guī)范,很好的標(biāo)準(zhǔn)資料.

    標(biāo)簽: 中興 印制電路板 設(shè)計(jì)規(guī)范

    上傳時(shí)間: 2013-07-05

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  • 華為公司印制電路板設(shè)計(jì)規(guī)范.rar

    華為公司印制電路板設(shè)計(jì)規(guī)范,很好的標(biāo)準(zhǔn)資料.

    標(biāo)簽: 華為公司 印制電路板 設(shè)計(jì)規(guī)范

    上傳時(shí)間: 2013-06-22

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  • 基于FPGA的語音增強(qiáng)算法研究與實(shí)現(xiàn).rar

    現(xiàn)實(shí)生活中的語音不可避免的要受到周圍環(huán)境的影響,背景噪聲例如機(jī)械噪聲、街頭音樂噪音,其他說話者的話音等均會(huì)嚴(yán)重地影響語音信號(hào)的質(zhì)量:此外傳輸系統(tǒng)本身也會(huì)產(chǎn)生各種噪聲,因此接收端的信號(hào)為帶噪語音信號(hào)。混疊在語音信號(hào)中的噪聲按類別可分為環(huán)境噪聲等的加法性噪聲及電器線路干擾等的乘法性噪聲;按性質(zhì)可分為平穩(wěn)噪聲和非平穩(wěn)噪聲。 語音增強(qiáng)的根本目的就是凈化語音質(zhì)量。把不需要的噪音減低到最小程度。但是由于噪音的復(fù)雜性,很難歸納出一個(gè)統(tǒng)一的特征,因此不可能尋求一種算法完全適應(yīng)于所有的噪音消除,因此語音增強(qiáng)是一個(gè)復(fù)雜的工程。 有關(guān)抗噪聲技術(shù)的研究以及實(shí)際環(huán)境下的語音信號(hào)處理系統(tǒng)的開發(fā),在國內(nèi)外已經(jīng)成為語音信號(hào)處理非常重要的研究課題,已經(jīng)作了大量的研究工作,取得了豐富的研究成果。本文僅對(duì)加性噪聲下的語音增強(qiáng)技術(shù)做了較為仔細(xì)的討論,我們先給出語音信號(hào)處理的基本理論,它是語音增強(qiáng)算法研究和實(shí)現(xiàn)的理論基礎(chǔ),在此基礎(chǔ)總結(jié)了自適應(yīng)信號(hào)處理技術(shù)的特點(diǎn)以及在語音增強(qiáng)方面的應(yīng)用。選取工程領(lǐng)域最常用的自適應(yīng)LMS濾波算法和RLS濾波算法作為研究對(duì)象,提出了利用最小均方誤差意義下自適應(yīng)濾波器的輸出信號(hào)與主通道噪聲信號(hào)的等效關(guān)系,得到濾波器最佳自適應(yīng)參數(shù)的方法,并分析了在平穩(wěn)和非平穩(wěn)噪聲環(huán)境下,L M S濾波器族和R L S濾波器在不同噪音輸入下的權(quán)系數(shù)收斂速度、權(quán)系數(shù)穩(wěn)定性、跟蹤輸入信號(hào)的能力和信噪比的改善等特性。 研究了MATLAB語言程序設(shè)計(jì)和使用MALTLAB對(duì)語音算法進(jìn)行仿真、并輸入了多種實(shí)際環(huán)境下的噪音進(jìn)行濾波仿真并對(duì)仿真的結(jié)果進(jìn)行比較和分析。總結(jié)出了LMS、NLMS、SIGN-ERROR-LMS、RLS自適應(yīng)濾波器在語音濾波方面的特點(diǎn) 和應(yīng)用情況。 最后在MATLAB仿真的基礎(chǔ)上,利用Altera公司的Cyclone2系列FPGA芯片和多種EDA工具,完成了L M S自適應(yīng)濾波器的FPGA設(shè)計(jì)。 關(guān)鍵詞:語音增強(qiáng),背景噪音,自適應(yīng)濾波器,LMS,RLS,F(xiàn)PGA

    標(biāo)簽: FPGA 語音增強(qiáng) 算法研究

    上傳時(shí)間: 2013-04-24

    上傳用戶:lijianyu172

  • 智能斷路器理論方法與關(guān)鍵技術(shù)的研究.rar

    斷路器是電力系統(tǒng)中重要的控制和保護(hù)設(shè)備,對(duì)維護(hù)電力系統(tǒng)的安全、穩(wěn)定和可靠運(yùn)行起著重要的作用。如何使斷路器高度智能化,并且更安全和可靠,是電力系統(tǒng)保護(hù)的發(fā)展要求,也是本論文研究的目的。 本文在深入研究了智能斷路器國內(nèi)外發(fā)展?fàn)顩r的基礎(chǔ)上,精心設(shè)計(jì)了以數(shù)字信號(hào)處理器DSP和復(fù)雜可編程邏輯器件CPLD為核心的系統(tǒng)硬件。DSP是智能斷路器測控單元的核心器件,它實(shí)現(xiàn)斷路器的各種保護(hù)、報(bào)警、顯示與控制功能。CPLD完成狀態(tài)量的監(jiān)測,以及各種邏輯信號(hào)的輸出。兩種器件相互配合使得斷路器系統(tǒng)更加智能化。研究了斷路器測控單元的測量原理及保護(hù)算法,并進(jìn)行了具體的硬件和軟件模塊的設(shè)計(jì),旨在實(shí)現(xiàn)斷路器的智能保護(hù)、遠(yuǎn)程控制和集中管理。本設(shè)計(jì)以TI公司的DSP芯片TMS320LF2407為核心。硬件設(shè)計(jì)主要包括信號(hào)調(diào)理模塊設(shè)計(jì)、信號(hào)采樣模塊設(shè)計(jì)、保護(hù)執(zhí)行模塊設(shè)計(jì)、CPLD模塊設(shè)計(jì)和輸入輸出模塊設(shè)計(jì)。并且利用TMS320LF2407本身具有的CAN2.0模塊,通過CAN總線實(shí)現(xiàn)斷路器和上位機(jī)的通信,實(shí)現(xiàn)遙測、遙調(diào)、遙控、遙信等“四遙”功能。軟件采用模塊化設(shè)計(jì),每一個(gè)模塊相對(duì)獨(dú)立,完成某個(gè)特定功能,便于維護(hù)和添加新功能,并且調(diào)試靈活方便。文中給出了主程序及各個(gè)子程序的流程圖,其中子程序有數(shù)據(jù)采集子程序、FFT計(jì)算子程序、液晶顯示子程序、短路瞬時(shí)保護(hù)子程序、過載長延時(shí)保護(hù)子程序、接地故障保護(hù)子程序和短路短延時(shí)保護(hù)子程序等。并且設(shè)計(jì)中充分考慮了斷路器工作環(huán)境的惡劣性,分析了各種干擾的來源,并針對(duì)各種干擾采取了對(duì)應(yīng)的軟件和硬件的抗干擾措施。最后,為了驗(yàn)證全波傅氏算法能否滿足電網(wǎng)數(shù)據(jù)處理精度的要求,利用MATLAB搭建仿真平臺(tái),對(duì)其進(jìn)行了仿真。結(jié)果表明全波傅氏算法能達(dá)到系統(tǒng)的要求。

    標(biāo)簽: 智能斷路器 關(guān)鍵技術(shù)

    上傳時(shí)間: 2013-04-24

    上傳用戶:BK094

  • 基于FPGA的Turbo碼編譯碼器設(shè)計(jì).rar

    作為性能優(yōu)異的糾錯(cuò)編碼,Turbo碼自誕生以來就一直受到理論界以及工程應(yīng)用界的關(guān)注。TD—SCDMA是我國擁有自主知識(shí)產(chǎn)權(quán)的3G通信標(biāo)準(zhǔn),該標(biāo)準(zhǔn)把Turbo碼是作為前向糾錯(cuò)體制,但Turbo碼的譯碼算法比較復(fù)雜并且需要多次迭代,這造成Turbo碼譯碼延時(shí)大,譯碼速度慢,因此限制了Turbo碼的實(shí)際應(yīng)用。因此有必要研究如何將現(xiàn)有的Turbo碼譯碼算法進(jìn)行簡化,加速,使其轉(zhuǎn)化成為適合在硬件上實(shí)現(xiàn)的算法,將實(shí)驗(yàn)室的理論研究成果轉(zhuǎn)化成為硬件產(chǎn)品。 論文主要的研究內(nèi)容有以下兩點(diǎn): 其一,提出信道自適應(yīng)迭代譯碼方案。在事先設(shè)定最大迭代次數(shù)的情況下,自適應(yīng)Turbo碼譯碼算法能夠根據(jù)信道的變化自動(dòng)調(diào)整迭代次數(shù)。 仿真結(jié)果表明:該自適應(yīng)迭代譯碼方案能夠根據(jù)信道的變化自動(dòng)調(diào)整迭代次數(shù),在保證譯碼性能基本上沒有損失的情況下,有效減少譯碼時(shí)間,明顯提高譯碼速度。 其二,根據(jù)得到的信道自適應(yīng)迭代譯碼方案,借助Xilinx公司Spartan3 FPGA硬件平臺(tái),使用Verilog硬件描述語言,將用C/C++語言寫成的信道自適應(yīng)迭代譯碼算法轉(zhuǎn)化成為硬件設(shè)計(jì)實(shí)現(xiàn),得到硬件電路,并對(duì)得到的譯碼器硬件電路進(jìn)行測試。 測試結(jié)果表明:隨著信道的變化,硬件電路的譯碼速度也隨之自動(dòng)變化,信噪比越高譯碼速度越快,并且硬件譯碼器性能(誤比特率)與實(shí)驗(yàn)仿真基本一致。

    標(biāo)簽: Turbo FPGA 編譯碼器

    上傳時(shí)間: 2013-05-31

    上傳用戶:huyiming139

  • 基于AT91RM9200和FPGA技術(shù)的變電站測控裝置.rar

    自20世紀(jì)90年代以來,隨著計(jì)算機(jī)技術(shù)、超大規(guī)模集成電路技術(shù)和通信及網(wǎng)絡(luò)技術(shù)的發(fā)展,微機(jī)保護(hù)和測控裝置的性能得到大幅提升,以此為基礎(chǔ)的變電站自動(dòng)化系統(tǒng)在我國的電力系統(tǒng)中得到長足的發(fā)展和廣泛的應(yīng)用。 @@ 為增加產(chǎn)品的市場競爭力,電力系統(tǒng)二次設(shè)備生產(chǎn)廠商緊跟市場需求,將各種具有高性價(jià)比的新型處理器芯片和外圍芯片大量應(yīng)用到變電站自動(dòng)化系統(tǒng)的保護(hù)、測控裝置上,如32位CPU、數(shù)字信號(hào)處理芯片DSP、高速高精度A/D轉(zhuǎn)換芯片、大容量Flash存儲(chǔ)芯片、可編程邏輯器件CPLD、FPGA等。這些功能強(qiáng)大的器件的應(yīng)用使保護(hù)測控裝置在外形上趨于小型化集成化,而在功能上則較以前有顯著提升。同時(shí),各種成熟的商用嵌入式實(shí)時(shí)操作系統(tǒng)的采用使處理器的性能得到充分發(fā)揮,裝置通信、數(shù)據(jù)存儲(chǔ)及處理能力更強(qiáng),性能大幅提高,程序移植升級(jí)更加方便快捷。 @@ 本論文以現(xiàn)階段國內(nèi)外變電站自動(dòng)化系統(tǒng)測控技術(shù)為參考,根據(jù)變電站自動(dòng)化系統(tǒng)的發(fā)展趨勢和要求,研究一種基于ARM和FPGA技術(shù)并采用嵌入式實(shí)時(shí)操作系統(tǒng)的高性能測控裝置,并給出硬軟件設(shè)計(jì)。 @@ 裝置硬件采用模塊化設(shè)計(jì),按照測控裝置基本功能設(shè)計(jì)插件板。分為主CPU插件、交流采樣插件、遙信采集插件、遙控出口插件、直流采樣及輸出插件。除主CPU插件,其他插件的數(shù)量可以根據(jù)需要任意增減,滿足不同用戶的需求。 @@ 裝置主CPU采用目前先進(jìn)的基于ARM技術(shù)的微處理器AT91RM9200,通過數(shù)據(jù)、地址總線和其他插件板連接,構(gòu)成裝置的整個(gè)系統(tǒng)。交流采樣插件采用FPGA技術(shù),利用ALTERA公司的FPGA芯片EP1K10實(shí)現(xiàn)交流采樣的控制,降低了CPU的負(fù)擔(dān)。 @@ 軟件采用Vxworks嵌入式實(shí)時(shí)操作系統(tǒng),增加了系統(tǒng)的性能。以任務(wù)來管理不同的軟件功能模塊,利于裝置軟件的并行開發(fā)和維護(hù)。 @@關(guān)鍵詞:測控裝置;嵌入式實(shí)時(shí)操作系統(tǒng);ARM;現(xiàn)場可編程門陣列

    標(biāo)簽: 9200 FPGA AT

    上傳時(shí)間: 2013-04-24

    上傳用戶:JESS

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