PIC單片機里C編譯器最高版本，不過要和微芯公司的匯編器一起使用哦！
上傳時間： 2013-08-02
上傳用戶：黃華強
摘要: 本文介紹了基于FPGA 的出租車計價器系統的功能、設計思想和實現, 該設計采用模塊化自上而下的層次化設計,頂\r\n層設計有5 個模塊,各模塊中子模塊采用VHDL 或圖形法設計。在Max+plusⅡ下實現編譯、仿真等,最后成功下載到FPGA 芯\r\n片中。完成了可預置自動計費、自動計程、計時、空車顯示等多功能計價器。由于FPGA 具有高密度、可編程及有強大的軟件\r\n支持等特點,所以該設計具有功能強、靈活和可靠性高等特點,具有一定的實用價值。
上傳時間： 2013-08-09
上傳用戶：Zxcvbnm
筆者以Freescale的S08系列8位微處理器MC9S08SL8為核心，為某電動汽車設計了一款儀表盤信號轉換器，實現了電機轉速檢測、與電機控制器的LIN通信、原車儀表信號模擬等功能。利用芯片內部資源特性設計了其硬件結構及電路，根據儀表盤的原理和工作方式設計了軟件流程，裝車試驗運行穩定，有很高的實用價值。
上傳時間： 2013-11-23
上傳用戶：lili123
內容簡介 本書以數字信號處理基礎內容為主，同時也介紹了有關數字信號處理實現與應用。書中 以主要篇幅討論了離散時間信號與系統的基本概念，離散傅里葉變換及其快速算法，數字濾 波器的結構與各種設計方法。這是數字信號處理中的經典內容，也是進一步學習和掌握更多 信號處理理論的基礎。為便于數字信號處理系統的設計與開發，書中介紹了數字信號處理芯 片的原理及其開發工具以及應用實例。 本書概念清晰，說明詳細，深入淺出，易于理解，具有豐富的例題和習題，便于自學。 本書可作為高等院校理工科類相關專業本科生教材，也可作為有關工程技術人員的自學 參考書。
標簽： 數字信號處理
上傳時間： 2013-10-24
上傳用戶：chaisz
本文的目的在于，介紹如何計算具有狹窄氣隙的圓形轉子電機中的繞組感應。我們僅處理理想化的氣隙磁場，不考慮槽、外部周邊或傾斜電抗。但我們將考察繞組磁動勢（MMF）的空間諧頻。 在圖1中，給出了12槽定子的軸截面示意圖。實際上，所顯示的是薄鋼片的形狀，或用于構成磁路的層片。鐵芯由薄片構成，以控制渦流電流損耗。厚度將根據工作頻率而變，在60Hz的電機中（大體積電機，工業用）層片的厚度典型為.014”（.355毫米）。它們堆疊在一起，以構成具有恰當長度的磁路。繞組位于該結構的槽內。 在圖1中，給出了帶有齒結構的梯形槽，在大部分長度方向上具有近乎均勻的截面，靠近氣隙處較寬。齒端與相對狹窄的槽凹陷區域結合在一起，通過改善氣隙場的均勻性、增加氣隙磁導、將繞組保持在槽中，有助于控制很多電機轉子中的寄生損耗。請注意，對于具有名為“形式纏繞”線圈的大型電機，它具有直邊矩形槽，以及非均勻截面齒。下面的介紹針對兩類電機。
上傳時間： 2013-10-13
上傳用戶：我干你啊
摘要: 介紹了時鐘分相技術并討論了時鐘分相技術在高速數字電路設計中的作用。 關鍵詞: 時鐘分相技術; 應用 中圖分類號: TN 79 文獻標識碼:A 文章編號: 025820934 (2000) 0620437203 時鐘是高速數字電路設計的關鍵技術之一, 系統時鐘的性能好壞, 直接影響了整個電路的 性能。尤其現代電子系統對性能的越來越高的要求, 迫使我們集中更多的注意力在更高頻率、 更高精度的時鐘設計上面。但隨著系統時鐘頻率的升高。我們的系統設計將面臨一系列的問 題。 1) 時鐘的快速電平切換將給電路帶來的串擾(Crosstalk) 和其他的噪聲。 2) 高速的時鐘對電路板的設計提出了更高的要求: 我們應引入傳輸線(T ransm ission L ine) 模型, 并在信號的匹配上有更多的考慮。 3) 在系統時鐘高于100MHz 的情況下, 應使用高速芯片來達到所需的速度, 如ECL 芯 片, 但這種芯片一般功耗很大, 再加上匹配電阻增加的功耗, 使整個系統所需要的電流增大, 發 熱量增多, 對系統的穩定性和集成度有不利的影響。 4) 高頻時鐘相應的電磁輻射(EM I) 比較嚴重。 所以在高速數字系統設計中對高頻時鐘信號的處理應格外慎重, 盡量減少電路中高頻信 號的成分, 這里介紹一種很好的解決方法, 即利用時鐘分相技術, 以低頻的時鐘實現高頻的處 理。 1 時鐘分相技術 我們知道, 時鐘信號的一個周期按相位來分, 可以分為360°。所謂時鐘分相技術, 就是把 時鐘周期的多個相位都加以利用, 以達到更高的時間分辨。在通常的設計中, 我們只用到時鐘 的上升沿(0 相位) , 如果把時鐘的下降沿(180°相位) 也加以利用, 系統的時間分辨能力就可以 提高一倍(如圖1a 所示)。同理, 將時鐘分為4 個相位(0°、90°、180°和270°) , 系統的時間分辨就 可以提高為原來的4 倍(如圖1b 所示)。 以前也有人嘗試過用專門的延遲線或邏輯門延時來達到時鐘分相的目的。用這種方法產生的相位差不夠準確, 而且引起的時間偏移(Skew ) 和抖動 (J itters) 比較大, 無法實現高精度的時間分辨。 近年來半導體技術的發展, 使高質量的分相功能在一 片芯片內實現成為可能, 如AMCC 公司的S4405, CY2 PRESS 公司的CY9901 和CY9911, 都是性能優異的時鐘 芯片。這些芯片的出現, 大大促進了時鐘分相技術在實際電 路中的應用。我們在這方面作了一些嘗試性的工作: 要獲得 良好的時間性能, 必須確保分相時鐘的Skew 和J itters 都 比較小。因此在我們的設計中, 通常用一個低頻、高精度的 晶體作為時鐘源, 將這個低頻時鐘通過一個鎖相環(PLL ) , 獲得一個較高頻率的、比較純凈的時鐘, 對這個時鐘進行分相, 就可獲得高穩定、低抖動的分 相時鐘。 這部分電路在實際運用中獲得了很好的效果。下面以應用的實例加以說明。2 應用實例 2. 1 應用在接入網中 在通訊系統中, 由于要減少傳輸 上的硬件開銷, 一般以串行模式傳輸 圖3 時鐘分為4 個相位 數據, 與其同步的時鐘信號并不傳輸。 但本地接收到數據時, 為了準確地獲取 數據, 必須得到數據時鐘, 即要獲取與數 據同步的時鐘信號。在接入網中, 數據傳 輸的結構如圖2 所示。 數據以68MBös 的速率傳輸, 即每 個bit 占有14. 7ns 的寬度, 在每個數據 幀的開頭有一個用于同步檢測的頭部信息。我們要找到與它同步性好的時鐘信號, 一般時間 分辨應該達到1ö4 的時鐘周期。即14. 7ö 4≈ 3. 7ns, 這就是說, 系統時鐘頻率應在300MHz 以 上, 在這種頻率下, 我們必須使用ECL inp s 芯片(ECL inp s 是ECL 芯片系列中速度最快的, 其 典型門延遲為340p s) , 如前所述, 這樣對整個系統設計帶來很多的困擾。 我們在這里使用鎖相環和時鐘分相技術, 將一個16MHz 晶振作為時鐘源, 經過鎖相環 89429 升頻得到68MHz 的時鐘, 再經過分相芯片AMCCS4405 分成4 個相位, 如圖3 所示。 我們只要從4 個相位的68MHz 時鐘中選擇出與數據同步性最好的一個。選擇的依據是: 在每個數據幀的頭部(HEAD) 都有一個8bit 的KWD (KeyWord) (如圖1 所示) , 我們分別用 這4 個相位的時鐘去鎖存數據, 如果經某個時鐘鎖存后的數據在這個指定位置最先檢測出這 個KWD, 就認為下一相位的時鐘與數據的同步性最好(相關)。 根據這個判別原理, 我們設計了圖4 所示的時鐘分相選擇電路。 在板上通過鎖相環89429 和分相芯片S4405 獲得我們所要的68MHz 4 相時鐘: 用這4 個 時鐘分別將輸入數據進行移位, 將移位的數據與KWD 作比較, 若至少有7bit 符合, 則認為檢 出了KWD。將4 路相關器的結果經過優先判選控制邏輯, 即可輸出同步性最好的時鐘。這里, 我們運用AMCC 公司生產的 S4405 芯片, 對68MHz 的時鐘進行了4 分 相, 成功地實現了同步時鐘的獲取, 這部分 電路目前已實際地應用在某通訊系統的接 入網中。 2. 2 高速數據采集系統中的應用 高速、高精度的模擬- 數字變換 (ADC) 一直是高速數據采集系統的關鍵部 分。高速的ADC 價格昂貴, 而且系統設計 難度很高。以前就有人考慮使用多個低速 圖5 分相技術應用于采集系統 ADC 和時鐘分相, 用以替代高速的ADC, 但由 于時鐘分相電路產生的相位不準確, 時鐘的 J itters 和Skew 比較大(如前述) , 容易產生較 大的孔徑晃動(Aperture J itters) , 無法達到很 好的時間分辨。 現在使用時鐘分相芯片, 我們可以把分相 技術應用在高速數據采集系統中: 以4 分相后 圖6 分相技術提高系統的數據采集率 的80MHz 采樣時鐘分別作為ADC 的 轉換時鐘, 對模擬信號進行采樣, 如圖5 所示。 在每一采集通道中, 輸入信號經過 緩沖、調理, 送入ADC 進行模數轉換, 采集到的數據寫入存儲器(M EM )。各個 采集通道采集的是同一信號, 不過采樣 點依次相差90°相位。通過存儲器中的數 據重組, 可以使系統時鐘為80MHz 的采 集系統達到320MHz 數據采集率(如圖6 所示)。 3 總結 靈活地運用時鐘分相技術, 可以有效地用低頻時鐘實現相當于高頻時鐘的時間性能, 并 避免了高速數字電路設計中一些問題, 降低了系統設計的難度。
上傳時間： 2013-12-17
上傳用戶：xg262122
多層板是由芯板和半固化片互相層疊壓合而成的。而半固化片構成所謂的浸潤層，起到粘合芯板的作用，雖然也有一定的初始厚度，但是在壓制過程中其厚度會發生一些變化。
上傳時間： 2013-10-29
上傳用戶：a296386173
計算機的ATX電源脫離主板是需要短接一下20芯接頭上的綠色（power on）和黑色（地）才能啟動的。啟動后把萬用表撥到主流電壓20V檔位，把黑表筆插入4芯D型插頭的黑色接線孔中，用紅表筆分別測量各個端子的電壓。樓上列的是20芯接頭的端子電壓，4芯D型插頭的電壓是黃色＋12V，黑色地，紅色＋5V。 主板電源接口 圖解 20-PIN ATX主板電源接口
上傳時間： 2013-10-28
上傳用戶：蔣清華嗯
給你們愛電力電子的！
上傳時間： 2013-11-02
上傳用戶：flg0001
AL-FNR系列發電機中性點接地電阻柜 我公司擁有技術優秀的研發隊伍和精良的設備,引進并消化國外先進技術,長期致力于對中性點接地技術產品的研發、生產，對降低電網過電壓、提高電網的安全性、可靠性，具有良好的效果。我公司以進口特殊不銹鋼合金材料，開發生產的系列不銹鋼中性點接地電阻柜。產品具有精度高，線性度好，運行可靠，安裝方便，外形美觀等特點，已廣泛用于許多國家重點工程。所生產的0.4KV～35KV發電機中性點接地電阻柜是發電機組中采用高阻接地的專用成套裝置。 AL-FNR型發電機中性點電阻柜連接在發電機中性點上，當電網或發電機定子繞組發生單相接地故障時，向接地點提供附加阻性電流，使接地點電流由容性變成阻容性電流，從而保證產生的過電壓不超過2.6倍的相電壓。 1、精心設計、保護到位 AL-FNR型發電機中性點電阻柜連接在發電機中性點與地之間，當電網或發電機定子繞組發生單相接地故障時，向接地點提供附加阻性電流，使接地點電流由容性變成阻容性電流，從而保證產生的過電壓不超過2.6倍的相電壓。 2、專業保護，避免燒損發電機鐵芯 AL-FNR型發電機中性點電阻柜在設計參數時，力求將總的接地電流控制在15A以內，不僅可以滿足繼電保護靈敏度的要求，同時也可減輕發電機定子繞組接地時鐵芯的損傷。 3、結構緊湊，元器件性能優異 AL-FNR型發電機中性點電阻柜將零散的單相變壓器、電阻器、電流互感器、接地保護輸出端子等電器設備整體組合在一個封閉金屬柜內，并可選配隔離開關、避雷器，智能保護儀表等成套供貨；安全可靠性高，布置清晰整齊，便于安裝調試及操作維護。裝置采用的單相變壓器為干式絕緣變壓器，工作性能穩定，抗沖擊能力強。變壓器二次側采用不銹鋼材料電阻。 4、監控功能齊全，并提供模擬量輸出 AL-FNR型發電機中性點電阻柜是0.4KV～35KV發電機中性點接地電阻柜是發電機組中采用高阻接地的專用成套裝置，可選配電流和動作記錄儀等智能控制儀表，正常時可監測中性點不平衡電流，出現單相接地故障時，可記錄動作次數；且可為保護和監控系統提供模擬量輸出。 5、性能可靠，維護簡便 AL-FNR型發電機中性點電阻柜中裝設干式單相接地變壓器及相應的大容量電阻器，柜中還可裝設單相隔離開關，以便在進行檢修或實驗時隔離電源。 6、技術力量雄厚，服務周到 我公司為中性點設備專業生產廠家，技術力量雄厚，售前的技術交流咨詢可隨時到位；售后的安裝技術指導可按用戶要求及時進行。
上傳時間： 2013-10-17
上傳用戶：王楚楚
