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基于FPGA和PLL的函數(shù)信號(hào)發(fā)生器時(shí)鐘部分的實(shí)現(xiàn)
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基于FPGA的DDS信號(hào)發(fā)生器的簡(jiǎn)單實(shí)現(xiàn)
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基于FPGA的自治型SPWM波形發(fā)生器的設(shè)計(jì)
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用FPGA實(shí)現(xiàn)任意波形發(fā)生器的源代碼
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Verilog實(shí)現(xiàn)的DDS正弦信號(hào)發(fā)生器和測(cè)頻測(cè)相模塊
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dds信號(hào)發(fā)生器程序設(shè)計(jì)
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基于CPLD的多功能信號(hào)發(fā)生器設(shè)計(jì)
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基于CPLD的FSK信號(hào)發(fā)生器的設(shè)計(jì)
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150Hz三角載波發(fā)生器(成品)
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模電函數(shù)發(fā)生器課程設(shè)計(jì)報(bào)告
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