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自動(dòng)識(shí)別算法

  • 自適應均衡器的LMS算法實現及其仿真 :自適應均衡器已廣泛應用于通信、雷達、聲納、控制和生物醫學工程等許多領域,為克服多徑衰落和信道失真 引起的碼間干擾,實時跟蹤移動通信信道的時變特性,筆者設計了一

    自適應均衡器的LMS算法實現及其仿真 :自適應均衡器已廣泛應用于通信、雷達、聲納、控制和生物醫學工程等許多領域,為克服多徑衰落和信道失真 引起的碼間干擾,實時跟蹤移動通信信道的時變特性,筆者設計了一個基于LMS 算法的自適應線性均衡器,并通過改變步 長因子Δ來分析其收斂速度和均方誤差特性.

    標簽: LMS 均衡器 信道 仿真

    上傳時間: 2017-09-17

    上傳用戶:lindor

  • 自定制Nios處理器的FFT算法指令

    本文深入研究了Nios 自定制指令的軟硬件接口,基于Altera 的IP 核FFT V2.2.0實現了變換長度為1024 點的高速復數FFT 算法,提出了一種在Nios 嵌入式系統中定制用戶FFT 算

    標簽: Nios FFT 定制 處理器

    上傳時間: 2013-04-24

    上傳用戶:hfmm633

  • 自適應濾波器算法設計及其FPGA實現

    自適應濾波器是智能天線技術中核心部分-自適應波束成形器的關鍵技術,算法的高效穩定性及硬件時鐘速率的快慢是判斷波束成形器性能優劣的主要標準。 首先選取工程領域最常用的自適應橫向LMS濾波算法作為研究對象,提出了利用最小均方誤差意義下自適應濾波器的輸出信號與主通道噪聲信號的等效關系,得到濾波器最佳自適應參數的方法。并分析了在平穩和非平穩環境噪聲下,濾波器的收斂速度、權系數穩定性、跟蹤輸入信號的能力和信噪比的改善等特性。 在分析梯度自適應格型算法的基礎上,提出利用最佳反射系數的收斂性和穩定性,得到了梯度自適應格型濾波器的定步長改進方法;并以改進的梯度自適應格型和線性組合器組成梯度自適應格型聯合處理算法,在同樣環境噪聲下,相比自適應橫向LMS算法,其各項性能指標都得到了極大地改善,而且有利于節省硬件資源。 設計了自適應橫向LMS濾波器和梯度自適應格型聯合處理濾波器的電路模型,并用馳豫超前技術對兩類濾波器進行了流水線優化。利用Altera公司的CycloneⅡ系列EP2C5T144C6芯片和多種EDA工具,完成了濾波器的FPGA硬件設計與仿真實現。并以FPGA實現的3節梯度自適應格型聯合處理器為核心,設計了一種TD-SCDMA系統的自適應波束成形器,分析表明可以很好地利用系統提供的參考信號對下行波束進行自適應成形。

    標簽: FPGA 自適應濾波器 算法設計

    上傳時間: 2013-07-16

    上傳用戶:xyipie

  • 用于軟件定義UHF RFID閱讀器的可編程基帶濾波器

    射頻識別 (RFID) 是一種自動識別技術,用於識別包含某個編碼標簽的任何物體

    標簽: RFID UHF 軟件定義 可編程基帶

    上傳時間: 2013-10-29

    上傳用戶:star_in_rain

  • 光伏電池的自適應占空比擾動MPPT算法研究

    環境溫度、光照強度和負載等因素對光伏電池的輸出特性影響很大,為了提高光伏電池的工作效率,需要準確快速地跟蹤光伏電池的最大功率點。在分析了光伏電池的輸出特性的基礎上,建立了光伏電池的仿真模型;針對傳統爬山法的不足,采用了自適應占空比擾動法對最大功率點進行了跟蹤控制。給出了上述兩種算法的工作原理及設計過程。仿真結果表明:自適應占空比擾動算法跟蹤迅速,減少了系統在最大功率點附近的振蕩現象,提高了系統的跟蹤速度和精度。

    標簽: MPPT 光伏電池 算法研究

    上傳時間: 2013-12-04

    上傳用戶:bakdesec

  • 基于Sage-husa自適應濾波算法的AUV組合導航系統設計

    文中針對水下自主航行器提出了一種新型的基于捷聯慣導(SINS)和GPS的組合導航系統設計方案。該方案以捷聯慣導作為主系統,同時利用GPS重調捷聯慣導系統,建立了該組合導航系統的卡爾曼濾波模型,設計了輸出校正間接法的卡爾曼濾波算法和Sage-husa自適應卡爾曼濾波算法。仿真結果表明由于GPS位置和速度信息的引入,一定程度上克服了捷聯慣導系統誤差狀態發散現象,提高了導航精度。同時通過兩種算法的對比,Sage-husa自適應卡爾曼濾波算法則具有更高的濾波精度和穩定性,能夠更好的滿足長時間遠距離導航的要求。

    標簽: Sage-husa AUV 自適應濾波算法 組合導航

    上傳時間: 2013-10-11

    上傳用戶:jeffery

  • 自適應噪聲抵消算法

    自適應噪聲抵消 LMS  算法 Matlab 仿真,用一個二階FIR的LMS自適應濾波 器消除正弦干擾的一個方案。

    標簽: 算法

    上傳時間: 2020-11-20

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  • H264AVC的CAVLC編碼算法研究及FPGA實現.rar

    H.264/AVC是國際電信聯盟與國際標準化組織/國際電工委員會聯合推出的活動圖像編碼標準,簡稱H.264。作為最新的國際視頻編碼標準,H.264/AVC與MPEG-4、H.263等視頻編碼標準相比,性能有了很大的提高,并已在流媒體、數字電視、電話會議、視頻存儲等諸多領域得到廣泛的應用。 本論文的研究課題是基于H.264/AVC視頻編碼標準的CAVLC(Context-based Adaptive Variable Length Coding,基于上下文的自適應可變長編碼)編碼算法研究及FPGA實現。對于變換后的熵編碼,H.264/AVC支持兩種編碼模式:基于上下文的可變長編碼(CAVLC)和基于上下文的自適應算術編碼(CABAC,Context-based Adaptive BinaryArithmetic Coding)。在H.264/AVC中,盡管CAVLC算法也是采用了VLC編碼,但是同以往標準不同,它所有的編碼都是基于上下文進行。這種方法比傳統的查單一表的方法提高了編碼效率,但也增加了設計上的困難。 作者在全面學習H.264/AVC協議和深入研究CAVLC編碼算法的基礎上,確定了并行編碼的CAVLC編碼器結構框圖,并總結出了影響CAVLC編碼器實現的瓶頸。針對這些瓶頸,對CAVLC編碼器中的各個功能模塊進行了優化設計,這些優化設計包括多參考塊的表格預測法、快速查找表法、算術消除法等。最后,用Verilog硬件描述語言對所設計的CAVLC編碼器進行了描述,用EDA軟件對其主要功能模塊進行了仿真,并在Cyclone II系列EP2C20F484的FPGA上驗證了它們的功能。結果表明,該CAVLC編碼器各編碼單元的編碼速度得到了顯著提高且均能滿足實時通信要求,為整個CAVLC編碼器的實時通信提供了良好的基礎。

    標簽: CAVLC H264 FPGA 264

    上傳時間: 2013-06-22

    上傳用戶:diamondsGQ

  • OFDM系統幀檢測及同步算法FPGA設計與實現

    正交頻分復用(OFDM)技術是一種多載波數字調制技術,它具有頻譜利用率高、抗多徑能力強等特點,在寬帶無線多媒體通信領域中受到了廣泛的關注。 OFDM系統可分為連續工作模式和突發工作模式。在IEEE802.11a、HiperLANType2等無線局域網標準中采用了OFDM的突發工作模式,該模式下的接收機首先對符合某種特定格式的幀做出檢測。本文介紹了一種基于最小錯誤概率準則的幀檢測算法,提出了該算法的FPGA實現方案。 同步技術是OFDM最關鍵的技術之一,它包括載波頻率同步和符號同步。載波頻率同步是為了糾正接收端相對于發送端的載波頻率偏移,以保證子載波間的正交性;符號同步確定OFDM符號有用數據信息的開始時刻,也就是確定FFT窗的開始時刻。本文首先介紹了一種基于自相關的載波頻率同步算法,給出了它的FPGA實現方案,重點講述了其中用到的Cordic算法及其實現;然后介紹了分別基于互相關和自相關的兩種符號同步算法,給出了各自的FPGA實現方案,從實現的角度比較了兩種算法的優缺點,并且在FPGA設計中體現了面積復用和流水線操作的設計思想。 文章最后介紹了系統調試的情況,總結出一種ChipScopePro與Matlab相結合的調試方法,該方法在FPGA調試方面具有一定的通用性。

    標簽: OFDM FPGA

    上傳時間: 2013-07-16

    上傳用戶:Killerboo

  • H264AVC的CAVLC編碼算法研究及FPGA實現

    H.264/AVC是國際電信聯盟與國際標準化組織/國際電工委員會聯合推出的活動圖像編碼標準,簡稱H.264。作為最新的國際視頻編碼標準,H.264/AVC與MPEG-4、H.263等視頻編碼標準相比,性能有了很大的提高,并已在流媒體、數字電視、電話會議、視頻存儲等諸多領域得到廣泛的應用。 本論文的研究課題是基于H.264/AVC視頻編碼標準的CAVLC(Context-based Adaptive Variable Length Coding,基于上下文的自適應可變長編碼)編碼算法研究及FPGA實現。對于變換后的熵編碼,H.264/AVC支持兩種編碼模式:基于上下文的可變長編碼(CAVLC)和基于上下文的自適應算術編碼(CABAC,Context-based Adaptive BinaryArithmetic Coding)。在H.264/AVC中,盡管CAVLC算法也是采用了VLC編碼,但是同以往標準不同,它所有的編碼都是基于上下文進行。這種方法比傳統的查單一表的方法提高了編碼效率,但也增加了設計上的困難。 作者在全面學習H.264/AVC協議和深入研究CAVLC編碼算法的基礎上,確定了并行編碼的CAVLC編碼器結構框圖,并總結出了影響CAVLC編碼器實現的瓶頸。針對這些瓶頸,對CAVLC編碼器中的各個功能模塊進行了優化設計,這些優化設計包括多參考塊的表格預測法、快速查找表法、算術消除法等。最后,用Verilog硬件描述語言對所設計的CAVLC編碼器進行了描述,用EDA軟件對其主要功能模塊進行了仿真,并在Cyclone II系列EP2C20F484的FPGA上驗證了它們的功能。結果表明,該CAVLC編碼器各編碼單元的編碼速度得到了顯著提高且均能滿足實時通信要求,為整個CAVLC編碼器的實時通信提供了良好的基礎。

    標簽: CAVLC H264 FPGA 264

    上傳時間: 2013-06-04

    上傳用戶:libenshu01

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