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自動代碼生成工具

  • 基于DSP控制的直流調速系統及其自適應方案的研究.rar

    直流電動機具有優良的調速特性,調速平滑、簡單,且范圍大.同時其過載能力大,能承受頻繁的沖擊負載,廣泛應用于切削機床、造紙機等高性能可控電力拖動領域. 以往直流調速系統控制器采用分立元件,其故障率高,穩定性差,技術落后,很難滿足生產的需要.隨著計算機技術及通信技術的發展,數字化直流調速系統克服了這一不足,成為直調系統的主流. 本文設計的系統以DSP為主控芯片,監控系統控制芯片使用P89C669單片機,通過上下位機的數據通訊,實現系統參數設計和調節的數字化.下面是具體工作闡述: 1.設計了電封閉直流調速系統的硬件和軟件,完成兩臺同軸電機的電封閉實驗. 2.主電路使用三菱公司的IPM-PS21867作為功率輸出模塊,同時設計了驅動保護電路、控制電路以及通信保護電路. 3.采用PWM控制方式,編寫了系統的軟件.主要包括主程序、通訊顯示程序以及中斷服務子程序. 4.完成了樣機的整體布局和調試,實現了系統的雙閉環控制. 5.針對由于負載、轉動慣量等的變化影響系統的調速性能,本文基于模型參考自適應控制原理,給出了雙閉環調速系統自適應的Narendra方案的具體實現,通過仿真驗證方案的可行性.

    標簽: DSP 控制 直流調速系統

    上傳時間: 2013-04-24

    上傳用戶:kennyplds

  • 51單片機常用工具包.rar

    51常用的一些工具 包括時鐘計算,等等

    標簽: 51單片機 工具包

    上傳時間: 2013-07-05

    上傳用戶:

  • 基于DSP實現G729語音編碼算法.rar

    高速發展的DSP技術為語音信號處理領域提供了良好的發展平臺,使得實時實現各種復雜的算法稱為可能。G.729語音編碼是國際電信聯盟(ITU-T)于1996年獲準通過的采用共軛結構代數碼激勵線性預測技術的具有8 kbit/s碼速率的語音算法建議,廣泛應用于數字移動通信、IP電話和數字衛星通信中。本文研究了G.729語音編碼原理和在TMS320C5416定點DSP芯片上實時實現該編碼器過程中的軟、硬件設計。主要涉及有以下幾方面內容: 1.介紹語音編碼技術和DSP技術的發展概況。 2.研究了基于CELP結構的G.729編碼的算法原理。 3.根據G.729聲碼器實時實現的需要,介紹硬件平臺的組成,研究了系統軟件的設計和基于算法和實時需要的軟件優化。 4.利用DSP代碼調試工具對系統性能進行分析,得出測試結果。

    標簽: G729 DSP 語音編碼

    上傳時間: 2013-07-11

    上傳用戶:woshiayin

  • 基于DSP的自適應噪聲抵消器設計.rar

    本文的目的在于設計一個自適應噪音抵消系統,使其能消除含噪語音信號中的背景噪音,達到提高語音信號質量的目的.主要工作分為兩大部分.本文在第一部分介紹了自適應數字濾波器的基本理論思想,具體闡述了自適應噪聲抵消系統基本原理,并對自適應噪聲抵消系統的指標、抵消性能進行了計算分析.自適應濾波器的算法是整個系統的核心,在第一部分中,對兩種最基本的自適應算法,進行了詳細的介紹和分析,并針對兩種算法的優缺點進行了詳細的比較.這一部分中最關鍵的是對設計的噪聲抵消系統進行計算機仿真,驗證系統設計的合理性和算法的正確性.通過對自適應噪聲抵消器的MATLAB仿真及對仿真圖形的分析,驗證了系統設計和自適應算法的可行性.第二部分主要完成自適應噪聲抵消系統的硬件設計和軟件編程.在第一部分計算機仿真分析的基礎上,利用高速信號處理芯片DSP(TMS320LF2407)設計了一個噪聲干擾抵消系統,在高速信號處理芯片(TMS320LF2407)上開發實現了自適應LMS算法.

    標簽: DSP

    上傳時間: 2013-06-28

    上傳用戶:zklh8989

  • 自舉驅動中文資料.rar

    關于半橋或全橋自舉式浮動柵極驅動的四個中文文檔,為飛兆和IR公司技術文檔,介紹了自舉電路元件的選取及實際問題解決。可從其官網中下載。這里集合上傳~

    標簽: 驅動

    上傳時間: 2013-07-30

    上傳用戶:碉堡1234

  • ARM開發工具ADS原理與應用.part1.rar

    介紹ARM的調試方法,及ARM開發工具ads的原理與應用(講的很詳細,共三部分)

    標簽: part ARM ADS

    上傳時間: 2013-07-24

    上傳用戶:www123lll

  • ARM開發工具ADS原理與應用.part2.rar

    介紹ARM的調試方法,及ARM開發工具ads的原理與應用(講的很詳細,共三部分)

    標簽: part ARM ADS

    上傳時間: 2013-05-29

    上傳用戶:zhuoying119

  • 基于FPGA的嵌入式系統設計.rar

    隨著電子技術的不斷發展和進步,嵌入式系統也越來越廣泛的滲入到人類生活的方方面面。我們生活中常用的手機、數碼相機、掌上電腦、便攜式掃描儀等等都應用到了嵌入式系統。 論文首先介紹了嵌入式系統,包括嵌入式系統的構成、特點、發展趨勢以及FPGA在嵌入式中的應用等,指明嵌入式系統設計一般可分為硬件設計和軟件設計兩部分。 硬件設計部分,首先介紹了FPGA的相關知識,包括FPGA構成、特性、開發工具、開發流程等,并對論文中選用的Altera公司的CyclonⅡ器件做了詳細的介紹。利用SOPC Builder、NiosⅡ等工具設計創建了NiosⅡ CPU內核,添加以太網、Flash、PIO以及VGA接口等模塊,生成了一個Nios CPU內核,完成硬件設計。 軟件設計部分,研究了嵌入式操作系統的發展、種類、特點等,簡單介紹了幾種代表性的嵌入式操作系統。選擇嵌入式操作系統時,綜合考慮了內核、可移植性、可裁剪性、外掛模塊、成本、服務等各種因素,最終選用μCLinux操作系統。詳細介紹了μCLinux的特點、基本架構、代碼結構等。利用NiosⅡIDE為宿主機建立Linux開發環境。在IDE里配置Linux內核和文件系統,編譯后上載到做好的硬件平臺上。啟動μCLinux后將一個C語言編寫的九宮格求解程序下載到開發板中運行,檢驗運行結果,驗證嵌入式系統的正確性。 論文所做的只是嵌入式系統的一個應用實例。實際應用過程中,用戶可以根據自己的實際需要對軟硬件進行修改,以實現不同的功能。

    標簽: FPGA 嵌入式系統設計

    上傳時間: 2013-07-19

    上傳用戶:zhuoying119

  • 基于FPGA利用FFT算法實現GPSCA碼捕獲的研究.rar

    隨著中國二代導航系統的建設,衛星導航的應用將普及到各個行業,具有自主知識產權的衛星導航接收機的研究與設計是該領域的一個研究熱點。在接收機的設計中,對于成熟技術將利用ASIC芯片進行批量生產,該芯片是專用芯片,一旦制造成型不能改變。但是對于正在研究的接收機技術,特別是在需要利用接收機平臺進行提高接收機性能研究時,利用FPGA通用可編程門陣列芯片是非常方便的。在FPGA上的研究成果,一旦成熟可以很方便的移植到ASIC芯片,進行批量生產。本課題就是基于FPGA研究GPS并行捕獲技術的硬件電路,著重進行了其中一個捕獲通道的設計和實現。 GPS信號捕獲時間是影響GPS接收機性能的一個關鍵因素,尤其是在高動態和實時性要求高的應用中或者對弱GPS信號的捕獲方面。因此,本文在滑動相關法基礎上引出了基于FFT的并行快速捕獲方法,采用自頂向下的方法對系統進行總體功能劃分和結構設計,并采用自底向上的方法對系統進行功能實現和驗證。 本課題以Xilinx公司的Spartan3E開發板為硬件開發平臺,以ISE9.2i為軟件開發平臺,采用Verilog HDL編程實現該系統。并利用Nemerix公司的GPS射頻芯片NJ1006A設計制作了GPS中頻信號產生平臺。該平臺可實時地輸出采樣頻率為16.367MHz的GPS數字中頻信號。 本課題主要是基于采樣率變換和FFT實現對GPS C/A碼的捕獲。該算法利用平均采樣的方法,將信號的采樣率降低到1.024 MHz,在低采樣率下利用成熟的1024點FFT IP核對C/A碼進行粗捕,給出GPS信號的碼相位(精度大約為1/4碼片)和載波的多普勒頻率,符合GPS后續跟蹤的要求。 同時,由于FFT算法是以資源換取時間的方法來提高GPS捕獲速度的,所以在設計時,合理地采用FPGA設計思想與技巧優化系統。基于實用性的要求,詳細的給出了基于FFT的GPS并行捕獲各個模塊的實現原理、實現結構以及仿真結果。并達到降低系統硬件資源,能夠快速、高效地實現對GPS C/A碼捕獲的要求。 本研究是導航研究所承擔的國家863課題“利用多徑信號提高GNSS接收機性能的新技術研究”中關于接收機信號捕獲算法的一部分,對接收機的設計具有一定的參考價值。

    標簽: GPSCA FPGA FFT

    上傳時間: 2013-07-22

    上傳用戶:user08x

  • 基于FPGA的通用異步收發器的設計.rar

    通用異步收發器(Universal Asynchronous Receiver Transmitter,UART)是一種能同時支持短距離和長距離數據傳輸的串行通信接口,被廣泛應用于微機和外設之間的數據交換。像8251、NS8250、NS16550等都是常用的UART芯片,但是這些專用的串行接口芯片的缺點是數據傳輸速率比較慢,難以滿足高速率數據傳輸的場合,而更重要的就是它們都具有不可移植性,因此要利用這些芯片來實現PC機和FPGA芯片之間的通信,勢必會增加接口連線的復雜程度以及降低整個系統的穩定性和有效性。 本課題就是針對UART的特點以及FPGA設計具有可移植性的優勢,提出了一種基于FPGA芯片的嵌入式UART設計方法,其中主要包括狀態機的描述形式以及自頂向下的設計方法,利用硬件描述語言來編制UART的各個子功能模塊以及頂層模塊,之后將其集成到FPGA芯片的內部,這樣不僅能解決傳統UART芯片的缺點而且同時也使整個系統變得更加具有緊湊性以及可靠性。 本課題所設計的LIART支持標準的RS-232C傳輸協議,主要設計有發送模塊、接收模塊、線路控制與中斷仲裁模塊、Modem控制模塊以及兩個獨立的數據緩沖區FIFO模塊。該模塊具有可變的波特率、數據幀長度以及奇偶校驗方式,還有多種中斷源、中斷優先級、較強的抗干擾數據接收能力以及芯片內部自診斷的能力,模塊內分開的接收和發送數據緩沖寄存器能實現全雙工通信。除此之外最重要的是利用IP模塊復用技術設計數據緩沖區FIFO,采用兩種可選擇的數據緩沖模式。這樣既可以應用于高速的數據傳輸環境,也能適合低速的數據傳輸場合,因此可以達到資源利用的最大化。 在具體的設計過程中,利用Synplify Pro綜合工具、ModelSim仿真工具、ISE集成的軟件開發環境中對各個功能模塊進行綜合優化、仿真驗證以及下載實現。各項數據結果表明,本課題中所設計的UART滿足預期設計目標。

    標簽: FPGA 異步收發器

    上傳時間: 2013-08-02

    上傳用戶:rocketrevenge

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