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  • 基于DSP的自適應(yīng)噪聲抵消器設(shè)計.rar

    本文的目的在于設(shè)計一個自適應(yīng)噪音抵消系統(tǒng),使其能消除含噪語音信號中的背景噪音,達到提高語音信號質(zhì)量的目的.主要工作分為兩大部分.本文在第一部分介紹了自適應(yīng)數(shù)字濾波器的基本理論思想,具體闡述了自適應(yīng)噪聲抵消系統(tǒng)基本原理,并對自適應(yīng)噪聲抵消系統(tǒng)的指標、抵消性能進行了計算分析.自適應(yīng)濾波器的算法是整個系統(tǒng)的核心,在第一部分中,對兩種最基本的自適應(yīng)算法,進行了詳細的介紹和分析,并針對兩種算法的優(yōu)缺點進行了詳細的比較.這一部分中最關(guān)鍵的是對設(shè)計的噪聲抵消系統(tǒng)進行計算機仿真,驗證系統(tǒng)設(shè)計的合理性和算法的正確性.通過對自適應(yīng)噪聲抵消器的MATLAB仿真及對仿真圖形的分析,驗證了系統(tǒng)設(shè)計和自適應(yīng)算法的可行性.第二部分主要完成自適應(yīng)噪聲抵消系統(tǒng)的硬件設(shè)計和軟件編程.在第一部分計算機仿真分析的基礎(chǔ)上,利用高速信號處理芯片DSP(TMS320LF2407)設(shè)計了一個噪聲干擾抵消系統(tǒng),在高速信號處理芯片(TMS320LF2407)上開發(fā)實現(xiàn)了自適應(yīng)LMS算法.

    標簽: DSP

    上傳時間: 2013-06-28

    上傳用戶:zklh8989

  • 自舉驅(qū)動中文資料.rar

    關(guān)于半橋或全橋自舉式浮動?xùn)艠O驅(qū)動的四個中文文檔,為飛兆和IR公司技術(shù)文檔,介紹了自舉電路元件的選取及實際問題解決。可從其官網(wǎng)中下載。這里集合上傳~

    標簽: 驅(qū)動

    上傳時間: 2013-07-30

    上傳用戶:碉堡1234

  • 1553B總線接口技術(shù)研究及FPGA實現(xiàn).rar

    本論文在詳細研究MIL-STD-1553B數(shù)據(jù)總線協(xié)議以及參考國外芯片設(shè)計的基礎(chǔ)上,結(jié)合目前新興的EDA技術(shù)和大規(guī)模可編程技術(shù),提出了一種全新的基于FPGA的1553B總線接口芯片的設(shè)計方法。 從專用芯片實現(xiàn)的具體功能出發(fā),結(jié)合自頂向下的設(shè)計思想,給出了總線接口的總體設(shè)計方案,考慮到電路的具體實現(xiàn)對結(jié)構(gòu)進行模塊細化。在介紹模擬收發(fā)器模塊的電路設(shè)計后,重點介紹了基于FPGA的BC、RT、MT三種類型終端設(shè)計,最終通過工作方式選擇信號以及其他控制信號將此三種終端結(jié)合起來以達到通用接口的功能。同時給出其設(shè)計邏輯框圖、算法流程圖、引腳說明以及部分模塊的仿真結(jié)果。為了資源的合理利用,對其中相當(dāng)部分模塊進行復(fù)用。在設(shè)計過程中采用自頂向下、碼型轉(zhuǎn)換中的全數(shù)字鎖相環(huán)、通用異步收發(fā)器UART等關(guān)鍵技術(shù)。本設(shè)計使用VHDL描述,在此基礎(chǔ)之上采用專門的綜合軟件對設(shè)計進行了綜合優(yōu)化,在FPGA芯片EP1K100上得以實現(xiàn)。通過驗證證明該設(shè)計能夠完成BC/RT/MT三種模式的工作,能處理多種消息格式的傳輸,并具有較強的檢錯能力。 最后設(shè)計了總線接口芯片測試系統(tǒng),選擇TMS320LF2407作為主處理器,測試主要包括主處理器的自發(fā)自收驗證,加入RS232串口調(diào)試過程提高測試數(shù)據(jù)的直觀性。驗證的結(jié)果表明本文提出的設(shè)計方案是合理的。

    標簽: 1553B FPGA 總線接口

    上傳時間: 2013-06-04

    上傳用戶:ayfeixiao

  • 基于FPGA控制的高速數(shù)據(jù)采集系統(tǒng)設(shè)計與實現(xiàn).rar

    數(shù)據(jù)采集系統(tǒng)是信號與信息處理系統(tǒng)中不可缺少的重要組成部分,同時也是軟件無線電系統(tǒng)中的核心模塊,在現(xiàn)代雷達系統(tǒng)以及無線基站系統(tǒng)中的應(yīng)用越來越廣泛。為了能夠滿足目前對軟件無線電接收機自適應(yīng)性及靈活性的要求,并充分體現(xiàn)在高性能FPGA平臺上設(shè)計SOC系統(tǒng)的思路,本文提出了由高速高精度A/D轉(zhuǎn)換芯片、高性能FPGA、PCI總線接口、DB25并行接口組成的高速數(shù)據(jù)采集系統(tǒng)設(shè)計方案及實現(xiàn)方法。其中FPGA作為本系統(tǒng)的控制核心和傳輸橋梁,發(fā)揮了極其重要的作用。通過FPGA不僅完成了系統(tǒng)中全部數(shù)字電路部分的設(shè)計,并且使系統(tǒng)具有了較高的可適應(yīng)性、可擴展性和可調(diào)試性。 在時序數(shù)字邏輯設(shè)計上,充分利用FPGA中豐富的時序資源,如鎖相環(huán)PLL、觸發(fā)器,緩沖器FIFO、計數(shù)器等,能夠方便的完成對系統(tǒng)輸入輸出時鐘的精確控制以及根據(jù)系統(tǒng)需要對各處時序延時進行修正。 在存儲器設(shè)計上,采用FPGA片內(nèi)存儲器。可根據(jù)系統(tǒng)需要隨時進行設(shè)置,并且能夠方便的完成數(shù)據(jù)格式的合并、拆分以及數(shù)據(jù)傳輸率的調(diào)整。 在傳輸接口設(shè)計上,采用并行接口和PCI總線接口的兩種數(shù)據(jù)傳輸模式。通過FPGA中的宏功能模塊和IP資源實現(xiàn)了對這兩種接口的邏輯控制,可使系統(tǒng)方便的在兩種傳輸模式下進行切換。 在系統(tǒng)工作過程控制上,通過VB程序編寫了應(yīng)用于PC端的上層控制軟件。并通過并行接口實現(xiàn)了PC和FPGA之間的交互,從而能夠方便的在PC機上完成對系統(tǒng)工作過程的控制和工作模式的選擇。 在系統(tǒng)調(diào)試方面,充分利用QuartuslI軟件中自帶的嵌入式邏輯分析儀SignalTaplI,實時準確的驗證了在系統(tǒng)整個傳輸過程中數(shù)據(jù)的正確性和時序性,并極大的降低了用常規(guī)儀器觀測FPGA中眾多待測引腳的難度。 本文第四章針對FPGA中各功能模塊的邏輯設(shè)計進行了詳細分析,并對每個模塊都給出了精確的仿真結(jié)果。同時,文中還在其它章節(jié)詳細介紹了系統(tǒng)的硬件電路設(shè)計、并行接口設(shè)計、PCI接口設(shè)計、PC端控制軟件設(shè)計以及用于調(diào)試過程中的SignalTapⅡ嵌入式邏輯分析儀的使用方法,并且也對系統(tǒng)的仿真結(jié)果和測試結(jié)果給出了分析及討論。最后還附上了系統(tǒng)的PCB版圖、FPGA邏輯設(shè)計圖、實物圖及注釋詳細的相關(guān)源程序清單。

    標簽: FPGA 控制 高速數(shù)據(jù)

    上傳時間: 2013-07-09

    上傳用戶:sdfsdfs

  • 在仿真環(huán)境下實現(xiàn)TMS320C6000系列DSP的程序自引導(dǎo).rar

    在仿真環(huán)境下實現(xiàn)TMS320C6000系列DSP的程序自引導(dǎo)

    標簽: C6000 320C 6000 TMS

    上傳時間: 2013-08-03

    上傳用戶:tdyoung

  • AN-6076供高電壓柵極驅(qū)動器IC使用的自舉電路的設(shè)計和使用準則

    本文講述了一種運用于功率型MOSFET 和IGBT 設(shè)計性能自舉式柵極驅(qū)動電路的系統(tǒng)方法,適用于高頻率,大功率及高效率的開關(guān)應(yīng)用場合。不同經(jīng)驗的電力電子工程師們都能從中獲益。在大多數(shù)開關(guān)應(yīng)用中

    標簽: 6076 AN 高電壓 柵極驅(qū)動器IC

    上傳時間: 2013-04-24

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  • 基于FPGA的自適應(yīng)濾波器設(shè)計與實現(xiàn)

    自適應(yīng)濾波器是統(tǒng)計信號處理的一個重要組成部分。在實際應(yīng)用中,由于沒有充足的信息來設(shè)計固定系數(shù)的數(shù)字濾波器,或者設(shè)計規(guī)則會在濾波器正常運行時改變,因此我們需要研究自適應(yīng)濾波器。凡是需要處理未知統(tǒng)計環(huán)境下運算結(jié)果所產(chǎn)生的信號或需要處理非平穩(wěn)信號時,自適應(yīng)濾波器可以提供一種吸引人的解決方法,而且其性能通常遠優(yōu)于用常規(guī)方法設(shè)計的固定濾波器。此外,自適應(yīng)濾波器還能提供非自適應(yīng)方法所不可能提供的新的信號處理能力。 本論文從自適應(yīng)濾波器研究的重要意義入手,介紹了線性自適應(yīng)濾波器的基本原理、算法及設(shè)計方法,對幾種基于最小均方誤差準則或最小平方誤差準則的自適應(yīng)濾波器算法進行研究,最終基于一改近的LMS算法設(shè)計復(fù)數(shù)自適應(yīng)濾波器,并以VHDL語言編寫在maxplus平臺上進行仿真測試。

    標簽: FPGA 自適應(yīng)濾波器

    上傳時間: 2013-07-11

    上傳用戶:W51631

  • 基于FPGA的高速采樣自適應(yīng)濾波系統(tǒng)的研究

    自適應(yīng)濾波器的硬件實現(xiàn)一直是自適應(yīng)信號處理領(lǐng)域研究的熱點。隨著電子技術(shù)的發(fā)展,數(shù)字系統(tǒng)功能越來越強大,對器件的響應(yīng)速度也提出更高的要求。 本文針對用通用DSP 芯片實現(xiàn)的自適應(yīng)濾波器處理速度低和用HDL語言編寫底層代碼用FPGA實現(xiàn)的自適應(yīng)濾波器開發(fā)效率低的缺點,提出了一種基于DSP Builder系統(tǒng)建模的設(shè)計方法。以隨機2FSK信號作為研究對象,首先在matlab上編寫了LMS去噪自適應(yīng)濾波器的點M文件,改變自適應(yīng)參數(shù),進行了一系列的仿真,對算法迭代步長、濾波器的階數(shù)與收斂速度和濾波精度進行了研究,得出了最佳自適應(yīng)參數(shù),即迭代步長μ=0.0057,濾波器階數(shù)m=8,為硬件實現(xiàn)提供了參考。 然后,利用最新DSP Builder工具建立了基于LMS算法的8階2FSK信號去噪自適應(yīng)濾波器的模型,結(jié)合多種EDA工具,在EPFlOKl00EQC208-1器件上設(shè)計出了最高數(shù)據(jù)處理速度為36.63MHz的8階LMS自適應(yīng)濾波器,其速度是文獻[3]通過編寫底層VHDL代碼設(shè)計的8階自適應(yīng)濾波器數(shù)據(jù)處理速度7倍多,是文獻[50]采用DSP通用處理器TMS320C54X設(shè)計的8階自適應(yīng)濾波器處理速度25倍多,開發(fā)效率和器件性能都得到了大大地提高,這種全新的設(shè)計理念與設(shè)計方法是EDA技術(shù)的前沿與發(fā)展方向。 最后,采用異步FIFO技術(shù),設(shè)計了高速采樣自適應(yīng)濾波系統(tǒng),完成了對雙通道AD器件AD9238與自適應(yīng)濾波器的高速匹配控制,在QuartusⅡ上進行了仿真,給出了系統(tǒng)硬件實現(xiàn)的原理框圖,并將采樣濾波控制器與異步FIF0集成到同一芯片上,既能有效降低高頻可能引起的干擾又降低了系統(tǒng)的成本。

    標簽: FPGA 高速采樣 自適應(yīng)濾波

    上傳時間: 2013-06-01

    上傳用戶:ynwbosss

  • 基于FPGA的雙自觸發(fā)脈沖激光測距關(guān)鍵技術(shù)研究

    激光測距技術(shù)被廣泛應(yīng)用于現(xiàn)代工業(yè)測量、航空與大地的測量、國防及通信等諸多領(lǐng)域。本文從已獲得廣泛應(yīng)用的脈沖激光測距技術(shù)入手,重點分析了近年提出的自觸發(fā)脈沖激光測距技術(shù)(STPLR)特別是其中的雙自觸發(fā)脈沖激光測距技術(shù)(BSTPLR),通過分析發(fā)現(xiàn)其核心部件之一就是用于測量激光脈沖飛行時間(周期)的高精度高速計數(shù)器,而目前一般的方式是采用昂貴的進口高速計數(shù)器或?qū)S眉呻娐?ASIC)來完成,這使得激光測距儀在研發(fā)、系統(tǒng)的改造升級和自主知識產(chǎn)權(quán)保護等諸多方面受到制約,同時在其整體性能上特別是在集成化、小型化和高可靠性方面帶來阻礙。為此,本文研究了采用現(xiàn)場可編程門陣列(FPGA)來實現(xiàn)脈沖激光測距中的高精度高速計數(shù)及其他相關(guān)功能,基本解決了以上存在的問題。 論文通過對雙自觸發(fā)脈沖激光測距的主要技術(shù)要求和技術(shù)指標進行分析,對其中的信號處理單元采用了FPGA+單片機的設(shè)計形式。由FPGA主控芯片(EPF10K20TC144-4)作為周期測量模塊,在整個測距系統(tǒng)中是信號處理的核心部件,借助其用戶可編程特性及很高的內(nèi)部時鐘頻率,設(shè)計了專用于BSTPLR的高速高精度計數(shù)芯片,負責(zé)對測距信號產(chǎn)生電路中的時刻鑒別電路輸出信號進行計數(shù)。數(shù)據(jù)處理模塊則主要由單片機(AT89C51)來實現(xiàn)。系統(tǒng)可以通過鍵盤預(yù)置門控信號的寬度以均衡測量的精度和速度,測量結(jié)果采用7位LED數(shù)碼管顯示。本設(shè)計在近距離(大尺寸)范圍內(nèi)實驗測試時基本滿足設(shè)計要求。

    標簽: FPGA 自觸發(fā)脈沖 激光測距 關(guān)鍵技術(shù)

    上傳時間: 2013-06-02

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  • 開關(guān)磁阻電機的新型齒極結(jié)構(gòu)及自組織模糊控制

    開關(guān)磁阻電機驅(qū)動系統(tǒng)(SRD)是一種新型交流驅(qū)動系統(tǒng),以結(jié)構(gòu)簡單、堅固耐用、成本低廉、控制參數(shù)多、控制方法靈活、可得到各種所需的機械特性,而備受矚目,應(yīng)用日益廣泛.并且SRD在寬廣的調(diào)速范圍內(nèi)均具有較高的效率,這一點是其它調(diào)速系統(tǒng)所不可比擬的.但開關(guān)磁阻電機(SRM)的振動與噪聲比較大,這影響了SRD在許多領(lǐng)域的應(yīng)用.本文針對上述問題進行了研究,提出了一種新型齒極結(jié)構(gòu),可有效降低開關(guān)磁阻電機的振動與噪聲.通過電磁場有限元計算可看出,在新型齒極結(jié)構(gòu)下,導(dǎo)致開關(guān)磁阻電機振動與噪聲的徑向力大為減小,尤其是當(dāng)轉(zhuǎn)子極相對定子極位于關(guān)斷位置時,徑向力大幅度地減小,并改善了徑向力沿定子圓周的分布,使其波動減小,從而減小了定子鐵心的變形與振動,進而降低了開關(guān)磁阻電機的噪聲.靜態(tài)轉(zhuǎn)矩因轉(zhuǎn)子極開槽也略微減小,但對電機的效率影響不大.開關(guān)磁阻電機因磁路的飽和導(dǎo)致參數(shù)的非線性,又因在不同控制方式下是變結(jié)構(gòu)的.這使得開關(guān)磁阻電機的控制非常困難.經(jīng)典的線性控制方法如PI、PID等方法用于開關(guān)磁阻電機的控制,效果不好.其它的控制方法如滑模變結(jié)構(gòu)控制、狀態(tài)空間控制方法等可取得較好的控制效果但大都比較復(fù)雜,實現(xiàn)起來比較困難.而智能控制方法如模糊控制本身為一種非線性控制方法,對于非線性、變結(jié)構(gòu)、時變的被控對象均可取得較好的控制效果且不需知道被控對象的數(shù)學(xué)模型,這對于很難精確建模的開關(guān)磁阻電機來說尤其適用.同時,模糊控制實現(xiàn)比較容易.但對于變參數(shù)、變結(jié)構(gòu)的開關(guān)磁阻電機來說固定參數(shù)的模糊控制在不同條件下其控制效果難以達到最優(yōu).為取得最優(yōu)的控制效果,該文采用帶修正因子的自組織模糊控制器,采用單純形加速優(yōu)化算法通過在線調(diào)整參數(shù),達到了較好的控制效果.仿真結(jié)果證明了這一點.

    標簽: 開關(guān)磁阻電機 自組織 模糊控制

    上傳時間: 2013-05-16

    上傳用戶:大三三

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