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芯片生產工藝

  • AD6525芯片參考設計電路原理圖

    基帶芯片AD6525的應用電路。在05年之前的手機中應用非常廣泛,配合AD652x的幾款芯片便可完成手機信號處理中的大部分功能。

    標簽: 6525 AD 芯片 參考設計

    上傳時間: 2013-04-24

    上傳用戶:guanliya

  • 基于ARM的手持式RFID讀寫器的研究與實現

    當代科學技術突飛猛進,極大促進了自動識別技術的發展——條形碼、光學字符識別、磁條(卡)、工C卡、語音識別、視覺識別、RFID等,其中,RFID無疑是最為前沿的自動識別技術,是一種非接觸式的識別技術;同時,隨著另外一項技術——嵌入式技術的飛速發展,機構小巧、性能優越、價格便宜、操作簡便的手持式數據自動讀寫設備發展尤為迅速。具體說來,一款好的手持式RFID讀寫器適用于工作現場,可以供工作人員對現場物品信息進行自動收集,而隨著嵌入式操作系統和網絡技術的應用,使讀寫器不僅有數據采集功能,而且可以對數據進行分析以供管理決策。在這其中,操作系統、芯片、總線、接口技術成為讀寫器的內核,嵌入式系統成為技術的代表。 隨著嵌入式操作系統(如linux、wirice.net)的出現,使得軟件開發人員在嵌入式系統和普通pc機上進行應用軟件開發不會感到太大的差別(借助于交叉開發環境,即在pc機上編譯連接,但生成的是目標機代碼)。但是,對于那些應用軟件開發者,往往對某一行業軟件開發比較熟悉卻對硬件有些陌生,熟悉硬件原理(嵌入式處理器架構、部件工作原理等)恰恰是構建一個嵌入式系統所必須的。因此,構建一個性能穩定、持續工作時間長、完善數據接口、方便讀寫器接口的手持式設備成為了當今一個比較熱門的技術領域。本項目就是根據以上事實,先分析了國內外研究現狀,再根據項目需求、生產成本以及RFID應用開發者的要求,決定采用以ARM920T為內核的$3C2410為嵌入式處理器、微軟公司力推的wiIice.net為嵌入式操作系統,設計開發了供RFID應用軟件開發者使用的手持式RFID讀寫器。針對手持式設備的特點和實際要求,對讀寫器軟硬件系統整體結構進行了規劃,完成了時鐘電路、nand flash存儲器接口電路、SDRAM電路、串行接口電路、RFID讀寫模塊接口電路、USB接口電路、無線通信模塊接口電路、LCD/觸摸屏接口電路的設計,并開發了讀寫器的二次發API;在wince.net平臺下,利用platform builder工具定制了適于讀寫器的操作系統,實現了嵌入式操作系統的設計,最后對整個系統進行了測試。

    標簽: RFID ARM 手持式 讀寫器

    上傳時間: 2013-06-21

    上傳用戶:yatouzi118

  • LED顯示屏單元板芯片介紹

    LED顯示屏單元板芯片介紹 IC的管腳功能 IC芯片分別:74HC245、74HC595、74HC138、74HC04、4953。各IC管腳功能如下: A: 74HC245功能是放大及緩沖。各引腳如圖 20 和1接電源(+5V) 19腳和10腳接電源地(GND)

    標簽: LED 顯示屏 單元板 芯片介紹

    上傳時間: 2013-05-17

    上傳用戶:小楊高1

  • ISD4004-16M語音芯片的循環錄放電路設計

    針對ISD 語音芯片的特點, 設計一種由單片機控制, 能夠循環錄放的語音電路,可作為錄音機、復讀機、音頻記錄儀使用, 既節省存儲空間, 又降低成本, 具有較高的實用價值。

    標簽: 4004 ISD 16 語音芯片

    上傳時間: 2013-06-24

    上傳用戶:yiwen213

  • Altera FPGA芯片的封裝尺寸選擇指南

    Altera FPGA芯片的封裝尺寸選擇指南

    標簽: Altera FPGA 芯片 封裝尺寸

    上傳時間: 2013-06-04

    上傳用戶:edisonfather

  • 基于ISD4004芯片的語音錄放設計

    基于ISD4004芯片的語音錄放設計,內含詳細說明,程序代碼。

    標簽: 4004 ISD 芯片 語音錄放

    上傳時間: 2013-06-29

    上傳用戶:hakim

  • 基于FPGA的擴頻通信芯片設計及應用

    隨著網絡技術和通信技術的突飛猛進,人們對通信的保密性能,抗干擾能力的要求越來越高,而且對信息隱蔽、多址保密通信等特性提出了更高的要求。這些要求的實現都離不開擴頻通信技術的應用,而擴頻通信芯片作為擴頻通信網絡的核心器件,自然也成了研究的重點。本論文旨在借鑒國內外相關研究成果,并以家庭電力線通信環境為背景,驗證了一種CDMA碼分多址通信的實現方案,并通過智能家庭系統展示了其應用效果。 本課題以構建家庭電力載波通信網絡為目標,首先,以兩塊Cyclone系列FPGA開發板為基礎,分別作為發送單元和接收單元,構建了系統的硬件開發平臺;以QuartusⅡ 7.2為開發環境,運用Verilog硬件描述語言,編寫擴頻模塊和解擴模塊,并且進行了測試、仿真和綜合,驗證了通過專用芯片實現擴頻通信系統的可行性。應用方面,采用電力線載波通信芯片,提出了一種由智能插線板和嵌入式網關構成的家電控制系統。用戶通過WEB方式登陸嵌入式網關,智能插線板能夠在嵌入式網關的控制下控制電器的電源、發送紅外遙控指令,實現對家電的遠程遙控。使用兩塊FPGA開發板,實現了擴頻通信基本收發是本設計得主要成果;將擴頻通訊技術、嵌入式Web技術引入到智能家庭系統的設計當中是本文的一個特點。 仿真和實驗表明:采用電力線載波通信芯片組建家庭網絡的方案可行,由智能插線板和嵌入式網關構成的家電控制系統能靈活、便捷地實施家電控制,并具有一定的節能效果。

    標簽: FPGA 擴頻通信 芯片設計

    上傳時間: 2013-06-17

    上傳用戶:vaidya1bond007b1

  • 基于FPGA的圖像處理算法及壓縮編碼

    本文以“機車車輛輪對動態檢測裝置”為研究背景,以改進提升裝置性能為目標,研究在Altera公司的FPGA(Field Programmable Gate Array)芯片Cyclone上實現圖像采集控制、圖像處理算法、JPEG(Joint Photographic Expert Group)壓縮編碼標準的基本系統。本文使用硬件描述語言Verilog,以RedLogic的RVDK開發板作為硬件平臺,在開發工具OUARTUS2 6.0和MODELSIM SE 6.1B環境中完成軟核的設計與仿真驗證。 數據采集部分完成的功能是將由模擬攝像機拍攝到的圖像信號進行數字化,然后從數據流中提取有效數據,加以適當裁剪,最后將奇偶場圖像數據合并成幀,存儲到存儲器中。數字化及碼流產生的功能由SAA7113芯片完成,由FPGA對SAA7113芯片初始化設置、控制,并對數字化后的數據進行操作。 圖像處理算法部分考慮到實時性與算法復雜度等因素,從裝置的圖像處理流程中有選擇性地實現了直方圖均衡化、中值濾波與邊緣檢測三種圖像處理算法。 壓縮編碼部分依據JPEG標準基本系統順序編碼模式,在FPGA上實現了DCT(Discrete Cosine Transform)變換、量化、Zig-Zag掃描、直流系數DPCM(Differential Pulse Code Modulation)編碼、交流系數RLC(Run Length code)編碼、霍夫曼編碼等主要步驟,最后用實際的圖像數據塊對系統進行了驗證。

    標簽: FPGA 圖像處理 壓縮編碼 算法

    上傳時間: 2013-04-24

    上傳用戶:qazwsc

  • AD芯片大全

    AD系列芯片 1.模數轉換器 AD1380JD 16位 20us高性能模數轉換器(民用級) AD1380KD 16位 20us高性能模數轉換器(民用級) AD1671JQ 12位 1.25MHz采樣速率 帶寬2MHz模數轉換器(民用級) AD1672AP 12位 3MHz采樣速率 帶寬20MHz單電源模數轉換器(工業級) AD1674JN 12位 100KHz采樣速率 帶寬500KHz模數轉換器(民用級) AD1674AD 12位 100KHz采樣速率 帶寬500KHz模數轉換器(工業級)

    標簽: AD芯片

    上傳時間: 2013-05-19

    上傳用戶:ljmwh2000

  • 系統芯片SoC原型驗證技術

    隨著系統芯片(SoC)設計復雜度不斷增加,使得縮短面市時間的壓力越來越大。雖然IP核復用大大減少了SoC的設計時間,但是SoC的驗證仍然非常復雜耗時。SoC和ASIC的最大不同之處在于它的規模和復雜的系統性,除了大量硬件模塊之外,SoC還需要大量的同件和軟件,如操作系統,驅動程序以及應用程序等。面對SoC數目眾多的硬件模塊,復雜的嵌入式軟件,由于軟件仿真速度和仿真模犁的局限性,驗證往往難以達到令人滿意的要求,耗費了大最的時間,將給系統芯片的上市帶來嚴重的影響。為了減少此類情況的發生,在流樣片之前,進行基于FPGA的系統原型驗證,即在FPGA上快速地實現SoC設計中的硬件模塊,讓軟件模塊在真正的硬件環境中高速運行,從而實現SoC設計的軟硬件協同驗證。這種方法已經成為SoC設計流程前期階段常用的驗證方法。 在簡要分析幾種業內常用的驗證技術的基礎上,本文重點闡述了基于FPGA的SoC驗證流程與技術。結合Mojox數碼相機系統芯片(以下簡稱為Mojox SoC)的FPGA原型驗證平臺的設計,介紹了Mojox FPGA原型驗證平臺的硬件設計過程和Mojox SoC的FPGA原型實現,并采用基于模塊的FPGA設計實現方法,加快了原型驗證的工作進程。 本文還介紹了Mojox SoC中ARM固件和PC應用軟件等原型軟件的設計實現以及原型驗證平臺的軟硬協同驗證的過程。通過軟硬協同驗證,本文實現了PC機對整個驗證平臺的摔制,達到了良好的驗證效果,且滿足了預期的設計要求。

    標簽: SoC 系統芯片 原型 驗證技術

    上傳時間: 2013-07-02

    上傳用戶:dsgkjgkjg

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