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芯片設(shè)(shè)計(jì)

基于FPGA的JPEG圖像壓縮芯片設(shè)計(jì)

基于FPGA的JPEG圖像壓縮芯片設(shè)計(jì)

標(biāo)簽： FPGA JPEG 圖像壓縮芯片設(shè)計(jì)

上傳時間： 2013-08-18

上傳用戶：木子葉1
一套基于XILIX,SPATAN2,XC2S200 芯片實(shí)驗(yàn)板上的,10個典型VRILOGHDL的FPGA實(shí)驗(yàn)

一套基于XILIX,SPATAN2,XC2S200 芯片實(shí)驗(yàn)板上的,10個典型VRILOGHDL的FPGA實(shí)驗(yàn),有幫助,

標(biāo)簽： VRILOGHDL SPATAN XILIX FPGA

上傳時間： 2013-08-19

上傳用戶：偷心的海盜
一個很好的對不同F(xiàn)PGA時芯片的選擇資料

一個很好的對不同F(xiàn)PGA時芯片的選擇資料,對你的設(shè)計(jì)很有幫助

標(biāo)簽： FPGA 芯片

上傳時間： 2013-08-20

上傳用戶：maricle
_Wiley_Synthesis_of_Arithmetic_Circuits_-_FPGA_ASIC_and_Embedded_Systems_(2006)

_Wiley_Synthesis_of_Arithmetic_Circuits_-_FPGA_ASIC_and_Embedded_Systems_(2006)_-_DDU一些硬體設(shè)計(jì)教學(xué)文件

標(biāo)簽： Wiley_Synthesis_of_Arithmetic_Cir FPGA_ASIC_and_Embedded_Systems cuits 2006

上傳時間： 2013-08-20

上傳用戶：lchjng
16QAM接收機(jī)解調(diào)芯片的FPGA實(shí)現(xiàn)

描述了一個用于微波傳輸設(shè)備的16QAM接收機(jī)解調(diào)芯片的FPGA實(shí)現(xiàn),芯片集成了定時恢復(fù)、載波恢復(fù)和自適應(yīng)盲判決反饋均衡器(DFE),采用恒模算法(CMA)作為均衡算法。芯片支持高達(dá)25M波特的符號速率,在一片EP1C12Q240C8(ALTERA)上實(shí)現(xiàn),即將用于量產(chǎn)的微波傳輸設(shè)備中。\\r\\n

標(biāo)簽： FPGA QAM 16 接收機(jī)

上傳時間： 2013-08-22

上傳用戶：23333
基于FPGA加密芯片設(shè)計(jì)論文（AES和DES算法）

基于FPGA加密芯片設(shè)計(jì)論文（AES和DES算法）

標(biāo)簽： FPGA AES DES 加密

上傳時間： 2013-08-29

上傳用戶：weixiao99
自己現(xiàn)在用的CPLD下載線原理圖用74HC244芯片\r\n

自己現(xiàn)在用的CPLD下載線，用74HC244芯片\r\n要注意設(shè)置下載模式

標(biāo)簽： CPLD 244 74 HC

上傳時間： 2013-08-31

上傳用戶：dancnc
采用Verilog語言,實(shí)現(xiàn)了FPGA控制視頻芯片的數(shù)據(jù)采集,并將數(shù)據(jù)按幀存儲起來

采用Verilog語言,實(shí)現(xiàn)了FPGA控制視頻芯片的數(shù)據(jù)采集,并將數(shù)據(jù)按幀存儲起來

標(biāo)簽： Verilog FPGA 語言控制

上傳時間： 2013-09-01

上傳用戶：喵米米米
RSA密碼芯片的FPGA實(shí)現(xiàn)

RSA密碼芯片的FPGA實(shí)現(xiàn)\r\n請有需要的人來下載

標(biāo)簽： FPGA RSA 密碼芯片

上傳時間： 2013-09-01

上傳用戶：tangsiyun
一段控制1394芯片的cpld的verilog程序

這是一段控制1394芯片的cpld的verilog程序,可以參考,在實(shí)際項(xiàng)目中已經(jīng)采用.

標(biāo)簽： verilog 1394 cpld 控制

上傳時間： 2013-09-04

上傳用戶：pkkkkp

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