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用了還是沒用上的，大家都來看看啊，呵呵，希望對你會有所幫助 cos()余弦tan()正切sin()正弦sqrt()平方根 asin()反正弦acos()反余弦atan()反正切sinh()雙曲線正弦 cosh()雙曲線余弦tanh()雙曲線正切 注釋：所有三角函數都使用單位度。 log()以10為底的對數ln()自然對數 exp()e的冪abs()絕對值 ceil()不小于其值的最小整數 floor()不超過其值的最大整數 可以給函數ceil和floor加一個可選的自變量，用它指定要圓整的小數位數。帶有圓整參數的這些函數的語法是： ceil(parameter_name或number,number_of_dec_places) floor(parameter_name或number,number_of_dec_places) 其中number_of_dec_places是可選值： 1、可以被表示為一個數或一個使用者自定義參數。如果該參數值是一個實數，則被截尾成為一個整數。 2、它的最大值是8。如果超過8，則不會舍入要舍入的數（第一個自變量），并使用其初值。 3、如果不指定它，則功能同前期版本一樣。 使用不指定小數部分位數的ceil和floor函數，其舉例如下： ceil(10.2)值為11 floor(10.2)值為11 使用指定小數部分位數的ceil和floor函數，其舉例如下： ceil(10.255,2)等于10.26 ceil(10.255,0)等于11[與ceil(10.255)相同] floor(10.255,1)等于10.2 floor(10.255,2)等于10.26
標簽： proe
上傳時間： 2013-10-20
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PROE的配置文件讓不少初學者感到煩惱，盡管不少教材里都會提到關于PROE的配置文件。但大多數顯得過于理論化，而不便于初學者理解，可操作性不強。本文力求以通俗的語言結合實際運用向大家介紹PROE的配置文件，希望能給各位帶來幫助。
上傳時間： 2013-11-03
上傳用戶：lps11188
通用陣列邏輯GAL實現基本門電路的設計 一、實驗目的 1.了解GAL22V10的結構及其應用； 2.掌握GAL器件的設計原則和一般格式； 3.學會使用VHDL語言進行可編程邏輯器件的邏輯設計； 4.掌握通用陣列邏輯GAL的編程、下載、驗證功能的全部過程。 二、實驗原理 1. 通用陣列邏輯GAL22V10 通用陣列邏輯GAL是由可編程的與陣列、固定（不可編程）的或陣列和輸出邏輯宏單元（OLMC）三部分構成。GAL芯片必須借助GAL的開發軟件和硬件，對其編程寫入后，才能使GAL芯片具有預期的邏輯功能。GAL22V10有10個I/O口、12個輸入口、10個寄存器單元，最高頻率為超過100MHz。 ispGAL22V10器件就是把流行的GAL22V10與ISP技術結合起來，在功能和結構上與GAL22V10完全相同，并沿用了GAL22V10器件的標準28腳PLCC封裝。ispGAl22V10的傳輸時延低于7.5ns，系統速度高達100MHz以上，因而非常適用于高速圖形處理和高速總線管理。由于它每個輸出單元平均能夠容納12個乘積項，最多的單元可達16個乘積項，因而更為適用大型狀態機、狀態控制及數據處理、通訊工程、測量儀器等領域。ispGAL22V10的功能框圖及引腳圖分別見圖1-1和1-2所示。 另外，采用ispGAL22V10來實現諸如地址譯碼器之類的基本邏輯功能是非常容易的。為實現在系統編程，每片ispGAL22V10需要有四個在系統編程引腳，它們是串行數據輸入(SDI)，方式選擇(MODE)、串行輸出(SDO)和串行時鐘(SCLK)。這四個ISP控制信號巧妙地利用28腳PLCC封裝GAL22V10的四個空腳，從而使得兩種器件的引腳相互兼容。在系統編程電源為+5V，無需外接編程高壓。每片ispGAL22V10可以保證一萬次在系統編程。 ispGAL22V10的內部結構圖如圖1-3所示。 2.編譯、下載源文件 用VHDL語言編寫的源程序，是不能直接對芯片編程下載的，必須經過計算機軟件對其進行編譯，綜合等最終形成PLD器件的熔斷絲文件(通常叫做JEDEC文件，簡稱為JED文件)。通過相應的軟件及編程電纜再將JED數據文件寫入到GAL芯片，這樣GAL芯片就具有用戶所需要的邏輯功能。 3.工具軟件ispLEVER簡介 ispLEVER 是Lattice 公司新推出的一套EDA軟件。設計輸入可采用原理圖、硬件描述語言、混合輸入三種方式。能對所設計的數字電子系統進行功能仿真和時序仿真。編譯器是此軟件的核心，能進行邏輯優化，將邏輯映射到器件中去，自動完成布局與布線并生成編程所需要的熔絲圖文件。軟件中的Constraints Editor工具允許經由一個圖形用戶接口選擇I/O設置和引腳分配。軟件包含Synolicity公司的“Synplify”綜合工具和Lattice的ispVM器件編程工具，ispLEVER軟件提供給開發者一個簡單而有力的工具。
上傳時間： 2013-11-17
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PCB設計問題集錦 問：PCB圖中各種字符往往容易疊加在一起，或者相距很近，當板子布得很密時，情況更加嚴重。當我用Verify Design進行檢查時，會產生錯誤，但這種錯誤可以忽略。往往這種錯誤很多，有幾百個，將其他更重要的錯誤淹沒了，如何使Verify Design會略掉這種錯誤，或者在眾多的錯誤中快速找到重要的錯誤。 答：可以在顏色顯示中將文字去掉,不顯示后再檢查;并記錄錯誤數目。但一定要檢查是否真正屬于不需要的文字。 問： What’s mean of below warning:(6230,8330 L1) Latium Rule not checked: COMPONENT U26 component rule.答：這是有關制造方面的一個檢查，您沒有相關設定，所以可以不檢查。 問： 怎樣導出jop文件？答：應該是JOB文件吧？低版本的powerPCB與PADS使用JOB文件。現在只能輸出ASC文件，方法如下STEP：FILE/EXPORT/選擇一個asc名稱/選擇Select ALL/在Format下選擇合適的版本/在Unit下選Current比較好/點擊OK/完成然后在低版本的powerPCB與PADS產品中Import保存的ASC文件，再保存為JOB文件。 問： 怎樣導入reu文件？答：在ECO與Design 工具盒中都可以進行，分別打開ECO與Design 工具盒，點擊右邊第2個圖標就可以。 問： 為什么我在pad stacks中再設一個via:1(如附件）和默認的standardvi(如附件）在布線時V選擇1，怎么布線時按add via不能添加進去這是怎么回事，因為有時要使用兩種不同的過孔。答：PowerPCB中有多個VIA時需要在Design Rule下根據信號分別設置VIA的使用條件，如電源類只能用Standard VIA等等，這樣操作時就比較方便。詳細設置方法在PowerPCB軟件通中有介紹。 問：為什么我把On-line DRC設置為prevent..移動元時就會彈出(圖2),而你們教程中也是這樣設置怎么不會呢?答：首先這不是錯誤,出現的原因是在數據中沒有BOARD OUTLINE.您可以設置一個,但是不使用它作為CAM輸出數據. 問：我用ctrl+c復制線時怎設置原點進行復制，ctrl+v粘帖時總是以最下面一點和最左邊那一點為原點 答： 復制布線時與上面的MOVE MODE設置沒有任何關系,需要在右鍵菜單中選擇,這在PowerPCB軟件通教程中有專門介紹. 問：用(圖4)進行修改線時拉起時怎總是往左邊拉起(圖5)，不知有什么辦法可以輕易想拉起左就左，右就右。答： 具體條件不明,請檢查一下您的DESIGN GRID,是否太大了. 問： 好不容易拉起右邊但是用(圖6)修改線怎么改怎么下面都會有一條不能和在一起，而你教程里都會好好的(圖8)答：這可能還是與您的GRID 設置有關,不過沒有問題,您可以將不需要的那段線刪除.最重要的是需要找到布線的感覺,每個軟件都不相同,所以需要多練習。 問： 尊敬的老師:您好！這個圖已經畫好了，但我只對（如圖1）一種的完全間距進行檢查，怎么錯誤就那么多，不知怎么改進。請老師指點。這個圖在附件中請老師幫看一下，如果還有什么問題請指出來，本人在改進。謝！！！！！答：請注意您的DRC SETUP窗口下的設置是錯誤的,現在選中的SAME NET是對相同NET進行檢查,應該選擇NET TO ALL.而不是SAME NET有關各項參數的含義請仔細閱讀第5部教程. 問： U101元件已建好，但元件框的拐角處不知是否正確，請幫忙CHECK 答：元件框等可以通過修改編輯來完成。問： U102和U103元件沒建完全，在自動建元件參數中有幾個不明白：如：SOIC--》silk screen欄下spacing from pin與outdent from first pin對應U102和U103元件應寫什么數值，還有這兩個元件SILK怎么自動設置，以及SILK內有個圓圈怎么才能畫得與該元件參數一致。 答：Spacing from pin指從PIN到SILK的Y方向的距離,outdent from first pin是第一PIN與SILK端點間的距離.請根據元件資料自己計算。
上傳時間： 2014-01-03
上傳用戶：Divine
電路板級的電磁兼容設計:本應用文檔從元件選擇、電路設計和印制電路板的布線等幾個方面討論了電路板級的電磁兼容性（EMC）設計。本文從以下幾個部分進行論述：第一部分：電磁兼容性的概述第二部分：元件選擇和電路設計技術第三部分：印制電路板的布線技術附錄A：電磁兼容性的術語附錄B：抗干擾的測量標準第一部分 — 電磁干擾和兼容性的概述電磁干擾是現代電路工業面對的一個主要問題。為了克服干擾，電路設計者不得不移走干擾源，或設法保護電路不受干擾。其目的都是為了使電路按照預期的目標來工作——即達到電磁兼容性。通常，僅僅實現板級的電磁兼容性這還不夠。雖然電路是在板級工作的，但是它會對系統的其它部分輻射出噪聲，從而產生系統級的問題。另外，系統級或是設備級的電磁兼容性必須要滿足某種輻射標準，這樣才不會影響其他設備或裝置的正常工作。許多發達國家對電子設備和儀器有嚴格的電磁兼容性標準；為了適應這個要求，設計者必須從板級設計開始就考慮抑制電子干擾。
上傳時間： 2013-11-19
上傳用戶：lingfei
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上傳時間： 2013-10-23
上傳用戶：彭玖華
介紹了基于Matlab/RTW（Real-time Workshop）和RTX（Real-time extension）構建實時仿真系統的方法；針對基于RTX的實時仿真系統不能直接進行在線調參的不足，提出了一種利用C API（C文件應用程序接口）實現在線調參的方法。經過實驗證明，此仿真系統不僅具有很強的實時性，并且擁有良好的人機交互能力；另外，在線調參功能的實現使仿真試驗的效率得到了大大的提高，而且還可以作為一種故障注入方法來考察模型的容錯能力，是基于RTX實時仿真系統的一大改良。
上傳時間： 2014-03-20
上傳用戶：lizhizheng88
隨著消費者數據需求量的不斷攀升，全球范圍內的運營商無一不面臨著對無線帶寬前所未有的增長需求。值得慶幸的是，包括標準制定機構 3GPP 等在內的整個行業都在竭盡全力來支持這種需求。LTE 正是為幫助運營商滿足這一指數級數據增長需求應運而生的最佳技術選擇。由于 LTE 部署實施已趨成熟，基站制造商紛紛熱衷于采用片上系統架構(SoC)，以使運營商可在維持并提升服務質量的同時還能大幅降低網絡成本。
上傳時間： 2015-01-02
上傳用戶：墻角有棵樹
本課題選用光電傳感器作為導向傳感器，以設計出使用方便、價格低廉、引導精確、響應速度快的AGV工廠自動運貨車為研究目的。 AGV是自動導引運輸車（Automated Guided Vehicle）的英文縮寫，是當今柔性制造系統(FMS)和自動化倉儲系統中物流運輸的有效手段。自動導引運輸車系統的核心設備是自動導引運輸車，作為一種無人駕駛工業搬運車輛，一般用蓄電池作為動力，載重量從幾公斤到上百噸，工作場地可以是辦公室、車間，也可以是港口、碼頭。 現代的AGV都是由計算機控制的，車上裝有微處理器。多數的AGVS配有系統集中控制與管理計算機，用于對AGV的作業過程進行優化，發出搬運指令，跟蹤傳送中的構件。裝備有電磁或光學等自動導引裝置，能夠沿規定的導引路徑行駛，具有安全保護以及各種移載功能的運輸車，工業應用中不需駕駛員的搬運車，以可充電之蓄電池為其動力來源。一般可透過電腦來控制其行進路線以及行為，或利用電磁軌道(electromagnetic path-following system)來設立其行進路線，電磁軌道黏貼於地板上，自動導引運輸車則依循電磁軌道所帶來的訊息進行移動與動作。 AGV以輪式移動為特征，較之步行、爬行或其它非輪式的移動機器人具有行動快捷、工作效率高、結構簡單、可控性強、安全性好等優勢。與物料輸送中常用的其他設備相比，AGV的活動區域無需鋪設軌道、支座架等固定裝置，不受場地、道路和空間的限制。因此，在自動化物流系統中，最能充分地體現其自動性和柔性，實現高效、經濟、靈活的無人化生產。 AGV的常用引導方式有電磁感應式引導，激光引導，電磁陀螺式引導等，通過對這種引導方式的比較，我們選用光電傳感器作為導向傳感器，因為光電檢測方法具有精度高、反應快、非接觸等優點，而且可測參數多，傳感器的結構簡單，形式靈活多樣。選用紅外傳感器作為蔽障傳感器，因為紅外線對外界環境光線的適應能力比較強。用直流測速發電機作為速度傳感器。設計出使用方便、價格低廉、引導精確、響應速度快的AGV。
上傳時間： 2015-01-02
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基于合成孔徑雷達（SAR）圖像的海面風場估計已經得到廣泛認可。多數風速反演算法是以估計的風向、校正的δvv為先驗條件，應用海風模型計算而得的。在相同風向的情況下，應用不同的海風模型會得到不同的風速反演值，因此選擇合適的模型是風場估計的關鍵。同時，風向數據的精確度也很重要，即使不大的誤差也會給風速的反演結果帶來明顯偏差。為解決上述問題這里提出一種不需要預先已知風向數據的風場估計算法。該算法將基于海洋SAR圖像中風浪的條紋信息，以及風浪條紋生成的自相關函數的周期性估計風速數據，同時由風浪條紋的最短周期方向估計風向數據，從而估計出完整的風場矢量。仿真結果顯示，該算法對風速和風向數據有較高的估計精度。
上傳時間： 2013-10-17
上傳用戶：520
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