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  • 華邦用系列單片機資料3

    華邦用系列單片機資料3

    標簽:

    上傳時間: 2013-04-15

    上傳用戶:eeworm

  • 華邦用系列單片機資料1

    華邦用系列單片機資料1

    標簽:

    上傳時間: 2013-06-02

    上傳用戶:eeworm

  • 最新電子元器件產品大全第4冊-電阻器、電容器、電感器及有關元器-1308頁-17.6M.pdf

    專輯類-器件數據手冊專輯-120冊-2.15G 最新電子元器件產品大全第4冊-電阻器、電容器、電感器及有關元器-1308頁-17.6M.pdf

    標簽: 1308 17.6 電子元器件

    上傳時間: 2013-06-02

    上傳用戶:liangrb

  • LED路燈標準與關鍵技術探討-清華-錢可元-40頁-2.8M.pdf

    New-尚未歸類-412冊-8.64G LED路燈標準與關鍵技術探討-清華-錢可元-40頁-2.8M.pdf

    標簽: LED 2.8 40

    上傳時間: 2013-07-22

    上傳用戶:開懷常笑

  • 華邦用系列單片機資料1-11頁-0.2M.pdf

    專輯類-單片機專輯-258冊-4.20G 華邦用系列單片機資料1-11頁-0.2M.pdf

    標簽: 0.2 11

    上傳時間: 2013-06-01

    上傳用戶:問題問題

  • 華邦用系列單片機資料3-22頁-0.3M.pdf

    專輯類-單片機專輯-258冊-4.20G 華邦用系列單片機資料3-22頁-0.3M.pdf

    標簽: 0.3 22

    上傳時間: 2013-08-06

    上傳用戶:1757122702

  • 基于FPGA的高光譜圖像實時端元提取

    由于遙感器的空間分辨力的限制以及自然界地物的復雜性,混合像元普遍存在于遙感圖像中,為了提高遙感應用的精度,就必須解決混合像元的分解問題。而端元提取,則是光譜解混合的重要組成部分。然而,高光譜圖像巨大的數據量和...

    標簽: FPGA 高光譜圖像

    上傳時間: 2013-06-07

    上傳用戶:維子哥哥

  • protel 元 件 封 裝 總 結 很 全 很 詳 細

    protel 元 件 封 裝 總 結 很 全 很 詳 細

    標簽: protel

    上傳時間: 2013-09-20

    上傳用戶:maricle

  • pcb layout design(臺灣硬件工程師15年經驗

    PCB LAYOUT 術語解釋(TERMS)1. COMPONENT SIDE(零件面、正面)︰大多數零件放置之面。2. SOLDER SIDE(焊錫面、反面)。3. SOLDER MASK(止焊膜面)︰通常指Solder Mask Open 之意。4. TOP PAD︰在零件面上所設計之零件腳PAD,不管是否鑽孔、電鍍。5. BOTTOM PAD:在銲錫面上所設計之零件腳PAD,不管是否鑽孔、電鍍。6. POSITIVE LAYER:單、雙層板之各層線路;多層板之上、下兩層線路及內層走線皆屬之。7. NEGATIVE LAYER:通常指多層板之電源層。8. INNER PAD:多層板之POSITIVE LAYER 內層PAD。9. ANTI-PAD:多層板之NEGATIVE LAYER 上所使用之絕緣範圍,不與零件腳相接。10. THERMAL PAD:多層板內NEGATIVE LAYER 上必須零件腳時所使用之PAD,一般稱為散熱孔或導通孔。11. PAD (銲墊):除了SMD PAD 外,其他PAD 之TOP PAD、BOTTOM PAD 及INNER PAD 之形狀大小皆應相同。12. Moat : 不同信號的 Power& GND plane 之間的分隔線13. Grid : 佈線時的走線格點2. Test Point : ATE 測試點供工廠ICT 測試治具使用ICT 測試點 LAYOUT 注意事項:PCB 的每條TRACE 都要有一個作為測試用之TEST PAD(測試點),其原則如下:1. 一般測試點大小均為30-35mil,元件分布較密時,測試點最小可至30mil.測試點與元件PAD 的距離最小為40mil。2. 測試點與測試點間的間距最小為50-75mil,一般使用75mil。密度高時可使用50mil,3. 測試點必須均勻分佈於PCB 上,避免測試時造成板面受力不均。4. 多層板必須透過貫穿孔(VIA)將測試點留於錫爐著錫面上(Solder Side)。5. 測試點必需放至於Bottom Layer6. 輸出test point report(.asc 檔案powerpcb v3.5)供廠商分析可測率7. 測試點設置處:Setup􀃆pads􀃆stacks

    標簽: layout design pcb 硬件工程師

    上傳時間: 2013-10-22

    上傳用戶:pei5

  • 在FPGA中基于信元的FIFO設計方法實戰方法

      設計工程師通常在FPGA上實現FIFO(先進先出寄存器)的時候,都會使用由芯片提供商所提供的FIFO。但是,由于其通用性使得其針對性變差,某些情況下會變得不方便或者將增加硬件成本。此時,需要進行自行FIFO設計。本文提供了一種基于信元的FIFO設計方法以供設計者在適當的時候選用。這種方法也適合于不定長包的處理。

    標簽: FPGA FIFO 信元 設計方法

    上傳時間: 2014-01-13

    上傳用戶:mengmeng444425

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