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處理器內(nèi)核

  • viterbi譯碼器的IP核

    viterbi譯碼器的IP核，可以直接編譯使用

    標(biāo)簽： viterbi IP核 譯碼器

    上傳時間： 2016-11-03

    上傳用戶：希醬大魔王

  • altera 中基于NIOS軟核系統(tǒng)的定時器應(yīng)用程序

    altera 中基于NIOS軟核系統(tǒng)的定時器應(yīng)用程序

    標(biāo)簽： altera NIOS 軟核

    上傳時間： 2016-12-03

    上傳用戶：asddsd

  • 一、 Protel 99SE 軟 件 介 紹 二、 編 輯 電 路 原 理 圖 元 器 件 三、 編 輯 PCB 元 器 件 封 裝 四、 設(shè) 計 電 路 原 理 圖 五、 生 成

    一、 Protel 99SE 軟 件 介 紹 二、 編 輯 電 路 原 理 圖 元 器 件 三、 編 輯 PCB 元 器 件 封 裝 四、 設(shè) 計 電 路 原 理 圖 五、 生 成 電 路 原 理 圖 報 表 文 件 六、 設(shè) 計 印 制 電 路 板(PCB)

    標(biāo)簽： Protel PCB 99 SE

    上傳時間： 2016-12-13

    上傳用戶：gengxiaochao

  • 基于NIOSII軟核的觸摸屏驅(qū)動軟體.采用的是AD7843觸摸屏數(shù)字轉(zhuǎn)換器

    基于NIOSII軟核的觸摸屏驅(qū)動軟體.采用的是AD7843觸摸屏數(shù)字轉(zhuǎn)換器

    標(biāo)簽： NIOSII 7843 觸摸屏 AD

    上傳時間： 2016-12-18

    上傳用戶：偷心的海盜

  • 紹 了一 種基 于 單 片機(jī)借 助 CAN總 線技 術(shù)設(shè) 計 的分 布 式 區(qū)域 交通信 號 燈 智能控 制 系統(tǒng) 。 系統(tǒng) 采 用 AT89C51作 為核 心控 制 器

    紹 了一 種基 于 單 片機(jī)借 助 CAN總 線技 術(shù)設(shè) 計 的分 布 式 區(qū)域 交通信 號 燈 智能控 制 系統(tǒng) 。 系統(tǒng) 采 用 AT89C51作 為核 心控 制 器 ，紅 外 接 收 器接 收 來 自發(fā) 射 器 的紅 外信 號 ，經(jīng) 解調(diào) 后 輸入 單 片機(jī)進(jìn) 行 處理 ，單 片機(jī) 與 CAN 總 線控 制 器構(gòu) 成 CAN 總線通信 系統(tǒng)進(jìn)行數(shù)據(jù)傳輸 ，實現(xiàn)了根據(jù)車流信息、遙控 、PC機(jī)控制的系統(tǒng)設(shè)計。文章詳細(xì)介紹 了系統(tǒng)總體方案及部分硬 件 設(shè) 計 方 案

    標(biāo)簽： CAN 89C C51

    上傳時間： 2017-01-26

    上傳用戶：hjshhyy

  • 電子報軟體. 你想輕輕鬆鬆的寄送電子報 功能介紹: 1. 支援多個伺服器分散流量. (已可設(shè)定每次的最大郵件數(shù)) 2. 支援多個設(shè)定檔選擇. 3. 可直接選擇硬碟內(nèi)的 HTML, 純文字檔當(dāng)做

    電子報軟體. 你想輕輕鬆鬆的寄送電子報 功能介紹: 1. 支援多個伺服器分散流量. (已可設(shè)定每次的最大郵件數(shù)) 2. 支援多個設(shè)定檔選擇. 3. 可直接選擇硬碟內(nèi)的 HTML, 純文字檔當(dāng)做寄信內(nèi)容. 4. 支援定時、每日、每週、每月送信. 5. 配合 ServiceAgent 可以成為NT/2000下的服務(wù). 6. 可夾帶附件檔案. 7. 在原本可直接選取電腦硬碟上的檔案(HTML)來做為HTML寄信的本文之外, 目前已能將 HTML 內(nèi)的圖檔(gif,jpg,bmp,png)的 <img> tag 和 音效檔(wav,mid,swf)的<EMBED> tag 的內(nèi)容一起勘進(jìn)郵件內(nèi)容裡. 8. 以 Command Line 執(zhí)行的方式就能啟動寄信流程. 9. 透過電子郵件信箱即可啟動自動化電子報訂閱/取消功能! 開發(fā)工具: 1. Delphi 5 2. Indy Winshoes8 (free delphi component)

    標(biāo)簽： HTML 伺服器 分散 流量

    上傳時間： 2014-01-05

    上傳用戶：l254587896

  • Altera IP核8B10B編碼器的完整設(shè)計流程包括Altera IP的定制、仿真和實現(xiàn)的全過程

    Altera IP核8B10B編碼器的完整設(shè)計流程包括Altera IP的定制、仿真和實現(xiàn)的全過程

    標(biāo)簽： Altera 8B10B IP核 編碼器

    上傳時間： 2017-08-19

    上傳用戶：lizhizheng88

  • 設(shè)計的帶嵌入式收發(fā)器的Gen1×1硬核IP的 PCI Express IP編譯器

    在Cyclone IV GX收發(fā)器入門套件上,設(shè)計帶嵌入式收發(fā)器的Gen1×1硬核IP的 PCI Express IP編譯器。.rar

    標(biāo)簽： 嵌入式

    上傳時間： 2022-04-23

    上傳用戶：kingwide

  • 基于FPGA的TS流復(fù)用器及其接口的設(shè)計與實現(xiàn).rar

    在數(shù)字電視系統(tǒng)中，MPEG-2編碼復(fù)用器是系統(tǒng)傳輸?shù)暮诵沫h(huán)節(jié)，所有的節(jié)目、數(shù)據(jù)以及各種增值服務(wù)都是通過復(fù)用打包成傳輸流傳輸出去。目前，只有少數(shù)公司掌握復(fù)用器的核心算法技術(shù)，能夠采用MPEG-2可變碼率統(tǒng)計復(fù)用方法提高帶寬利用率，保證高質(zhì)量圖像傳輸。由于目前正處廣播電視全面向數(shù)字化過渡期間，市場潛力巨大，因此對復(fù)用器的研究開發(fā)非常重要。本文針對復(fù)用器及其接口技術(shù)進(jìn)行研究并設(shè)計出成形產(chǎn)品。 文中首先對MPEG-2標(biāo)準(zhǔn)及NIOS Ⅱ軟核進(jìn)行分析。重點研究了復(fù)用器中的部分關(guān)鍵技術(shù)：PSI信息提取及重構(gòu)算法、PID映射方法、PCR校正及CRC校驗算法，給出了實現(xiàn)方法，并通過了硬件驗證。然后對復(fù)用器中主要用到的AsI接口和DS3接口進(jìn)行了分析與研究，給出了設(shè)計方法，并通過了硬件驗證。 本文的主要工作如下： ●首先對復(fù)用器整體功能進(jìn)行詳細(xì)分析，并劃分軟硬件各自需要完成的功能。給出復(fù)用器的整體方案以及ASI接口和DS3接口設(shè)計方案。 ●在FPGA上采用c語言實現(xiàn)了PSI信息提取與重構(gòu)算法。 ●給出了實現(xiàn)快速的PID映射方法，并根據(jù)FPGA特點給出一種新的PID映射方法，減少了邏輯資源的使用，提高了穩(wěn)定性。 ●采用Verilog設(shè)計了SI信息提取與重構(gòu)的硬件平臺，并用c語言實現(xiàn)了SDT表的提取與重構(gòu)算法，在FPGA中成功實現(xiàn)了動態(tài)分配內(nèi)存空間。 ●在FPGA上實現(xiàn)了．ASI接口，主要分析了位同步的實現(xiàn)過程，實現(xiàn)了一種新的快速實現(xiàn)字節(jié)同步的設(shè)計。 ●在FPGA上實現(xiàn)了DS3接口，提出并實現(xiàn)了一種兼容式DS3接口設(shè)計。并對幀同步設(shè)計進(jìn)行改進(jìn)。 ●完成部分PCB版圖設(shè)計，并進(jìn)行調(diào)試監(jiān)測。 本復(fù)用器設(shè)計最大特點是將軟件設(shè)計和硬件設(shè)計進(jìn)行合理劃分，硬件平臺及接口采用Verilog語言實現(xiàn)，PSI信息算法主要采用c語言實現(xiàn)。這種軟硬件的劃分使系統(tǒng)設(shè)計更加靈活，且軟件設(shè)計與硬件設(shè)計可同時進(jìn)行，極大的提高了工作效率。 整個項目設(shè)計采用verilog和c兩種語言完成，采用Altera公司的FPGA芯片EP1C20，在Quartus和NIOS IDE兩種設(shè)計平臺下設(shè)計實現(xiàn)。根據(jù)此方案已經(jīng)開發(fā)出兩臺帶有ASI和DS3接口的數(shù)字電視TS流復(fù)用器，經(jīng)測試達(dá)到了預(yù)期的性能和技術(shù)指標(biāo)。

    標(biāo)簽： FPGA TS流 復(fù)用器

    上傳時間： 2013-08-03

    上傳用戶：gdgzhym

  • 基于FPGA的調(diào)制解調(diào)器的研究和設(shè)計.rar

    當(dāng)今電子系統(tǒng)的設(shè)計是以大規(guī)模FPGA為物理載體的系統(tǒng)芯片的設(shè)計，基于FPGA的片上系統(tǒng)可稱為可編程片上系統(tǒng)(SOPC)。SOPC的設(shè)計是以知識產(chǎn)權(quán)核(IPCore)為基礎(chǔ)，以硬件描述語言為主要設(shè)計手段，借助以計算機(jī)為平臺的EDA工具進(jìn)行的。 本文在介紹了FPGA與SOPC相關(guān)技術(shù)的基礎(chǔ)上，給出了SOPC技術(shù)開發(fā)調(diào)制解調(diào)器的方案。在分析設(shè)計軟件Matlab/DSP(Digital Signal Processing)。builder以及Quartus Ⅱ開發(fā)軟件進(jìn)行SOPC(System On a Programmable Chip)設(shè)計流程后，依據(jù)調(diào)制解調(diào)算法提出了一種基于DSP Builder調(diào)制解調(diào)器的SOPC實現(xiàn)方案，模塊化的設(shè)計方法大大縮短了調(diào)制解調(diào)器的開發(fā)周期。 在SOPC技術(shù)開發(fā)調(diào)制解調(diào)器的過程中，用MATLAB/Simulink的圖形方式調(diào)用Altera DSP Builder和其他Simulink庫中的圖形模塊(Block)進(jìn)行系統(tǒng)建模，在Simulink中仿真通過后，利用DSP Builder將Simulink的模型文件(．mdl)轉(zhuǎn)化成通用的硬件描述語言VHDL文件，從而避免了VHDL語言手動編寫系統(tǒng)的煩瑣過程，將精力集中于算法的優(yōu)化上。 基于DSP Builder的開發(fā)功能，調(diào)制解調(diào)器電路中的低通濾波器可直接調(diào)用FIRIP Core，進(jìn)一步提高了開發(fā)效率。 在進(jìn)行編譯、仿真調(diào)試成功后，經(jīng)過QuartusⅡ?qū)⒕幾g生成的編程文件下載到ALTERA公司Cyclone Ⅱ系列的FPGA芯片EP2C5F256C6，完成器件編程，從而給出了一種調(diào)制解調(diào)器的SOPC系統(tǒng)實現(xiàn)方案。

    標(biāo)簽： FPGA 調(diào)制解調(diào)器

    上傳時間： 2013-06-24

    上傳用戶：liuchee

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