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解碼芯片

基于ARM芯片的GPS接收機設計

GPS以全天候、高精度、自動化、高效益等顯著特點，贏得廣大測繪工作者的信賴，而一體化GPS接收機更是具有全內置、防水、耐寒以及操作方便、適用范圍廣等優點，己經廣泛應用于控制測量和大地測量中。隨著全球定位系統的不斷改進，硬、軟件的不斷完善，應用領域正在不斷地開拓，目前已遍及國民經濟各種部門，并開始逐步深入人們的日常生活。本文介紹了GPS系統的特點、工作原理、課題背景、國內外相關產品的現狀以及發展趨勢，闡述了GPS接收機的設計原理。文章認為，GPS接收機中的微處理器的性能直接影響整機的性能，相比較其它微處理器，ARM微處理器具有一些獨特的優勢。文章了ARM系列微處理器尤其是ARM7微處理器的性能特點，并給出了利用ARM7微處理器LPC2138芯片和xc3s1000型FPGA設計GPS接收機的實際設計和調試方案，并對此方案進行了論證，同時給出了各個功能模塊的軟硬件實現過程，并對樣機進行了性能指標測試。

標簽： ARM GPS 芯片收機設計

上傳時間： 2013-04-24

上傳用戶：kakuki123
基于DSP的高性能異步電機矢量控制系統設計.pdf

作為交流異步電機控制的一種方式，矢量控制技術已成為高性能變頻調速系統的首選方案。矢量控制系統中，磁鏈的觀測精度直接影響到系統控制性能的好壞。在轉子磁鏈定向的矢量控制系統中，轉矩電流和勵磁電流能得到完全解耦[1]。一般而言，轉子磁鏈觀測有兩種方法:電流模型法和電壓模型法。磁鏈的電流模型觀測法中需要電機轉子時間常數，而轉子時間常數易受溫度和磁飽和影響。為克服這些缺點，需要對電機的轉子參數進行實時觀測，但這樣將使得系統更加的復雜。磁鏈的電壓模型觀測法中不含轉子參數，受電機參數變化的影響較小。矢量控制計算量大，要求具有一定的實時性，從而對控制芯片的運算速度提出了更高的要求。本文介紹了一種異步電機矢量控制系統的設計方法，采用了電壓模型觀測器[2]對轉子磁鏈進行估計，針對積分環節的誤差積累和直流漂移問題，采用了一種帶飽和反饋環節的積分器[3]來代替電壓模型觀測器中的純積分環節。整個算法在tms320f2812 dsp芯片上實現，運算速度快，保證了系統具有很好的實時性。

標簽： DSP 性能異步電機

上傳時間： 2013-04-24

上傳用戶：jhksyghr
10100M以太網芯片的I2C接口模塊的FPGA設計

該文結合"10M/100M以太網交換芯片的設計"課題,介紹了以太網技術發展的概況和IP CORE、SoC的設計方法,闡述了以太網交換原理及關鍵技術,研究了CSMA/CD協議、交換機、VLAN的原理和數據流優先技術及流量控制,在此基礎上完成了10M/100M以太網交換芯片的主要模塊的設計方案和實現框圖.同時結合Philip公司的IC總線的工作原理,給出了10M/100M以太網交換芯片的設計方案中的IC接口模塊的FPGA設計的驗證和仿真,并對仿真結果進行分析比較,驗證了IC接口模塊可以作為一個軟核來使用.

標簽： 10100M FPGA I2C 以太網

上傳時間： 2013-07-18

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電路實例詳解

49個電路實例詳解三位數字顯示電容測試表電路圖市電電壓雙向越限報警保護器等

標簽： 電路實例

上傳時間： 2013-06-19

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開關電源設計詳解

開關電源設計詳解開關電源設計詳解開關電源設計詳解開關電源設計詳解

標簽： 開關電源設計

上傳時間： 2013-04-24

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一種基于單片機和SA4828芯片的變頻變壓電源

一種基于單片機和SA4828芯片的變頻變壓電源:摘要：介紹了一種三相變頻變壓電源的設計方法。電源采用單片機和SPWM發生器SA4828專用芯片控制，使得控制系統簡單可靠，使用靈活，適用性強，具有

標簽： 4828 SA 單片機芯片

上傳時間： 2013-07-26

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MAX809/MAX810中文資料 (微處理器復位芯片)

MAX809/MAX810是一種單一功能的微處理器復位芯片，用于監控微控制器和其他邏輯系統的電源電壓。它可以在上電，掉電和節電情況下向微控制器提供復位信號。當電源電壓低于預設的門檻電壓時，器件會發出復

標簽： MAX 809 810 微處理器

上傳時間： 2013-07-29

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USB3.0–SATA橋接芯片MB86C30A的主要規范,pdf datasheet

USB3.0–SATA橋接芯片MB86C30A的主要規范:*CBC (密碼段鏈接):一種適合加密模塊數據的AES 模式。*XTS (帶調整和密文竊取的XEX 加密模式):IEE

標簽： datasheet SATA USB 3.0

上傳時間： 2013-06-10

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DVBH發射端信道內碼和調制部分的FPGA設計和實現

數字電視技術和超大規模深亞微米的系統級芯片設計技術是當前信息產業中最受關注的兩個方向。它們的交叉就是數字電視應用中的一系列系統級芯片和超深亞微米專用集成電路。其中信道處理系統及其相關芯片更是集中了數字信號處理前向糾錯編解碼等數字電視傳輸的核心技術，成為設計和開發整個數字電視系統的關鍵之一。數字高清晰度電視(Digital HDTV)做為第三代電視標準，已成為當今世界高技術競爭的焦點，本文正是從這個交叉點上出發對DVB-H(Digital Video Broadcasting-Handheld)標準中所涉及的信道編碼和調制部分進行了研究，重點分析了信道內編碼部分的硬件優化實現。本項目完成了DVB-H傳輸系統信道編碼的FPGA硬件設計和實現，系統所有FPGA硬件電路設計采用了Veillog HDL語言編寫。同時對清華大學數字電視地面傳輸標準DMB-T(Terrestrial Digital Multimedia/TV Broadcasting)中的關鍵技術做了研究，與DVB標準中的相關技術做了對比。本文首先對DVB．H以及COFDM的相關理論進行介紹和研究。然后針對DVB-H信道編碼調制器中的部分核心算法的FPGA設計和實現進行了詳細的研究工作，包括外編碼、內編碼(卷積刪余)、內交織(包括比特交織和符號交織)、星座映射、幀形成、OFDM調制的部分設計等。相應地對DVB-H信道解碼解調器中的部分算法的FPGA設計的研究工作做了描述，包括符號解交織和比特解交織。同時對清華大學數字電視地面傳輸標準DMB-T外接收機中頻域和時域解交織模塊的FPGA設計實現做了描述。筆者在項目中完成的主要工作有： (1)與項目組成員合作制定系統框架，劃分模塊。 (2)對所負責的模塊，包括外編碼、內編碼(卷積刪余)、內交織(包括比特交織和符號交織)、星座映射、幀形成、OFDM調制的算法進行研究并加以優化，建立軟件仿真模型，進行FPGA設計，仿真和實現。

標簽： DVBH FPGA 發射端信道

上傳時間： 2013-06-10

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DVB信道編解碼算法研究與FPGA實現

隨著人們對于數字視頻和數字圖像的需求越來越大，數字電視廣播和手機電視迅速發展起來，但是人們對于數字圖像質量的要求也越來越高。對于觀眾來講，畫面的質量幾乎是最為重要的，然而由于信道傳輸特性不理想和加性噪聲的影響，不可避免地會產生誤碼，導致圖像質量的下降，甚至無法正常收看。因此，為了保障圖像質量就需要采用糾錯編碼(又稱信道編碼)的方式來實現通信。在數字視頻廣播系統(DVB)中，無論是衛星傳輸，電纜傳輸還是地面傳輸都采用了信道編碼。本文首先深入研究DVB標準中的信道編碼部分的關鍵技術；然后依照DVB-T標準技術要求，設計并硬件實現了數字視頻傳輸的信道編解碼系統。在該系統中，編解碼器與信源端的接口利用了MPEG-2的視頻傳輸接口同步并行接口(SPI)，這種接口的應用讓系統具有很強的通用性；與信道端接口采用了G.703接口，具有G.703接口功能和特性的數據通信設備可以直接與數字通信設備連接，這使得應用時對于信道的選擇具有較大的靈活性。在深入理解RS編解碼算法，卷積交織/解交織原理，卷積編碼/VITERBI譯碼算法原理的基礎上，本文給出了解碼部分的設計方案，并利用Xilinx公司的SpartanⅢ系列XC3S2000芯片完成方案的硬件實現。在RS解碼過程中引入了流水線機制，從而很大程度上提高了解碼效率。解交織器部分采用了RAM分區循環法，利用對RAM讀寫地址的控制實現解卷積交織，這種方法控制電路簡單，實現速度比較快，代價小。VITERBI譯碼器采用截尾譯碼，在幾乎不影響譯碼準確度的基礎上大大提高了解碼效率。

標簽： FPGA DVB 信道編解碼

上傳時間： 2013-07-16

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