GPS全球定位系統(tǒng)是美國(guó)國(guó)防部為軍事目的而建立的衛(wèi)星導(dǎo)航系統(tǒng)，其主要目的是解決海上、陸地和空中運(yùn)載工具的導(dǎo)航定位問(wèn)題。GPS作為新一代衛(wèi)星導(dǎo)航系統(tǒng)，不僅具有全球、全天候、連續(xù)、高精度導(dǎo)航與定位能力，而且具有優(yōu)良的抗干擾性和保密性。因此，發(fā)展全球定位系統(tǒng)是當(dāng)今導(dǎo)航技術(shù)現(xiàn)代化的一個(gè)重要標(biāo)志。在GPS接收機(jī)中，為了得到導(dǎo)航電文并對(duì)其進(jìn)行解算，要完成復(fù)雜的信號(hào)處理過(guò)程。其中，怎樣捕獲到衛(wèi)星信號(hào)，并對(duì)C/A碼進(jìn)行跟蹤是研制GPS接收機(jī)的重要問(wèn)題之一。本文在對(duì)GPS信號(hào)的結(jié)構(gòu)進(jìn)行深入的分析后，結(jié)合FPGA的特點(diǎn)，對(duì)算法進(jìn)行設(shè)計(jì)及優(yōu)化后，給出了相應(yīng)的仿真。內(nèi)容主要包括以下幾個(gè)方面： 1.對(duì)GPS信號(hào)結(jié)構(gòu)的產(chǎn)生原理進(jìn)行了深入地分析，并對(duì)GPS信號(hào)的調(diào)制機(jī)理進(jìn)行詳細(xì)地闡述。 2.在GPS信號(hào)的捕獲方面，采用了基于FFT頻域的快速捕獲的方法，即將接收到的GPS信號(hào)先利用快速傅立葉變換(FFT)變換到頻域，在頻域完成相應(yīng)的運(yùn)算后，再利用傅立葉反變換(IFFT)變換到時(shí)域。從而大大減少了計(jì)算量，加快了信號(hào)捕獲的速度，提高了捕獲性能。 3.在C/A碼跟蹤部分，本文采用了非相干延遲鎖定環(huán)對(duì)C/A碼進(jìn)行跟蹤。來(lái)自載波跟蹤環(huán)路的本地載波將輸入的信號(hào)變成基帶信號(hào)，然后分別和本地碼的三個(gè)不同相位序列進(jìn)行相乘，將相乘結(jié)果進(jìn)行累加，經(jīng)過(guò)處理將得到碼相位和當(dāng)前的載波頻率送到載波跟蹤環(huán)路。 4.載波跟蹤環(huán)，本文采用的是科斯塔斯環(huán)。載波跟蹤環(huán)和碼跟蹤環(huán)在結(jié)構(gòu)上相似，故本文只對(duì)關(guān)鍵的載波NCO進(jìn)行了仿真。 本文的創(chuàng)新點(diǎn)主要是使用FPGA對(duì)整個(gè)GPS信號(hào)的捕獲及C/A碼的跟蹤進(jìn)行設(shè)計(jì)。此外，根據(jù)FPGA的特點(diǎn)，在不改變外部硬件設(shè)計(jì)的前提下，改變相應(yīng)的IP核或相關(guān)的VHDL程序就可對(duì)系統(tǒng)進(jìn)行各種優(yōu)化設(shè)計(jì)，以適應(yīng)不同類(lèi)型的GPS接收機(jī)的不同功能。
上傳時(shí)間： 2013-06-27
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PCB特性阻抗計(jì)算工具：用于射頻電路，高速數(shù)字電路中傳輸線阻抗的計(jì)算
上傳時(shí)間： 2013-07-02
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Cadence 軟件是我們公司統(tǒng)一使用的原理圖設(shè)計(jì)、PCB 設(shè)計(jì)、高速仿真、自動(dòng)布線的EDA 工具。本篇 Cadence 使用手冊(cè)是一本基于Allegro SPB V15.2 版本的Cadence 軟件的基礎(chǔ)使用手冊(cè)，包括原理圖設(shè)計(jì)、 PCB 設(shè)計(jì)、高速仿真、約束管理器、自動(dòng)布線五個(gè)方面的內(nèi)容，是一個(gè)入門(mén)級(jí)的教材。通過(guò)這本手冊(cè)旨在 讓新進(jìn)員工能掌握Cadence 的基本使用方法，能獨(dú)立進(jìn)行原理圖及PCB 的設(shè)計(jì)，了解自動(dòng)布線、約束管理 器的使用，熟悉高速仿真的過(guò)程，并對(duì)公司的EDA 流程有全面的了解。
上傳時(shí)間： 2013-04-24
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C240x/28xx 通用Flash燒寫(xiě)工具,已經(jīng)經(jīng)過(guò)測(cè)試，燒寫(xiě)比較方便實(shí)用，解決FLASH燒寫(xiě)問(wèn)題。-???????????
上傳時(shí)間： 2013-07-04
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51單片機(jī)定時(shí)器時(shí)間計(jì)算工具，即是計(jì)算定時(shí)器溢出時(shí)間TH0，TL0也是研究51單片機(jī)定時(shí)器的軟件模形。軟件中分析了定時(shí)器的工作流程和寄存器功能。可以助你更深刻的了解51單片機(jī)定時(shí)器。
標(biāo)簽： 51定時(shí)器 計(jì)算
上傳時(shí)間： 2013-06-13
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51單片機(jī)定時(shí)器時(shí)間計(jì)算工具，即是計(jì)算定時(shí)器溢出時(shí)間TH0，TL0也是研究51單片機(jī)定時(shí)器的軟件模形。軟件中分析了定時(shí)器的工作流程和寄存器功能。可以助你更深刻的了解51單片機(jī)定時(shí)器。
標(biāo)簽： 51定時(shí)器 計(jì)算
上傳時(shí)間： 2013-05-24
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隨著圖像分辨率的越來(lái)越高，軟件實(shí)現(xiàn)的圖像處理無(wú)法滿足實(shí)時(shí)性的需求；同時(shí)FPGA等可編程器件的快速發(fā)展使得硬件實(shí)現(xiàn)圖像處理變得可行。如今基于FPGA的圖像處理研究成為了國(guó)內(nèi)外的一個(gè)熱門(mén)領(lǐng)域。 本文在FPGA平臺(tái)上，用Verilog HDL實(shí)現(xiàn)了一個(gè)研究圖像處理算法的可重復(fù)配置的硬件模塊架構(gòu)，架構(gòu)包括PC機(jī)預(yù)處理和通信軟件，控制模塊，計(jì)算單元，存儲(chǔ)器模塊和通信適配模塊五個(gè)部分。其中的計(jì)算模塊負(fù)責(zé)具體算法的實(shí)現(xiàn)，根據(jù)不同的圖像處理算法可以獨(dú)立實(shí)現(xiàn)。架構(gòu)為計(jì)算模塊實(shí)現(xiàn)了一個(gè)可添加、移出接口，不同的算法設(shè)計(jì)只要符合該接口就可以方便的加入到模塊架構(gòu)中來(lái)進(jìn)行調(diào)試和運(yùn)行。 在硬件架構(gòu)的基礎(chǔ)上本文實(shí)現(xiàn)了排序?yàn)V波，中值濾波，卷積運(yùn)算及高斯濾波，形態(tài)學(xué)算子運(yùn)算等經(jīng)典的圖像處理算法。討論了FPGA的圖像處理算法的設(shè)計(jì)方法及優(yōu)化策略，通過(guò)性能分析，F(xiàn)PGA實(shí)現(xiàn)圖像處理在時(shí)間上比軟件處理有了很大的提高；通過(guò)結(jié)果的比較，發(fā)現(xiàn)FPGA的處理結(jié)果達(dá)到了軟件處理幾乎同等的效果水平。最后本文在實(shí)現(xiàn)較大圖片處理和圖像處理窗口的大小可配置性方面做了一定程度的討論和改進(jìn)，提高了算法的可用性，同時(shí)為進(jìn)一步的研究提供了更加便利的平臺(tái)。 整個(gè)設(shè)計(jì)都是在ISE8.2和ModelSim第三方仿真軟件環(huán)境下開(kāi)發(fā)的，在xilinx的Spartan-3E XC3S500E硬件平臺(tái)上實(shí)現(xiàn)。在軟件仿真過(guò)程中利用了ISE8.2自帶仿真工具和ModelSim結(jié)合使用。 本課題為制造FPGA的專(zhuān)用圖像處理芯片做了有益的探索性研究，為實(shí)現(xiàn)FPGA為核心處理芯片的實(shí)時(shí)圖像處理系統(tǒng)有著積極的作用。
標(biāo)簽： 圖像處理 算法研究 硬件設(shè)計(jì)
上傳時(shí)間： 2013-05-30
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遺傳算法是基于自然選擇的一種魯棒性很強(qiáng)的解決問(wèn)題方法。遺傳算法已經(jīng)成功地應(yīng)用于許多難優(yōu)化問(wèn)題，現(xiàn)已成為尋求滿意解的最佳工具之一。然而，較慢的運(yùn)行速度也制約了其在一些實(shí)時(shí)性要求較高場(chǎng)合的應(yīng)用。利用硬件實(shí)現(xiàn)遺傳算法能夠充分發(fā)揮硬件的并行性和流水線的特點(diǎn)，從而在很大程度上提高算法的運(yùn)行速度。 本文對(duì)遺傳算法進(jìn)行了理論介紹和分析，結(jié)合硬件自身的特點(diǎn)，選用了適合硬件化的遺傳算子，設(shè)計(jì)了標(biāo)準(zhǔn)遺傳算法硬件框架；為了進(jìn)一步利用硬件自身的并行特性，同時(shí)提高算法的綜合性能，本文還對(duì)現(xiàn)有的一些遺傳算法的并行模型進(jìn)行了研究，討論了其各自的優(yōu)缺點(diǎn)及研究現(xiàn)狀，并在此基礎(chǔ)上提出一種適合硬件實(shí)現(xiàn)的粗粒度并行遺傳算法。 我們構(gòu)建的基于FPGA構(gòu)架的標(biāo)準(zhǔn)遺傳算法硬件框架，包括初始化群體、適應(yīng)度計(jì)算、選擇、交叉、變異、群體存儲(chǔ)和控制等功能模塊。文中詳細(xì)分析了各模塊的功能和端口連接，并利用硬件描述語(yǔ)言編寫(xiě)源代碼實(shí)現(xiàn)各模塊功能。經(jīng)過(guò)功能仿真、綜合、布局布線、時(shí)序仿真和下載等一系列步驟，實(shí)現(xiàn)在Altera的Cyclone系列FPGA上。并且用它嘗試解決一些函數(shù)的優(yōu)化問(wèn)題，給出了實(shí)驗(yàn)結(jié)果。這些硬件模塊可以被進(jìn)一步綜合映射到ASIC或做成IP核方便其他研究者調(diào)用。 最后，本文對(duì)硬件遺傳算法及其在函數(shù)優(yōu)化中的一些尚待解決的問(wèn)題進(jìn)行了討論，并對(duì)本課題未來(lái)的研究進(jìn)行了展望。
標(biāo)簽： FPGA 算法 硬件 實(shí)現(xiàn)研究
上傳時(shí)間： 2013-07-22
上傳用戶：誰(shuí)偷了我的麥兜
隨著電子技術(shù)和計(jì)算機(jī)技術(shù)的飛速發(fā)展，視頻圖像處理技術(shù)近年來(lái)得到極大的重視和長(zhǎng)足的發(fā)展，其應(yīng)用范圍主要包括數(shù)字廣播、消費(fèi)類(lèi)電子、視頻監(jiān)控、醫(yī)學(xué)成像及文檔影像處理等領(lǐng)域。當(dāng)前視頻圖像處理主要問(wèn)題是當(dāng)處理的數(shù)據(jù)量很大時(shí)，處理速度慢，執(zhí)行效率低。而且視頻算法的軟件和硬件仿真和驗(yàn)證的靈活性低。 本論文首先根據(jù)視頻信號(hào)的處理過(guò)程和典型視頻圖像處理系統(tǒng)的構(gòu)成提出了基于FPGA的視頻圖像處理系統(tǒng)總體框圖；其次選擇視頻轉(zhuǎn)換芯片SAA7113，完成視頻圖像采集模塊的設(shè)計(jì)，主要分三步完成：1)配置視頻轉(zhuǎn)換芯片的工作模式，完成視頻轉(zhuǎn)化芯片SAA7113的初始化：2)通過(guò)分析輸出數(shù)據(jù)流的格式標(biāo)準(zhǔn)，來(lái)識(shí)別奇偶場(chǎng)信號(hào)、場(chǎng)消隱信號(hào)和有效行數(shù)據(jù)的開(kāi)始和結(jié)束信號(hào)三種控制信號(hào)，并根據(jù)控制信號(hào)，用Verilog硬件描述語(yǔ)言編程實(shí)現(xiàn)圖像數(shù)據(jù)的采集；3)分析SRAM的讀寫(xiě)控制時(shí)序，采用兩塊SRAM完成圖像數(shù)據(jù)的存儲(chǔ)。然后編寫(xiě)軟件測(cè)試文件，在ISE Simulator仿真環(huán)境進(jìn)行程序測(cè)試與運(yùn)行，并分析仿真結(jié)果，驗(yàn)證了數(shù)據(jù)采集和存儲(chǔ)的正確性；最后，對(duì)常用視頻圖像算法的MATLAB仿真，選擇適當(dāng)?shù)乃阕樱捎霉ぞ進(jìn)ATLAB、System Generator for DSP和ISE，利用模塊構(gòu)建方式，搭建視頻算法平臺(tái)，實(shí)現(xiàn)圖像平滑濾波、銳化濾波算法，在Simulink中仿真并自動(dòng)生成硬件描述語(yǔ)言和網(wǎng)表，對(duì)資源的消耗做簡(jiǎn)要分析。 本論文的創(chuàng)新點(diǎn)是采用新的開(kāi)發(fā)環(huán)境System Generator for DSP實(shí)現(xiàn)視頻圖像算法。這種開(kāi)發(fā)視頻圖像算法的方式靈活性強(qiáng)、設(shè)計(jì)周期短、驗(yàn)證方便、是視頻圖像處理發(fā)展的必然趨勢(shì)。
標(biāo)簽： FPGA 視頻圖像 處理系統(tǒng)
上傳時(shí)間： 2013-07-28
上傳用戶：lingzhichao
photoshop 7.0 實(shí)用基礎(chǔ)工具，詳細(xì)講解了ps中有關(guān)工具的使用方法和使用范圍，對(duì)于新學(xué)者有較大的幫助。
上傳時(shí)間： 2013-05-31
上傳用戶：zhf1234
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